JPH03166359A - チタン薄膜の形成方法及び抵抗温度補償用チタン薄膜 - Google Patents
チタン薄膜の形成方法及び抵抗温度補償用チタン薄膜Info
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- JPH03166359A JPH03166359A JP30609889A JP30609889A JPH03166359A JP H03166359 A JPH03166359 A JP H03166359A JP 30609889 A JP30609889 A JP 30609889A JP 30609889 A JP30609889 A JP 30609889A JP H03166359 A JPH03166359 A JP H03166359A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
【産業上の利用分野】
本発明は、スパッタ法によるチタン薄膜の形成方法の改
良及び応カセンサの抵抗温度補償に用いて好適なチタン
薄膜に関する。 〔従来の技術〕 近時、チタン薄膜は耐食性、耐熱性等の優れた性質を持
っていることから、種々の分野で利用されているが、例
えば半導体歪ゲージを用いた応力センサの抵抗温度補償
用抵抗として用いられている。即ち、圧カセンサ、歪み
センサ等として適用される応カセンサには半導体歪ゲー
ジが用いられているが、該半導体歪ゲージは負の抵抗温
度係数を有しており、ゲージ温度が上昇すると抵抗値が
下がる特性がある。このため、半導体歪ゲージには正の
抵抗温度係数を有する抵抗温度補償用のチタン薄膜抵抗
を接続し、半導体歪ゲージの抵抗値の降下分を補償する
ようになっている。 そして、従来技術によればダイヤフラムに形成したシリ
コン薄膜製絶縁膜上にチタン薄膜抵抗を形或する方法と
しては、真空蒸着法が一般的に用いられており、該真空
蒸着法によって形成したチタン薄膜にホトリソグラフィ
法によってパターン成形するようにしている。 〔発明が解決しようとする課題〕 ところで、真空蒸着法を用いてダイヤフラムのシリコン
薄膜上にチタン薄膜を形成する場合、次のような問題が
ある。即ち、真空蒸着法はチタンを加熱して発生させた
蒸発物をシリコン薄膜に付着させるため、付着強度がス
パッタ法、イオンプレーティング法、気相成長法に比較
して弱く、特に酸化ケイ素膜に対する付着力が弱く、し
かも均一に成膜されないという問題点がある。 このため、高い検出圧力を測定するのに用いられる高圧
用応カセンサに真空蒸着法を用いて抵抗温度補償用のチ
タン薄膜抵抗を形成した場合、応力測定時にダイヤフラ
ムが荷重を受けて変形するとき、チタン薄膜がシリコン
薄膜から剥離しやすく、信頼性に欠けるという欠点があ
る。 本発明は上述した従来技術の欠点に鑑みなされたもので
、シリコン膜に対する付着力が強く、しかも酸化物を含
まない高純度のチタン薄膜の形成方法及び抵抗温度補償
用抵抗に用いて好適なチタン薄膜を提供することを目的
とする。 〔課題を解決するための手段〕 上述した課題を解決するために、本発明による手段の特
徴は、スパッタ法を用いてシリコン基板上に形成するチ
タン薄膜の膜厚を0.2μm以上にすることにある。 また、スパッタ法には高周波スパッタ法を用い、スパッ
タ出力を略0.3kw、スパッタ時間10分以上の条件
によりチタン薄膜を形成することにある。 さらに、抵抗温度補償用チタン薄膜は、膜厚を0.2μ
m以上とし、結晶構造に(011)面を選択配向したこ
とを特徴とする。 〔作用〕 スパッタ法を用いることにより、チタン薄膜はシリコン
基板に対して強い付着力をもつ。そして、膜厚を0.2
μm以上に形成することにより、チタン薄膜には酸化物
を含まず、しかも抵抗温度係数を持つ。従って、該チタ
ン薄膜は応カセンサ、特に高圧用応カセンサの抵抗温度
補償に使用できる。 〔実施例〕 以下、本発明の実施例方法をダイヤフラム式応カセンサ
に適用する場合を例に挙げ、図面を参照しつつ説明する
。 第1図及び第2図はダイヤフラム式応カセンサを示す。 図において、1は金属材料、例えばステンレススチール
からなる高圧用のダイヤフラムで、該ダイヤフラム1は
薄肉円板状の起歪部1Aと、該起歪部1Aの外周に厚肉
円筒状に一体に形成された非起歪部IBとからなってお
り、起歪部1Aの図中下側面は矢示方向からの液圧を受
承する受圧面IA,になり、上側面は後述する絶縁膜2
を形成するための膜形成面IA2になっている。 2は前記起歪部IAの膜形成面IAz上に形或された絶
縁膜で、該絶縁膜2は例えばプラズマ−CVD法、真空
蒸着法、スパッタ法等の適宜の成膜技術によって数μm
の厚さに形成された酸化ケイ素(Sing)膜からなっ
ている。 3A,3B,3C,3Dは前記絶縁膜2上に形成された
4個の半導体歪ゲージからなるゲージ抵抗(以下ゲージ
抵抗3と総称する)で、該ゲージ抵抗3は例えばプラズ
マーCVD法によって絶縁膜2上に薄膜状に形成したケ
イ素基板にリン(P)又はホウ素(B)の不純物をドー
ピングしてゲージ用薄膜を形成した後、ホトリソグラフ
ィ法によってパターン形成されており、外力を受けて歪
んだときに比抵抗が変化するビエゾ抵抗素子として構成
されている。 4A,4B,4C,4D,4E,4Fは前記ゲージ抵抗
3を接続してホイーストンブリッジ回路を構成する薄膜
導体(以下薄膜導体4と総称する)で、4Aは第1のゲ
ージ抵抗3Aの一端側に接続された第1の薄膜導体、4
Bは該ゲージ抵抗3Aの他端側と第2のゲージ抵抗3B
の一端側に接続された第2の薄膜導体、4Cは該第2の
ゲージ抵抗3Bの他端側に接続された第3の薄膜導体を
示す。また、4Dは第3のゲージ抵抗3Cの一端側に接
続された第4の薄膜導体、4Eは該第3のゲージ抵抗3
Cの他端側と第4のゲージ抵抗3Dの一端側に接続され
た第5の薄膜導体で、4Fは該第4のゲージ抵抗3Dの
他端側に接続された第6の薄膜導体を示す。 これら薄膜導体4は絶縁膜2上に真空蒸着法を用いて金
(Au)、アルミニウム(AJ2)、銅(Cu)等の良
導体材料からなる導体的薄膜を形成した後、ホトリソグ
ラフィ法によりパターン成形されている。そして、各薄
膜導体4A,4B,4C,4D,4E,4Fの外側端部
は電源或は測定器の配線を接続するための接続用端子5
A,5B,5G,5D,5E,5Fに形成されており、
端子5C,5Dは出力側の接続用端子になっている。 6は前記薄膜導体4のうち、第3の薄膜導体4Cと第4
の薄膜導体4Dとの間に並列接続された抵抗温度補償用
のチタン薄膜抵抗を示し、該チタン 薄膜抵抗6は高周
波スパッタ法を用いて後に詳述するように絶縁膜2上に
チタン薄膜を0.2μm以上の膜厚に形成した後、ホト
リソグラフィ法によってパターン成形されている。 7は酸化シリコン(Sin.)膜からなり、前記ゲージ
抵抗3、薄膜導体4及びチタン薄膜抵抗6を一体的に覆
うバッシベーション膜、8は前記パッシベーション膜7
を覆うようにダイヤフラムlに固着された合成樹脂製の
ターミナルベースで、該ターミナルベース8には配線導
出穴8A,8Aが形成されている。そして、該ターミナ
ルベース8に設けられた接続端子9.10は前記接続用
端子5C,5Dと配線11.12を介してそれぞれ接続
されると共に、出力用のリード線13,14が接続され
ている。 更に、l5はターミナルベース8の外周側を囲むように
ダイヤフラム1のフランジ部に嵌着された外力バーで、
該外力バー15内はターミナルベース8を密封するよう
に絶縁製樹脂16によってモールドされている。 応カセンサは上述の如く構成されており、端子5B、5
Eと端子5C (5A) 、5D (5F)とを用いて
ホイートストンブリッジ回路を形成し、端子5C,5D
間に電圧計、電流計等の測定器を接続し、端子5B,5
E間に電源を接続してダイヤフラム1の起歪部lAの歪
を測定する。起歪部IAが無負荷状態であればゲージ抵
抗3の電気抵抗は変化しないから、端子5C,5D間に
電位差は生じなく、測定器に電流は流れない。一方ダイ
ヤフラム1に矢示方向の負荷が掛って起歪部IAが歪む
と、ゲージ抵抗の電気抵抗が変化する結果、端子5C,
5D間に電位差が生じて電流が流れるため、測定器によ
り歪を測定することができる。そして、上述した測定中
チタン薄膜抵抗6はゲージ抵抗3の温度上昇に伴う抵抗
の減少を補償するようになっている。 そこで、次にシリコン製絶縁膜2上に該チタン薄膜抵抗
6を形成する方法について詳述する。 まず、抵抗温度補償用のチタン薄膜抵抗6を形成するに
は、抵抗値が20〜200Ωのチタン薄膜を形成する必
要があるが、高周波スパッタ法によりこのようなチタン
薄膜を形成するためには、0.3〜0.5kwのスパッ
タ出力が必要である(第3図参照)。しかし、0.4k
w以上のスパッタ出力でチタンを酸化シリコン膜上に成
膜すると、膜形成後にチッピング(チタン内の気泡の飛
び出しによる膜の剥離)が発生し、チタン薄膜の抵抗が
急増する現象が認められる。なお、スパッタ出力を0.
3kw未満とした場合には抵抗値が急増し、抵抗温度補
償には適用しえない。 そこで、スパッタ出力な略0.3kwに設定し、スパッ
タ時間を変えてチタン薄膜を形成し、このチタン薄膜の
抵抗をスパッタ時間との関係から見ると、第4図に示す
ようにスパッタ時間を10分以上に設定したチタン薄膜
が20〜200Ωの安定した抵抗を得ることができる。 次に,前述の如くスパッタ出力を略0. 3kw、スパ
ッタ時間を10分以上に設定して形成したチタン薄膜の
膜厚(1)と抵抗温度係数(TCR)との関係を第5図
に示す。抵抗温度係数(TCR)は膜厚(1)が1.5
μmになるまでは当該膜厚(1)に比例して増大し−、
膜厚が1.5μm以上になるとほぼ一定の値約2,00
0ppmになり、応カセンサの抵抗温度補償用チタン薄
膜としては十分な抵抗温度係数(TCR)を得ることが
認められる。 更に、純チタン材及び高周波スパッタ法によりシリコン
膜上に形成したチタン薄膜の結晶構造をX線回折法によ
って測定した結果を第6図に示す。抵抗温度係数(TC
R)が2,OOOppm以上である純チタン材(純Tl
)の結晶には、(011)、(010)、(002)の
各面が明瞭に検出される。また、前述の如く抵抗温度係
数(TCR)の大きい膜厚が1.5umのチタン薄膜(
T.)の結晶についても、純チタン材とは各面のX線の
ピーク強度比が異なるが(011)、(010)、(0
02)の各面が明瞭に検出される。更に、膜厚が0.3
μmのチタン薄膜(T.2)の結晶についても、(01
1)(010)、(002)の各面でピークを検出でき
る。 他方、抵抗温度係数(TCP)の小さい薄膜が04 1
μmのチタン薄膜(T,3)の結晶については(010
)、(002)の面は検出されるが、(011)面が全
く検出されず、しかも抵抗温度係数(TCR)に悪影響
を及ぼす酸化チタン(T,O)の結晶面も検出されてい
る。なお、酸化チタン(T.O)はスパッタの途中で酸
素と反応して形成されるものである。 かくして、チタン薄膜が応カセンサの抵抗温度補償用抵
抗として必要な抵抗温度係数(TCR)を得るためには
、(011)面を選択配向させることが必要であり、そ
のためにはチタン薄膜の膜厚を0.2μm以上に形成す
ればよいことになる。 叙上の如く本実施例によれば、真空蒸着法と比較して付
着力の強い高周波スパッタ法を用いてシリコン薄膜製の
絶縁膜2上にチタン薄膜を形或するから、応カセンサに
適用しても剥離することがないチタン薄膜抵抗6にする
ことができる。また、高周波スパッタ法によりチタン薄
膜を形成する場合、スパッタ出力を略0.3kw,スパ
ッタ時間を10分以上に設定し、膜厚を0.2tLm以
上に形或することにより、酸化物を含まない高純度のチ
タン薄膜を得ることができる。 なお、実施例はスパッタ法として高周波スパッタ法を用
いたが、他のスパッタ法も本発明に適用できるものであ
る。 C発明の効果〕 本発明は以上詳述した如くであって、膜厚を0.2μm
以上に形成することにより、酸化物を含まない高純度の
チタン薄膜を形成できる。また、本発明方法によればチ
タン薄膜はシリコン製絶縁膜に対して強い付着力を持つ
から、高圧用応カセンサの抵抗温度補償に用いることが
できる。 更に、スパッタ法の各条件を選択することによって任意
の抵抗温度係数を持ったチタン薄膜な形或でき、特にス
パッタ出力を略0.3kw、スパッタ時間10分以上に
設定したとき、純チタン材と同等の抵抗値を持ったチタ
ン薄膜を形成できる。また、膜厚を0.2μm以上にし
,結晶構造に(011)面を選択配向したチタン薄膜は
高純度で、所望の抵抗温度係数を持った抵抗温度補償用
抵抗として用いることかできる。
良及び応カセンサの抵抗温度補償に用いて好適なチタン
薄膜に関する。 〔従来の技術〕 近時、チタン薄膜は耐食性、耐熱性等の優れた性質を持
っていることから、種々の分野で利用されているが、例
えば半導体歪ゲージを用いた応力センサの抵抗温度補償
用抵抗として用いられている。即ち、圧カセンサ、歪み
センサ等として適用される応カセンサには半導体歪ゲー
ジが用いられているが、該半導体歪ゲージは負の抵抗温
度係数を有しており、ゲージ温度が上昇すると抵抗値が
下がる特性がある。このため、半導体歪ゲージには正の
抵抗温度係数を有する抵抗温度補償用のチタン薄膜抵抗
を接続し、半導体歪ゲージの抵抗値の降下分を補償する
ようになっている。 そして、従来技術によればダイヤフラムに形成したシリ
コン薄膜製絶縁膜上にチタン薄膜抵抗を形或する方法と
しては、真空蒸着法が一般的に用いられており、該真空
蒸着法によって形成したチタン薄膜にホトリソグラフィ
法によってパターン成形するようにしている。 〔発明が解決しようとする課題〕 ところで、真空蒸着法を用いてダイヤフラムのシリコン
薄膜上にチタン薄膜を形成する場合、次のような問題が
ある。即ち、真空蒸着法はチタンを加熱して発生させた
蒸発物をシリコン薄膜に付着させるため、付着強度がス
パッタ法、イオンプレーティング法、気相成長法に比較
して弱く、特に酸化ケイ素膜に対する付着力が弱く、し
かも均一に成膜されないという問題点がある。 このため、高い検出圧力を測定するのに用いられる高圧
用応カセンサに真空蒸着法を用いて抵抗温度補償用のチ
タン薄膜抵抗を形成した場合、応力測定時にダイヤフラ
ムが荷重を受けて変形するとき、チタン薄膜がシリコン
薄膜から剥離しやすく、信頼性に欠けるという欠点があ
る。 本発明は上述した従来技術の欠点に鑑みなされたもので
、シリコン膜に対する付着力が強く、しかも酸化物を含
まない高純度のチタン薄膜の形成方法及び抵抗温度補償
用抵抗に用いて好適なチタン薄膜を提供することを目的
とする。 〔課題を解決するための手段〕 上述した課題を解決するために、本発明による手段の特
徴は、スパッタ法を用いてシリコン基板上に形成するチ
タン薄膜の膜厚を0.2μm以上にすることにある。 また、スパッタ法には高周波スパッタ法を用い、スパッ
タ出力を略0.3kw、スパッタ時間10分以上の条件
によりチタン薄膜を形成することにある。 さらに、抵抗温度補償用チタン薄膜は、膜厚を0.2μ
m以上とし、結晶構造に(011)面を選択配向したこ
とを特徴とする。 〔作用〕 スパッタ法を用いることにより、チタン薄膜はシリコン
基板に対して強い付着力をもつ。そして、膜厚を0.2
μm以上に形成することにより、チタン薄膜には酸化物
を含まず、しかも抵抗温度係数を持つ。従って、該チタ
ン薄膜は応カセンサ、特に高圧用応カセンサの抵抗温度
補償に使用できる。 〔実施例〕 以下、本発明の実施例方法をダイヤフラム式応カセンサ
に適用する場合を例に挙げ、図面を参照しつつ説明する
。 第1図及び第2図はダイヤフラム式応カセンサを示す。 図において、1は金属材料、例えばステンレススチール
からなる高圧用のダイヤフラムで、該ダイヤフラム1は
薄肉円板状の起歪部1Aと、該起歪部1Aの外周に厚肉
円筒状に一体に形成された非起歪部IBとからなってお
り、起歪部1Aの図中下側面は矢示方向からの液圧を受
承する受圧面IA,になり、上側面は後述する絶縁膜2
を形成するための膜形成面IA2になっている。 2は前記起歪部IAの膜形成面IAz上に形或された絶
縁膜で、該絶縁膜2は例えばプラズマ−CVD法、真空
蒸着法、スパッタ法等の適宜の成膜技術によって数μm
の厚さに形成された酸化ケイ素(Sing)膜からなっ
ている。 3A,3B,3C,3Dは前記絶縁膜2上に形成された
4個の半導体歪ゲージからなるゲージ抵抗(以下ゲージ
抵抗3と総称する)で、該ゲージ抵抗3は例えばプラズ
マーCVD法によって絶縁膜2上に薄膜状に形成したケ
イ素基板にリン(P)又はホウ素(B)の不純物をドー
ピングしてゲージ用薄膜を形成した後、ホトリソグラフ
ィ法によってパターン形成されており、外力を受けて歪
んだときに比抵抗が変化するビエゾ抵抗素子として構成
されている。 4A,4B,4C,4D,4E,4Fは前記ゲージ抵抗
3を接続してホイーストンブリッジ回路を構成する薄膜
導体(以下薄膜導体4と総称する)で、4Aは第1のゲ
ージ抵抗3Aの一端側に接続された第1の薄膜導体、4
Bは該ゲージ抵抗3Aの他端側と第2のゲージ抵抗3B
の一端側に接続された第2の薄膜導体、4Cは該第2の
ゲージ抵抗3Bの他端側に接続された第3の薄膜導体を
示す。また、4Dは第3のゲージ抵抗3Cの一端側に接
続された第4の薄膜導体、4Eは該第3のゲージ抵抗3
Cの他端側と第4のゲージ抵抗3Dの一端側に接続され
た第5の薄膜導体で、4Fは該第4のゲージ抵抗3Dの
他端側に接続された第6の薄膜導体を示す。 これら薄膜導体4は絶縁膜2上に真空蒸着法を用いて金
(Au)、アルミニウム(AJ2)、銅(Cu)等の良
導体材料からなる導体的薄膜を形成した後、ホトリソグ
ラフィ法によりパターン成形されている。そして、各薄
膜導体4A,4B,4C,4D,4E,4Fの外側端部
は電源或は測定器の配線を接続するための接続用端子5
A,5B,5G,5D,5E,5Fに形成されており、
端子5C,5Dは出力側の接続用端子になっている。 6は前記薄膜導体4のうち、第3の薄膜導体4Cと第4
の薄膜導体4Dとの間に並列接続された抵抗温度補償用
のチタン薄膜抵抗を示し、該チタン 薄膜抵抗6は高周
波スパッタ法を用いて後に詳述するように絶縁膜2上に
チタン薄膜を0.2μm以上の膜厚に形成した後、ホト
リソグラフィ法によってパターン成形されている。 7は酸化シリコン(Sin.)膜からなり、前記ゲージ
抵抗3、薄膜導体4及びチタン薄膜抵抗6を一体的に覆
うバッシベーション膜、8は前記パッシベーション膜7
を覆うようにダイヤフラムlに固着された合成樹脂製の
ターミナルベースで、該ターミナルベース8には配線導
出穴8A,8Aが形成されている。そして、該ターミナ
ルベース8に設けられた接続端子9.10は前記接続用
端子5C,5Dと配線11.12を介してそれぞれ接続
されると共に、出力用のリード線13,14が接続され
ている。 更に、l5はターミナルベース8の外周側を囲むように
ダイヤフラム1のフランジ部に嵌着された外力バーで、
該外力バー15内はターミナルベース8を密封するよう
に絶縁製樹脂16によってモールドされている。 応カセンサは上述の如く構成されており、端子5B、5
Eと端子5C (5A) 、5D (5F)とを用いて
ホイートストンブリッジ回路を形成し、端子5C,5D
間に電圧計、電流計等の測定器を接続し、端子5B,5
E間に電源を接続してダイヤフラム1の起歪部lAの歪
を測定する。起歪部IAが無負荷状態であればゲージ抵
抗3の電気抵抗は変化しないから、端子5C,5D間に
電位差は生じなく、測定器に電流は流れない。一方ダイ
ヤフラム1に矢示方向の負荷が掛って起歪部IAが歪む
と、ゲージ抵抗の電気抵抗が変化する結果、端子5C,
5D間に電位差が生じて電流が流れるため、測定器によ
り歪を測定することができる。そして、上述した測定中
チタン薄膜抵抗6はゲージ抵抗3の温度上昇に伴う抵抗
の減少を補償するようになっている。 そこで、次にシリコン製絶縁膜2上に該チタン薄膜抵抗
6を形成する方法について詳述する。 まず、抵抗温度補償用のチタン薄膜抵抗6を形成するに
は、抵抗値が20〜200Ωのチタン薄膜を形成する必
要があるが、高周波スパッタ法によりこのようなチタン
薄膜を形成するためには、0.3〜0.5kwのスパッ
タ出力が必要である(第3図参照)。しかし、0.4k
w以上のスパッタ出力でチタンを酸化シリコン膜上に成
膜すると、膜形成後にチッピング(チタン内の気泡の飛
び出しによる膜の剥離)が発生し、チタン薄膜の抵抗が
急増する現象が認められる。なお、スパッタ出力を0.
3kw未満とした場合には抵抗値が急増し、抵抗温度補
償には適用しえない。 そこで、スパッタ出力な略0.3kwに設定し、スパッ
タ時間を変えてチタン薄膜を形成し、このチタン薄膜の
抵抗をスパッタ時間との関係から見ると、第4図に示す
ようにスパッタ時間を10分以上に設定したチタン薄膜
が20〜200Ωの安定した抵抗を得ることができる。 次に,前述の如くスパッタ出力を略0. 3kw、スパ
ッタ時間を10分以上に設定して形成したチタン薄膜の
膜厚(1)と抵抗温度係数(TCR)との関係を第5図
に示す。抵抗温度係数(TCR)は膜厚(1)が1.5
μmになるまでは当該膜厚(1)に比例して増大し−、
膜厚が1.5μm以上になるとほぼ一定の値約2,00
0ppmになり、応カセンサの抵抗温度補償用チタン薄
膜としては十分な抵抗温度係数(TCR)を得ることが
認められる。 更に、純チタン材及び高周波スパッタ法によりシリコン
膜上に形成したチタン薄膜の結晶構造をX線回折法によ
って測定した結果を第6図に示す。抵抗温度係数(TC
R)が2,OOOppm以上である純チタン材(純Tl
)の結晶には、(011)、(010)、(002)の
各面が明瞭に検出される。また、前述の如く抵抗温度係
数(TCR)の大きい膜厚が1.5umのチタン薄膜(
T.)の結晶についても、純チタン材とは各面のX線の
ピーク強度比が異なるが(011)、(010)、(0
02)の各面が明瞭に検出される。更に、膜厚が0.3
μmのチタン薄膜(T.2)の結晶についても、(01
1)(010)、(002)の各面でピークを検出でき
る。 他方、抵抗温度係数(TCP)の小さい薄膜が04 1
μmのチタン薄膜(T,3)の結晶については(010
)、(002)の面は検出されるが、(011)面が全
く検出されず、しかも抵抗温度係数(TCR)に悪影響
を及ぼす酸化チタン(T,O)の結晶面も検出されてい
る。なお、酸化チタン(T.O)はスパッタの途中で酸
素と反応して形成されるものである。 かくして、チタン薄膜が応カセンサの抵抗温度補償用抵
抗として必要な抵抗温度係数(TCR)を得るためには
、(011)面を選択配向させることが必要であり、そ
のためにはチタン薄膜の膜厚を0.2μm以上に形成す
ればよいことになる。 叙上の如く本実施例によれば、真空蒸着法と比較して付
着力の強い高周波スパッタ法を用いてシリコン薄膜製の
絶縁膜2上にチタン薄膜を形或するから、応カセンサに
適用しても剥離することがないチタン薄膜抵抗6にする
ことができる。また、高周波スパッタ法によりチタン薄
膜を形成する場合、スパッタ出力を略0.3kw,スパ
ッタ時間を10分以上に設定し、膜厚を0.2tLm以
上に形或することにより、酸化物を含まない高純度のチ
タン薄膜を得ることができる。 なお、実施例はスパッタ法として高周波スパッタ法を用
いたが、他のスパッタ法も本発明に適用できるものであ
る。 C発明の効果〕 本発明は以上詳述した如くであって、膜厚を0.2μm
以上に形成することにより、酸化物を含まない高純度の
チタン薄膜を形成できる。また、本発明方法によればチ
タン薄膜はシリコン製絶縁膜に対して強い付着力を持つ
から、高圧用応カセンサの抵抗温度補償に用いることが
できる。 更に、スパッタ法の各条件を選択することによって任意
の抵抗温度係数を持ったチタン薄膜な形或でき、特にス
パッタ出力を略0.3kw、スパッタ時間10分以上に
設定したとき、純チタン材と同等の抵抗値を持ったチタ
ン薄膜を形成できる。また、膜厚を0.2μm以上にし
,結晶構造に(011)面を選択配向したチタン薄膜は
高純度で、所望の抵抗温度係数を持った抵抗温度補償用
抵抗として用いることかできる。
第1図は本発明の実施例に係るスパッタ法により形成し
たチタン薄膜抵抗を用いた応カセンサの縦断面図、第2
図は第1図中の絶縁膜上の実装状態を示す拡大平面図,
第3図はチタン薄膜抵抗とスパッタ出力との関係を示す
線図、第4図はスパッタ出力をO− 3kwに設定した
ときのスパッタ時間とチタン薄膜抵抗との関係を示す線
図、第5図はスパッタ出力0.3kwのときにおけるチ
タン薄膜厚さと抵抗温度係数との関係を示す線図、第6
図は純チタン材及び膜厚の異なるチタン薄膜のX線回折
結果を示す線図である。 1・・・ダイヤフラム、2・・・絶縁膜、3A,3B,
3C,3D・・・ゲージ抵抗、4A,4B,4C,4D
,4E,4F・・・薄膜導体、6・・・チタン薄膜抵抗
。
たチタン薄膜抵抗を用いた応カセンサの縦断面図、第2
図は第1図中の絶縁膜上の実装状態を示す拡大平面図,
第3図はチタン薄膜抵抗とスパッタ出力との関係を示す
線図、第4図はスパッタ出力をO− 3kwに設定した
ときのスパッタ時間とチタン薄膜抵抗との関係を示す線
図、第5図はスパッタ出力0.3kwのときにおけるチ
タン薄膜厚さと抵抗温度係数との関係を示す線図、第6
図は純チタン材及び膜厚の異なるチタン薄膜のX線回折
結果を示す線図である。 1・・・ダイヤフラム、2・・・絶縁膜、3A,3B,
3C,3D・・・ゲージ抵抗、4A,4B,4C,4D
,4E,4F・・・薄膜導体、6・・・チタン薄膜抵抗
。
Claims (3)
- (1)スパッタ法を用いてシリコン基板上にチタン薄膜
を形成するチタン薄膜の形成方法において、前記チタン
薄膜の膜厚を0.2μm以上に形成することを特徴とす
るチタン薄膜の形成方法。 - (2)前記チタン薄膜を高周波スパッタ法を用いてスパ
ッタ出力を略0.3kw、スパッタ時間10分以上の条
件により形成するようにした特許請求の範囲1項記載の
チタン薄膜の形成方法。 - (3)薄膜が0.2μm以上で、結晶構造に(011)
面が選択配向されている抵抗温度補償用チタン薄膜。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP30609889A JPH03166359A (ja) | 1989-11-24 | 1989-11-24 | チタン薄膜の形成方法及び抵抗温度補償用チタン薄膜 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP30609889A JPH03166359A (ja) | 1989-11-24 | 1989-11-24 | チタン薄膜の形成方法及び抵抗温度補償用チタン薄膜 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03166359A true JPH03166359A (ja) | 1991-07-18 |
Family
ID=17953014
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP30609889A Pending JPH03166359A (ja) | 1989-11-24 | 1989-11-24 | チタン薄膜の形成方法及び抵抗温度補償用チタン薄膜 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03166359A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2018508781A (ja) * | 2015-03-03 | 2018-03-29 | 江▲蘇▼多▲維▼科技有限公司Multidimension Technology Co., Ltd. | 銅熱抵抗薄膜温度センサチップおよびその製造方法 |
-
1989
- 1989-11-24 JP JP30609889A patent/JPH03166359A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2018508781A (ja) * | 2015-03-03 | 2018-03-29 | 江▲蘇▼多▲維▼科技有限公司Multidimension Technology Co., Ltd. | 銅熱抵抗薄膜温度センサチップおよびその製造方法 |
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