JPH0318276A - 交流対直流変換器 - Google Patents
交流対直流変換器Info
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- JPH0318276A JPH0318276A JP2130399A JP13039990A JPH0318276A JP H0318276 A JPH0318276 A JP H0318276A JP 2130399 A JP2130399 A JP 2130399A JP 13039990 A JP13039990 A JP 13039990A JP H0318276 A JPH0318276 A JP H0318276A
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- 239000003990 capacitor Substances 0.000 claims abstract description 21
- 230000005669 field effect Effects 0.000 claims description 10
- 239000004065 semiconductor Substances 0.000 claims description 4
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- 238000010586 diagram Methods 0.000 description 4
- 230000010354 integration Effects 0.000 description 2
- 230000001681 protective effect Effects 0.000 description 2
- 230000000903 blocking effect Effects 0.000 description 1
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- 230000007935 neutral effect Effects 0.000 description 1
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-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of AC power input into DC power output; Conversion of DC power input into AC power output
-
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- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of AC power input into DC power output; Conversion of DC power input into AC power output
- H02M7/02—Conversion of AC power input into DC power output without possibility of reversal
- H02M7/04—Conversion of AC power input into DC power output without possibility of reversal by static converters
- H02M7/12—Conversion of AC power input into DC power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
- H02M7/21—Conversion of AC power input into DC power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal
- H02M7/217—Conversion of AC power input into DC power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only
- H02M7/2176—Conversion of AC power input into DC power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only comprising a passive stage to generate a rectified sinusoidal voltage and a controlled switching element in series between such stage and the output
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Dc-Dc Converters (AREA)
- Rectifiers (AREA)
- Direct Current Feeding And Distribution (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（技術分野）
この発明は交流源から低電圧直流を生成する変換器に関
連し、さらに特定すると、幹線交流から低電圧直流を生
成する変換器のみに関連しているものではない。
連し、さらに特定すると、幹線交流から低電圧直流を生
成する変換器のみに関連しているものではない。
（背景技術）
例えば交流幹線電源から駆動された半導体回路における
ように、交流源から直流電圧が与えられることが要求さ
れる多くの適用が存在する。例えば整流器に給電する変
成器により交流幹線電圧が低直流電圧に変換されるその
ような変換を遂行する多数の既知のやり方が存在する。
ように、交流源から直流電圧が与えられることが要求さ
れる多くの適用が存在する。例えば整流器に給電する変
成器により交流幹線電圧が低直流電圧に変換されるその
ような変換を遂行する多数の既知のやり方が存在する。
しかしこれはかさばった装置であり、たとえ既存の変成
器を有する機器で分巻線（ｓｅｐａｒａｔｅ ｗｉｎｄ
ｉｎｇ）が使用できても、それは常に都合の良い方法で
はない。別の可能性は、幹線電圧を整流しかつ例えば抵
抗器あるいはトランジスタのような直列電圧降下素子に
より生成されるように直流高電圧を低減することである
。しかし、もし低電圧源が適度な電源電流を備えるよう
要求されるなら、そのような装置は直列素子で高い電力
消費を必要とする。別の可能性は交流電源ラインで直列
キャパシタを使用して整流器ブリッジに給電することで
あるが、これもまた扱いにくい解決法である。
器を有する機器で分巻線（ｓｅｐａｒａｔｅ ｗｉｎｄ
ｉｎｇ）が使用できても、それは常に都合の良い方法で
はない。別の可能性は、幹線電圧を整流しかつ例えば抵
抗器あるいはトランジスタのような直列電圧降下素子に
より生成されるように直流高電圧を低減することである
。しかし、もし低電圧源が適度な電源電流を備えるよう
要求されるなら、そのような装置は直列素子で高い電力
消費を必要とする。別の可能性は交流電源ラインで直列
キャパシタを使用して整流器ブリッジに給電することで
あるが、これもまた扱いにくい解決法である。
（発明の開示）
本発明は上述の欠点の考察から生じ、かつ集積回路とし
て具体化するのに適した解決法を与えるよう探求してい
る。
て具体化するのに適した解決法を与えるよう探求してい
る。
本発明によると、交流対低電圧直流変換器が備えられ、
該変換器が、 一対の入力電圧電源ライン、 半導体スイッチ素子、および 電源ラインの間に直列に接続されたキャパシタ、を具え
、ここで直流量圧の出力がキャパシタにわたって与えら
れるものにおいて、 交流電圧の一部が所定の電圧以下である間にのみ導通す
るようセンシング回路がスイッチ素子をトリガする入力
電圧に感応することを特徴としている。
該変換器が、 一対の入力電圧電源ライン、 半導体スイッチ素子、および 電源ラインの間に直列に接続されたキャパシタ、を具え
、ここで直流量圧の出力がキャパシタにわたって与えら
れるものにおいて、 交流電圧の一部が所定の電圧以下である間にのみ導通す
るようセンシング回路がスイッチ素子をトリガする入力
電圧に感応することを特徴としている。
５
６
スイッチ素子は電界効果トランジスタを具えることがで
きる。
きる。
スイッチ素子とキャパシタの直列配列において、電源ラ
インの１つとスイッチ素子の間に接続されたダイオード
を備えることができる。代案として、ダイオードがスイ
ッチ素子とキャパシタの間に接続できる。
インの１つとスイッチ素子の間に接続されたダイオード
を備えることができる。代案として、ダイオードがスイ
ッチ素子とキャパシタの間に接続できる。
上述の直列配列を使用する１つの有利な装置において、
センシング回路は、ダイオードと、キャパシタとツエナ
ーダイオードの並列配列とに直列になって出力接続され
た入力電源ラインの１つに接続された抵抗器を具え、 第２電界効果トランジスタは抵抗器とダイオードの接合
点に接続されたそのゲートと、ダイオートの別の側に接
続されたそのソースと、スイッチ素子のゲートおよび接
合トランジスタのコレクタに接続されたそのドレインを
有し、接合トランジスタのエミッタはツェナーダイオー
ドを介して入力電源ラインの別の１つに接続され、接合
トランジスタのベースは出力に接続され、ダイオードは
別の入力ラインに接続されたそのアノー１・および入カ
ラインの１つに接続されていない抵抗器の端子に接続さ
れたそのカソードを有している。
センシング回路は、ダイオードと、キャパシタとツエナ
ーダイオードの並列配列とに直列になって出力接続され
た入力電源ラインの１つに接続された抵抗器を具え、 第２電界効果トランジスタは抵抗器とダイオードの接合
点に接続されたそのゲートと、ダイオートの別の側に接
続されたそのソースと、スイッチ素子のゲートおよび接
合トランジスタのコレクタに接続されたそのドレインを
有し、接合トランジスタのエミッタはツェナーダイオー
ドを介して入力電源ラインの別の１つに接続され、接合
トランジスタのベースは出力に接続され、ダイオードは
別の入力ラインに接続されたそのアノー１・および入カ
ラインの１つに接続されていない抵抗器の端子に接続さ
れたそのカソードを有している。
すぐ前の直列接続を使用する別の有利な装置では、セン
シング回路は第２電界効果トランジスタのゲートに接続
されている第ｌツェナーダイオードに直列に接続されて
いる入力電源ラインの１つに接続された第１抵抗器を具
え、第２電界効果トランジスタのソースは第２ツェナー
ダイオードと、出力に接続されている第２抵抗器の直列
配列に並列に接続されているキャパシタに接続され、第
２電界効果トランジスタのソースとゲートは第３ツェナ
ーダイオードにより橋絡され、一方そのドレインはダイ
オードを介して接合トランジスタのコレクタに接続され
、接合トランジスタのエミッタは第４ツェナーダイオー
ドを介して他の入力電源ラインに接続され、かつ接合ト
ランジスタのベースは出力に接続され、そして第２接合
トランジスタは第２ツェナーダイオードと第２抵抗器の
接合点に接続されたそのベースおよび出力に接続された
そのエミッタおよびスイッチ素子のゲートに接続された
そのコレクタを有するよう備えられている。
シング回路は第２電界効果トランジスタのゲートに接続
されている第ｌツェナーダイオードに直列に接続されて
いる入力電源ラインの１つに接続された第１抵抗器を具
え、第２電界効果トランジスタのソースは第２ツェナー
ダイオードと、出力に接続されている第２抵抗器の直列
配列に並列に接続されているキャパシタに接続され、第
２電界効果トランジスタのソースとゲートは第３ツェナ
ーダイオードにより橋絡され、一方そのドレインはダイ
オードを介して接合トランジスタのコレクタに接続され
、接合トランジスタのエミッタは第４ツェナーダイオー
ドを介して他の入力電源ラインに接続され、かつ接合ト
ランジスタのベースは出力に接続され、そして第２接合
トランジスタは第２ツェナーダイオードと第２抵抗器の
接合点に接続されたそのベースおよび出力に接続された
そのエミッタおよびスイッチ素子のゲートに接続された
そのコレクタを有するよう備えられている。
整流器が交流電源と、入力電圧電源ラインのペアーとの
間に備えることができる。さらに交流電源と整流器の間
に変成器を備えることができる。
間に備えることができる。さらに交流電源と整流器の間
に変成器を備えることができる。
本発明とその種々の別の好ましい特徴をさらに容易に理
解するために、そのいくつかの実施例を図面を参照し、
実例により説明する。
解するために、そのいくつかの実施例を図面を参照し、
実例により説明する。
（実施例）
第１図の構成はダイオードを介して例えば２３０Ｖ Ｒ
ＭＳの交流幹線電源（ａ．ｃ． ｍａｉｎ ｓｏｕｒｃ
ｅ）に接続された電界効果スイッチトランジスタＴＩを
具えている。スイッチトランジスタＴＩのドレインがダ
イオードＤＩを介して交流幹線電圧源に接続されるか、
あるいはスイッチトランジスタのソースが１００マイク
ロファラッドのキャパシタＣＩに直列になったダイオー
ドＤ２を介して中性点あるいは零電圧ラインＯｖに接続
されるよう図面に例示された２つの代案の接続が存在す
る。０Ｖラインに接続されていないキャパシタＣＩの端
子は回路の直流出力端子■０を形成する。もしシステム
の入力電圧がＣＩに掛かる電圧より低くなるなら、Ｄｉ
とＤ２はその１つのみが必要とされるブロッキングダイ
オードの２つの可能な位置を表示する。スイッチトラン
ジスタを駆動するセンシング回路１０はｐｎｐ トラン
ジスタＴ２を具え、そのエミッタは高抵抗（３メグオー
ム）の抵抗器Ｒｌにより入力ラインＶｉｎに連結され、
また電界効果トランジスタＴ３のゲートにも接続されて
いる。ダイオードＤ４は抵抗器Ｒｌ／エミッタ接合点と
０Ｖラインとの間に接続され、もし高い（２３０ＶＲＭ
Ｓ ）電源が使用されるなら、さもなければ整流器が回
路の前に必要とされるよう交流源から直接動作すること
を許容する。トランジスタＴ２のコレクタとベースは共
に接続され、従ってＴ２はダイオードとして機能する。
ＭＳの交流幹線電源（ａ．ｃ． ｍａｉｎ ｓｏｕｒｃ
ｅ）に接続された電界効果スイッチトランジスタＴＩを
具えている。スイッチトランジスタＴＩのドレインがダ
イオードＤＩを介して交流幹線電圧源に接続されるか、
あるいはスイッチトランジスタのソースが１００マイク
ロファラッドのキャパシタＣＩに直列になったダイオー
ドＤ２を介して中性点あるいは零電圧ラインＯｖに接続
されるよう図面に例示された２つの代案の接続が存在す
る。０Ｖラインに接続されていないキャパシタＣＩの端
子は回路の直流出力端子■０を形成する。もしシステム
の入力電圧がＣＩに掛かる電圧より低くなるなら、Ｄｉ
とＤ２はその１つのみが必要とされるブロッキングダイ
オードの２つの可能な位置を表示する。スイッチトラン
ジスタを駆動するセンシング回路１０はｐｎｐ トラン
ジスタＴ２を具え、そのエミッタは高抵抗（３メグオー
ム）の抵抗器Ｒｌにより入力ラインＶｉｎに連結され、
また電界効果トランジスタＴ３のゲートにも接続されて
いる。ダイオードＤ４は抵抗器Ｒｌ／エミッタ接合点と
０Ｖラインとの間に接続され、もし高い（２３０ＶＲＭ
Ｓ ）電源が使用されるなら、さもなければ整流器が回
路の前に必要とされるよう交流源から直接動作すること
を許容する。トランジスタＴ２のコレクタとベースは共
に接続され、従ってＴ２はダイオードとして機能する。
コレクター・ベース接合は２０ｐＦのキャパシタＣ２と
２２ボルトのツェナーダイオードＺｌとの並列接続を介
して出力ＶＯに接続されている。トランジスターＴ３の
ソースはＴ２のベースに接続され、Ｔ３のドレインはｎ
ｐｎ ｈランジスタＴ４の９ １０ コレクタに接続され、そのエミッタはｌ５ボルトのツエ
ナーダイオードＺ２を介してＯｖラインに接続されてい
る。Ｔ４のベースは出力Ｖｏに接続されている。
２２ボルトのツェナーダイオードＺｌとの並列接続を介
して出力ＶＯに接続されている。トランジスターＴ３の
ソースはＴ２のベースに接続され、Ｔ３のドレインはｎ
ｐｎ ｈランジスタＴ４の９ １０ コレクタに接続され、そのエミッタはｌ５ボルトのツエ
ナーダイオードＺ２を介してＯｖラインに接続されてい
る。Ｔ４のベースは出力Ｖｏに接続されている。
ダイオードＤ４は、もし入力電圧が負になるなら保護ク
ランプを与えるために、０ＶとＶｉｎに接続されていな
い抵抗器Ｒ１の端子との間に接続されている。
ランプを与えるために、０ＶとＶｉｎに接続されていな
い抵抗器Ｒ１の端子との間に接続されている。
この回路がまずスイッチオンされると、キャパシタＣ２
はダイオード接続されたトランジスタＴ２を通してツェ
ナーダイオードＺｌにより規定された２２ボルトに充電
され、電流はＲｌによって制限される。
はダイオード接続されたトランジスタＴ２を通してツェ
ナーダイオードＺｌにより規定された２２ボルトに充電
され、電流はＲｌによって制限される。
トランジスタＴ３とＴＩは最初はオフになっている。
電圧Ｖｉｎが２０ボルト＋■ｏ以下に落ちると、Ｔ３は
導通し（オン）、そしてＣ２からの電荷はＴｌのゲース
・ソースキャパシタンスと直列ダイオードＤ２にわたっ
て印加され、それによりＴｌをオンにする。
導通し（オン）、そしてＣ２からの電荷はＴｌのゲース
・ソースキャパシタンスと直列ダイオードＤ２にわたっ
て印加され、それによりＴｌをオンにする。
導通が止みかつＤ２がブロックすると、電圧ＶｉｎがＶ
ｏ以下に落ちるまでキャパシタＣ１は電源Ｖｉｎから充
電電流を受け取る。電圧波形ＶｉｎがＴＩによってまだ
オンとなっているＶｏ以上に再び上昇すると、トランジ
スタは再び電流を通過し始め、そしてＣｌはトランジス
タＴ４が導通しＴＩがスイッチオフする場合にその電圧
が１５ボルトプラスｌトランジスタ接合電圧に上昇する
まで充電し、Ｃ２は再充電し、そしてこのサイクルが再
び繰り返される。このようにして、トランジスタは入力
波形の低い電圧部分の間にのみ導通し、かつこの短い期
間の間に低電圧電源の負荷電流に等しい平均値を有する
ピーク電流が流れる。例えば１０ｍＡのような小電流要
求に対して、これは特に回路がシステムの開始の間にの
み有効である場合に受容できよう。回路は交流電源から
直接給電できるか、あるいは交流電源から給電されたブ
リッジ整流器から給電できる。
ｏ以下に落ちるまでキャパシタＣ１は電源Ｖｉｎから充
電電流を受け取る。電圧波形ＶｉｎがＴＩによってまだ
オンとなっているＶｏ以上に再び上昇すると、トランジ
スタは再び電流を通過し始め、そしてＣｌはトランジス
タＴ４が導通しＴＩがスイッチオフする場合にその電圧
が１５ボルトプラスｌトランジスタ接合電圧に上昇する
まで充電し、Ｃ２は再充電し、そしてこのサイクルが再
び繰り返される。このようにして、トランジスタは入力
波形の低い電圧部分の間にのみ導通し、かつこの短い期
間の間に低電圧電源の負荷電流に等しい平均値を有する
ピーク電流が流れる。例えば１０ｍＡのような小電流要
求に対して、これは特に回路がシステムの開始の間にの
み有効である場合に受容できよう。回路は交流電源から
直接給電できるか、あるいは交流電源から給電されたブ
リッジ整流器から給電できる。
第１図の回路はもしトランジスタＴ１がスイッチオンで
最初起こる相対的に大きい電力消費をうまく処理するな
ら満足に機能でき、また交流幹線電源で起こる過渡現象
を許容できる。しかし、スイッチオンと過渡現象生起の
問題に打ち勝ち、かつ低定格トランジスタの使用を許容
するために、本発明のいくつかの精密化が存在し、それ
らは第２図と第３図に関淳して説明されるように可能で
あ１１ １２ る。第１図に類似する要素に対してこれらの図面で同じ
参照記号が使用されている。
最初起こる相対的に大きい電力消費をうまく処理するな
ら満足に機能でき、また交流幹線電源で起こる過渡現象
を許容できる。しかし、スイッチオンと過渡現象生起の
問題に打ち勝ち、かつ低定格トランジスタの使用を許容
するために、本発明のいくつかの精密化が存在し、それ
らは第２図と第３図に関淳して説明されるように可能で
あ１１ １２ る。第１図に類似する要素に対してこれらの図面で同じ
参照記号が使用されている。
第２図を参照すると、トランジスタＴ２が省略され、２
２ボルトのツェナーダイオードＺ３が抵抗器Ｒｌとトラ
ンジスタＴ３の間に直列に導入され、かつＴ３のゲート
とソースの間に接続された別のツェナーダイオードＺ４
が導入されていることが分かろう。
２ボルトのツェナーダイオードＺ３が抵抗器Ｒｌとトラ
ンジスタＴ３の間に直列に導入され、かつＴ３のゲート
とソースの間に接続された別のツェナーダイオードＺ４
が導入されていることが分かろう。
ダイオードＤ２は省略され、ダイオードＤ３がトランジ
スタＴ３のドレインラインに挿入されている。２２ボル
トのツェナーダイオードＺｌがＴ３のソースと出力Ｖｏ
の間に抵抗器Ｒ２と直列に接続されている。ｎｐｎトラ
ンジスタＴ５は、Ｒ２とＺｌの接合点に接続されたその
ベースと、出力Ｖｏに接続されたそのエミッタと、Ｔ４
のコレクタに接続されたそのコレクタを有している。こ
の回路は入力電圧が出力電圧より高い定常状態条件から
出発して以下のように動作する。Ｔｌはオフである（初
期状態）。Ｃ２はＺ１によって規定されたように２２ボ
ルトに充電される。Ｔ５は導通し、Ｔｌをオフに保つ。
スタＴ３のドレインラインに挿入されている。２２ボル
トのツェナーダイオードＺｌがＴ３のソースと出力Ｖｏ
の間に抵抗器Ｒ２と直列に接続されている。ｎｐｎトラ
ンジスタＴ５は、Ｒ２とＺｌの接合点に接続されたその
ベースと、出力Ｖｏに接続されたそのエミッタと、Ｔ４
のコレクタに接続されたそのコレクタを有している。こ
の回路は入力電圧が出力電圧より高い定常状態条件から
出発して以下のように動作する。Ｔｌはオフである（初
期状態）。Ｃ２はＺ１によって規定されたように２２ボ
ルトに充電される。Ｔ５は導通し、Ｔｌをオフに保つ。
もしＶｉｎが２０ボルト＋ＶＯに減少すると、Ｔ３は導
通になり、ＴＩのＣＯＳはＴ３を介してＣ２から充電さ
れ、Ｄ３はＴｌをスイッチオンし、ＣｌはＤＩとｔｌを
介してＶｉｎから充電される。入力電圧がＶｏより低く
なると、ＣＩはもはや充電せず、ＴＩはオンに保持され
よう。次に入力電圧は１５ボルト以上に上昇し、ＣＩは
Ｔ４がスイッチオンされる場合にそれが１５ボルトプラ
ス１接合電圧降下に上昇するまで再び充電されよう。も
しＶｉｎが０ボルトなら、Ｃ２は保護ツェナーダイオー
ドｚ４、Ｚ３およびＲｌを介して２２ボルトに放電され
る。ＴｌのＣＧＳの放電はＤ３を介して禁止される。
通になり、ＴＩのＣＯＳはＴ３を介してＣ２から充電さ
れ、Ｄ３はＴｌをスイッチオンし、ＣｌはＤＩとｔｌを
介してＶｉｎから充電される。入力電圧がＶｏより低く
なると、ＣＩはもはや充電せず、ＴＩはオンに保持され
よう。次に入力電圧は１５ボルト以上に上昇し、ＣＩは
Ｔ４がスイッチオンされる場合にそれが１５ボルトプラ
ス１接合電圧降下に上昇するまで再び充電されよう。も
しＶｉｎが０ボルトなら、Ｃ２は保護ツェナーダイオー
ドｚ４、Ｚ３およびＲｌを介して２２ボルトに放電され
る。ＴｌのＣＧＳの放電はＤ３を介して禁止される。
第２図の回路がＶｏ＝０に開始される場合、ＴＩはＲｌ
， Ｚ３， Ｚ４， Ｚｌ， Ｒ２（７）通路が導通に
なるや否やスイッチオフされる。ターンオン（Ｔｌオン
）中の最大電圧はｚ３とＺｌにより決定される。この構
成はトランジスタＴ１を低消費にでき、チップ上の集積
を容易にする。
， Ｚ３， Ｚ４， Ｚｌ， Ｒ２（７）通路が導通に
なるや否やスイッチオフされる。ターンオン（Ｔｌオン
）中の最大電圧はｚ３とＺｌにより決定される。この構
成はトランジスタＴ１を低消費にでき、チップ上の集積
を容易にする。
第３図の線図は変成器Ｔに給電する２３０ボルトの幹線
電源を示しており、この変成器Ｔは電圧をステップダウ
ンし、かつブリッジ整流器ＢＲに給電し、直流３０ボル
トのその出力はダイオード０１０をｌ３ ｌ４ 介して直流電源電圧の１電源を与えるようキャパシタＣ
ＩＯに給電される。整流された電圧はまた１２ボルト出
力を与えるよう第１図あるいは第２図に関連して説明さ
れた集積回路変換器ＩＣに給電するために使用される。
電源を示しており、この変成器Ｔは電圧をステップダウ
ンし、かつブリッジ整流器ＢＲに給電し、直流３０ボル
トのその出力はダイオード０１０をｌ３ ｌ４ 介して直流電源電圧の１電源を与えるようキャパシタＣ
ＩＯに給電される。整流された電圧はまた１２ボルト出
力を与えるよう第１図あるいは第２図に関連して説明さ
れた集積回路変換器ＩＣに給電するために使用される。
１２ボルトの出力電圧はツェナーダイオードと通常のダ
イオードの適当なスタックを選ぶことにより実現できる
。述べられた特定値はシステムの動作を説明する一例と
してのみ使用されることが理解されるべきである。
イオードの適当なスタックを選ぶことにより実現できる
。述べられた特定値はシステムの動作を説明する一例と
してのみ使用されることが理解されるべきである。
たとえこの回路が特定の導電型のトランジスタを用いて
説明されていても、この発明の範囲から逸脱することな
く反対の導電型が使用できることが評価されよう。この
回路は単一集積回路チップ上の集積によって与えられる
ことが好ましく、かつ他の回路よりも容易に集積できる
。
説明されていても、この発明の範囲から逸脱することな
く反対の導電型が使用できることが評価されよう。この
回路は単一集積回路チップ上の集積によって与えられる
ことが好ましく、かつ他の回路よりも容易に集積できる
。
第１図は電圧保護を持たない本発明により構成された交
流対直流変換器の回路線図であり、第２図は本発明によ
りかつ電圧保護を組み込んで構成された交流対直流変換
器の別の実施例の回路線図であり、 第３図は本発明によるが変成器を用いて構成された交流
対直流変換器である。 １０・・・センシング回路
流対直流変換器の回路線図であり、第２図は本発明によ
りかつ電圧保護を組み込んで構成された交流対直流変換
器の別の実施例の回路線図であり、 第３図は本発明によるが変成器を用いて構成された交流
対直流変換器である。 １０・・・センシング回路
Claims (1)
- 【特許請求の範囲】 １、交流対低電圧直流変換器であって、該変換器が、 一対の入力電圧電源ライン（Ｖｉｎ，０Ｖ）、半導体ス
イッチ素子（Ｔ１）、および 電源ラインの間に直列に接続されたキャパシタ（Ｃ１）
、 を具え、ここで直流電圧の出力（Ｖ０）がキャパシタ（
Ｃ１）にわたって与えられるものにおいて、交流電圧の
一部が所定の電圧以下である間 にのみ導通するようセンシング回路（１０）がスイッチ
素子（Ｔ１）をトリガする入力電圧に感応することを特
徴とする変換器。 ２、半導体スイッチ素子（Ｔ１）が電界効果トランジス
タであることを特徴とする請求項１に記載の変換器。 ３、スイッチ素子（Ｔ１）とキャパシタ（Ｃ１）の上記
の直列接続において、ダイオード（Ｄ１）が電源ライン
の１つとスイッチ素子の間に接続されていることを特徴
とする請求項２に記載の変換器。 ４、スイッチ素子（Ｔ１）とキャパシタ（Ｃ１）の上記
の直列接続において、ダイオード（Ｄ２）がスイッチ素
子（Ｔ１）とキャパシタ（Ｃ１）の間に接続されている
ことを特徴とする請求項２に記載の変換器。 ５、センシング回路は、ダイオード（Ｔ２）と、キャパ
シタ（Ｃ２）とツェナーダイオード（Ｚ１）の並列配列
とに直列になって出力（Ｖ０）接続された入力電源ライ
ン（Ｖｉｎ）の１つに接続された抵抗器（Ｒ１）を具え
、 第２電界効果トランジスタ（Ｔ３）は抵抗器（Ｒ１）と
ダイオード（Ｔ２）の接合点に接続されたそのゲートと
、ダイオード（Ｔ２）の別の側に接続されたそのソース
と、スイッチ素子（Ｔ１）のゲートおよび接合トランジ
スタ（Ｔ４）のコレクタに接続されたそのドレインを有
し、接合トランジスタ（Ｔ４）のエミッタはツェナーダ
イオード（Ｚ２）を介して入力電源ライン（０Ｖ）の別
の１つに接続され、接合トランジスタ（Ｔ４）のベース
は出力（Ｖ０）に接続され、ダイオード（Ｄ４）は別の
入力ライン（０Ｖ）に接続されたそのアノードおよび入
力ラインの１つに接続されていない抵抗器（Ｒ１）の端
子に接続されたそのカソードを有することを特徴とする
請求項２から４のいずれか１つに記載の変換器。 ６、センシング回路は第２電界効果トランジスタ（Ｔ３
）のゲートに接続されている第１ツェナーダイオード（
Ｚ３）に直列に接続されている入力電源ライン（Ｖｉｎ
）の１つに接続された第１抵抗器（Ｒ１）を具え、第２
電界効果トランジスタ（Ｔ３）のソースは第２ツェナー
ダイオード（Ｚ１）と、出力（Ｖ０）に接続されている
第２抵抗器（Ｒ２）の直列配列に並列に接続されている
キャパシタ（Ｃ２）に接続され、第２電界効果トランジ
スタ（Ｔ３）のソースとゲートは第３ツェナーダイオー
ド（Ｚ４）により橋絡され、一方そのドレインはダイオ
ード（Ｄ３）を介して接合トランジスタ（Ｔ４）のコレ
クタに接続され、接合トランジスタ（Ｔ４）のエミッタ
は第４ツェナーダイオード（Ｚ２）を介して他の入力電
源ライン（０Ｖ）に接続され、かつ接合トランジスタ（
Ｔ４）のベースは出力（Ｖ０）に接続され、そして第２
接合トランジスタ（Ｔ５）は第２ツェナーダイオード（
Ｚ１）と第２抵抗器（Ｒ２）の接合点に接続されたその
ベースおよび出力（Ｖ０）に接続されたそのエミッタお
よびスイッチ素子（Ｔ１）のゲートに接続されたそのコ
レクタを有するよう備えられていることを特徴とする請
求項２から４のいずれか１つに記載の変換器。 ７、整流器が交流電源と、入力電圧電源ラインのペアー
との間に備えられていることを特徴とする請求項１から
６のいずれか１つに記載の変換器。 ８、交流電源と整流器の間に変成器が備えられているこ
とを特徴とする請求項７に記載の変換器。
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