JPH03187503A - 多層基板 - Google Patents

多層基板

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Publication number
JPH03187503A
JPH03187503A JP1326782A JP32678289A JPH03187503A JP H03187503 A JPH03187503 A JP H03187503A JP 1326782 A JP1326782 A JP 1326782A JP 32678289 A JP32678289 A JP 32678289A JP H03187503 A JPH03187503 A JP H03187503A
Authority
JP
Japan
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dielectric
circuit
layer
dielectric layer
layers
Prior art date
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Pending
Application number
JP1326782A
Other languages
English (en)
Inventor
Takayuki Arai
隆之 新居
Takashi Saeki
隆 佐伯
Haruo Nakano
晴夫 中野
Toshiro Mishina
三品 俊郎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Electric Works Co Ltd
Original Assignee
Matsushita Electric Works Ltd
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Filing date
Publication date
Application filed by Matsushita Electric Works Ltd filed Critical Matsushita Electric Works Ltd
Priority to JP1326782A priority Critical patent/JPH03187503A/ja
Publication of JPH03187503A publication Critical patent/JPH03187503A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/0213Electrical arrangements not otherwise provided for
    • H05K1/0237High frequency adaptations
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/03Use of materials for the substrate
    • H05K1/0313Organic insulating material
    • H05K1/0353Organic insulating material consisting of two or more materials, e.g. two or more polymers, polymer + filler, + reinforcement
    • H05K1/036Multilayers with layers of different types

Landscapes

  • Structure Of Printed Boards (AREA)
  • Waveguides (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、電気回路を構成するための多層基板に関する
ものであり、特に高周波の無線通信回路を構成する用途
に適するものである。
[従来の技術] 第4図は、従来の3層プリント回路基板の構成を示して
いる0図において、1.2は回路部品が実装される導体
層であり、3は回路部品が実装されない導体層である。
14.15は誘電率の等しい誘電体層である。このよう
な構成とすることにより、部品の取り付は等の最小限の
配線以外の配線を誘電体層14.15に挟まれた導体層
3に構成することができ、プリント回路基板の面積の小
型化が可能となる。また、配線が複雑な回路に関しては
、誘電体層に挟まれた導体層を増やし、さらに多層化を
図ることにより基板面積の増加を防ぐことができる。
[発明が解決しようとする課題] 近年、電気回路の高周波化に伴い、使用する回路基板の
大きさに対して、使用する周波数の波長が無視できない
長さとなってきたため、分布定数回路の理論を用いて設
計する必要が生じてきた。
分布定数回路において、回路の小型化を図るためには、
回路基板上での波長の短縮率の大きい高誘電率の誘電体
層を用いた基板を使用すれば良いが、逆に回路部品実装
時の取り付は位置のばらつきに対する回路特性のばらつ
きが大きくなるという問題があった。また、無線通信機
器用の回路基板に関しては、アンテナ部は誘電率が低く
、誘電体厚みの厚い基板を用いた方が放射効率が良い、
そして、アンテナ部以外の回路に関しては、誘電率が高
く、誘電体厚みの薄い基板を用いた方が小型化が可能と
なり、回路損失も少なくなる。しかしながら、従来の多
層基板では、このような要求を同時に満たすことはでき
ず、特性の良い高周波回路を得ることができないという
問題があった。
本発明はこのような点に鑑みてなされたものであり、そ
の目的とするところは、特性の良好な高周波回路を構成
するのに適した多層基板を提供することにある。
[課題を解決するための手段] 第1図に本発明の基本1戊を示す。図において、1.2
は部品実装の可能な導体層であり、3は部品実装されな
い導体層である。4は第1の誘電体層、5は第2の誘電
体層である。本発明にあっては、このような構成におい
て、第1の誘電体層4と第2の誘電体層5のそれぞれの
誘電率を変えることによって、上記の課題を解決するも
のである。
また、必要に応じて第1の誘電体[4と第2の誘電体層
5の厚みを変えることによっても、上記の課題を解決す
るものである。
[作用] 本発明の多層基板は、このように構成されているので、
小型で且つ低損失が要求される部分には、高誘電率で薄
い基板を使用し、実装によるばらつきを少なくしたい部
分には、低誘電率で薄い基板を使用すれば良く、また、
アンテナのように放射効率の高い方が良い場合は、低誘
電率で厚い基板を使用するなど、回路各部のそれぞれの
目的に合わせて最適の基板で回路が構成できるので、特
性の良い高周波回路を実現することができるものである
[実施例] 第2図は本発明の一実施例の断面図である0図において
、3は回路部品が実装されない導体層であり、6は低誘
電率の誘電体層、7は高誘電率の誘電体層、8はデジタ
ルIC19は遅延線である。
図のように、デジタルIC8は低誘電率の誘電体層6の
上に実装することにより、実装位置のばらつきに対して
電気的特性の変化が少なくなり、安定した回路が実現で
きる。また、遅延線9は高誘電率の誘電体層7の上に構
成することにより同じ遅延量を得るのに短い線路で実現
することができ、回路の小型化を図ることができる。
第3図は本発明の他の実施例の斜視図である。
図において、10はプリントアンテナ面、11は送受信
回路面、12は低誘電率で厚い誘電体層、13は高誘電
率で薄い誘電体層である。このように、プリントアンテ
ナ面10を低誘電率で厚い誘電体層12の上に構成する
ことにより、波長短縮率が小さくなって、アンテナ素子
のサイズが大きくなり、受信面積が大きくなると共に、
回路基板が厚いために、アンテナからの放射効率も上が
り、アンテナ特性が向上する。また、送受信回路面11
を高誘電率で薄い誘電体層13の上に構成することによ
り、波長短縮率が大きくなって、回路の小型化が実現で
きると共に、回路基板が薄いために、送受信回路からの
放射損失も少なく、回路特性が向上する。
なお、第2図に示すデジタルIC8と遅延線9の接続、
及び第3図に示すアンテナ回路面10と送受信回路面1
1の接続は、図中、破線で示したスルーホールにより実
現されている0本発明では、誘電体層12.13が一体
戒形されているので、スルーホールによる接続距離は短
く、また、コネクタ等を用いる接続構造に比べると、安
価に構成できる。
[発明の効果] 本発明の多層基板にあっては、誘電率が異なり表面に電
気回路を構成される誘電体層を一体形成によって多層化
したので、誘電体層の材料を適切に選択することにより
、回路の小型化、特性の向上、動作の安定化を実現する
ことができるという効果がある。
【図面の簡単な説明】
第1図は本発明の基本構成を示す斜視図、第2図は本発
明の第1実施例を示す断面図、第3図は本発明の第2実
施例を示す斜視図、第4図は従来例の斜視図である。 1.2.3は導体層、4.5は誘電体層である。

Claims (2)

    【特許請求の範囲】
  1. (1)誘電率が異なり表面に電気回路を構成される誘電
    体層を一体形成によって多層化したことを特徴とする多
    層基板。
  2. (2)平面アンテナが印刷配線された低誘電率の厚い誘
    電体層と、高周波回路が印刷配線された高誘電率の薄い
    誘電体層とを一体形成によって多層化し、平面アンテナ
    と高周波回路をスルーホールを介して接続したことを特
    徴とする請求項1記載の多層基板。
JP1326782A 1989-12-15 1989-12-15 多層基板 Pending JPH03187503A (ja)

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