JPH0318763B2 - - Google Patents

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JPH0318763B2
JPH0318763B2 JP59009780A JP978084A JPH0318763B2 JP H0318763 B2 JPH0318763 B2 JP H0318763B2 JP 59009780 A JP59009780 A JP 59009780A JP 978084 A JP978084 A JP 978084A JP H0318763 B2 JPH0318763 B2 JP H0318763B2
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JP
Japan
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transistor
collector
base
leakage current
resistor
Prior art date
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JP59009780A
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Japanese (ja)
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JPS60153204A (en
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Tatsuya Kakehi
Kenji Ootani
Kyogo Fujii
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Rohm Co Ltd
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Rohm Co Ltd
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Description

【発明の詳細な説明】 この発明は増幅回路に係り、特に、半導体集積
回路で構成される増幅回路において、その出力ト
ランジスタの飽和防止に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an amplifier circuit, and more particularly, to prevention of saturation of an output transistor in an amplifier circuit configured with a semiconductor integrated circuit.

第1図は従来のドライバ回路として用いられる
増幅回路を示している。即ち、この増幅回路は半
導体集積回路で構成され、その入力部にはトラン
ジスタ2,4が設置され、これらトランジスタ
2,4は電流反転回路を構成し、入力端子6に加
えられる電流は電流反転されてトランジスタ4に
流れる。
FIG. 1 shows an amplifier circuit used as a conventional driver circuit. That is, this amplifier circuit is composed of a semiconductor integrated circuit, and transistors 2 and 4 are installed at its input section, and these transistors 2 and 4 constitute a current inversion circuit, so that the current applied to the input terminal 6 is inverted. and flows to transistor 4.

トランジスタ4には、駆動電圧Vccが加えられ
る電源端子8から抵抗10を介して電流が与えら
れるとともに、出力駆動用のトランジスタ12の
ベースからも電流を引き込む。この結果、トラン
ジスタ12に電流が流れ、出力トランジスタ14
に電流が流れる。この電流は、出力端子16と基
準電位点端子18との間に接続された負荷20に
流れ、この電流によつて負荷20が駆動される。
A current is applied to the transistor 4 via a resistor 10 from a power supply terminal 8 to which a drive voltage Vcc is applied, and current is also drawn from the base of a transistor 12 for output driving. As a result, current flows through transistor 12 and output transistor 14
A current flows through. This current flows to a load 20 connected between the output terminal 16 and the reference potential point terminal 18, and the load 20 is driven by this current.

ここで、負荷20に流れる電流をIL、負荷20
の抵抗値をRLとすると、負荷20の電圧降下は
両者の積RL・ILで与えられる。この電圧値が高く
なるとPNPトランジスタで構成される出力トラ
ンジスタ14は飽和状態になり、そのコレクタか
ら破線22で示すように半導体集積回路の半導体
基板に向かつて漏れ電流が流れる。
Here, the current flowing through the load 20 is I L , and the load 20
Assuming that the resistance value of is R L , the voltage drop of the load 20 is given by the product of both R L and I L . When this voltage value increases, the output transistor 14, which is a PNP transistor, becomes saturated, and a leakage current flows from its collector toward the semiconductor substrate of the semiconductor integrated circuit, as shown by a broken line 22.

この漏れ電流が増加すると、半導体基板に所謂
電位の浮きが発生し、最悪の場合では、半導体集
積回路の構成素子が誤動作するおそれがある。
When this leakage current increases, a so-called floating potential occurs in the semiconductor substrate, and in the worst case, there is a risk that the constituent elements of the semiconductor integrated circuit may malfunction.

特に、集積回路では、このような電位の浮きを
防止するために付加回路を用いないで行おうとす
れば、接地ラインの面積を大きくする必要があ
り、これは集積度を低下させる原因になる。ま
た、漏れ電流のためにトランジスタの損失が増
し、容量不足を生じたり、急激な温度上昇を伴つ
たりする。
In particular, in integrated circuits, if it is attempted to prevent such potential floating without using an additional circuit, it is necessary to increase the area of the ground line, which causes a reduction in the degree of integration. Furthermore, leakage current increases loss in the transistor, resulting in insufficient capacity and rapid temperature rise.

そこで、この発明は、出力トランジスタの飽和
を抑制して動作の信頼性を高めた増幅回路の提供
を目的とする。
SUMMARY OF THE INVENTION Therefore, an object of the present invention is to provide an amplifier circuit that suppresses saturation of an output transistor and improves operational reliability.

即ち、この発明の増幅回路は、ベース・コレク
タ間を共通に接続した第1のトランジスタ2の前
記ベース・コレクタに第2のトランジスタ4のベ
ースを共通に接続し、前記第1のトランジスタの
ベース・コレクタに入力信号を加える入力回路を
設置し、この入力回路の前記第2のトランジスタ
のコレクタに第1の抵抗10を介して電源を接続
するとともに、出力トランジスタ14を駆動すべ
き駆動用トランジスタ12のベースを接続した増
幅回路において、半導体基板32に形成されたエ
ピタキシヤル層36の表面層にエミツタE、該エ
ミツタを包囲して第1のコレクタC1、該第1の
コレクタを包囲してベースB及び該ベースを包囲
して第2のコレクタC2をそれぞれ形成して成る
トランジスタ24を前記出力トランジスタに用い
て、前記第1のコレクタに負荷20を接続し、前
記第2のコレクタと基準電位点との間に第2の抵
抗26を設置するとともに、この抵抗の漏れ電流
による電圧降下が一定のレベルを超えたとき、前
記第2のコレクタからの漏れ電流を前記駆動用ト
ランジスタのベース側に帰還するダイオード28
から成る帰還回路30を設置したことを特徴とす
るものである。
That is, in the amplifier circuit of the present invention, the bases of the second transistors 4 are commonly connected to the bases and collectors of the first transistors 2 whose bases and collectors are connected in common, and the bases and collectors of the first transistors are connected in common. An input circuit that applies an input signal to the collector is installed, a power supply is connected to the collector of the second transistor of this input circuit via the first resistor 10, and the drive transistor 12 which is to drive the output transistor 14 is connected to the collector of the second transistor of the input circuit. In the base-connected amplifier circuit, an emitter E is formed on the surface layer of an epitaxial layer 36 formed on a semiconductor substrate 32, a first collector C 1 surrounds the emitter, and a base B surrounds the first collector. and a transistor 24 formed by surrounding the base to form a second collector C 2 is used as the output transistor, a load 20 is connected to the first collector, and a reference potential point is connected between the second collector and the reference potential point. A second resistor 26 is installed between the resistor and when the voltage drop due to the leakage current of this resistor exceeds a certain level, the leakage current from the second collector is returned to the base side of the drive transistor. diode 28
The feature is that a feedback circuit 30 consisting of the following is installed.

以下、この発明を図面に示した実施例を参照し
て詳細に説明する。
Hereinafter, the present invention will be described in detail with reference to embodiments shown in the drawings.

第2図はこの発明の増幅回路の実施例を示し、
第1図に示す増幅回路と共通部分には同一符号を
付してある。
FIG. 2 shows an embodiment of the amplifier circuit of the present invention,
Components common to the amplifier circuit shown in FIG. 1 are given the same reference numerals.

第2図において、この増幅回路の入力回路に
は、電流反転回路を構成する第1及び第2のトラ
ンジスタ2,4が設置され、トランジスタ2のベ
ース・コレクタ間は共通に接続されるとともに、
そのベース・コレクタはトランジスタ4のベース
に共通に接続されている。入力端子6に加えられ
た入力電流は、トランジスタ2に流れるととも
に、トランジスタ4に流れる。トランジスタ4に
は、電源から第1の抵抗10を介して流れ込むと
ともに、出力トランジスタ24を駆動するための
駆動用トランジスタ12のベース電流が引き込ま
れる。そして、出力トランジスタ24には第1の
コレクタC1とともに、その漏れ電流を検知する
第2のコレクタC2が設置されている。第1のコ
レクタC1には出力端子16を形成し、負荷20
を接続する。また、第2のコレクタC2と基準電
位点端子18を通じて基準電位点に接続された共
通ラインとの間には第2の抵抗26が接続されて
いるとともに、第2のコレクタC2と駆動用トラ
ンジスタ12のベースとの間には、ダイオード2
8が接続されて帰還回路30が構成されている。
即ち、このダイオード28には漏れ電流による電
圧降下が発生し、この電圧降下がダイオード28
の順方向降下電圧VFを超える場合、漏れ電流が
トランジスタ12のベース側に帰還される。
In FIG. 2, first and second transistors 2 and 4 constituting a current inversion circuit are installed in the input circuit of this amplifier circuit, and the base and collector of the transistor 2 are connected in common.
Its base and collector are commonly connected to the base of transistor 4. The input current applied to input terminal 6 flows through transistor 2 and transistor 4 as well. A base current of the driving transistor 12 for driving the output transistor 24 is drawn into the transistor 4 from the power supply through the first resistor 10 . The output transistor 24 is provided with a first collector C 1 and a second collector C 2 for detecting its leakage current. The first collector C 1 forms an output terminal 16 and a load 20
Connect. Further, a second resistor 26 is connected between the second collector C 2 and a common line connected to the reference potential point through the reference potential point terminal 18, and a second resistor 26 is connected between the second collector C 2 and the common line connected to the reference potential point through the reference potential point terminal 18. A diode 2 is connected between the base of the transistor 12 and the base of the transistor 12.
8 are connected to form a feedback circuit 30.
That is, a voltage drop occurs in the diode 28 due to the leakage current, and this voltage drop is caused by the diode 28.
If the forward voltage drop VF is exceeded, the leakage current is fed back to the base side of the transistor 12.

第3図及び第4図はトランジスタ24の集積回
路構成例を示し、第3図はその平面構成、第4図
は第3図の−線に沿つた断面を示している。
即ち、半導体基板32にはトランジスタ24の形
成領域に例えばN型の埋込み層34を形成した
後、エピタキシヤル層36が形成され、このエピ
タキシヤル層36のトランジスタ24の形成領域
は分離領域37によつて区画されている。区画さ
れたエピタキシヤル層36には、P型の拡散領域
38,40,42が形成され、さらにN型の拡散
領域44が形成されている。拡散領域38はエミ
ツタE、拡散領域40は第1のコレクタC1、拡
散領域42は第2のコレクタC2、拡散領域44
はベースBを構成している。そして、その表面層
には酸化膜46が形成され、それぞれの領域には
コンタクトホール48が形成されている。図示し
ていないが、コンタクトホール48にはアルミニ
ウム等の配線導体が接続される。
3 and 4 show examples of integrated circuit configurations of the transistor 24, with FIG. 3 showing the planar structure thereof, and FIG. 4 showing a cross section taken along the line - in FIG. 3.
That is, after forming, for example, an N-type buried layer 34 on the semiconductor substrate 32 in the region where the transistor 24 is to be formed, the epitaxial layer 36 is formed, and the region where the transistor 24 in this epitaxial layer 36 is to be formed is separated by the isolation region 37. It is divided into sections. In the divided epitaxial layer 36, P-type diffusion regions 38, 40, and 42 are formed, and an N-type diffusion region 44 is further formed. Diffusion region 38 is emitter E, diffusion region 40 is first collector C 1 , diffusion region 42 is second collector C 2 , diffusion region 44
constitutes base B. An oxide film 46 is formed on the surface layer, and contact holes 48 are formed in each region. Although not shown, a wiring conductor made of aluminum or the like is connected to the contact hole 48.

以上の構成に基づき、その動作を説明する。ト
ランジスタ24に漏れ電流が流れると、この漏れ
電流は第2のコレクタC2から抵抗26に流れる。
抵抗26はこの漏れ電流を電圧降下として検知す
る。この電圧降下がダイオード28の順方向降下
電圧VFを超えると、ダイオード28に漏れ電流
が流れてトランジスタ4に流れる。この漏れ電流
の帰還によつて、トランジスタ12のベース電流
は、トランジスタ24の漏れ電流分だけ減少し、
この結果、トランジスタ24の入力ベース電流が
減少し、その出力電流が抑制され、飽和が防止さ
れる。
The operation will be explained based on the above configuration. When a leakage current flows through the transistor 24, this leakage current flows from the second collector C2 to the resistor 26.
Resistor 26 detects this leakage current as a voltage drop. When this voltage drop exceeds the forward voltage drop V F of the diode 28 , a leakage current flows through the diode 28 and flows into the transistor 4 . Due to the feedback of this leakage current, the base current of transistor 12 is reduced by the leakage current of transistor 24.
As a result, the input base current of transistor 24 is reduced, its output current is suppressed, and saturation is prevented.

また、半導体基板32への漏れ電流の流出が防
止される結果、半導体基板32の電位の浮きを防
止することができ、接地ラインの面積を大きくす
る等の不都合もない。
Further, as a result of preventing leakage current to the semiconductor substrate 32, floating of the potential of the semiconductor substrate 32 can be prevented, and there is no problem such as increasing the area of the ground line.

以上説明したように、この発明によれば、出力
トランジスタの漏れ電流を、第1のコレクタの外
側にベースを介在させて設置された第2のコレク
タによつて検出し、その漏れ電流をダイオードか
ら成る帰還回路を通じて出力トランジスタの駆動
用トランジスタのベースに帰還することにより、
その漏れ電流に応じて入力電流を制御するように
したので、出力トランジスタの飽和を防止できる
とともに、漏れ電流による半導体基板の電位の浮
きを防止でき、動作の信頼性を高めることができ
る。
As explained above, according to the present invention, the leakage current of the output transistor is detected by the second collector installed outside the first collector with the base interposed, and the leakage current is detected from the diode. By feeding back to the base of the driving transistor of the output transistor through a feedback circuit consisting of
Since the input current is controlled according to the leakage current, saturation of the output transistor can be prevented, and the potential of the semiconductor substrate can be prevented from floating due to the leakage current, thereby increasing the reliability of operation.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は従来の増幅回路を示す回路図、第2図
はこの発明の増幅回路の実施例を示す回路図、第
3図は出力トランジスタの構成を示す平面図、第
4図はその断面構成を示す説明図である。 2……第1のトランジスタ、4……第2のトラ
ンジスタ、10……第1の抵抗、12……駆動用
トランジスタ、14,24……出力トランジス
タ、20……負荷、26……第2の抵抗、28…
…ダイオード、30……帰還回路、32……半導
体基板、36……エピタキシヤル層。
Figure 1 is a circuit diagram showing a conventional amplifier circuit, Figure 2 is a circuit diagram showing an embodiment of the amplifier circuit of the present invention, Figure 3 is a plan view showing the configuration of an output transistor, and Figure 4 is its cross-sectional configuration. FIG. 2...First transistor, 4...Second transistor, 10...First resistor, 12...Drive transistor, 14, 24...Output transistor, 20...Load, 26...Second transistor Resistance, 28...
...Diode, 30...Feedback circuit, 32...Semiconductor substrate, 36...Epitaxial layer.

Claims (1)

【特許請求の範囲】 1 ベース・コレクタ間を共通に接続した第1の
トランジスタの前記ベース・コレクタに第2のト
ランジスタのベースを共通に接続し、前記第1の
トランジスタのベース・コレクタに入力信号を加
える入力回路を設置し、この入力回路の前記第2
のトランジスタのコレクタに第1の抵抗を介して
電源を接続するとともに、出力トランジスタを駆
動すべき駆動用トランジスタのベースを接続した
増幅回路において、 半導体基板に形成されたエピタキシヤル層の表
面層にエミツタ、該エミツタを包囲して第1のコ
レクタ、該第1のコレクタを包囲してベース及び
該ベースを包囲して第2のコレクタをそれぞれ形
成して成るトランジスタを前記出力トランジスタ
に用いて、前記第1のコレクタに負荷を接続し、
前記第2のコレクタと基準電位点との間に第2の
抵抗を設置するとともに、この抵抗の漏れ電流に
よる電圧降下が一定のレベルを超えたとき、前記
第2のコレクタからの漏れ電流を前記駆動用トラ
ンジスタのベース側に帰還するダイオードから成
る帰還回路を設置したことを特徴とする増幅回
路。
[Claims] 1. The bases of second transistors are commonly connected to the bases and collectors of the first transistors whose bases and collectors are commonly connected, and an input signal is connected to the bases and collectors of the first transistors. An input circuit is installed to add the second input circuit.
In an amplifier circuit in which a power supply is connected to the collector of a transistor via a first resistor and the base of a driving transistor that drives an output transistor is connected, an emitter is connected to the surface layer of an epitaxial layer formed on a semiconductor substrate. , a transistor having a first collector surrounding the emitter, a base surrounding the first collector, and a second collector surrounding the base is used as the output transistor; Connect the load to the collector of 1,
A second resistor is installed between the second collector and the reference potential point, and when the voltage drop due to the leakage current of this resistor exceeds a certain level, the leakage current from the second collector is An amplifier circuit characterized by installing a feedback circuit consisting of a diode that feeds back to the base side of a driving transistor.
JP59009780A 1984-01-22 1984-01-22 amplifier circuit Granted JPS60153204A (en)

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JPS60153204A JPS60153204A (en) 1985-08-12
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS51102577A (en) * 1975-03-07 1976-09-10 Hitachi Ltd
JPS5765013A (en) * 1980-10-09 1982-04-20 Nec Corp Output protection circuit

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JPS60153204A (en) 1985-08-12

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