JPH0319452A - label conversion circuit - Google Patents

label conversion circuit

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JPH0319452A
JPH0319452A JP1152318A JP15231889A JPH0319452A JP H0319452 A JPH0319452 A JP H0319452A JP 1152318 A JP1152318 A JP 1152318A JP 15231889 A JP15231889 A JP 15231889A JP H0319452 A JPH0319452 A JP H0319452A
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Abstract

PURPOSE:To reduce the storage capacity of a label conversion table by converting an in-switch call identification number combining plural reference number bit strings resulting from dividing a bit string of a call identifier included in a header part into plural numbers and from converting them into the output terminal number of a switch and a new call identifier. CONSTITUTION:Call identifiers I1, I2 decomposed into N and M bits are converted into reference numbers r1, r2 respectively by using the identifiers as read addresses to index conversion tables 103, 104. Then a numeral r1+r2 being the combination of the numbers r1, r2 is used as a readout address to index a conversion table 105, thereby obtaining new call identifiers (I1, I2) and an output terminal number (DA). An incoming terminal number (SA) depends definitely on the line physical position, it is added to the header part of the cell or the header part is converted to form an in-switch cell. Since the conversion table is divided and subjected to hierarchy processing, the memory capacity is reduced.

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はデイジタル′或子交換機に係り、特にヘッダ部
及び情報部からなる固定長パケット(以下、「セル」と
称する)を用いて通信情報を交換する自己ルーテイング
型交換機における、ヘッダ部の内容を畜き換えるラベル
変換回路、及び交換機内部で呼を識別するための参照番
号を割り当てる参照番号割当回路の構成に関する。
[Detailed Description of the Invention] [Industrial Application Field] The present invention relates to a digital or secondary switch, and in particular, transmits communication information using fixed-length packets (hereinafter referred to as "cells") consisting of a header section and an information section. The present invention relates to the configuration of a label conversion circuit that rearranges the contents of a header section in a self-routing type switch that exchanges calls, and a reference number assignment circuit that allocates a reference number for identifying calls within the switch.

〔従来の技術〕[Conventional technology]

従来の代表的な例としては、電子情報通信学会技術報告
(交換システム研究会)SSE88−29「広帯域I 
SDN用ATM交遺機の試作」(加膿,初鹿野,下江.
村上)に示されている交換機がある。ラベル変換の方法
については上記文献の図3に示されているが、それによ
るとラベル変換テーブルをスイッチに前置し、入力セル
の呼識別子をアドレスとしてこの変換テーブルを引き、
スイッチ内のルーティング情報と新たな呼識別子を祷る
#l戒となっている。ラベル変換テーブルの内容は、呼
設定時に交換機の制御系からデータを送って省き込むよ
うになっている。
A typical conventional example is the Institute of Electronics, Information and Communication Engineers Technical Report (Switching System Study Group) SSE88-29 “Wideband I
``Prototype of ATM replacement machine for SDN'' (Kayu, Hatsukano, Shimoe.
There is an exchange shown in Murakami). The label conversion method is shown in Figure 3 of the above document, and according to it, a label conversion table is placed in front of the switch, and this conversion table is drawn using the call identifier of the input cell as an address.
This is a precept #1 that prays for routing information within the switch and a new call identifier. The contents of the label conversion table are omitted by sending data from the control system of the exchange at the time of call setup.

〔発明が解決しようとする課題〕[Problem to be solved by the invention]

上記従来技術では、大容量のラベル変換テーブルが必要
になるという問題があった。呼識別子は通信量に対して
十分な余裕を持ったビット長にしておく必要があり、ま
た伝送路の管理単位であるパスの識別と呼の識別子に相
当する回線の識別が必喪な場合もあるので、ビット長と
しては20ビット以上になると考えられる。従って、変
換テーブルとして用いるメモリは、アドレスだけでも2
2°になるため1回線当り数10Mビットから数100
Mビットの容量が必要となる。メモリの高集積化が進ん
でいるとはいうものの、これは非現実的な値である。
The conventional technique described above has a problem in that a large-capacity label conversion table is required. The call identifier must have a bit length with sufficient margin for the amount of communication, and there are cases where it is necessary to identify the path, which is the management unit of the transmission path, and the line, which corresponds to the call identifier. Therefore, the bit length is considered to be 20 bits or more. Therefore, the memory used as the conversion table requires only 2 addresses.
2°, so the number of 10 Mbits to several 100 Mbits per line
A capacity of M bits is required. Although memory is becoming increasingly highly integrated, this is an unrealistic value.

本発明の目的は、ラベル変換テーブルの記憶゛谷量が比
較的少なくて済むラベル変換回路を提供することにある
。また、本発明の他の目的は、このラベル変換回路を実
現するために必要な参照番号1Il当回路を提供するこ
とである。
An object of the present invention is to provide a label conversion circuit that requires a relatively small amount of storage space for a label conversion table. Another object of the present invention is to provide a circuit with reference numeral 1Il necessary for realizing this label conversion circuit.

〔課題を解決するための手段〕[Means to solve the problem]

上記目的を達成するための基本的考え方は、呼識別子を
分解し、複数の変換テーブルを用いて一つのテーブルが
1チップのメモリ素子で実現可能とすることと、変換テ
ーブルを階層化し、階層を移るときにアドレス空間を圧
縮することIζある。
The basic idea for achieving the above purpose is to decompose the call identifier and use multiple conversion tables so that one table can be realized with a single chip memory element, and to layer the conversion tables and create layers. There is a need to compress the address space when moving.

具体的手段を以下に述べる。Specific measures are described below.

まず上記第1の目的を達成するために、ヘッダ部に含ま
れる呼識別子のビット列を複数に分割し、分割したそれ
ぞれをそれぞれに対応する参照番号に変換する複数の変
換テーブルと、該複数の参照番号ビット列を結合したス
イッチ内呼識別番号をスイッチの出端子番号および新た
な呼識別子に変換する変換テーブルとを持つラベル変換
回路を考案した。
First, in order to achieve the first objective above, a plurality of conversion tables are provided that divide the bit string of the call identifier included in the header part into a plurality of parts and convert each divided part into a corresponding reference number, and We devised a label conversion circuit that has a conversion table that converts an internal switch call identification number, which is a combination of number bit strings, into a switch output terminal number and a new call identification number.

また、上記ラベル変換回路に、交換制御のための伽号の
通信のために用いる信号セルが入力しても回路動作に不
都合をきたさないために、ヘッダ部に含まれるセル種別
情報を検出し、該セルが交換制御のための信号セルか否
かを検出する手段と信号セルであった場合には、呼識別
子を変換しないようにする手段と、該セルの内容を交換
機の制御機構部に伝達する手段とを設けた。
In addition, in order to avoid any inconvenience to the circuit operation even if a signal cell used for communication of a sign for exchange control is input to the label conversion circuit, cell type information included in the header section is detected, means for detecting whether the cell is a signaling cell for switching control; means for not converting a call identifier if the cell is a signaling cell; and transmitting the contents of the cell to a control mechanism section of the exchange. We have provided means to do so.

次に、上記第2の目的を達成するために、信号セルを入
力情報とし、該信号セルのヘッダ部に含まれる呼識別子
のビット列を複数に分割し、分割したそれぞれをそれぞ
れに対応する参照番号に変換する複数の変換テーブルを
持つ参照番号割当回路を考案した。
Next, in order to achieve the above second objective, the signal cell is used as input information, the bit string of the call identifier included in the header part of the signal cell is divided into a plurality of parts, and each of the divided parts is given a reference number corresponding to each. We devised a reference number assignment circuit with multiple conversion tables to convert into .

さらに、上記参照番号割当回路において、変換テーブル
の記憶容量を最小限とするために、分割した呼識別子を
参照番号に変換する変換テーブルの内容が特定のビット
パターン(例えばオールゼロ)であることを検出する比
較回路と、比較の結果が特定のビットパターンであると
きに上記変換テーブルに新たな参照番号を書き込む手段
と、比較の結果が特定のビットパターンでないときに該
ビットパターンをアドレスとして、書き込み、及び読み
出しが出来る参照番号管理テーブルと、該管理テーブル
の内容がゼロであるか否かを検出し、ゼロである場合に
上記変換テーブル内の上記ビットパターンを特定のビッ
トパターンに書き換える手段と、該管理テーブルの内容
を信号セルに含まれる信号種別情報に基づいて増減させ
る手段とを持つ参照番号割当回路を考案した。
Furthermore, in order to minimize the storage capacity of the conversion table, the reference number allocation circuit detects that the contents of the conversion table for converting divided call identifiers into reference numbers are a specific bit pattern (for example, all zeros). means for writing a new reference number in the conversion table when the comparison result is a specific bit pattern; and writing the bit pattern as an address when the comparison result is not the specific bit pattern; and a reference number management table that can be read, a means for detecting whether or not the content of the management table is zero, and rewriting the bit pattern in the conversion table to a specific bit pattern if it is zero; A reference number assignment circuit has been devised that has means for increasing or decreasing the contents of a management table based on signal type information included in a signal cell.

〔作用〕[Effect]

ラベル変換回路の複数の変換テーブルは、情報通信フェ
ーズに於で、情報通信用セルから取り出し、分割された
呼識別子のビット列を、それぞれそれより少ない桁数か
らなる参照番号に変換する。
In the information communication phase, the plurality of conversion tables of the label conversion circuit convert the bit strings of call identifiers extracted from the information communication cell and divided into reference numbers each having a smaller number of digits.

この複数の参照番号を、結合したビット列で呼を一意に
臓別する。このビット列のビット長は,1回線で同時に
通信される呼の数に対して十分余裕のある数値が表現で
きるものであればよい。したがって、本変換テーブルは
、呼識別子を#R#号に変換することでビット長を削減
し、呼識別に必賛なアドレス空間を縮小する役目を果た
している。
A call is uniquely identified using a bit string that combines these multiple reference numbers. The bit length of this bit string may be any value that can express a value with sufficient margin for the number of calls simultaneously communicated on one line. Therefore, this conversion table serves to reduce the bit length by converting the call identifier to the #R# number, thereby reducing the address space required for call identification.

参照番号割当回路は、呼設定フェーズに於で信号セル,
に含まれている呼識別子のビット列を分解し、参照番号
に変換する。分解されたビット列は、他0呼識別子を分
解したビット列と値が同等である場合があるが、この場
合は同じ参照番号を割り当てる。但し、同じ参照番号を
割り当てたときは、別に設けてある参照番号管理テーブ
ルにてその参照番号を{gJ回用いたかを記憶する。こ
の記憶のために要するビット長は、参照番号自体のビッ
ト長よりさらに少なくて済むため、全体のテーブルとし
て必要なメモリ量が削減できる。
The reference number assignment circuit assigns signaling cells,
The call identifier bit string contained in the call identifier is decomposed and converted into a reference number. The decomposed bit string may have the same value as the bit string obtained by decomposing the other 0 call identifier, and in this case, the same reference number is assigned. However, when the same reference number is assigned, a separately provided reference number management table stores whether that reference number has been used {gJ times. Since the bit length required for this storage is even smaller than the bit length of the reference number itself, the amount of memory required for the entire table can be reduced.

〔″!A厖例〕 以下、本発明の実施例を図を用いて説明する。[″!A example] Embodiments of the present invention will be described below with reference to the drawings.

まず第2図は、自己ルーティング型交換機Cv構成例の
概略ブロック囚である。本交換機では、t本の回線を収
容し、自己ルーティングスイッチ300によってセルの
スイッチングを行う。回線対応部(入線側)100、及
び回線対応部(出紛側)200は、目嶽毎に設けられる
回路である。このうち口線対応部(人&14lI)10
0は、スイッチに前Iitされ、1本の入り回線が入力
として、またスイッチの入力端子が枦力として接続され
る。この回紛対応部100は、入力セルの呼識別子の付
け替えやスイッチ内ルーテイング情報の付加などラベル
変換機能を持つ。一方回線対応部(出線{all)20
0は、スイッチに後置され、スイッチからの出力の1本
が入力として、また出力回線が出力として接続される。
First, FIG. 2 is a schematic block diagram of a configuration example of a self-routing type exchange Cv. This exchange accommodates t lines and performs cell switching using a self-routing switch 300. The line handling unit (incoming line side) 100 and the line handling unit (outgoing side) 200 are circuits provided for each box. Of these, 10 of the mouth line correspondence departments (people & 14lI)
0 is connected to the switch, one incoming line is connected as an input, and the input terminal of the switch is connected as a force. This error response unit 100 has label conversion functions such as changing call identifiers of input cells and adding intra-switch routing information. On the other hand, line support section (outgoing line {all) 20
0 is placed after the switch, one of the outputs from the switch is connected as an input, and the output line is connected as an output.

この回線対応部200では、制御機構400からの信号
セルを受信し、回線対応部(入線側)l00の変換テー
ブルを1!Fき換える!II’@を持つ。制御機構都4
00は、スイッチの出力のうちの1本が入力として接続
され、スイッチの入力のうちの1本が出力として接続さ
れる。
This line handling unit 200 receives the signal cell from the control mechanism 400 and converts the conversion table of the line handling unit (input side) l00 to 1! Change F! Has II'@. control mechanism capital 4
00, one of the outputs of the switch is connected as an input, and one of the inputs of the switch is connected as an output.

次に、各種セルフォーマットを第5図に示す。Next, various cell formats are shown in FIG.

ここでは、一例として呼識別子がIl . I2の2つ
に分解されているものとする。Il.I2は、例えばパ
ス識別子,回線鐵別子という意味のあるものでも良いし
、単にビット列を区切ったものでも良い。
Here, as an example, the call identifier is Il. Assume that it is decomposed into two parts, I2. Il. I2 may be something meaningful, such as a path identifier or a line identifier, or it may simply be a bit string separated.

尚、以下の説明には、特に断わりなく第5図の記号を用
いることがある。
In the following description, the symbols shown in FIG. 5 may be used unless otherwise specified.

第2図で示した自己ルーティング型交換機の呼設定フd
.−ズにおいては、呼設定情報(DN,II,12など
)を載せた信号セルが、回線対応部(人線lIg)10
0に到着し、ここで制御機構部400に接続する出力端
子番号(DA’ )と入力端子番号(SA)を付加され
送り出される。制御機構部400は、信号セルの呼設定
情報に含まれる予約された呼識別子(I1.I2)を基
に参照番号(rl,r2)を割り当て、また出線側の呼
識別子として用いる新たな識別子Ql’ ,工2! )
やスイッチの出力端子番号(DA)などを決定し、これ
らの情報を載せた信号セルを回線対応部(出線側)20
0へ宛てて送り出す。回線対応部(出線側)200では
、受け取った上記の情報を回線対応部(入線側)l00
の変換テーブルに書き込む。ここで回線対応部(入線I
I)100と回線対応部(出1)III)200は、第
1図に示すように実際には一体化されている。
The call setup diagram of the self-routing switch shown in Figure 2
.. - In the system, a signal cell carrying call setting information (DN, II, 12, etc.)
0, where the output terminal number (DA') and input terminal number (SA) connected to the control mechanism section 400 are added and sent out. The control mechanism unit 400 allocates reference numbers (rl, r2) based on the reserved call identifiers (I1, I2) included in the call setting information of the signaling cell, and also assigns a new identifier to be used as a call identifier on the outgoing line. Ql', engineering 2! )
, the output terminal number (DA) of the switch, etc., and sends the signal cell containing this information to the line handling section (output side) 20.
Send it to 0. The line handling unit (outgoing line side) 200 transfers the above received information to the line handling unit (incoming line side) l00.
write to the conversion table. Here, line support section (incoming line I
I) 100 and the line corresponding section (output 1) III) 200 are actually integrated as shown in FIG.

情報転送フェーズにおいては、回線対応S(入線側)1
00へ到着したセルは、ラベル変換が行われ、出力端子
番号などが付加され、自己ルーティングスイッチ300
へ送り出される。スイッチングされ本セルは、回線対応
部(出線側)200にて出、A 力端子番号などが除去され、出力回線へと送り出される
In the information transfer phase, line support S (incoming line) 1
00 is subjected to label conversion, an output terminal number etc. are added, and the cell is sent to the self-routing switch 300.
sent to. After switching, this cell is output from the line corresponding section (output line side) 200, the A power terminal number, etc. are removed, and the cell is sent out to the output line.

第3図に制御機構部400の構成の一例を示す。FIG. 3 shows an example of the configuration of the control mechanism section 400.

参照番号割当回路4l00は、回線対応に複数個設ける
。入力信号セルは、振り分け機構4200にて入力端子
番号(SA)を基に振り分けられる。また、各参照番号
割当回路4100からの出力信号セルは、集線機構43
00にてまとめられ、自己ルーナイングスイッチ300
へと送られる。
A plurality of reference number assignment circuits 4l00 are provided corresponding to lines. Input signal cells are distributed by a distribution mechanism 4200 based on input terminal numbers (SA). Further, the output signal cells from each reference number assignment circuit 4100 are transmitted to the line concentrator 43
00, self-runing switch 300
sent to.

次に、第1図を用いてラベル変換回路の詳細を説明する
Next, details of the label conversion circuit will be explained using FIG.

まず、人回線は、入カレジスタlot .及び遅延回路
109を介して出力レジスタ102に接続される。
First, the human line is input to the input register lot. and is connected to the output register 102 via the delay circuit 109.

入力レジスタ101から、IlとI2の取り出し線が設
けられ、それぞれ変換テーブル103 ( TAB l
c )、変換テーブル104 ( TAl32c ) 
 の読みだしアドレス入力へ接続されている。また, 
II取り出し線は、信号セル検出回路106へも接続さ
れている。変換テーブル103 . 104の各データ
出力線は、変換テーフル105 ( TAB 3c )
  の読みだしアドレス入力へ接続されている。変換テ
ーブル105のデータ出力線は,ゲート107を介して
、出力レジスタ102へと接続されている。ゲート10
7には、信号セル検出回路106の出力が接続されてい
る。入力端子番号設定回路108の出力は、出力レジス
タ102へ接続されている。出力レジスタ102の出力
は、自己ルーティングスイッチ300の入り潮予めひと
つに接続されている。
Output lines Il and I2 are provided from the input register 101, and are connected to a conversion table 103 (TABl), respectively.
c), conversion table 104 (TAL32c)
is connected to the read address input of the . Also,
The II take-out line is also connected to the signal cell detection circuit 106. Conversion table 103. Each data output line of 104 is connected to a conversion table 105 (TAB3c).
is connected to the read address input of the . The data output line of conversion table 105 is connected to output register 102 via gate 107. gate 10
7 is connected to the output of the signal cell detection circuit 106. The output of the input terminal number setting circuit 108 is connected to the output register 102. The output of the output register 102 is connected to the input terminal of the self-routing switch 300.

一方、スイッチの出端子のひとつは、人カレジスタ20
1と遅延回路205を介して、出力レジスタ203へと
接続されている。人力レジスタ201からは、各種の取
り出し線か転送レジスタ202へと接続されている。転
送レジスタ202の各種出力線のうち、呼識別子I1.
I2はそれぞれ変換テーブル103,104の書き込み
アドレス入力、及び変換テーブルl050書き込みアド
レス入力へ、参照番号rl . r2はそれぞれ変換テ
ーブル103 , 104のデータ入力へと接続されて
いる。出線側の呼識別子として用いる新たな識別子(I
l’ .I2’ )やスイッチの出力端子番で(D人)
などは、変換テーブル105のデータ入力へと接続され
ている。尚、呼識別子クリア回M 204は、受け取っ
て用済みとなった信号セルを空きセル化する回路である
On the other hand, one of the output terminals of the switch is connected to the person register 20.
1 and a delay circuit 205 to an output register 203. The manual register 201 is connected to various take-out lines or a transfer register 202 . Among the various output lines of the transfer register 202, the call identifier I1.
I2 to the write address inputs of translation tables 103 and 104 and the write address input of translation table 1050, respectively, with reference numbers rl. r2 are connected to data inputs of conversion tables 103 and 104, respectively. A new identifier (I
l'. I2') or switch output terminal number (D person)
etc. are connected to the data inputs of the conversion table 105. Note that the call identifier clearing circuit M204 is a circuit that converts the received and used signal cells into empty cells.

このラベル変換回路の動作を、第6図を用いて説明する
。第6図には、変換テーブルによる変換の様子が示され
ている。NビットとMビットに分解された呼識別子II
,I2は、これらを読みだしアドレスとして、変換テー
ブル103 , 104を引くことで、それぞれ参照番
号rl.r2に変換される。次に、rlとr2を結合し
た数値(例えば、rlが上位ビット,r2が下位ビット
の場合は、「rl+r2Jと略記する)を読みだしアド
レスとして、変換テーブル105を引くことで、新たな
呼識別子(II,I2)と出端子番号(DA)が得られ
る。入り端子番号(SA)は、回線の物理的位置により
一意に定まる。
The operation of this label conversion circuit will be explained using FIG. 6. FIG. 6 shows how the conversion is performed using the conversion table. Call identifier II broken down into N bits and M bits
, I2 are read by referring to the conversion tables 103 and 104, respectively. It is converted to r2. Next, a new call identifier is created by referring to the conversion table 105 using the combination of rl and r2 (for example, if rl is the upper bit and r2 is the lower bit, it will be abbreviated as "rl+r2J"). (II, I2) and the output terminal number (DA) are obtained.The input terminal number (SA) is uniquely determined by the physical position of the line.

これらをセルのヘッダ部に付加、ないしヘッダ部を変換
することで、スイッチ内セルとする。入カセルが信号セ
ルであった場合は、変換は行わず、出燗子#r号として
、制御機構部へ接続する端子番号を付加する。
By adding these to the header part of the cell or converting the header part, it becomes an intra-switch cell. If the input cell is a signal cell, no conversion is performed and the terminal number connected to the control mechanism section is added as the output #r number.

以上のような変換方法を採った場合、rlのビット長は
Ifより知いnでよく、r2のビット長は工2より短い
mでよい。なぜならば、呼識別子のビット長をフルに使
うほどの呼が一度に一つの回線で設定されることはない
からである。
When the above conversion method is adopted, the bit length of rl may be n, which is shorter than If, and the bit length of r2 may be m, which is shorter than f2. This is because so many calls are not set up on one line at a time that the bit length of the call identifier is fully used.

ここで具体的に数値例をあげて比較してみる。Here, we will give a concrete numerical example and compare it.

N =12 , M =16 . U=10(ビット)
の場合、従来の方法即ち一つのテーブルで変換する場合
は、211”’x12+16+10となり、これは約1
0Gビットのメモリ容量である。一方、n=m−8とす
ると212×8+2”X (12+16+IQ)となり
、これは約2.5Mビットである。前者は非現実的な値
であるが、後者はIMビットクラスの1チップメモリが
入手可能な現在、実現可能な値である。
N = 12, M = 16. U=10 (bit)
In this case, when converting using the conventional method, that is, using one table, the result is 211"' x 12 + 16 + 10, which is approximately 1
It has a memory capacity of 0 Gbit. On the other hand, if n=m-8, it becomes 212×8+2” This value is currently available and is achievable.

次に、第4図により参照番号割当回路の説明を行う。ス
イッチの出端子から第3図で示す振り分け機構4200
を介した入力線は、入力レジスタ4101 と出力レジ
スタ4110へと接続される。呼設定情報等(呼切断情
報等も含む信号情報)の取り出し線は、変換テーブル4
1l1の読みだしアドレス入力に接続されている。また
、同時に上記情報のうち11の部分が変換テーブル41
02の読みだしアドレス入力へと接続されている。変換
テーブル4111のデータ出力は、出力レジスタ411
0へと接続されている。変換テーブル4l02のデータ
出力は、レジスタ4104と比較回WI14103へと
接続されている。比較回路の出力のうち、Oでない場合
の出力が、レジスタ4l04のイネーブル入力となって
いる。一方、Oである場合の出力は、参照番号格納回路
4106(FIFO  l)の出力イネーブル入力とな
っている。レジスタ4104の出力は、リセット回路4
l12を介して出力レジスタ4110へと接続されてい
る。また、該出力は同時に参照番号管理テーブル410
5の読みだしアドレス入力と、参照番号格納回路410
6の入力ともなっている。参照番号格納回路4106の
データ出力は、比較回路4107に!1!続されている
。比較回路4107の出力は、リセット回路41l2の
リセット入力と、参照番号格納回路4106の入カイネ
ーブルAカとなっている。入カレジスタ4101からは
、呼識別子の部分であるJl及び信号種別Kの取り出し
線が信号種別検出回路4109へと接続され,その出力
はデータインクリメント/デクリメント回路4108へ
と接続されている。データインクリメント/デクリメン
ト回路4108の出力は、参照番号管理テーブル4l0
5のデータ入力となっている。
Next, the reference number assignment circuit will be explained with reference to FIG. Distribution mechanism 4200 shown in FIG. 3 from the output terminal of the switch
The input line via is connected to input register 4101 and output register 4110. The extraction line for call setting information, etc. (signal information including call disconnection information, etc.) is converted to conversion table 4.
It is connected to the read address input of 1l1. At the same time, 11 parts of the above information are stored in the conversion table 41.
It is connected to the read address input of 02. The data output of the conversion table 4111 is output from the output register 411.
connected to 0. The data output of the conversion table 4l02 is connected to the register 4104 and the comparison circuit WI14103. Among the outputs of the comparator circuit, the output when the output is not O is the enable input of the register 4l04. On the other hand, the output when it is O is the output enable input of the reference number storage circuit 4106 (FIFO 1). The output of the register 4104 is sent to the reset circuit 4.
It is connected to output register 4110 via l12. In addition, the output is also sent to the reference number management table 410 at the same time.
5 readout address input and reference number storage circuit 410
It also serves as the input for 6. The data output of the reference number storage circuit 4106 is sent to the comparison circuit 4107! 1! It is continued. The output of the comparison circuit 4107 serves as the reset input of the reset circuit 41l2 and the input enable A of the reference number storage circuit 4106. From the input register 4101, take-out lines for call identifier part Jl and signal type K are connected to a signal type detection circuit 4109, and its output is connected to a data increment/decrement circuit 4108. The output of the data increment/decrement circuit 4108 is the reference number management table 4l0.
There are 5 data inputs.

尚、呼識別子の残りの部分であるJ2に対応する回路は
、Jlに対応する回路と同様な構成なので,詳細は省略
する。
Note that the circuit corresponding to J2, which is the remaining part of the call identifier, has the same configuration as the circuit corresponding to Jl, so the details will be omitted.

以上の回路の動作は、第7図に示してある。呼設定情報
に含まれるII,I2にてそれぞれ変換テーブルを引き
、cl,a2を得る。(以下%ll側のみ説明する。)
clが特定パターン、例えば0である場合は、このII
は初めて用いられたものであり、このときは参照番号格
納回路から新たな参照番号としてrlを取り出し、変換
テーブル上のclと置き換える。一方、clがOでない
場合は、このIIはすでに使われているので、このC1
の値で参照番号管理テーブルを引く。するとそこには、
このC1が現在例回使われているかがqlとして書かれ
てあり、呼設定の場合は、さらにこの値を1つ増加させ
る。
The operation of the above circuit is shown in FIG. Conversion tables are looked up at II and I2 included in the call setting information, respectively, to obtain cl and a2. (Only the %ll side will be explained below.)
If cl is a specific pattern, for example 0, then this II
is used for the first time, and at this time, rl is taken out as a new reference number from the reference number storage circuit and replaced with cl on the conversion table. On the other hand, if cl is not O, this II is already in use, so this C1
Look up the reference number management table using the value of . Then there is
The number of times this C1 is currently used is written as ql, and in the case of call setup, this value is further increased by one.

呼の切断の場合は、1つ減少させる。qlが0の場合は
, rlを用いていた全ての呼が切断されたことに相当
するので, rlを参照番号格納回路へ戻す。
In case of call disconnection, decrease by one. If ql is 0, this means that all calls using rl have been disconnected, so rl is returned to the reference number storage circuit.

同時に、出力レジスタへの転送をやめる。At the same time, the transfer to the output register is stopped.

呼設定情報(例えばダイヤル番号:DN)からは、変換
テーブル( TRANS )をひいて、新たな呼識別子
II’,I2’および出端子番号DAを得る。
From the call setting information (for example, dialed number: DN), a translation table (TRANS) is drawn to obtain new call identifiers II', I2' and output terminal number DA.

この辺間テーブルの内容は、一連の呼設定手順の中で図
示しない制御系によって設定されたものである。
The contents of this edge table are set by a control system (not shown) during a series of call setting procedures.

本回路の変換テーブルも前記のラベル変換テーブルと同
様な構成であり、本構成を採ることによりメモリ容量の
削減が図れる。尚、参照番号管理テーブルは、ビット幅
がn,mよりさらlこ少なくて済み、ワード数も2n 
 ないし2mで良いため必袂なメモリ量はきわめて少な
い。
The conversion table of this circuit also has the same configuration as the label conversion table described above, and by adopting this configuration, memory capacity can be reduced. Note that the reference number management table has a bit width that is even less than n and m, and the number of words is 2n.
The required amount of memory is extremely small since it is only 2m long.

〔発明の効果〕〔Effect of the invention〕

本発明は以上述べたように、ラベル変換回路に於で、変
換テーブルの分割と階層化を行っているのて、本一の変
換テーブルを用いるよりもきわめて少ないメモリ量で必
賛な+!A能を実現できる。
As described above, the present invention divides and hierarchizes the conversion table in the label conversion circuit, so it requires much less memory than using the original conversion table. A-ability can be achieved.

また、上記変換テーブルの階層化に有効な参照番号割当
回路1こおいても同様ム変換テーブルの分割と階層化を
行っているので、上記ラベル変換回路と同程度のメモリ
削減がーれる。一例とし゛Cは、従来方法では約10G
ビットものメモリ容量が回線対応に必要である場合に、
これの約4000分の1の2.5Mビットのメモリ容量
で同等機能が実現できる。
Furthermore, since the reference number allocation circuit 1, which is effective in hierarchizing the conversion table, similarly divides and hierarchizes the conversion table, the memory can be reduced to the same extent as in the label conversion circuit. As an example, C is approximately 10G in the conventional method.
When a bit of memory capacity is required for line support,
Equivalent functionality can be achieved with a memory capacity of 2.5 Mbit, which is about 1/4000th of this.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の一実施例であるラベル変決回路のブロ
ック図、第2図は第1図のラベル変換回路を用いる交換
機の構或図、第3図はWJz図の一部である制御機構部
のブロック図、第4図は本発明の一央施例である参照番
号割当回路のブロック図、第5図は本実施例の交換機で
扱うセルの構造図、第6図は第1図の動作説明図,第7
図は第4図の動作説明図である。 100・・・回線対応部(入り線側) 200・・回線対応部(出線gl!l)300・・・自
己ノレーテイングスイッチ400・・・制御機構部 103, 104, 105・・・変換テーブル410
2  ・・・変換テーブル 4105  ・・・参照番号管理テーブル4l06  
・・参照番号格納回路 00 口示U4K1子ひ、り車象事リ)   300 
 自己ルーティ)7′スイ/チ200  11D,?袈
n/iefP(,t41{LJ)  400  4’J
{#I’# 4A目P101 , 201−一一人力し
ジス7102,205−−一エカしジスタ 202     転送しシ又ク 10t5, 104, +05・一史J!!テー7゛ル
4+00−4!.’!.4’rlりai,n4200−
−−JE=v分t7M才* 431)D−噂、,線職4鼻 霧4図 4101・・一人力しシ゛又7 41 10−−一エ刀し〉スタ 4102−−・変イ夾ナーフノレ 4105・−・参!!、沓令奮建テーフル4105−・
・参!!、)k岑絡納団路霧6図 (住) (C) [TAB C] [TAB 3C] n(<11) I−N  十M +  U→ 力5図 1−  M  @←N@ I−バ→トN一トυ→←U→ +MmI−N−+ 弟7図 (OL) [TA[l ’−n(<N) [FIFD [M〜G 1コ h  i(<n) −1 (b) [TAB 2sl [酬G2] [TRAIIS] +−門+N中υ州
Fig. 1 is a block diagram of a label conversion circuit which is an embodiment of the present invention, Fig. 2 is a diagram of the structure of an exchange using the label conversion circuit of Fig. 1, and Fig. 3 is a part of a WJz diagram. 4 is a block diagram of a reference number assignment circuit which is a central embodiment of the present invention; FIG. 5 is a structural diagram of a cell handled by the exchange of this embodiment; and FIG. Operation explanatory diagram of figure 7
The figure is an explanatory diagram of the operation of FIG. 4. 100...Line corresponding section (incoming line side) 200...Line corresponding section (outgoing line gl!l) 300...Self-norting switch 400...Control mechanism section 103, 104, 105...Conversion table 410
2...Conversion table 4105...Reference number management table 4l06
...Reference number storage circuit 00 instruction U4K1 child vehicle event) 300
Self Rooty) 7' Sui/Chi 200 11D,?袈n/iefP(,t41{LJ) 400 4'J
{#I'# 4Ath P101, 201-Each one works hard Jisu 7102, 205--One ekashi Jisu 202 Transfers Shimataku 10t5, 104, +05・Issushi J! ! Table 7 4+00-4! .. '! .. 4'rli ai, n4200-
--JE = v minutes t7M years old * 431) D-Rumor,, Line job 4 Nose mist 4 Figure 4101...Single person Shimata 7 41 10--Ichie sword〉Star 4102--・Weird nerf nore 4105--see! ! , Kutsurei Fengken Teful 4105-・
·three! ! , ) k 岑辑辑田路郎 6fig. (Residence) (C) [TAB C] [TAB 3C] n (<11) I-N 10M + U→ Force 5fig. 1- M @←N@ I- Bat→ToNto υ→←U→ +MmI−N−+ Younger brother 7 figure (OL) [TA[l'−n(<N) [FIFD [M~G 1koh i(<n) −1 ( b) [TAB 2sl [Response G2] [TRAIIS] +-gate+N middle υ state

Claims (1)

【特許請求の範囲】 1、ヘッダ部及び情報部からなる固定長パケット(以下
、「セル」と称する)を用いて通信情報を交換する自己
ルーテイング型交換機において、ヘッダ部に含まれる呼
識別子のビット列を複数に分割し、分割したそれぞれの
ビット列をそれぞれに対応する参照番号に変換する複数
の変換テーブルと、該複数の参照番号ビット列を結合し
たスイッチ内呼識別番号をスイッチの出端子番号および
新たな呼識別子に変換する変換テーブルとを有すること
を特徴とする自己ルーティングスイツチに適するラベル
変換回路。 2、請求項1のラベル変換回路において、ヘッダ部に含
まれるセル種別情報を検出し該セルが交換制御のための
信号セルか否かを検出する手段と、信号セルであった場
合には、呼識別子を変換しないようにする手段と、該セ
ルの内容を交換機の制御機構部に伝達する手段とを有す
ることを特徴とするラベル変換回路。 3、請求項2のラベル変換回路において、セル種別が信
号セルである場合、該セルに付加する出端子番号を制御
機構部の入力端子番号とすることによって信号セルの内
容を交換機の制御機構部に伝達することを特徴とするラ
ベル変換回路。 4、ヘッダ部及び情報部からなるセルを用いて通信情報
を交換する自己ルーテイング型交換機において、ヘッダ
部に含まれる呼識別子のビット列を2つに分割し、分割
した一方のビット列をそれに対応する参照番号に変換す
る変換テーブルと、分割したもう一方のビット列と該参
照番号ビット列で構成したスイッチ内呼識別番号をスイ
ッチの出端子番号および新たな呼識別子に変換する変換
テーブルとを持つことを特徴とする自己ルーテイングス
イッチに適するラベル変換回路。 5、ヘッダ部及び情報部からなるセルを用いて通信情報
を交換する自己ルーティング型交換機において、交換制
御のための信号の通信のために用いる信号セルを入力情
報とし、該信号セルに含まれる呼識別子のビット列を複
数に分割し、分割したそれぞれのビット列をそれぞれに
対応する参照番号に変換する複数の変換テーブルを有す
ることを特徴とする参照番号割当回路。 6、請求項5の参照番号割当回路において、分割した呼
識別子を参照番号に変換する変換テーブルの内容が特定
のビットパターンであることを検出する比較回路と、比
較の結果が特定のビットパターンであるときに上記変換
テーブルに新たな参照番号を書き込む手段と、比較の結
果が特定のビットパターンでないときに該ビットパター
ンをアドレスとして書き込み、及び読み出しが出来る参
照番号管理テーブルと、該管理テーブルの内容がゼロで
あるか否かを検出しゼロである場合に上記変換テーブル
内の上記ビットパターンを特定のビットパターンに書き
換える手段と、該管理テーブルの内容を信号セルに含ま
れる信号種別情報に基づいて増減させる手段とを有する
ことを特徴とする参照番号割当回路。
[Claims] 1. In a self-routing switch that exchanges communication information using fixed-length packets (hereinafter referred to as "cells") consisting of a header section and an information section, a bit string of a call identifier included in the header section. is divided into a plurality of parts, and each of the divided bit strings is converted into a corresponding reference number using a plurality of conversion tables. 1. A label conversion circuit suitable for a self-routing switch, comprising a conversion table for converting into a call identifier. 2. In the label conversion circuit according to claim 1, means for detecting cell type information included in the header portion and detecting whether or not the cell is a signal cell for switching control, and if the cell is a signal cell, 1. A label conversion circuit comprising means for not converting a call identifier and means for transmitting the contents of the cell to a control mechanism section of an exchange. 3. In the label conversion circuit of claim 2, when the cell type is a signal cell, the content of the signal cell is transferred to the control mechanism section of the exchange by setting the output terminal number added to the cell as the input terminal number of the control mechanism section. A label conversion circuit characterized in that it transmits information to the user. 4. In a self-routing switch that exchanges communication information using cells consisting of a header section and an information section, the bit string of the call identifier included in the header section is divided into two, and one of the divided bit strings is used as the corresponding reference. It is characterized by having a conversion table for converting into a number, and a conversion table for converting an internal switch call identification number composed of the other divided bit string and the reference number bit string into an output terminal number of the switch and a new call identifier. A label conversion circuit suitable for self-routing switches. 5. In a self-routing type switch that exchanges communication information using cells consisting of a header part and an information part, a signal cell used for communication of signals for switching control is used as input information, and a call included in the signal cell is used as input information. 1. A reference number assignment circuit comprising a plurality of conversion tables for dividing a bit string of an identifier into a plurality of parts and converting each divided bit string into a corresponding reference number. 6. The reference number assignment circuit according to claim 5, further comprising: a comparison circuit that detects that the contents of the conversion table for converting the divided call identifier into the reference number is a specific bit pattern; A means for writing a new reference number into the conversion table at a certain time, a reference number management table capable of writing and reading the bit pattern as an address when the comparison result is not a specific bit pattern, and the contents of the management table. means for detecting whether or not is zero and rewriting the bit pattern in the conversion table to a specific bit pattern when it is zero; A reference number assignment circuit characterized in that it has means for increasing or decreasing.
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