JPH0323377U - - Google Patents
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- Publication number
- JPH0323377U JPH0323377U JP8364189U JP8364189U JPH0323377U JP H0323377 U JPH0323377 U JP H0323377U JP 8364189 U JP8364189 U JP 8364189U JP 8364189 U JP8364189 U JP 8364189U JP H0323377 U JPH0323377 U JP H0323377U
- Authority
- JP
- Japan
- Prior art keywords
- data
- port memory
- processing
- perform
- devices
- Prior art date
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- Pending
Links
- 230000015654 memory Effects 0.000 claims description 17
- 230000006835 compression Effects 0.000 claims description 8
- 238000007906 compression Methods 0.000 claims description 8
- 238000001514 detection method Methods 0.000 claims description 8
- 230000001629 suppression Effects 0.000 claims description 8
- 238000010586 diagram Methods 0.000 description 6
Landscapes
- Radar Systems Or Details Thereof (AREA)
Description
第１図はこの考案の一実施例を示すレーダ信号
処理装置の構成図、第２図はこの考案の他の実施
例を示すレーダ信号処理装置の構成図、第３図は
第１図で示したレーダ信号処理装置の処理時間を
説明する図、第４図は制御データを説明する図、
第５図は従来のレーダ信号処理装置の構成図、第
６図は従来のレーダ信号処理装置の処理時間を説
明する図である。 図において、１はＡ／Ｄ変換器、２は出力装置
、３はパルス圧縮装置、４はクラツタ抑圧装置、
５は目標検出装置、６は相関処理装置、７はマル
チポートメモリ、８はコネクタ、９は１０は制御
データ書き込み装置である。なお、各図中同一符
号は同一または相当部分を示す。
処理装置の構成図、第２図はこの考案の他の実施
例を示すレーダ信号処理装置の構成図、第３図は
第１図で示したレーダ信号処理装置の処理時間を
説明する図、第４図は制御データを説明する図、
第５図は従来のレーダ信号処理装置の構成図、第
６図は従来のレーダ信号処理装置の処理時間を説
明する図である。 図において、１はＡ／Ｄ変換器、２は出力装置
、３はパルス圧縮装置、４はクラツタ抑圧装置、
５は目標検出装置、６は相関処理装置、７はマル
チポートメモリ、８はコネクタ、９は１０は制御
データ書き込み装置である。なお、各図中同一符
号は同一または相当部分を示す。
Claims (1)
- 【実用新案登録請求の範囲】 (1) アナログ信号をデイジタル信号に変換する
Ａ／Ｄ変換器、Ａ／Ｄ変換器と接続され、複数の
入出力ポートを持つ複数のマルチポートメモリを
直列接続された形で持ち、マルチポートメモリの
データに対してパルス圧縮処理を行う一個以上の
パルス圧縮装置を持ち、マルチポートメモリのデ
ータに対してクラツタ抑圧処理を行う一個以上の
クラツタ抑圧装置を持ち、マルチポートメモリの
データに対して目標検出処理を行う一個以上の目
標検出装置を持ち、マルチポートメモリのデータ
に対し参照データとの相関処理を行う一個以上の
相関処理装置を持ち、マルチポートメモリのデー
タを外部に出力する出力装置を持ち、パルス圧縮
装置およびクラツタ抑圧装置および目標検出装置
および相関処理装置とマルチポートメモリを接続
し必要に応じて接続するパルス圧縮装置およびク
ラツタ抑圧装置および目標検出装置および相関処
理装置を交換できるようなコネクタを持つことを
特徴とするレーダ信号処理装置。 (2) アナログ信号をデイジタル信号に変換する
Ａ／Ｄ変換器、Ａ／Ｄ変換器と接続され、複数の
入出力ポートを持つ複数のマルチポートメモリを
直列接続された形で持ち、マルチポートメモリの
データに対してパルス圧縮処理を行う一個以上の
パルス圧縮装置を持ち、マルチポートメモリのデ
ータに対してクラツタ抑圧処理を行う一個以上の
クラツタ抑圧装置を持ち、マルチポートメモリの
データに対して目標検出処理を行う一個以上の目
標検出装置を持ち、マルチポートメモリのデータ
に対し参照データとの相関処理を行う一個以上の
相関処理装置を持ち、マルチポートメモリのデー
タを外部に出力する出力装置を持ち、パルス圧縮
装置およびクラツタ抑圧装置および目標検出装置
および相関処理装置とマルチポートメモリを接続
し必要に応じて接続するパルス圧縮装置およびク
ラツタ抑圧装置および目標検出装置および相関処
理装置を交換できるようなコネクタを持ち、制御
データをマルチポートメモリのメモリ領域を介し
て行うことを特徴とする制御データ書き込み装置
を持つことを特徴とするレーダ信号処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8364189U JPH0323377U (ja) | 1989-07-17 | 1989-07-17 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8364189U JPH0323377U (ja) | 1989-07-17 | 1989-07-17 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0323377U true JPH0323377U (ja) | 1991-03-11 |
Family
ID=31631473
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8364189U Pending JPH0323377U (ja) | 1989-07-17 | 1989-07-17 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0323377U (ja) |
-
1989
- 1989-07-17 JP JP8364189U patent/JPH0323377U/ja active Pending
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