JPH03250971A - 画像処理装置 - Google Patents
画像処理装置Info
- Publication number
- JPH03250971A JPH03250971A JP2048226A JP4822690A JPH03250971A JP H03250971 A JPH03250971 A JP H03250971A JP 2048226 A JP2048226 A JP 2048226A JP 4822690 A JP4822690 A JP 4822690A JP H03250971 A JPH03250971 A JP H03250971A
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- JP
- Japan
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- processing
- data
- output
- image
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- Color Image Communication Systems (AREA)
- Image Processing (AREA)
- Storing Facsimile Image Data (AREA)
- Editing Of Facsimile Originals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野］
本発明は、文字に対して模様画像などの特殊処理をデジ
タルで行うための画像処理装置に関するものである。
タルで行うための画像処理装置に関するものである。
従来、複写機などの画像処理装置は、原画像に対し１；
１、あるいは縮小／拡大などの加工を施すのみであった
が、デジタル処理技術の採用に伴って、画像などに対す
る加工が考えられている。
１、あるいは縮小／拡大などの加工を施すのみであった
が、デジタル処理技術の採用に伴って、画像などに対す
る加工が考えられている。
この加工として、例えば、縁取りなどの処理がある。
従来、縁取り画像などの模様画像を形成するには、原画
像を細らせたり、太らせたりして処理を行っているが、
具体的には、フレームメモリに対して必要な画像データ
を毎回読み込み、ＣＰＵ（中央処理装置）を用いて演算
処理することにより行っている。
像を細らせたり、太らせたりして処理を行っているが、
具体的には、フレームメモリに対して必要な画像データ
を毎回読み込み、ＣＰＵ（中央処理装置）を用いて演算
処理することにより行っている。
しかしながら、上舵した従来技術にあっては、装置の構
成が大規模になって回路構成が複雑化すると共に、リア
ルタイムに画像処理を行うことはできなかった。
成が大規模になって回路構成が複雑化すると共に、リア
ルタイムに画像処理を行うことはできなかった。
また、白黒のディジタル複写機におけるリアルタイム処
理では、従来、縁取り画像や影付は処理程度しか行われ
ていなかった。
理では、従来、縁取り画像や影付は処理程度しか行われ
ていなかった。
本発明は、上記に鑑みてなされたものであって、フレー
ムメモリを用いることなく簡単な構成により模様画像処
理をリアルタイムに行うことを目的とする。
ムメモリを用いることなく簡単な構成により模様画像処
理をリアルタイムに行うことを目的とする。
本発明は上記の目的を達成するために、入力画像データ
を２値化する２値化処理手段と、該手段による複数ライ
ン分のデータを記憶するラインメモリと、該ラインメモ
リから読み出した原画データに対して太らせ処理及び細
らせ処理を行う画像加工部と、該画像加工部による縁取
り文字と細らせ文字を合成する色付処理部とを設けた画
像処理装置を提供するものである。
を２値化する２値化処理手段と、該手段による複数ライ
ン分のデータを記憶するラインメモリと、該ラインメモ
リから読み出した原画データに対して太らせ処理及び細
らせ処理を行う画像加工部と、該画像加工部による縁取
り文字と細らせ文字を合成する色付処理部とを設けた画
像処理装置を提供するものである。
本発明による画像処理装置にあっては、原画データを２
値化したのち、これに対する太らせ処理及び細らせ処理
が行われ、この２つの処理の合成処理を行うことにより
模様画像（縁取り文字＋細らせ文字）が得られる。これ
により、フレームメモリを用いることなく、リアルタイ
ムに模様画像を作成することが可能となる。
値化したのち、これに対する太らせ処理及び細らせ処理
が行われ、この２つの処理の合成処理を行うことにより
模様画像（縁取り文字＋細らせ文字）が得られる。これ
により、フレームメモリを用いることなく、リアルタイ
ムに模様画像を作成することが可能となる。
［実施例〕
以下、本発明の実施例について図面を参照しながら説明
する。
する。
第１図は本発明による画像処理装置の概略構成を示すブ
ロック図であり、第２図は第１図の画像処理部１０２の
詳細を示すブロック図である。
ロック図であり、第２図は第１図の画像処理部１０２の
詳細を示すブロック図である。
第１図において、画像処理装置は、光学的に原稿などの
画像を読み取って電気信号として出力する画像読み取り
部１０１、この画像読み取り部１０１からの信号をディ
ジタルにより加工処理する画像処理部１０２、及び画像
処理部１０２によって得られた信号をハードコピーし或
いは磁気ディスクなどの記録媒体に保存する画像記録部
１０３から成る。
画像を読み取って電気信号として出力する画像読み取り
部１０１、この画像読み取り部１０１からの信号をディ
ジタルにより加工処理する画像処理部１０２、及び画像
処理部１０２によって得られた信号をハードコピーし或
いは磁気ディスクなどの記録媒体に保存する画像記録部
１０３から成る。
画像処理部１０２は、第２図に示すように、カラー原稿
を色分解した多値データに対し色範囲を２値化する２値
化処理部２０１、この２値化処理部２０１による処理結
果の９５４７分を記憶するラインメモリ部２０２、この
ラインメモリ部２０２より読み出した９５４７分のライ
ン方向のデータに対し縁取り処理を行う画像加工部２０
３、及び画像加工部２０３の出力データ及び入力画像デ
ータに基づいて、模様画像（縁取り文字＋細らせ文字）
を形成して出力画像データを出力する色付は処理部２０
４の各々を備えて構成される。
を色分解した多値データに対し色範囲を２値化する２値
化処理部２０１、この２値化処理部２０１による処理結
果の９５４７分を記憶するラインメモリ部２０２、この
ラインメモリ部２０２より読み出した９５４７分のライ
ン方向のデータに対し縁取り処理を行う画像加工部２０
３、及び画像加工部２０３の出力データ及び入力画像デ
ータに基づいて、模様画像（縁取り文字＋細らせ文字）
を形成して出力画像データを出力する色付は処理部２０
４の各々を備えて構成される。
第３図はラインメモリ部２０２の詳細を示し、データ入
力端子Ｉ）ｏｉ、〜Ｄい一１ｏｉｎ、データ出力端子Ｄ
０゜１〜Ｄい−１．。０、読み出しクロック端子ＲＤＣ
ＬＫ、書き込みクロック端子ＷＲＣＬ Ｋ。
力端子Ｉ）ｏｉ、〜Ｄい一１ｏｉｎ、データ出力端子Ｄ
０゜１〜Ｄい−１．。０、読み出しクロック端子ＲＤＣ
ＬＫ、書き込みクロック端子ＷＲＣＬ Ｋ。
ライトイネーブル入力端子ＷＥ、リードイネーブル入力
端子ＲＥ、リセットライト入力端子ＲＳＴＷ、及びリセ
ットリード入力端子Ｒ３ＴＲを備えた１チツプのＩＣで
ある。
端子ＲＥ、リセットライト入力端子ＲＳＴＷ、及びリセ
ットリード入力端子Ｒ３ＴＲを備えた１チツプのＩＣで
ある。
なお、図中、ＣＬＫはデータクロックであり、ＬＳＹＮ
Ｃはライン同期信号である。
Ｃはライン同期信号である。
第３図の構成においては、１ビツトのデータ入力Ｄ Ｏ
ｉ Ｘとデータ出力Ｄ０゜□とを入力データＤ Ｉ’ｉ
、 ｎ としている。同様な操作を入力データＤ Ｌｎ
−１１ｉｎまで繰り返すことにより、ラインメモリ部２
０２の出力を９５４７分持ったことになる。
ｉ Ｘとデータ出力Ｄ０゜□とを入力データＤ Ｉ’ｉ
、 ｎ としている。同様な操作を入力データＤ Ｌｎ
−１１ｉｎまで繰り返すことにより、ラインメモリ部２
０２の出力を９５４７分持ったことになる。
Ｄｏ。、〜Ｄ（ＩＩ−１１゜、のｎビットのデータを加
えて、ｎ＋１ビット分のデータをＦＩＦＯ（ファースト
・イン・ファースト・アウト）出力として出力する。
えて、ｎ＋１ビット分のデータをＦＩＦＯ（ファースト
・イン・ファースト・アウト）出力として出力する。
第４図は画像加工部２０３の詳細を示す回路図である。
第３図に示したＦＩＦＯ出力には、オアゲート４０１、
アンドゲート４０２及びシフトレジスタ４０３が接続さ
れている。オアゲート４−０１には、シフトレジスタ４
０４が接続され、このシフトレジスタ４０４にはオアゲ
ート４０５が接続されている。
アンドゲート４０２及びシフトレジスタ４０３が接続さ
れている。オアゲート４−０１には、シフトレジスタ４
０４が接続され、このシフトレジスタ４０４にはオアゲ
ート４０５が接続されている。
また、シフトレジスタ４０３の出力にはインバータ４０
６が接続され、このインバータ４０６の出力とオアゲー
ト４０５の出力には２人力のアントゲ−）４０７が接続
され、処理結果（１）を出力する。
６が接続され、このインバータ４０６の出力とオアゲー
ト４０５の出力には２人力のアントゲ−）４０７が接続
され、処理結果（１）を出力する。
さらに、アンドゲート４０２には、シフトレジスタ４０
８が接続され、このシフトレジスタ４０８にはアンドゲ
ート４０９が接続され、処理結果（ｎ）を出力する。
８が接続され、このシフトレジスタ４０８にはアンドゲ
ート４０９が接続され、処理結果（ｎ）を出力する。
なお、前記各シフトレジスタには、例えば、テキサスイ
ンストルメンツ社製、８ビツト、パラレルアウト／シリ
アルシフトレジスタの５Ｎ５４１６４．５Ｎ７４１６４
．５Ｎ７４ＬＳ１６４を用いることができる。
ンストルメンツ社製、８ビツト、パラレルアウト／シリ
アルシフトレジスタの５Ｎ５４１６４．５Ｎ７４１６４
．５Ｎ７４ＬＳ１６４を用いることができる。
第４図の構成においては、オアゲート４０１、シフトレ
ジスタ４０４及びオアゲート４０５によって第５図の（
ｃ）のような「太らせ処理」を行う。また、シフトレジ
スタ４０３では、（ｂ）に示すように、原稿（ａ）に対
して「太らせ処理」で生じたずれのシフト操作を行う。
ジスタ４０４及びオアゲート４０５によって第５図の（
ｃ）のような「太らせ処理」を行う。また、シフトレジ
スタ４０３では、（ｂ）に示すように、原稿（ａ）に対
して「太らせ処理」で生じたずれのシフト操作を行う。
さらに、アンドゲート４０２、シフトレジスタ４０８及
びアンドゲート４０９によって、原稿（ａ）に対し、（
ｄ）のように「細らせ処理」を行う。ついで、シフトレ
ジスタ４０３によるシフトデータをインバータ４０６で
反転させた信号と、オアデー１−４０５による「太らせ
処理」との論理積をアンドゲート４０７でとり、（ｅ）
のような「中抜き処理」を行って処理結果（１）を得る
。
びアンドゲート４０９によって、原稿（ａ）に対し、（
ｄ）のように「細らせ処理」を行う。ついで、シフトレ
ジスタ４０３によるシフトデータをインバータ４０６で
反転させた信号と、オアデー１−４０５による「太らせ
処理」との論理積をアンドゲート４０７でとり、（ｅ）
のような「中抜き処理」を行って処理結果（１）を得る
。
次に、アンドゲート４０９により得られたＣｄ）のよう
な「細らせ処理（すなわち、処理結果（Ｉ）」結果と、
アンドゲート４０７によって得られた（ｅ）の「中抜き
処理（すなわち、処理結果（■）」結果とを色付は処理
部２０４によって合成し、（ｆ）の合成画像を得る。
な「細らせ処理（すなわち、処理結果（Ｉ）」結果と、
アンドゲート４０７によって得られた（ｅ）の「中抜き
処理（すなわち、処理結果（■）」結果とを色付は処理
部２０４によって合成し、（ｆ）の合成画像を得る。
なお、第５図の点線枠はオリジナルデータの位置を示し
、右下がり斜線は色データ（Ｉ）、左下がり斜線は色デ
ータ（Ｉｆ）または画像データを示している。また、空
白部分は、イレース処理される部分を示している。
、右下がり斜線は色データ（Ｉ）、左下がり斜線は色デ
ータ（Ｉｆ）または画像データを示している。また、空
白部分は、イレース処理される部分を示している。
さらに、第４図においては、各ゲートに９本の信号を入
力させて、９×９の正方形のパターンで「細らせ処理」
及び「太らせ処理」を行うものとしたが、これは任意に
することが可能である。
力させて、９×９の正方形のパターンで「細らせ処理」
及び「太らせ処理」を行うものとしたが、これは任意に
することが可能である。
第６図は色付は処理部２０４の詳細を示す回路図である
。
。
ＣＰＵ （図示せず）のハスには、イレーズ用のレジス
タ６０１、第１の指定色用のレジスタ６０２、第２の指
定色用のレジスタ６０３及びモード切換用のレジスタ６
０４が接続されている。
タ６０１、第１の指定色用のレジスタ６０２、第２の指
定色用のレジスタ６０３及びモード切換用のレジスタ６
０４が接続されている。
入力画像データを入力端子Ａとするデータセレクタ６０
５の入力端子Ｂが、レジスタ６０２の出力端子に接続さ
れている。更に、データセレクタ６０５のセレクト端子
Ｓには、レジスタ６０４の出力が接続されている。
５の入力端子Ｂが、レジスタ６０２の出力端子に接続さ
れている。更に、データセレクタ６０５のセレクト端子
Ｓには、レジスタ６０４の出力が接続されている。
データセレクタ６０５の出力端子Ｙには、データセレク
タ６０６の入力端子Ａが接続され、その入力端子Ｂは指
定色用のレジスタ６０３の出力端子に接続されている。
タ６０６の入力端子Ａが接続され、その入力端子Ｂは指
定色用のレジスタ６０３の出力端子に接続されている。
また、データセレクタ６０６のセレクト端子Ｓには、ア
ンドゲート４０７の出力信号が印加される。
ンドゲート４０７の出力信号が印加される。
レジスタ６０１の出力端子には、データセレクタ６０７
の入力端子Ａが接続され、その入力端子Ｂはデータセレ
クタ６０６の出力端子Ｙに接続され、そのセレクト端子
Ｓにはオアゲート６０８の出力が接続されている。オア
ゲート６０８は、方の入力端子には処理結果（１）が入
力され、他方の入力端子には処理結果（ｎ）が入力され
る。
の入力端子Ａが接続され、その入力端子Ｂはデータセレ
クタ６０６の出力端子Ｙに接続され、そのセレクト端子
Ｓにはオアゲート６０８の出力が接続されている。オア
ゲート６０８は、方の入力端子には処理結果（１）が入
力され、他方の入力端子には処理結果（ｎ）が入力され
る。
さらに、データセレクタ６０７の出力端子Ｙにはデータ
セレクタ６０９の入力端子Ｂが接続され、その入力端子
Ａには入力画像データが印加される。
セレクタ６０９の入力端子Ｂが接続され、その入力端子
Ａには入力画像データが印加される。
また、データセレクタ６０９のセレクト端子には、レジ
スタ６０４の出力信号が印加され、さらにデー出力端子
Ｙから出力画像データが出力される。
スタ６０４の出力信号が印加され、さらにデー出力端子
Ｙから出力画像データが出力される。
なお、第６図の各データセレクタは、例えば、テキサス
インストルメンツ社製ＩＣ１ＳＮ５４１５７．５Ｎ５４
ＬＳ１５７．５Ｎ７４１５７、ＳＮ７４ ＬＳ １５７
などを用いることができる。
インストルメンツ社製ＩＣ１ＳＮ５４１５７．５Ｎ５４
ＬＳ１５７．５Ｎ７４１５７、ＳＮ７４ ＬＳ １５７
などを用いることができる。
第６図の構成では、ＣＰＵによって、レジスタ６０１、
レジスタ６０２、レジスタ６０３及びレジスタ６０４の
各々のセットが行われる。モード切換用レジスタ６０４
は、色情報を用いて細らせデータを、指定色にするか入
力画像データするかの選択を行うほか、処理を実行する
か否かの選択も行う。
レジスタ６０２、レジスタ６０３及びレジスタ６０４の
各々のセットが行われる。モード切換用レジスタ６０４
は、色情報を用いて細らせデータを、指定色にするか入
力画像データするかの選択を行うほか、処理を実行する
か否かの選択も行う。
処理の実行が選択された場合、選択内容に応して次のよ
うな処理が行われる。
うな処理が行われる。
■ イレースデータ
アンドゲート４０７の出カニオフ
（Ｌレベル）
アンドゲート４０９の出カニオフ
（Ｌレベル）
■
■
■
第１の指定色
アンドゲート４０７の出カニオフ
（Ｌレベル）
アンドゲート４０９の出カニオン
（Ｈレベル）
第２の指定色
アンドゲート４０７の出カニオン
（Ｈレベル）
アンドゲート４０９の出カニオン
（Ｈレベル）
モード切換用レジスタ６０４の出カ
ニ指定色データ
画像データ
アントゲート４０７の出カニオン
（Ｈレベル）
アンドゲート１４０９の出カニオン
（Ｈレベル）
モード切換用レジスタ６０４の出カ
ニ画像データ
また、処理を行わない場合、データセレクタ６０９は常
に画像データを選択する。以上の動作により、第５図の
（ｆ）に示す合成画像を得ることができる。
に画像データを選択する。以上の動作により、第５図の
（ｆ）に示す合成画像を得ることができる。
〔発明の効果］
以上より明らかなように、本発明によれば、入力画像デ
ータを２値化する２値化処理手段と、該手段による複数
ライン分のデータを記憶するラインメモリと、該ライン
メモリから読み出した原画データに対して太らせ処理及
び細らせ処理を行う画像加工部と、該画像加工部による
縁取り文字と細らせ文字を合成する色付処理部とを設け
るようにしたので、フレームメモリを用いることなく、
簡単な構成により、リアルタイムに模様画像を作成する
ことが可能になる。
ータを２値化する２値化処理手段と、該手段による複数
ライン分のデータを記憶するラインメモリと、該ライン
メモリから読み出した原画データに対して太らせ処理及
び細らせ処理を行う画像加工部と、該画像加工部による
縁取り文字と細らせ文字を合成する色付処理部とを設け
るようにしたので、フレームメモリを用いることなく、
簡単な構成により、リアルタイムに模様画像を作成する
ことが可能になる。
第１図は本発明による画像処理装置の概略構成を示すブ
ロック図、第２図は第１図の画像処理部の詳細を示すブ
ロック図、第３図はラインメモリ部の詳細を示す回路図
、第４図は画像加工部の詳細を示す回路図、第５図は本
発明による画像処理内容を示す説明図、第６図は色付は
処理部の詳細を示す回路図である。 符号の説明 １０１−画像読み取り部 １０２−・画像処理部１０３
−・−画像記録部 ２０１−＝２値化処理部２０２−・
−ラインメモリ部 ２０３−画像加工部２０４−色付は
処理部 ４０１．４０５．６０８−−オアゲート４０２．４０７
，４０１−アンドゲート４０３．４０４．４０８・・−
シフトレジスタ４０６・・−インバータ
ロック図、第２図は第１図の画像処理部の詳細を示すブ
ロック図、第３図はラインメモリ部の詳細を示す回路図
、第４図は画像加工部の詳細を示す回路図、第５図は本
発明による画像処理内容を示す説明図、第６図は色付は
処理部の詳細を示す回路図である。 符号の説明 １０１−画像読み取り部 １０２−・画像処理部１０３
−・−画像記録部 ２０１−＝２値化処理部２０２−・
−ラインメモリ部 ２０３−画像加工部２０４−色付は
処理部 ４０１．４０５．６０８−−オアゲート４０２．４０７
，４０１−アンドゲート４０３．４０４．４０８・・−
シフトレジスタ４０６・・−インバータ
Claims (1)
- 【特許請求の範囲】 入力画像データを２値化する２値化処理手段と、前記２
値化処理手段による複数ライン分のデータを記憶するラ
インメモリと、 前記ラインメモリから読み出した原画データに対して太
らせ処理及び細らせ処理を行う画像加工部と、 前記画像加工部による縁取り文字と細らせ文字を合成す
る色付処理部とを具備することを特徴とする画像処理装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2048226A JP3061830B2 (ja) | 1990-02-28 | 1990-02-28 | 画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2048226A JP3061830B2 (ja) | 1990-02-28 | 1990-02-28 | 画像処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03250971A true JPH03250971A (ja) | 1991-11-08 |
| JP3061830B2 JP3061830B2 (ja) | 2000-07-10 |
Family
ID=12797514
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2048226A Expired - Fee Related JP3061830B2 (ja) | 1990-02-28 | 1990-02-28 | 画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3061830B2 (ja) |
-
1990
- 1990-02-28 JP JP2048226A patent/JP3061830B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP3061830B2 (ja) | 2000-07-10 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |