JPH0325790B2 - - Google Patents
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- JPH0325790B2 JPH0325790B2 JP19288283A JP19288283A JPH0325790B2 JP H0325790 B2 JPH0325790 B2 JP H0325790B2 JP 19288283 A JP19288283 A JP 19288283A JP 19288283 A JP19288283 A JP 19288283A JP H0325790 B2 JPH0325790 B2 JP H0325790B2
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- Japan
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- display
- signal
- optical display
- drive
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Description
〔発明の技術分野〕
この発明は、複数の光表示素子を並設して構成
された表示ユニツトを利用し、２種類の入力信号
を、同一表示ユニツトに識別表示する表示装置に
関するものである。 〔従来技術〕 従来、この種の表示装置として実公昭58−216
号公報に記載のものがあつた。この従来装置を、
第１図〜第３図により要約して説明する。第１図
は表示ユニツトの構成説明図で、螢光表示セグメ
ント、LEDセグメント等からなる多数の光表示
素子Ｄが上下に所定間隔毎に一列に配列されてい
る。第２図ａ〜ｄは第１図に示す表示ユニツトに
よる表示画面の例を示し、同図において、Ａは第
１の入力信号の大きさを表示する第１表示部、Ｂ
は第２の入力信号の大きさを表示する第２表示部
である。第２図ａ，ｂでは第１表示部Ａが、１個
の非点灯表示素子の上下がそれぞれ５個の点灯表
示素子となるようにしてブランキング表示し、第
２表示部Ｂが、第１表示部Ａの点灯表示素子より
も高輝度で１個の表示素子を点灯表示するように
してあり、第２図ａは第１及び第２の入力信号の
大きさが異なる場合を、第２図ｂは第１及び第２
の入力信号の大きさが等しい場合をそれぞれ示し
ている。第２図ｃは、第１表示部Ａの非点灯表示
素子及び第２表示部Ｂの高輝度表示素子が何れも
３個であり、第１表示部Ａにおける非点灯表示素
子の上下の点灯表示素子がそれぞれ７個の場合を
示し、第２図ｄは第１の入力信号に属する２の入
力信号をそれぞれ同一構成の第１の表示部Ａ，
A′で表示する場合を示している。第３図は、第
１図の表示ユニツトに第２図ａ〜ｄの表示を行な
わせるための具体的回路構成を示す図で、入力端
子１1に供給されたアナログ入力信号の大きさは、
Ａ／Ｄコンバータ２1でデジタル信号に変換され
て制御ユニツト３に供給され、同様に入力端子１
２に供給されたアナログ入力信号の大きさは、
Ａ／Ｄコンバータ２2でデジタル信号に変換され
て制御ユニツト３に供給され、この制御ユニツト
３において、上記第２図における第１表示部Ａの
非点灯表示素子、点灯表示素子、第２表示部Ｂの
高輝度表示素子の位置及び数の設定、輝度の設定
等が行なわれ、駆動ユニツト４を介して表示ユニ
ツト５が上記第２図ａ〜ｄの表示を行なうように
してある。 従来の表示装置は上記のように、第１の表示部
Ａについては１〜３個の表示素子を非点灯とする
と共に、この非点灯表示素子を挟んでその上方及
び下方に５〜７個の表示素子を点灯させる所謂ブ
ランキング表示する構成であるので表示ユニツト
における表示素子の数を多数必要とするのは勿論
のこと、制御ユニツト、駆動ユニツトの構成も複
雑となる。しかも、第２表示部Ｂについては、１
〜３個の表示素子を、第１表示部Ａの点灯表示素
子より高輝度で点灯表示させる必要がある。即
ち、第２表示部Ｂの表示形態は第１表示部Ａの表
示形態と相違している。従つて、この相違によ
り、制御ユニツト、駆動ユニツトの構成は更に複
雑になる。 〔発明の概要〕 この発明は上記従来の実情に鑑みて表示ユニツ
トの構成、表示ユニツトの入力側回路の構成が簡
単であり安価な表示装置を提供することを目的と
するものであり、第１の入力信号が供給されると
この第１の入力信号に対応した数だけ光表示素子
が光表示するように各光表示素子への駆動信号を
選択的に発生する第１の駆動回路と、第２の入力
信号が供給されるとこの第２の入力信号に対応し
た数だけ上記光表示素子が光表示するように上記
各光表示素子への駆動信号を選択的に発生する第
２の駆動回路と、上記光表示素子の数だけ設けら
れそれぞれその対応光表示素子への両駆動回路の
各出力駆動信号を入力しこれら各出力駆動信号の
排他的論理和出力を対応光表示素子に供給する排
他的論理和ゲートとを有し、上記第２の駆動回路
の出力が断の期間と続の期間の異なる断続信号と
なるようにしたものである。 〔発明の実施例〕 第４図はこの発明の一実施例を示すブロツク
図、第５図は第４図に示す実施例による表示形態
の一例を示す図で、これらの図において、１1は
大きさが変化する第１のアナログ入力信号S1が供
給される第１の入力端子、２1は上記第１のアナ
ログ入力信号S1をその大きさに応じた第１のデジ
タル入力信号S11に変換する第１のＡ／Ｄ変換器、
４1は上記第１のデジタル信号S11が供給されその
連続出力信号S111，S112，S113，S114，S115を上記
第１のアナログ入力信号S1の大きさに応じた数だ
け選択的に発生する第１の駆動回路で、例えば上
記第１のアナログ入力信号S1が最大（100％）の
時には連続出力信号S111〜S115の総てを出力し、
また20％の大きさの時には連続出力信号S111のみ
を出力、40％の時には連続出力信号S111，S112を
出力し、60％の時にはS111，S112，S113を、80％
の時にはS111〜S114をそれぞれ出力する。１2は大
きさが変化する第２のアナログ入力信号S2が供給
される第２の入力端子で、上記第２のアナログ入
力信号S2は例えば、第１のアナログ入力信号S1が
可変の設定値信号であるとすれば、測定値信号で
あるというように、第１のアナログ入力信号S1と
は異なる信号発生源からの入力信号である。２2
は上記第２のアナログ入力信号S2をその大きさに
応じた第２のデジタル入力信号S21に変換する第
２のＡ／Ｄ変換器、４2は上記第２のデジタル信
号S21が振動接点装置６を介して断続信号SS21（但
し、断（休止）の期間の方が続（パルス）の期間
より短かい）として供給される第２の駆動回路
で、その断続出力信号SS211，SS212，SS213，
SS214，SS215を上記第２のアナログ入力信号S2の
大きさに応じた数だけ選択的に発生する。即ち、
上記第１の駆動回路４1の場合と同様に、上記第
２のアナロク入力信号の大きさが最大（100％）
の時には断続出力信号SS211〜SS215の総てを出力
し、また20％の大きさの時には断続出力信号
SS211のみを出力し、40％の時には断続出力信号
SS211，SS212を出力し、60％の時にはSS211，
SS212，SS213を、80％の時にはSS211〜SS214をそ
れぞれ出力する。なお、上記振動接点装置６は図
示のように第２のＡ／Ｄ変換器２2と第２の駆動
回路４2との間に直列接続されており、一定周期
で開閉を繰り返す。７は排他的論理和ゲート８1，
８2，８3，８4，８5群からなるゲートアレイで、
上記第１の駆動回路４1及び上記第２の駆動回路
４2の双方からそれらの出力駆動信号S111〜S115，
SS211〜SS215が供給される。更に詳述すれば、上
記各排他的論理和ゲート８1〜８5は何れも下記真
理値表に基づいて作動するもので、上記排他的論
理和ゲート８1は上記第１の駆動回路４1の出力駆
動信号S111と上記第２の駆動回路４2の出力駆動
信号SS211とを入力して下記真理値表に基づいて
出力信号S31を出し、同様に上記ゲート８2は出力
駆動信号S112，SS212を入力して出力信号S32を、
上記ゲート８3はS113，SS213を入力して出力信号
S33を、上記ゲート８4はS114，SS214を入力して出
力信号S34を、上記ゲート８5はS115，SS215を入力
して出力信号S35を、それぞれ下記真理値表に基
づいて出力する。
された表示ユニツトを利用し、２種類の入力信号
を、同一表示ユニツトに識別表示する表示装置に
関するものである。 〔従来技術〕 従来、この種の表示装置として実公昭58−216
号公報に記載のものがあつた。この従来装置を、
第１図〜第３図により要約して説明する。第１図
は表示ユニツトの構成説明図で、螢光表示セグメ
ント、LEDセグメント等からなる多数の光表示
素子Ｄが上下に所定間隔毎に一列に配列されてい
る。第２図ａ〜ｄは第１図に示す表示ユニツトに
よる表示画面の例を示し、同図において、Ａは第
１の入力信号の大きさを表示する第１表示部、Ｂ
は第２の入力信号の大きさを表示する第２表示部
である。第２図ａ，ｂでは第１表示部Ａが、１個
の非点灯表示素子の上下がそれぞれ５個の点灯表
示素子となるようにしてブランキング表示し、第
２表示部Ｂが、第１表示部Ａの点灯表示素子より
も高輝度で１個の表示素子を点灯表示するように
してあり、第２図ａは第１及び第２の入力信号の
大きさが異なる場合を、第２図ｂは第１及び第２
の入力信号の大きさが等しい場合をそれぞれ示し
ている。第２図ｃは、第１表示部Ａの非点灯表示
素子及び第２表示部Ｂの高輝度表示素子が何れも
３個であり、第１表示部Ａにおける非点灯表示素
子の上下の点灯表示素子がそれぞれ７個の場合を
示し、第２図ｄは第１の入力信号に属する２の入
力信号をそれぞれ同一構成の第１の表示部Ａ，
A′で表示する場合を示している。第３図は、第
１図の表示ユニツトに第２図ａ〜ｄの表示を行な
わせるための具体的回路構成を示す図で、入力端
子１1に供給されたアナログ入力信号の大きさは、
Ａ／Ｄコンバータ２1でデジタル信号に変換され
て制御ユニツト３に供給され、同様に入力端子１
２に供給されたアナログ入力信号の大きさは、
Ａ／Ｄコンバータ２2でデジタル信号に変換され
て制御ユニツト３に供給され、この制御ユニツト
３において、上記第２図における第１表示部Ａの
非点灯表示素子、点灯表示素子、第２表示部Ｂの
高輝度表示素子の位置及び数の設定、輝度の設定
等が行なわれ、駆動ユニツト４を介して表示ユニ
ツト５が上記第２図ａ〜ｄの表示を行なうように
してある。 従来の表示装置は上記のように、第１の表示部
Ａについては１〜３個の表示素子を非点灯とする
と共に、この非点灯表示素子を挟んでその上方及
び下方に５〜７個の表示素子を点灯させる所謂ブ
ランキング表示する構成であるので表示ユニツト
における表示素子の数を多数必要とするのは勿論
のこと、制御ユニツト、駆動ユニツトの構成も複
雑となる。しかも、第２表示部Ｂについては、１
〜３個の表示素子を、第１表示部Ａの点灯表示素
子より高輝度で点灯表示させる必要がある。即
ち、第２表示部Ｂの表示形態は第１表示部Ａの表
示形態と相違している。従つて、この相違によ
り、制御ユニツト、駆動ユニツトの構成は更に複
雑になる。 〔発明の概要〕 この発明は上記従来の実情に鑑みて表示ユニツ
トの構成、表示ユニツトの入力側回路の構成が簡
単であり安価な表示装置を提供することを目的と
するものであり、第１の入力信号が供給されると
この第１の入力信号に対応した数だけ光表示素子
が光表示するように各光表示素子への駆動信号を
選択的に発生する第１の駆動回路と、第２の入力
信号が供給されるとこの第２の入力信号に対応し
た数だけ上記光表示素子が光表示するように上記
各光表示素子への駆動信号を選択的に発生する第
２の駆動回路と、上記光表示素子の数だけ設けら
れそれぞれその対応光表示素子への両駆動回路の
各出力駆動信号を入力しこれら各出力駆動信号の
排他的論理和出力を対応光表示素子に供給する排
他的論理和ゲートとを有し、上記第２の駆動回路
の出力が断の期間と続の期間の異なる断続信号と
なるようにしたものである。 〔発明の実施例〕 第４図はこの発明の一実施例を示すブロツク
図、第５図は第４図に示す実施例による表示形態
の一例を示す図で、これらの図において、１1は
大きさが変化する第１のアナログ入力信号S1が供
給される第１の入力端子、２1は上記第１のアナ
ログ入力信号S1をその大きさに応じた第１のデジ
タル入力信号S11に変換する第１のＡ／Ｄ変換器、
４1は上記第１のデジタル信号S11が供給されその
連続出力信号S111，S112，S113，S114，S115を上記
第１のアナログ入力信号S1の大きさに応じた数だ
け選択的に発生する第１の駆動回路で、例えば上
記第１のアナログ入力信号S1が最大（100％）の
時には連続出力信号S111〜S115の総てを出力し、
また20％の大きさの時には連続出力信号S111のみ
を出力、40％の時には連続出力信号S111，S112を
出力し、60％の時にはS111，S112，S113を、80％
の時にはS111〜S114をそれぞれ出力する。１2は大
きさが変化する第２のアナログ入力信号S2が供給
される第２の入力端子で、上記第２のアナログ入
力信号S2は例えば、第１のアナログ入力信号S1が
可変の設定値信号であるとすれば、測定値信号で
あるというように、第１のアナログ入力信号S1と
は異なる信号発生源からの入力信号である。２2
は上記第２のアナログ入力信号S2をその大きさに
応じた第２のデジタル入力信号S21に変換する第
２のＡ／Ｄ変換器、４2は上記第２のデジタル信
号S21が振動接点装置６を介して断続信号SS21（但
し、断（休止）の期間の方が続（パルス）の期間
より短かい）として供給される第２の駆動回路
で、その断続出力信号SS211，SS212，SS213，
SS214，SS215を上記第２のアナログ入力信号S2の
大きさに応じた数だけ選択的に発生する。即ち、
上記第１の駆動回路４1の場合と同様に、上記第
２のアナロク入力信号の大きさが最大（100％）
の時には断続出力信号SS211〜SS215の総てを出力
し、また20％の大きさの時には断続出力信号
SS211のみを出力し、40％の時には断続出力信号
SS211，SS212を出力し、60％の時にはSS211，
SS212，SS213を、80％の時にはSS211〜SS214をそ
れぞれ出力する。なお、上記振動接点装置６は図
示のように第２のＡ／Ｄ変換器２2と第２の駆動
回路４2との間に直列接続されており、一定周期
で開閉を繰り返す。７は排他的論理和ゲート８1，
８2，８3，８4，８5群からなるゲートアレイで、
上記第１の駆動回路４1及び上記第２の駆動回路
４2の双方からそれらの出力駆動信号S111〜S115，
SS211〜SS215が供給される。更に詳述すれば、上
記各排他的論理和ゲート８1〜８5は何れも下記真
理値表に基づいて作動するもので、上記排他的論
理和ゲート８1は上記第１の駆動回路４1の出力駆
動信号S111と上記第２の駆動回路４2の出力駆動
信号SS211とを入力して下記真理値表に基づいて
出力信号S31を出し、同様に上記ゲート８2は出力
駆動信号S112，SS212を入力して出力信号S32を、
上記ゲート８3はS113，SS213を入力して出力信号
S33を、上記ゲート８4はS114，SS214を入力して出
力信号S34を、上記ゲート８5はS115，SS215を入力
して出力信号S35を、それぞれ下記真理値表に基
づいて出力する。
この発明は上記のように、第１の入力信号が供
給されるとこの第１の入力信号に対応した数だけ
光表示素子が光表示するように各光表示素子への
駆動信号を選択的に発生する第１の駆動回路と、
第２の入力信号が供給されるとこの第２の入力信
号に対応した数だけ上記光表示素子が光表示する
ように上記各光表示素子への駆動信号を選択的に
発生する第２の駆動回路と、上記光表示素子の数
だけ設けられそれぞれその対応光表示素子への両
駆動回路の各出力駆動信号を入力しこれら各出力
駆動信号の排他的論理和出力を対応光表示素子に
供給する排他的論理和ゲートとを設け、上記第２
の駆動回路の出力が断の期間と続の期間の異なる
断続信号となるようにしたので、上記従来の表示
装置のように、１〜３個の表示素子を非点灯とす
ると共にこの非点灯表示素子を挾んでその上方及
び下方に５〜７個の表示素子を点灯させる所謂複
雑なブランキング表示構成とする必要がなく、光
表示素子の数が少なくてよいばかりでなく、光表
示素子を光表示させるための制御・駆動回路の回
路構成が簡単になる。更に、上記従来の表示装置
のように、第２の入力信号に対する表示を、第１
の入力信号に対する表示と識別するために１〜３
個の表示素子を第１の入力信号に対する場合より
高輝度で点灯表示させ、しかも第１の入力信号に
対する光表示に使用する光表示素子の数と第２の
入力信号に対する光表示に使用する光表示素子の
数と常に一定の異なる数とするといつた複雑な制
御をする必要がないので、光表示素子を光表示さ
せるための制御・駆動回路の回路構成が更に簡単
になる。
給されるとこの第１の入力信号に対応した数だけ
光表示素子が光表示するように各光表示素子への
駆動信号を選択的に発生する第１の駆動回路と、
第２の入力信号が供給されるとこの第２の入力信
号に対応した数だけ上記光表示素子が光表示する
ように上記各光表示素子への駆動信号を選択的に
発生する第２の駆動回路と、上記光表示素子の数
だけ設けられそれぞれその対応光表示素子への両
駆動回路の各出力駆動信号を入力しこれら各出力
駆動信号の排他的論理和出力を対応光表示素子に
供給する排他的論理和ゲートとを設け、上記第２
の駆動回路の出力が断の期間と続の期間の異なる
断続信号となるようにしたので、上記従来の表示
装置のように、１〜３個の表示素子を非点灯とす
ると共にこの非点灯表示素子を挾んでその上方及
び下方に５〜７個の表示素子を点灯させる所謂複
雑なブランキング表示構成とする必要がなく、光
表示素子の数が少なくてよいばかりでなく、光表
示素子を光表示させるための制御・駆動回路の回
路構成が簡単になる。更に、上記従来の表示装置
のように、第２の入力信号に対する表示を、第１
の入力信号に対する表示と識別するために１〜３
個の表示素子を第１の入力信号に対する場合より
高輝度で点灯表示させ、しかも第１の入力信号に
対する光表示に使用する光表示素子の数と第２の
入力信号に対する光表示に使用する光表示素子の
数と常に一定の異なる数とするといつた複雑な制
御をする必要がないので、光表示素子を光表示さ
せるための制御・駆動回路の回路構成が更に簡単
になる。
第１図は従来の表示装置における表示ユニツト
の構成説明図、第２図ａ〜ｄはそれぞれ従来の表
示装置による表示形態を示す図、第３図は従来の
表示装置の回路構成を示すブロツク図、第４図は
この発明による表示装置の一実施例を示すブロツ
ク図、第５図ａ〜ｄはそれぞれこの発明の一実施
例による表示形態を示す図である。 図において、４1は第１の駆動回路、４2は第２
の駆動回路、５は表示ユニツト、８1，８2，８3，
８4，８5は排他的論理和ゲート、９1，９2，９3，
９4，９5は光表示素子である。なお、図中同一符
号は同一又は相当部分を示す。
の構成説明図、第２図ａ〜ｄはそれぞれ従来の表
示装置による表示形態を示す図、第３図は従来の
表示装置の回路構成を示すブロツク図、第４図は
この発明による表示装置の一実施例を示すブロツ
ク図、第５図ａ〜ｄはそれぞれこの発明の一実施
例による表示形態を示す図である。 図において、４1は第１の駆動回路、４2は第２
の駆動回路、５は表示ユニツト、８1，８2，８3，
８4，８5は排他的論理和ゲート、９1，９2，９3，
９4，９5は光表示素子である。なお、図中同一符
号は同一又は相当部分を示す。
Claims (1)
- 【特許請求の範囲】 １ それぞれ個別に駆動信号が供給されて光表示
する複数個の光表示素子を並設して構成された表
示ユニツト、第１の入力信号が供給されこの第１
の入力信号に対応した数だけ上記光表示素子が光
表示するように上記各光表示素子への駆動信号を
選択的に発生する第１の駆動回路、上記第１の入
力信号とは異なる第２の入力信号が供給されこの
第２の入力信号に対応した数だけ上記光表示素子
が光表示するように上記各光表示素子への駆動信
号を選択的に発生する第２の駆動回路、及び上記
光表示素子の数だけ設けられそれぞれその対応光
表示素子への両駆動回路の各出力駆動信号を入力
しこれら各出力駆動信号の排他的論理和出力を対
応光表示素子に供給する排他的論理和ゲートを備
え、上記第２の駆動回路の出力が断の期間と続の
期間の異なる断続信号となるようにしたことをこ
とを特徴とする表示装置。 ２ 第１及び第２の駆動回路の入力信号がＡ／Ｄ
変換されたデシタル信号であることを特徴とする
特許請求の範囲第１項記載の表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19288283A JPS6083994A (ja) | 1983-10-14 | 1983-10-14 | 表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19288283A JPS6083994A (ja) | 1983-10-14 | 1983-10-14 | 表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6083994A JPS6083994A (ja) | 1985-05-13 |
| JPH0325790B2 true JPH0325790B2 (ja) | 1991-04-08 |
Family
ID=16298543
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19288283A Granted JPS6083994A (ja) | 1983-10-14 | 1983-10-14 | 表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6083994A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6352194A (ja) * | 1986-08-22 | 1988-03-05 | カルロ・ガバッツイ・ホ−ルディング・アクチエンゲゼルシャフト | バ−グラフ表示方法 |
| JP2615422B2 (ja) * | 1994-03-23 | 1997-05-28 | 工業技術院長 | 時系列学習神経回路素子およびそれを用いた時系列学習神経回路 |
-
1983
- 1983-10-14 JP JP19288283A patent/JPS6083994A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6083994A (ja) | 1985-05-13 |
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