JPH03291580A - 整相回路 - Google Patents

整相回路

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JPH03291580A
JPH03291580A JP9450190A JP9450190A JPH03291580A JP H03291580 A JPH03291580 A JP H03291580A JP 9450190 A JP9450190 A JP 9450190A JP 9450190 A JP9450190 A JP 9450190A JP H03291580 A JPH03291580 A JP H03291580A
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phasing
phase delay
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Tokimori Kawamura
河村　時守
Izumi Hayashi
泉 林
Mitsuo Ono
小野　三男
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NEC Engineering Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は入力信号の整相回路に関し、例えば水中の目標
物を探知するンーナーにおいて、目標物から反射した信
号を入力信号として、ビームを形成するための整相回路
に関する。
〔従来の技術〕
従来、この種の整相回路は、所定の方位にビームを振ら
すために各入力チャネルにおいてビームに対応した遅延
量を入力信号に与えるが、この遅延量を与える素子にア
ナログ遅延線を使用していた（アナログ整相回路）。
〔発明が解決しようとする課題〕
従来のアナログ整相回路では、寸法、質量等ハード的規
模が大きくなるため、入カチャネル数、ビームチャネル
数を増やすことができにくく、従って広範囲の目標物の
捜索や分解能を上げることができるソーナー装置を実現
することが困難であった。
又、ディジタル整相回路においても、シフトレジスタを
用いる時間遅延整相回路のみの構成ではシフトレジスタ
の段数が非常に多く必要となるため実現は困難であり、
演算による位相遅延整相回路においても入力信号の周波
数が変移した場合、ビーム方位がずれてしまう、といっ
た問題点があった。
〔課題を解決するための手段〕
本発明によれば、入力信号゛を９０°位相の単位で時間
的に遅延するためのシフトレジスタを有する時間遅延整
相回路と、これより１／ｗ（ｗ：信号の帯域＠）周期で
実数部、虚数部の２成分を抽出するサンプリング回路と
、０°〜９０’の範囲の位相を補正するため演算によっ
て位相を遅延する位相遅延整相回路と、この回路の出力
を合皮してビームを形成するための演算回路を具備する
ことによって、時間遅延整相と位相遅延整相の２通りの
整相方式を合せ持ったソーナー装置の整相方式が得られ
る。
〔実施例〕
次に本発明について図面を参照して詳細に説明する。
第１図は本発明によるティジタル整相回路ブロック図で
ある。図で目標物で反射した音波は、送受波器ｌによっ
て電気信号に変えられ、入力信号としてＡ／Ｄ変換回路
２に入る。ここで入力信号はディジタルデータに変えら
れ、時間遅延整相回路３に送られる。
時間遅延整相回路３内では第２図のようにディジタルデ
ータをシフトレジスタに取り込み、９０゜位相のステッ
プでデータをシフトし時間的に遅延する。遅延されたデ
ータからサンプリング回路４によって１　／　ｗ周期で
（ｗ：信号帯域幅）実数部、虚数部データを取り出し、
これらを位相遅延整相回路５に送る。
位相遅延整送回路５では第３図のようにサンプリング回
路より２成分のデータを受けとり、演算によってＯ°〜
９０°位相の遅延を行っている。
ここまでの回路によって、ビーム方位に対応した遅延量
を入力信号に与え、なおかつ実数部、虚数部データを取
り出している。この取り出された２成分のデータを演算
回路６で受けとり、これらのデータから第３図のように
ビーム出力を演算し出力する。
〔発明の効果〕
以上説明したように本発明は、整相回路として時間遅延
整相と位相遅延整相を組合せたことでシフトレジスタの
段数を大幅に減らすことができ、０〜９０°内の限られ
た位相角範囲の補正のため入力信号の周波数変移による
影響も小さく、ビーム捩角のずれもほとんどなくすこと
ができる。
又、整相回路をディジタル化することで、整相回路自体
を小型化することができ、入力チャネルやビームチャネ
ルのチャネル数を増やし、目標物の捜索域を広げ、分解
能を上げるといった効果を有することができる。
５・・・・・・位相遅延整相回路、６・・・・・・演算
回路、第２図は第１図における時間遅延整相回路及びサ
ンプリング回路部を示す図である。
第３図は第１図における位相遅延整相回路及び演算回路
部を示す図である。

Claims (1)

  1. 【特許請求の範囲】 １、入力信号を９０°位相の単位で時間的に遅延する時
    間遅延整相回路と、１／ｗ（ｗ：信号の帯域幅）周期で
    ９０°位相差の信号データを実数部、虚数部の２成分と
    して抽出するサンプリング回路と、前記２成分のデータ
    を０°から９０°の範囲で演算によって位相を遅延する
    位相遅延整相回路と、前記位相遅延整相回路から出力さ
    れる２成分を合成する演算回路とを有することを特徴と
    する整相回路。 ２、前記位相遅延整相回路がサンプリング回路からの前
    記２成分に対して位相遅延量に応じた三角関数を乗算す
    る乗算器から構成されることを特徴とする特許請求の範
    囲第１項の整相回路。
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JP2001099914A (ja) * 1999-07-28 2001-04-13 Furuno Electric Co Ltd 信号処理方法、信号処理装置およびソナー装置
JP2013106931A (ja) * 2011-10-26 2013-06-06 Ge Medical Systems Global Technology Co Llc 受信回路、超音波プローブ及び超音波画像表示装置

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JPS6138477A (ja) * 1984-07-30 1986-02-24 Nec Corp 指向性ビ−ム形成回路

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