JPH032996Y2 - - Google Patents
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- Publication number
- JPH032996Y2 JPH032996Y2 JP18770383U JP18770383U JPH032996Y2 JP H032996 Y2 JPH032996 Y2 JP H032996Y2 JP 18770383 U JP18770383 U JP 18770383U JP 18770383 U JP18770383 U JP 18770383U JP H032996 Y2 JPH032996 Y2 JP H032996Y2
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- JP
- Japan
- Prior art keywords
- switch
- amplifier section
- function
- switches
- amplifier
- Prior art date
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- Expired
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- 238000010586 diagram Methods 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
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- Electronic Switches (AREA)
Description
【考案の詳細な説明】
本考案はシステムオーデイオにおけるフアンク
シヨン切換回路に関する。
シヨン切換回路に関する。
従来より、チユーナ、デツキ、プレーヤ等の各
種機器の出力が1台のアンプに接続され、アンプ
のフアンクシヨンスイツチによりこれら各種機器
のうちの1つを選択する様にしたシステムオーデ
イオ装置が知られている。最近ではこれらシステ
ムオーデイオ装置の上記各種機器にそれぞれ操作
釦を設け、上記アンプのフアンクシヨンスイツチ
を操作することも出来る様になされたものがあ
る。しかしながら、この様なオーデイオ装置では
上記機器を操作してフアンクシヨンスイツチを切
換えたあと、誤つてフアンクシヨンスイツチを直
接操作すると動作させていない他の機器を選択し
てしまう不都合を生ずる。
種機器の出力が1台のアンプに接続され、アンプ
のフアンクシヨンスイツチによりこれら各種機器
のうちの1つを選択する様にしたシステムオーデ
イオ装置が知られている。最近ではこれらシステ
ムオーデイオ装置の上記各種機器にそれぞれ操作
釦を設け、上記アンプのフアンクシヨンスイツチ
を操作することも出来る様になされたものがあ
る。しかしながら、この様なオーデイオ装置では
上記機器を操作してフアンクシヨンスイツチを切
換えたあと、誤つてフアンクシヨンスイツチを直
接操作すると動作させていない他の機器を選択し
てしまう不都合を生ずる。
本考案はこの様な欠点のないフアンクシヨン切
換装置を提供する為になされたもので、以下実施
例に従つて詳細に説明する。
換装置を提供する為になされたもので、以下実施
例に従つて詳細に説明する。
図は本考案の一実施例である。
図において、チユーナ1、デツキ2及びプレー
ヤ3の各機器のスタートスイツチ1−1,2−1
及び3−1のスタート出力1−4、2−4及び3
−4は、それぞれ制御ユニツト32のフリツプフ
ロツプ7,8及び9のセツト端子に接続れると共
に、スタート出力1−4は制御ユニツト32のア
ンド回路5及び6に加えられ、スタート出力2−
4は制御ユニツト32のアンド回路4及び6に加
えられ、スタート出力3−4はアンド回路及び6
に加えられる。上記アンド回路4,5及び6の出
力はそれぞれフリツプフロツプ7,8及び9のリ
セツト端子に加えられると共に、チユーナ1、デ
ツキ2及びプレーヤ3のストツプ制御端子1−
2,2−2及び3−2に加えられる。チユーナ
1、デツキ2及びプレーヤ3の出力端子1−3,
2−3及び3−3はアンプ34の入力端子22,
23及び24を介してそれぞれアンプ34のフア
ンクシヨンスイツチ33のスイツチ18,19及
び20に接続される。フリツプフロツプ7,8及
び9の出力はそれぞれアンプ34のアンド回路1
3,14及び15に接続される。アンプ34の、
一端が接地されやフアンクシヨン制御スイツチ1
0,11及び12の他端は、アンド回路13,1
4及び15に接続される。アンプ34のAUX端
子21はフアンクシヨンスイツチ33のスイツチ
17に接続された。フアンクシヨン制御スイツチ
16の一端はアンド回路4,5及び6に接続され
ると共に、フアンクシヨンスイツチ33の制御端
子25に接続され、他端は接地されている。アン
ド回路13,14及び15の出力はそれぞれフア
ンクシヨンスイツチ33の制御端子26,27及
び28に接続される。スイツチ17,18,19
及び20の出力はアンプ29で増幅されて出力端
子30に導出される。
ヤ3の各機器のスタートスイツチ1−1,2−1
及び3−1のスタート出力1−4、2−4及び3
−4は、それぞれ制御ユニツト32のフリツプフ
ロツプ7,8及び9のセツト端子に接続れると共
に、スタート出力1−4は制御ユニツト32のア
ンド回路5及び6に加えられ、スタート出力2−
4は制御ユニツト32のアンド回路4及び6に加
えられ、スタート出力3−4はアンド回路及び6
に加えられる。上記アンド回路4,5及び6の出
力はそれぞれフリツプフロツプ7,8及び9のリ
セツト端子に加えられると共に、チユーナ1、デ
ツキ2及びプレーヤ3のストツプ制御端子1−
2,2−2及び3−2に加えられる。チユーナ
1、デツキ2及びプレーヤ3の出力端子1−3,
2−3及び3−3はアンプ34の入力端子22,
23及び24を介してそれぞれアンプ34のフア
ンクシヨンスイツチ33のスイツチ18,19及
び20に接続される。フリツプフロツプ7,8及
び9の出力はそれぞれアンプ34のアンド回路1
3,14及び15に接続される。アンプ34の、
一端が接地されやフアンクシヨン制御スイツチ1
0,11及び12の他端は、アンド回路13,1
4及び15に接続される。アンプ34のAUX端
子21はフアンクシヨンスイツチ33のスイツチ
17に接続された。フアンクシヨン制御スイツチ
16の一端はアンド回路4,5及び6に接続され
ると共に、フアンクシヨンスイツチ33の制御端
子25に接続され、他端は接地されている。アン
ド回路13,14及び15の出力はそれぞれフア
ンクシヨンスイツチ33の制御端子26,27及
び28に接続される。スイツチ17,18,19
及び20の出力はアンプ29で増幅されて出力端
子30に導出される。
以上の構成による動作を説明する。今チユーナ
1のスタートスイツチ1−1を押すと、、負パル
スが発生してフリツプフロツプ7をセツトしその
出力を低レベルにするので、アンド回路13の出
力が低レベルになる。一方上記負パルスによりア
ンド回路5及び6の出力が低レベルになるので、
フリツプフロツプ8及び9がリセツトされてその
出力が高レベルになる。従つてフアンクシヨン制
御スイツチ11又は12が押されない限り、アン
ド回路14及び15の入力端子はいずれも高レベ
ルであり、その出力は高レベルとなる。ここでフ
アンクシヨンスイツチ33は第1回路4接点スイ
ツチの動作をする周知の半導体スイツチ回路で、
制御端子25〜28のいずれかが低レベルになる
と、以後はスイツチ17〜20のうちの対応する
もののみがオン状態を保持する様になされてい
る。従つて上述の場合はアンド回路13が接続さ
れた制御端子26だけが低レベルになるので、チ
ユーナ1の出力端子1−3からの出力が増幅器2
9により増幅される。又各機器1〜3の各ストツ
プ制御端子が高レベルであると各機器は停止状態
となる様になされている。従つてこの場合はアン
ド回路5及び6の出力が高レベルであるから、デ
ツキ2及びプレーヤ3が停止状態になされる。
1のスタートスイツチ1−1を押すと、、負パル
スが発生してフリツプフロツプ7をセツトしその
出力を低レベルにするので、アンド回路13の出
力が低レベルになる。一方上記負パルスによりア
ンド回路5及び6の出力が低レベルになるので、
フリツプフロツプ8及び9がリセツトされてその
出力が高レベルになる。従つてフアンクシヨン制
御スイツチ11又は12が押されない限り、アン
ド回路14及び15の入力端子はいずれも高レベ
ルであり、その出力は高レベルとなる。ここでフ
アンクシヨンスイツチ33は第1回路4接点スイ
ツチの動作をする周知の半導体スイツチ回路で、
制御端子25〜28のいずれかが低レベルになる
と、以後はスイツチ17〜20のうちの対応する
もののみがオン状態を保持する様になされてい
る。従つて上述の場合はアンド回路13が接続さ
れた制御端子26だけが低レベルになるので、チ
ユーナ1の出力端子1−3からの出力が増幅器2
9により増幅される。又各機器1〜3の各ストツ
プ制御端子が高レベルであると各機器は停止状態
となる様になされている。従つてこの場合はアン
ド回路5及び6の出力が高レベルであるから、デ
ツキ2及びプレーヤ3が停止状態になされる。
この様にして各機器1〜3のスタートスイツチ
のうち所望のものを押すと、その機器の出力が、
増幅されて出力端子30に導出され、他の機器は
停止状態になされる。
のうち所望のものを押すと、その機器の出力が、
増幅されて出力端子30に導出され、他の機器は
停止状態になされる。
ここで、誤つてフアンクシヨン制御スイツチ1
0〜12うちいずれかを押した場合、アンド回路
13〜15の出力のうち対応するものが一瞬低レ
ベルになるので、フアンクシヨンスイツチ33は
一度は切り換ることがあつても、依然として、フ
リツプフロツプ回路7〜9のいずれかが低レベル
となつているので、直ちにもとへ戻つてこれまで
受聴していた機器が選択される。次にフアンクシ
ヨン制御スイツチ16を押した場合は、アンド回
路4〜6の出力が低レベルとなつて、フリツプフ
ロツプ7〜9がリセツトされてその出力が高レベ
ルになるので、アンド回路13〜15の出力は高
レベルになるのでスイツチ18〜20はいずれも
オフになる。一方スイツチ16によりフアンクシ
ヨン制御端子25が低レベルとなつてスイツチ1
7がオンとなり、AUX端子21が増幅器29に
接続される。
0〜12うちいずれかを押した場合、アンド回路
13〜15の出力のうち対応するものが一瞬低レ
ベルになるので、フアンクシヨンスイツチ33は
一度は切り換ることがあつても、依然として、フ
リツプフロツプ回路7〜9のいずれかが低レベル
となつているので、直ちにもとへ戻つてこれまで
受聴していた機器が選択される。次にフアンクシ
ヨン制御スイツチ16を押した場合は、アンド回
路4〜6の出力が低レベルとなつて、フリツプフ
ロツプ7〜9がリセツトされてその出力が高レベ
ルになるので、アンド回路13〜15の出力は高
レベルになるのでスイツチ18〜20はいずれも
オフになる。一方スイツチ16によりフアンクシ
ヨン制御端子25が低レベルとなつてスイツチ1
7がオンとなり、AUX端子21が増幅器29に
接続される。
又、制御ユニツト32を用いない場合、アンド
回路13〜15はフアンクシヨン制御スイツチ1
0〜12によつてのみ制御される。従つてこの場
合はフアンクシヨン制御スイツチ10,11,1
2及び16のうちいずれかを押すことにより、フ
アンクシヨンスイツチ18,19,20及び16
のうちの任意のものを選択することが出来る。
回路13〜15はフアンクシヨン制御スイツチ1
0〜12によつてのみ制御される。従つてこの場
合はフアンクシヨン制御スイツチ10,11,1
2及び16のうちいずれかを押すことにより、フ
アンクシヨンスイツチ18,19,20及び16
のうちの任意のものを選択することが出来る。
以上の様に本考案によれば、アンプに接続され
た複数の機器のうち所望のものを、上記機器に設
けられた操作スイツチにより選択することが出
来、誤つてアンプに設けられたフアンクシヨンス
イツチを操作しても上記各機器のうち上記操作ス
イツチによりあらかじめ選択してあつたものが再
び優先して選択され、しかもこの様な操作スイツ
チを持たない機器をアンプに接続する場合は従来
同様にアンプのフアンクシヨンスイツチにより任
意に選択することが出来る等の優れた効果を得る
ことが出来る。
た複数の機器のうち所望のものを、上記機器に設
けられた操作スイツチにより選択することが出
来、誤つてアンプに設けられたフアンクシヨンス
イツチを操作しても上記各機器のうち上記操作ス
イツチによりあらかじめ選択してあつたものが再
び優先して選択され、しかもこの様な操作スイツ
チを持たない機器をアンプに接続する場合は従来
同様にアンプのフアンクシヨンスイツチにより任
意に選択することが出来る等の優れた効果を得る
ことが出来る。
図は本考案の一実施例を示す回路図である。
1……チユーナ、2……デツキ、3……プレー
ヤ、32……制御ユニツト、34……アンプ。
ヤ、32……制御ユニツト、34……アンプ。
Claims (1)
- それぞれがスタートスイツチを有する複数の機
器と、該複数の機器にそれぞれ対応した複数の第
1の外部入力端子及び少くとも1つの第2の外部
入力端子を有すると共にこれら各外部入力端子の
うちのいずれか1つを選択して内部増幅器に伝達
するフアンクシヨンスイツチを有するアンプ部
と、上記各スタートスイツチに対応して上記アン
プ部外に設けられ上記各スタートスイツチのうち
直近に操作されたスタートスイツチに対応するも
のが出力を出し続ける複数の記憶手段と、上記ア
ンプ部外に設けられ上記複数の機器のうちスター
トスイツチが直近に操作されたもの以外の機器を
停止させる手段と、上記各記憶手段にそれぞれ対
応して上記アンプ部内に設けられた複数の第1の
マニアルスイツチと、該各第1のマニアルスイツ
チとこれらにそれぞれ対応する上記各記憶手段の
各出力同志の論理和を得る上記アンプ部内に設け
られた複数の論理和手段と、上記アンプ部内に設
けられた第2マニアルスイツチと、該第2マニア
ルスイツチの出力により上記各機器を停止させる
手段と、上記各論理手段及び第2のマニアルスイ
ツチの出力に応じて上記フアンクシヨンスイツチ
のうちの1つを動作させる手段とを有することを
特徴とするシステムオーデイオのフアンクシヨン
切換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18770383U JPS6095738U (ja) | 1983-12-05 | 1983-12-05 | システムオ−デイオのフアンクシヨン切換回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18770383U JPS6095738U (ja) | 1983-12-05 | 1983-12-05 | システムオ−デイオのフアンクシヨン切換回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6095738U JPS6095738U (ja) | 1985-06-29 |
| JPH032996Y2 true JPH032996Y2 (ja) | 1991-01-25 |
Family
ID=30405109
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18770383U Granted JPS6095738U (ja) | 1983-12-05 | 1983-12-05 | システムオ−デイオのフアンクシヨン切換回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6095738U (ja) |
-
1983
- 1983-12-05 JP JP18770383U patent/JPS6095738U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6095738U (ja) | 1985-06-29 |
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