JPH0334312U - - Google Patents

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JPH0334312U
JPH0334312U JP9411789U JP9411789U JPH0334312U JP H0334312 U JPH0334312 U JP H0334312U JP 9411789 U JP9411789 U JP 9411789U JP 9411789 U JP9411789 U JP 9411789U JP H0334312 U JPH0334312 U JP H0334312U
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  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Description

【図面の簡単な説明】
第１図は本考案の一実施例を示すブロツク図、
第２図は一実施例の動作を説明するためのタイミ
ング図、第３図は一実施例の動作を説明するため
のメモリ図である。第４図は本考案の他の実施例
を説明するための要部回路図、第５図および第６
図は本考案の他の実施例を示す要部ブロツク図で
ある。第７図はデジタルシンセサイザの基本構成
を示すブロツク図、第８図は従来装置を示すブロ
ツク図である。 １０……周波数設定部、１１……上位シフトレ
ジスタ、１２……上位設定レジスタ、１４……Ｂ
ＣＤ加算器、１５……キヤリレジスタ、１７……
下位シフトレジスタ、１８……下位設定レジスタ
、２０……上位加算器、２２……下位加算器、２
４……ＲＯＭ回路、２５……ＤＡ変換器、２６…
…分周器。

Claims (1)

  1. 【実用新案登録請求の範囲】 複数桁のＢＣＤコードを含む周波数ゲータをＮ
    倍にして設定する周波数設定手段１０と、 前記周波数設定手段に設定されたデータに応じ
    たステツプで変化するアドレス値を出力するアド
    レス可変手段２０〜２３と、 予め所定の波形データが記憶され、前記アドレ
    ス値に対応する波形データを出力する波形データ
    記憶手段２４と、 前記波形データ記憶手段から順次出力される波
    形データをアナログ信号に変換して出力するデジ
    タルアナログ変換器２５と、 前記アナログ信号を１／Ｎに分周する分周器２
    ６とを備えたデジタルシンセサイザにおいて、 前記周波数設定手段は、前記複数桁のＢＣＤコ
    ードの周波数データを、下位の桁から順に１桁ず
    つ受け、該受けた１桁のデータと前桁のキヤリデ
    ータとを加算し、Ｎ倍して得られたデータを、下
    位の桁から順に設定するように構成されているこ
    とを特徴とするデジタルシンセサイザ。
JP9411789U 1989-08-10 1989-08-10 デジタルシンセサイザ Expired - Lifetime JP2561394Y2 (ja)

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JP9411789U JP2561394Y2 (ja) 1989-08-10 1989-08-10 デジタルシンセサイザ

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JPH0334312U true JPH0334312U (ja) 1991-04-04
JP2561394Y2 JP2561394Y2 (ja) 1998-01-28

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0754179A (ja) * 1993-08-06 1995-02-28 Kimura Chem Plants Co Ltd 洗浄乾燥装置
JP2022159932A (ja) * 2021-04-05 2022-10-18 興治郎 川井 ダイレクトデジタルシンセサイザ

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0754179A (ja) * 1993-08-06 1995-02-28 Kimura Chem Plants Co Ltd 洗浄乾燥装置
JP2022159932A (ja) * 2021-04-05 2022-10-18 興治郎 川井 ダイレクトデジタルシンセサイザ

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JP2561394Y2 (ja) 1998-01-28

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