JPH0345073A - 原稿読取り装置 - Google Patents

原稿読取り装置

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JPH0345073A
JPH0345073A JP1181259A JP18125989A JPH0345073A JP H0345073 A JPH0345073 A JP H0345073A JP 1181259 A JP1181259 A JP 1181259A JP 18125989 A JP18125989 A JP 18125989A JP H0345073 A JPH0345073 A JP H0345073A
Authority
JP
Japan
Prior art keywords
line
shift
timing signal
signals
ccd
Prior art date
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Pending
Application number
JP1181259A
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English (en)
Inventor
Yoshinobu Kagami
宜伸 加賀美
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Ricoh Co Ltd
Original Assignee
Ricoh Co Ltd
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、読取り素子としてCCD構成のラインイメー
ジセンサを用いたデジタル複写機、ファクシミリ等の原
稿読取り装置に関する。
従来の技術 一般に、原稿読取り装置において、原稿を副走査方向に
走査して読取るために移動するキャリッジに、イメージ
センサやこのイメージセンサに必要な処理部の内の一部
を載せて読取る方式のものにあっては、イメージセンサ
として一般に等倍ラインイメージセンサが用いられる。
このような等倍センサによれば、大型の縮小光学系を必
要とする通常の小型のCCDの場合に比して、光学系の
構成を単純化させることができ、装置全体を小型にでき
るとともに、光学的な位置ずれが少なくなる等の長所が
ある。
第3図は、このような等倍ラインイメージセンサ1を用
いたA3サイズ対応の原稿読取り装置の一例を示すもの
である。まず、装置本体2上部のコンタクトガ、ラス3
上に載置され原稿圧板4により押えられた原稿(図示せ
ず)をスリット露光する光源として2木の蛍光灯5が設
けられている。
原稿からの反射光はセルフォックレンズアレイ6を経て
イメージセンサ1に結像されて光電変換される。これら
のイメージセンサl、蛍光灯5及びレンズアレイ6は、
ガイドシャフト7によりガイドされて副走査方向に走査
移動するキャリッジ8上に搭載されている。ここに、キ
ャリッジ8の駆動は駆動モータ(図示せず)を駆動源と
して複数個のプーリ9を経て一部がキャリッジ8に連結
された駆動ワイヤ10により行われる。
このような等倍センサの場合、1チツプのCCDのみで
は読取り長に限度があるため、同一基板上に複数チップ
のCCDを搭載させて分割読取りさせることにより読取
り長を長くするのが一般的である。また、各CCDチッ
プによる読取りを主走査方向に同一画素ピッチで連続さ
せるため、複数のCCDチップを同一線上ではなく、互
いに少しずつオーバラップさせつつ2列千鳥状配列させ
ることも一般に行われる。第4図はこのような2列千鳥
配列構造のラインイメージセンサ1の一例(例えば、株
式会社東芝製のCCDリニアイメージセンサTCD 1
16 DC)の概略構造を示すものである。これは、A
3短手サイズ読取り用として、5つのCCD11を同一
基板12上に2列に千鳥状配列させたものである。各C
C:D11はS1〜52928で示すように2928画
素ずつの読取りが可能なものである。ここに、千鳥配列
の場合、副走査方向の列の位置によって同一ラインの読
取りタイミングが異なり、先行して走査する偶数列グル
ープ(副走査方向に見て先行列グループとなる)の2つ
のC,CDIIゎと、後行して走査する奇数列グループ
(後行列グループとなる)の3つのCCD11oDとに
分けられる。
第5図は、このようなCGDIIの各チップの電気的な
回路構成を示すブロック図である。まず、31〜329
28で示すフォトダイオードセル13部分がDo−D7
1で示すダミーフォトダイオードセル14部分とともに
直線的に設けられ、障壁電極15に接続されている。こ
の障壁電極15以下は、蓄積電極16、第1〜第7ライ
ンシフトゲート17〜23、シフトゲート24が順に設
けられ、最終的に水平CCDレジスタ25に接続されて
いる。これらのゲート17〜24、レジスタ25はシフ
トレジスタとなるものである。
このようなCCD11は、リセットパルスR3等ととも
に、各ラインシフトゲート17〜23に対するラインシ
フト信号φV5〜φV9、シフトゲート24に対するシ
フトパルスSH1水平CCDレジスタ25に対する駆動
クロックφIA、φ2A。
φ28等により駆動される。まず、フォトダイオードセ
ル13の受光面に照射されたlライン分の撮像は、電荷
量に変換され障壁電極15を通った後、第1ラインシフ
トゲート17に対してラインシフト信号φV1 のパル
スが入った時から蓄積電極16に蓄積され始め、次のラ
インシフト信号φV、のパルスにより完了する。つまり
、ある1つのCGDIIの受光量を決定する光信号蓄積
時間は第6図に示すようにこの第1ラインシフト信号φ
V、の出力される間隔による。蓄積完了と同時に、今ま
で蓄積電極16に蓄積された電荷は、第1ラインシフト
ゲート17にシフトされ、蓄積電極16は次ラインの電
荷を蓄え始める。第1ラインシフトゲート17にシフト
された信号は、次のラインシフト信号φV、により第2
ラインシフトゲート18にシフトされる。以下の、ライ
ンシフトゲートi9〜23についても同様にシフト動作
が行われて、第7ラインシフトゲート23までシフトさ
れる。そして、第7ラインシフトゲート23の信号はシ
フトパルスSHによりシフトゲート24を通った後、水
平CCDレジスタ25にシフトされ、駆動クロックφI
 A、 φ2A、φ2Bによって画像信号O8として順
次出力される(CCD駆動)。
ここに、画像信号O8出力のタイミングの一例をみると
、例えば第7図に示すように、空送り(Do−Dllな
る12画素分)十光シールド画素信号(D12〜D59
なる48画素分)十空送り(D60〜D71なる12画
素分)とからなるダミー信号(72画素分)後が、本来
のV。IVBIVRなるカラー有効画素信号(2928
画素分)の読取り範囲となる。よって、1ライン出力期
間は3000画素分からなる。
このようにしてイメージセンサlが原稿を読取るために
は、ある定められたタイミング信号が電源とともに各C
GDIIに入力されなければならず、かつ、読取った画
像信号O8についてアナログ・デジタル変換などの処理
をしなければならない。この時、第3図に示したように
イメージセンサlはキャリッジ8上に搭載されており、
副走査動作とともに移動するものであり、装置本体2の
電源部26やタイミング信号発生部27側と、キャリッ
ジ8側とを第3図に示すようにキャリッジ8の動きに追
従し得る可撓性及び長さを有する伝送線28により電気
的に接続する必要がある。
ここに、伝送線28は電源線と各種タイミング信号線と
画像信号出力線などよりなるが、これらの線が別々に配
設されていると、キャリッジ8の走行時に線同士にから
みやねじれを生じ、キャリッジ8の円滑な走行が妨げら
れるとともに、断線や短絡等の故障の原因ともなり、好
ましくない。
このようなことから、複数本の伝送線28をまとめてリ
ボン状としたものが特開昭62−86611号公報によ
り提案され、実際に製品化されている。ここに、リボン
状とされた伝送線28において、電源線はある程度太く
しなければならず、タイミング信号線や画像信号出力線
は同軸線であることが望ましい。このため、各線側々で
はそれ程ではないが、線の本数が多くなるにつれ、曲げ
力が大きくなるため、キャリッジ8やその駆動モータの
負荷が大きくなり、負担がかかる。また、複数本の伝送
線28をリボン状にしたとしても移動部分の信頼性の低
下は避けられず、本数が多ければ多い程、ねじれやから
みによる問題が起こる確率が高くなる。また、本数が多
いことはコスト的にも不利となる。特に、同軸線にあっ
てはコスト高となる。従って、装置本体2側とキャリッ
ジ8側とを接続する伝送線28の本数はできるだけ少な
い方がよい。
発明が解決しようとする課題 ところが、上記の如きリボン状の伝送線方式を実装した
実際の回路構成を見ると、第8図に示すような構成とな
っており、伝送線28の本数の多いものである。即ち、
第8図はラインイメージセンサ1用の駆動回路等の一部
を示すもので、タイミング信号線だけを考えても、これ
らを全て装置本体2のタイミング信号発生部27側で生
成して個別に伝送させているため、タイミング信号コネ
クタ29に対して22本の伝送線を要しているものであ
る。
この点を、より詳細に説明する。ラインイメージセンサ
lを構成する5つのCGDIIは、前述したように先行
して走査する偶数列グループのCGDIIゎと、後行し
て走査する奇数列グループのCGDII。0からなる。
このように走査タイミングの異なる2グループであって
も、画像信号出力が同一ラインについては同時となるよ
うに、タイミング信号発生部27は、偶数列グループ用
のラインシフト信号φV、、V〜φV v E V、シ
フトパルスSHgv、駆動クロックφ111V、φ2E
V及びリセットパルスRSEVを生成して伝送し、奇数
列グループ用のラインシフト信号φV + OD〜φV
 * Q D s シフトパルス5HoI)、駆動クロ
ックφ10D、φ2oD及びリセットパルスR3ooを
生成して伝送する。
これにより、合計22本の伝送線28を必要としている
。タイミング信号コネクタ29を経た後は、マトリック
ス配線回路30.  ドライブ回路31を経て各CGD
IIに分配される。
よって、従来方式によると、伝送線28のリボン状化等
の対策はなされているものの、本数の多いものであり、
伝送線トラブルに関する対策が不十分なものである。
課題を解決するための手段 原稿面を露光する光源と、各々駆動クロックにより駆動
されて出力するシフトレジスタを持つ複数個のCCDが
主走査方向に2列千鳥状に配列され前記原稿面からの反
射光を受光して光電変換するラインイメージセンサとを
、前記原稿面に対して副走査方向に移動するキャリッジ
上に搭載し、このキャリッジ側とタイミング信号発生部
を備えた装置本体側とを複数の伝送線で電気的に接続し
た原稿読取り装置において、前記伝送線により前記ライ
ンイメージセンサ中の副走査方向先行列グループの各C
CDと副走査方向後行列グループの各CCDとに対する
タイミング信号を、CCDの蓄積時間を決定するグルー
プ別のラインシフト信号を除き、共通に伝送させてグル
ープ毎に振り分けるタイミング信号処理回路を前記キャ
リッジ上に設けた。
さらには、タイミング信号処理回路が、グロックパルス
とCCDの蓄積時間を決定するグループ別のラインシフ
ト信号とによるタイミング信号の伝送線による伝送を受
けてこれらのタイミング信号のシフト処理により2グル
ープのCCDのシフトレジスタ用の残りのラインシフト
信号を生成するシフト信号生成部を有するものとして構
成した。
作用 千鳥状配列構成された複数のCCDの動作を考えた場合
、副走査方向先行列グループに属するCCDと副走査方
向後行列グループに属するCCDとでは、グループ毎に
その蓄積時間を決めるラインシフト信号さえ別個に確保
できれば、他のタイミング信号は共通であっても何んら
支障ない。つまり、タイミング信号についてはその伝送
線の本数を減らすことが可能である。よって、タイミン
グ信号伝送用に2グル一プ分の伝送線を別個に用意する
必要はなく、蓄積時間を決めるラインシフト信号を除き
タイミング信号を共通に伝送させてキャリッジ上に搭載
のタイくング信号処理回路において振り分ければよく、
タイミング信号用の伝送線の本数を半減させることがで
きる。よって、伝送線のねじれやからみの発生が減少し
、キャリッジの走行移動も円滑なものとなり、その負担
も軽減できる。また、低コスト化も可能となる。
さらには、(、CDのシフトレジスタ駆動用に要する複
数のラインシフト信号なるタイミング信号にあっては、
相互に所定のシフトタイミング関係にあり、伝送線によ
り個別に伝送しなくても容易に生成し得る。よって、キ
ャリッジ上に搭載のタイミング信号処理回路においてシ
フト信号生成部を持つことにより、クロックパルスとと
もに、基本となるCCDの蓄積時間を決定するグループ
別のラインシフト信号だけを伝送線により伝送させるだ
けで、残りの必要なラインシフト信号を生成できる。よ
って、より一層伝送線の本数を少ないものとすることが
できる。
実施例 本発明の一実施例を第1図及び第2図に基づいて説明す
る。第3図ないし第8図で示した部分と同一部分は同一
符号を用いて示す。本実施例は、伝送線28中、タイミ
ング信号伝送用の本数を、従来の22本から7本に大幅
に削減させるようにしたものである。
まず、タイミング信号発生部27により生成させ伝送線
28により伝送させるタイミング信号は、シフトクロッ
クSH1駆動クロックφ1.φ2、クロックパルスφC
LK s リセットパルスR3,CGDIIの蓄積時間
を決定するための基本的なラインシフトクロックφV□
、  φV、FLの7つの信号である(第1図上は負論
理で示す)。これに対応して伝送線28にて伝送される
信号を受けるタイミング信号コネクタ32は7端子を有
するものとされている。このタイミング信号コネクタ3
2より入力したこれらの7つの信号は、タイミング信号
処理回路33により各CCDIIに分配される。
このタイミング信号処理回路33は駆動クロックφ2か
らφ2^、φ2Bを生成して、7つの信号を8つの信号
にするIC構成の変換処理回路34と、各CGDIIに
対して各信号を分配するマトリックス配線回路35と、
変換処理回路34とマトリックス配線回路35との間に
設けられてクロックパルスφCLに、ラインシフト信号
φVo及びφV、Eに基づくシフト処理により各グルー
プのラインシフト信号φV1〜φV、を生成する2つの
シフトレジスタ36.37によるシフト信号生成部38
とよりなる。
このような構成は、次のような思想に基づくものである
。まず、第4図に示したような千鳥状配列構造のCCD
1lの動作を考えた場合、偶数列グループと奇数列グル
ープとで、シフトクロックSH1駆動クロックφl、φ
2は共通、即ち全てのCGDIIに共通に使用しても何
んら支障ない。
また、7つのラインシフト信号φV、〜φV、について
はその基本となるグループ別の蓄積時間決定用のライン
シフト信号が別個であれば、ラインシフト信号φV、〜
φV、は共通に用いても支障ない。
つまり、偶数列グループ用と奇数列グループ用とで殆ど
のタイミング信号を共通化させても支障がなく、2グル
ープの共通化のみを考慮しただけでも、基本的には、伝
送線28を従来の22本に対しほぼ半減させ得る(12
本)。
さらに、ラインシフト信号を考えると、前述したように
各CGDIIの蓄積時間を決める信号がグループで別々
であればよい。ここではラインシフト信号φv16が偶
数列グループのCCDIIEV用の蓄積時間決定用であ
る。これは、第2図に示すように、変倍率によってその
位相が変るものであり、タイミング信号発生部27にお
いて変倍率に応じて何れか1つが選択される。その他の
ラインシフト信号、即ち奇数列グループ用のラインシフ
ト信号φV、〜φV、及び偶数列グループ用のラインシ
フト信号φv3〜φV7は、所定タイミングで発生する
基本のラインシフト信号φV、をシフト処理することに
より生成できるものであり、全てを個々に伝送線28を
用いて伝送させる必要はなく、キャリッジ8上のタイミ
ング信号処理回路33中での処理により生成しても何ん
ら支障ない。
具体的には、信号としてφCLK、φV 、 B及びφ
V。
の3つのみとし、シフトレジスタ36.37によるシフ
ト処理生成できる。第2図図示例は、ラインシフト信号
φV 、 1!とじてタイミング2945のものが選択
されている場合を示し、このラインシフト信号φV、H
の出力後の最初のクロックφlの立下りであって最初の
ラインシフト信号φV1 より位相的に少し早いタイミ
ングなる所定タイミングで生ずるラインシフト信号φ■
、をクロックパルスφCLKのタイミングで順次シフト
処理することにより、第2図に示すように偶数列及び奇
数列グループ用のラインシフト信号φV1〜φV、を生
成できる。よって、伝送線28の本数を、従来の22本
から半減に留まらず、7本に大幅に減少させることがで
きたものである。
なお、本実施例では伝送線28中の電源線については特
に考慮しなかったが、例えば+12VのレギュレータI
Cをキャリッジ8上に搭載させ、このレギュレータIC
から+12Vの他に+5■を生成して必要個所に給電さ
せるようにすれば、電源線についてもその本数を減らす
ことができる。
発明の効果 本発明は、複数のCCDの千鳥状配列やタイミング信号
の特徴に着目して、上述したように蓄積時間を決めるラ
インシフト信号を除きタイミング信号を共通に伝送させ
てキャリッジ上に搭載のタイミング信号処理回路におい
て振り分けるようにしたので、タイミング信号用の伝送
線の本数を半減させることができ、よって、伝送線のね
じれやからみの発生を減少させることができるとともに
、負荷も少なくなり、キャリッジの走行移動も円滑なも
のとすることができ、かつ、タイミング信号用の伝送線
を同軸線で構成したとしても、本数が少ない分、低コス
ト化が可能となり、リボン状仮構成する上でも有利なも
のとなり、さらには、CCDのシフトレジスタ駆動用に
要する複数のラインシフト信号なるタイミング信号の特
質に着目すれば、キャリッジ上に搭載のタイミング信号
処理回路においてシフト信号生成部を持つことにより、
クロックパルスとともに、基本となるCCDの蓄積時間
を決定するグループ別のラインシフト信号だけを伝送線
により伝送させるだけで、残りの必要なラインシフト信
号を生成でき、よって、必要とする伝送線の本数をより
一層少ないものとし、上記の効果を増大させることがで
きる。
【図面の簡単な説明】
第1図及び第2図は本発明の一実施例を示すもので、第
1図は概略ブロック図、第2図はCCD駆動を示す各信
号のタイミングチャート、第3図は一般的な原稿読取り
装置の一例を示す概略構成図、第48!Iはラインイメ
ージセンサ構成例を示す概略平面図、第5図はCCDの
ブロック構成図、第6図はCCD駆動を示す各信号のタ
イミングチャート、第7図は画像信号出力を示すタイミ
ングチャート、第8図は従来例を示す概略ブロック図で
ある。 1・・・ラインイメージセンサ、2・・・装置本体、5
・・・光源、8・・・キャリッジ、11・・・CCD、
27・・・タイミング信号発生部、28・・・伝送線、
33・・・タイミング信号処理回路、38・・・シフト
信号生成部、SH,φ1.φ2.R3・・・タイミング
信号、φCLK・・・クロックパルス(タイミングf言
号)、φVO,φV4・・・ラインシフト信号(タイミ
ング信号)、φv1〜φV、・・・ラインシフト信号出 願 人 株式会社 リ コ

Claims (1)

  1. 【特許請求の範囲】 1、原稿面を露光する光源と、各々駆動クロックにより
    駆動されて出力するシフトレジスタを持つ複数個のCC
    Dが主走査方向に2列千鳥状に配列され前記原稿面から
    の反射光を受光して光電変換するラインイメージセンサ
    とを、前記原稿面に対して副走査方向に移動するキャリ
    ッジ上に搭載し、このキャリッジ側とタイミング信号発
    生部を備えた装置本体側とを複数の伝送線で電気的に接
    続した原稿読取り装置において、前記伝送線により前記
    ラインイメージセンサ中の副走査方向先行列グループの
    各CCDと副走査方向後行列グループの各CCDとに対
    するタイミング信号を、CCDの蓄積時間を決定するグ
    ループ別のラインシフト信号を除き、共通に伝送させて
    グループ毎に振り分けるタイミング信号処理回路を前記
    キャリッジ上に設けたことを特徴とする原稿読取り装置
    。 2、タイミング信号処理回路が、クロックパルスとCC
    Dの蓄積時間を決定するグループ別のラインシフト信号
    とによるタイミング信号の伝送線による伝送を受けてこ
    れらのタイミング信号のシフト処理により2グループの
    CCDのシフトレジスタ用の残りのラインシフト信号を
    生成するシフト信号生成部を有することを特徴とする請
    求項1記載の原稿読取り装置。
JP1181259A 1989-07-13 1989-07-13 原稿読取り装置 Pending JPH0345073A (ja)

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JP1181259A JPH0345073A (ja) 1989-07-13 1989-07-13 原稿読取り装置

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JP1181259A JPH0345073A (ja) 1989-07-13 1989-07-13 原稿読取り装置

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ID=16097576

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JP1181259A Pending JPH0345073A (ja) 1989-07-13 1989-07-13 原稿読取り装置

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5598291A (en) * 1993-09-24 1997-01-28 Ebara Corporation Polygon mirror mounting structure
US6118568A (en) * 1995-07-07 2000-09-12 Hitachi, Ltd. Polygon mirror motor and polygon mirror supporting structure

Cited By (2)

* Cited by examiner, † Cited by third party
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US5598291A (en) * 1993-09-24 1997-01-28 Ebara Corporation Polygon mirror mounting structure
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