JPH0349384A - 画像信号の符号化装置 - Google Patents
画像信号の符号化装置Info
- Publication number
- JPH0349384A JPH0349384A JP1185472A JP18547289A JPH0349384A JP H0349384 A JPH0349384 A JP H0349384A JP 1185472 A JP1185472 A JP 1185472A JP 18547289 A JP18547289 A JP 18547289A JP H0349384 A JPH0349384 A JP H0349384A
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- JP
- Japan
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- bits
- circuit
- error correction
- buffer memory
- signal
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- Pending
Links
- 230000005540 biological transmission Effects 0.000 claims abstract description 8
- 238000006243 chemical reaction Methods 0.000 claims description 4
- 238000010586 diagram Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000009432 framing Methods 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- 230000000007 visual effect Effects 0.000 description 1
Landscapes
- Compression Or Coding Systems Of Tv Signals (AREA)
- Error Detection And Correction (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は画像信号の符号化装置に関し、特に伝送路の符
号誤り訂正の機能をもつ画像信号の符号化装置に関する
。
号誤り訂正の機能をもつ画像信号の符号化装置に関する
。
従来のこの種の画像信号符号化装置では、符号化画像信
号の全ビットに対して誤り訂正を行なっている。
号の全ビットに対して誤り訂正を行なっている。
上述した従来の画像信号の符号化装置では、符号化画像
信号の全ビットに誤り訂正を行っているので、誤り訂正
を行なう為の付加情報量が莫大になる。例えば、画像信
号を１０ビツトのデジタル信号に変換して伝送する場合
、下位３〜４ビツトに生じた誤りは画面上では人間の視
覚特性の認識範囲外である為、下位３〜４ビツトにおけ
る誤り訂正動作は冗長な情報として扱われるなど、莫大
な情報量には実効の無い部分を含んでいるという欠点が
ある。
信号の全ビットに誤り訂正を行っているので、誤り訂正
を行なう為の付加情報量が莫大になる。例えば、画像信
号を１０ビツトのデジタル信号に変換して伝送する場合
、下位３〜４ビツトに生じた誤りは画面上では人間の視
覚特性の認識範囲外である為、下位３〜４ビツトにおけ
る誤り訂正動作は冗長な情報として扱われるなど、莫大
な情報量には実効の無い部分を含んでいるという欠点が
ある。
本発明の符号化装置は、アナログ画像信号をｉビットの
デジタル信号に変換するアナログ−デジタル変換回路と
、前記ρデジタル信号の上位ｍビット及び下位ｎビット
（ｍ＋ｎ＝Ｊ）をそれぞれ一時記憶する第１及び第２の
バッファメモリ回路と、前記第１のバッファメモリ回路
から読出した前記上位ｍビットのデジタル信号に対して
誤り訂正を行なう為の情報を付加する誤り訂正回路と、
前記誤り訂正回路の出力信号と前記第２のバッファメモ
リ回路から読出した前記下位ｎビットのディジタル信号
とを多重化して伝送路に出力する多重化回路とを備えて
いる。
デジタル信号に変換するアナログ−デジタル変換回路と
、前記ρデジタル信号の上位ｍビット及び下位ｎビット
（ｍ＋ｎ＝Ｊ）をそれぞれ一時記憶する第１及び第２の
バッファメモリ回路と、前記第１のバッファメモリ回路
から読出した前記上位ｍビットのデジタル信号に対して
誤り訂正を行なう為の情報を付加する誤り訂正回路と、
前記誤り訂正回路の出力信号と前記第２のバッファメモ
リ回路から読出した前記下位ｎビットのディジタル信号
とを多重化して伝送路に出力する多重化回路とを備えて
いる。
次に本発明について図面を参照して説明する。
第１図は、本発明の一実施例を示すブロック図である。
画像信号入力端子１に入力されたアナログ画像信号は、
アナログ−デジタル変換回路２によりｇビットのデジタ
ル信号に変換される。このときの変換速度は、ｆＳなる
周波数をもつクロック発生源３から得られる。１ビツト
のデジタル画像信号は、上位ｍビットと下位ｎビットと
（ｍ＋ｎ＝ｆｆ１）に分割され、それぞれバッファメモ
リ回路４及び５に入力される。バッファメモリ回路４の
出力信号は、誤り訂正回路６により誤り訂正に必要な付
加情報が付加されて、多重化回路７に送られる。多重化
回路７には、この他に、バッファメモリ回路５の出力信
号及びフレームパターン発生回路８から出力されるフレ
ーム同期信号が入力され、画像信号のフレーミング処理
即ち多重化がなされて、伝送路９に出力される。このと
きの伝送速度は、ｆｌなる周波数をもつクロック発生源
１０から得られる。
アナログ−デジタル変換回路２によりｇビットのデジタ
ル信号に変換される。このときの変換速度は、ｆＳなる
周波数をもつクロック発生源３から得られる。１ビツト
のデジタル画像信号は、上位ｍビットと下位ｎビットと
（ｍ＋ｎ＝ｆｆ１）に分割され、それぞれバッファメモ
リ回路４及び５に入力される。バッファメモリ回路４の
出力信号は、誤り訂正回路６により誤り訂正に必要な付
加情報が付加されて、多重化回路７に送られる。多重化
回路７には、この他に、バッファメモリ回路５の出力信
号及びフレームパターン発生回路８から出力されるフレ
ーム同期信号が入力され、画像信号のフレーミング処理
即ち多重化がなされて、伝送路９に出力される。このと
きの伝送速度は、ｆｌなる周波数をもつクロック発生源
１０から得られる。
一般に周波数ｆｓとｆｌどの両クロックは非同期である
為、タロツク発生源３及び１０は、パルス発生回路１１
を制御して多重化を行なう為の制御パルスを発生させる
。この制御パルスは、バッファメモリ回路４及び５、誤
まり訂正回路６、多重化訂正回路７、フレームパターン
発生回路８にそれぞれ出力され、各部の動作タイミング
の制御を行なう。
為、タロツク発生源３及び１０は、パルス発生回路１１
を制御して多重化を行なう為の制御パルスを発生させる
。この制御パルスは、バッファメモリ回路４及び５、誤
まり訂正回路６、多重化訂正回路７、フレームパターン
発生回路８にそれぞれ出力され、各部の動作タイミング
の制御を行なう。
本実施例においては、ｌ＝９、ｍ＝５、ｎ＝４に設定し
、誤り訂正に必要な付加情報の情報量割増率（ｋ）を、
従来装置での約７％から３．７％まで低減している。伝
送路での画像信号情報量（ｆＶ）は、ｆ ｓ ＝ １４
．３ Ｍ Ｈｚ 、 １ ＝ ９、ｋ＝７％の場合、ｆ
ｖ ＝ １３７．７ Ｍｂｉｔ ／ ｓとなるが、本
実施例では１３３．５Ｍｂｉｔ ／ ｓで済むことにな
り、４．２Ｍｂｉｔ／ｓの情報量を減らすことができる
。
、誤り訂正に必要な付加情報の情報量割増率（ｋ）を、
従来装置での約７％から３．７％まで低減している。伝
送路での画像信号情報量（ｆＶ）は、ｆ ｓ ＝ １４
．３ Ｍ Ｈｚ 、 １ ＝ ９、ｋ＝７％の場合、ｆ
ｖ ＝ １３７．７ Ｍｂｉｔ ／ ｓとなるが、本
実施例では１３３．５Ｍｂｉｔ ／ ｓで済むことにな
り、４．２Ｍｂｉｔ／ｓの情報量を減らすことができる
。
以上説明したように本発明は、ｉビットの画像信号の上
位ｍビットについてのみ誤り訂正を行なうことによって
、誤り訂正に必要な付加情報量を多重化回路、８・・・
フレームパターン発生回路、９・・・伝送路、１１・・
・パルス発生回路。
位ｍビットについてのみ誤り訂正を行なうことによって
、誤り訂正に必要な付加情報量を多重化回路、８・・・
フレームパターン発生回路、９・・・伝送路、１１・・
・パルス発生回路。
Claims (1)
- アナログ画像信号をｌビットのデジタル信号に変換す
るアナログ−デジタル変換回路と、前記ｌデジタル信号
の上位ｍビット及び下位ｎビット（ｍ＋ｎ＝ｌ）をそれ
ぞれ一時記憶する第１及び第２のバッファメモリ回路と
、前記第１のバッファメモリ回路から読出した前記上位
ｍビットのデジタル信号に対して誤り訂正を行なう為の
情報を付加する誤り訂正回路と、前記誤り訂正回路の出
力信号と前記第２のバッファメモリ回路から読出した前
記下位ｎビットのディジタル信号とを多重化して伝送路
に出力する多重化回路とを備えていることを特徴とする
画像信号の符号化装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1185472A JPH0349384A (ja) | 1989-07-17 | 1989-07-17 | 画像信号の符号化装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1185472A JPH0349384A (ja) | 1989-07-17 | 1989-07-17 | 画像信号の符号化装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0349384A true JPH0349384A (ja) | 1991-03-04 |
Family
ID=16171369
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1185472A Pending JPH0349384A (ja) | 1989-07-17 | 1989-07-17 | 画像信号の符号化装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0349384A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2018136370A (ja) * | 2017-02-20 | 2018-08-30 | セイコーエプソン株式会社 | ドライバー、電気光学装置及び電子機器 |
Citations (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52103902A (en) * | 1976-02-03 | 1977-08-31 | Nec Corp | Code error correcting method |
| JPS54138318A (en) * | 1978-04-19 | 1979-10-26 | Toshiba Corp | Error correction system |
| JPS5542546A (en) * | 1978-09-22 | 1980-03-25 | Eito Sangyo:Kk | Automatic machine for making rice ball |
| JPS6173486A (ja) * | 1984-09-19 | 1986-04-15 | Hitachi Ltd | デイジタル画像記録再生装置 |
| JPS61140225A (ja) * | 1984-12-13 | 1986-06-27 | Matsushita Electric Ind Co Ltd | 誤り訂正装置 |
| JPS62163432A (ja) * | 1986-01-13 | 1987-07-20 | Matsushita Electric Ind Co Ltd | 符号化装置 |
-
1989
- 1989-07-17 JP JP1185472A patent/JPH0349384A/ja active Pending
Patent Citations (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52103902A (en) * | 1976-02-03 | 1977-08-31 | Nec Corp | Code error correcting method |
| JPS54138318A (en) * | 1978-04-19 | 1979-10-26 | Toshiba Corp | Error correction system |
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| JPS6173486A (ja) * | 1984-09-19 | 1986-04-15 | Hitachi Ltd | デイジタル画像記録再生装置 |
| JPS61140225A (ja) * | 1984-12-13 | 1986-06-27 | Matsushita Electric Ind Co Ltd | 誤り訂正装置 |
| JPS62163432A (ja) * | 1986-01-13 | 1987-07-20 | Matsushita Electric Ind Co Ltd | 符号化装置 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2018136370A (ja) * | 2017-02-20 | 2018-08-30 | セイコーエプソン株式会社 | ドライバー、電気光学装置及び電子機器 |
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