JPH03523Y2 - - Google Patents
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- JPH03523Y2 JPH03523Y2 JP10180786U JP10180786U JPH03523Y2 JP H03523 Y2 JPH03523 Y2 JP H03523Y2 JP 10180786 U JP10180786 U JP 10180786U JP 10180786 U JP10180786 U JP 10180786U JP H03523 Y2 JPH03523 Y2 JP H03523Y2
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Landscapes
- Combined Controls Of Internal Combustion Engines (AREA)
- Motor And Converter Starters (AREA)
Description
【考案の詳細な説明】
〔産業上の利用分野〕
本考案は、スタータ並列運転スイツチ装置、特
に複数個のスタータを用いて１つのエンジンを始
動させるに当たつて、例えば２個以上のスタータ
が正しく噛み合つた場合には、エンジン駆動を行
い得るようにし、すべてのスタータが噛み合つて
いない状態の下でもエンジン駆動を行い得るよう
にしたスタータ並列運転スイツチ装置に関する。
に複数個のスタータを用いて１つのエンジンを始
動させるに当たつて、例えば２個以上のスタータ
が正しく噛み合つた場合には、エンジン駆動を行
い得るようにし、すべてのスタータが噛み合つて
いない状態の下でもエンジン駆動を行い得るよう
にしたスタータ並列運転スイツチ装置に関する。
複数のスタータによつて単一のエンジンを始動
せしめるようにすることが考慮されていて、出願
人は先に実願昭60−104338号「スタータ並列運転
用同期スイツチ装置」として出願を行つている。
せしめるようにすることが考慮されていて、出願
人は先に実願昭60−104338号「スタータ並列運転
用同期スイツチ装置」として出願を行つている。
第３図は先に行つた出願の概念図を示してい
る。図中の符号１−１ないし１−４は夫々スター
タであつて例えば４個のスタータが協同して１つ
の図示しないエンジンを始動するように働く。２
−１ないし２−４は夫々エンゲージ・スイツチ、
３−１ないし３−４は夫々メイン・リレー、４は
キー・スイツチ、５はバツテリ、６はアンド回
路、７はリレー・ドライバを表している。
る。図中の符号１−１ないし１−４は夫々スター
タであつて例えば４個のスタータが協同して１つ
の図示しないエンジンを始動するように働く。２
−１ないし２−４は夫々エンゲージ・スイツチ、
３−１ないし３−４は夫々メイン・リレー、４は
キー・スイツチ、５はバツテリ、６はアンド回
路、７はリレー・ドライバを表している。
キー・スイツチ４を投入すると、エンゲージ・
スイツチ２−１ないし２−４におけるC1端子な
いしC4端子にバツテリ電源５の直流電圧が印加
され、スタータ１−１ないし１−４を介して電流
がエンゲージ・スイツチ２−１ないし２−４に流
れる。該エンゲージ・スイツチ２−１ないし２−
４の作動により、スタータ１−１ないし１−４の
ピニオンが、図示しないエンジンのリングギヤに
噛み合うように動作する。これによつてエンゲー
ジ・スイツチ２−１ないし２−４におけるC1端
子ないしC4端子が夫々対応するM1端子ないしM4
端子と継がり、アンド回路６がオンし、リレー・
ドライバ７が働いて各メイン・リレー３−１ない
し３−４を一斉に付勢する。即ち、各スタータ１
−１ないし１−４には、メイン・リレー３−１な
いし３−４側から、バツテリ５の電圧がM1端子
から印加されることとなり、エンジンを始動すべ
く駆動する。
スイツチ２−１ないし２−４におけるC1端子な
いしC4端子にバツテリ電源５の直流電圧が印加
され、スタータ１−１ないし１−４を介して電流
がエンゲージ・スイツチ２−１ないし２−４に流
れる。該エンゲージ・スイツチ２−１ないし２−
４の作動により、スタータ１−１ないし１−４の
ピニオンが、図示しないエンジンのリングギヤに
噛み合うように動作する。これによつてエンゲー
ジ・スイツチ２−１ないし２−４におけるC1端
子ないしC4端子が夫々対応するM1端子ないしM4
端子と継がり、アンド回路６がオンし、リレー・
ドライバ７が働いて各メイン・リレー３−１ない
し３−４を一斉に付勢する。即ち、各スタータ１
−１ないし１−４には、メイン・リレー３−１な
いし３−４側から、バツテリ５の電圧がM1端子
から印加されることとなり、エンジンを始動すべ
く駆動する。
上記第３図図示の構成は、それ以前に考慮され
た構成における難点を解決しているものではなる
が、この解決に伴つて、次の新しい問題が提起さ
れることとなつた。
た構成における難点を解決しているものではなる
が、この解決に伴つて、次の新しい問題が提起さ
れることとなつた。
即ち、第３図図示の構成の場合には、すべての
スタータ１−１ないし１−４がエンジンのリング
ギヤと正しく噛み合うことが必要であり、１つで
も噛み合いに失敗すると、エンジンを始動するこ
とができない形となつている。
スタータ１−１ないし１−４がエンジンのリング
ギヤと正しく噛み合うことが必要であり、１つで
も噛み合いに失敗すると、エンジンを始動するこ
とができない形となつている。
エンジンを始動せしめるべく駆動する例えば４
個のスタータの合計出力は、エンジンを駆動する
に必要な出力にくらべて、一般には余裕をもつて
いる。そして、特に夏場においては、４個のスタ
ータがすべて正しく噛み合わなくても、３個のス
タータによつて、あるいは２個のスタータによつ
て、エンジンを始動すべく駆動することが可能で
ある。一方、４個のスタータがすべて正しく噛み
合うことを条件とすると、エンジン始動失敗とな
る頻度が比較的高くなる場合がある。
個のスタータの合計出力は、エンジンを駆動する
に必要な出力にくらべて、一般には余裕をもつて
いる。そして、特に夏場においては、４個のスタ
ータがすべて正しく噛み合わなくても、３個のス
タータによつて、あるいは２個のスタータによつ
て、エンジンを始動すべく駆動することが可能で
ある。一方、４個のスタータがすべて正しく噛み
合うことを条件とすると、エンジン始動失敗とな
る頻度が比較的高くなる場合がある。
本考案は上記の点を解決しており、キー・スイ
ツチ４をオンしてから例えば0.4秒経過時におい
て、各スタータ１−１ないし１−４の噛み合い状
態をチエツクし、例えば２個以上正しく噛み合つ
ていれば、エンジンを始動すべく駆動を行つてみ
るようにしている。
ツチ４をオンしてから例えば0.4秒経過時におい
て、各スタータ１−１ないし１−４の噛み合い状
態をチエツクし、例えば２個以上正しく噛み合つ
ていれば、エンジンを始動すべく駆動を行つてみ
るようにしている。
第１図は本考案の原理構成図を示している。図
中の符号１−ｉ，２−ｉ，５，Ci，Miは第３図
に対応しており、８はキー・スイツチのスター
タ・ポジシヨン、９はキー・スイツチのアクセレ
レーシヨン・ポジシヨン、１０は同期スイツチ回
路部を表している。また各エンゲージ・スイツチ
２−ｉにおける端子Ｂは、図示を省略している
が、バツテリ５の電圧が供給されている端子であ
り、第１図図示のスイツチ８と９とが夫々オンさ
れると、各エンゲージ・スイツチ２−ｉにおける
端子Ｂと端子Ｃとが接続され、端子C1ないしC4
に電圧が印加される。なお、スイツチ８と９とは
第３図図示のキー・スイツチ４に対応するもので
ある。
中の符号１−ｉ，２−ｉ，５，Ci，Miは第３図
に対応しており、８はキー・スイツチのスター
タ・ポジシヨン、９はキー・スイツチのアクセレ
レーシヨン・ポジシヨン、１０は同期スイツチ回
路部を表している。また各エンゲージ・スイツチ
２−ｉにおける端子Ｂは、図示を省略している
が、バツテリ５の電圧が供給されている端子であ
り、第１図図示のスイツチ８と９とが夫々オンさ
れると、各エンゲージ・スイツチ２−ｉにおける
端子Ｂと端子Ｃとが接続され、端子C1ないしC4
に電圧が印加される。なお、スイツチ８と９とは
第３図図示のキー・スイツチ４に対応するもので
ある。
本考案における主要な構成は、第１図図示の同
期スイツチ回路部１０に内蔵されている。その具
体的構成については、第２図を参照して後述され
るが、次の如き機能をもつているものと考えてよ
い。即ち、スイツチ８，９がオンされて、例えば
0.4秒経過時に、 Ａ スタータ１−ｉが１個しか噛合しないか１個
も噛合しない場合には、すべてのスタータに対
する給電をオフするようにする（詳細は省略す
るが、同期スイツチ回路部１０における端子S1
ないしS4を介して）。
期スイツチ回路部１０に内蔵されている。その具
体的構成については、第２図を参照して後述され
るが、次の如き機能をもつているものと考えてよ
い。即ち、スイツチ８，９がオンされて、例えば
0.4秒経過時に、 Ａ スタータ１−ｉが１個しか噛合しないか１個
も噛合しない場合には、すべてのスタータに対
する給電をオフするようにする（詳細は省略す
るが、同期スイツチ回路部１０における端子S1
ないしS4を介して）。
Ｂ ２個あるいは３個だけが噛合している場合に
は、噛み合つていないスタータへの給電を停止
し、当該給電を停止されたスタータにおけるエ
ンゲージ・スイツチ２−ｉが元に戻るのを待つ
て（例えば0.4秒）、噛み合つているスタータに
対して端子Miを介してバツテリ５の電圧を供
給する。
は、噛み合つていないスタータへの給電を停止
し、当該給電を停止されたスタータにおけるエ
ンゲージ・スイツチ２−ｉが元に戻るのを待つ
て（例えば0.4秒）、噛み合つているスタータに
対して端子Miを介してバツテリ５の電圧を供
給する。
Ｃ ４個のスタータがすべて噛み合つたことが確
認されると、上記0.4秒を待つことなくその時
点で、すべてのスタータに対して端子M1ない
しM4を介して給電する。
認されると、上記0.4秒を待つことなくその時
点で、すべてのスタータに対して端子M1ない
しM4を介して給電する。
Ｄ 上記噛み合つているスタータが２台の場合に
は例えば12秒後に、噛み合つているスタータが
３台の場合には例えば16秒後に、噛み合つてい
るスタータが４台の場合には例えば24秒後に
は、自動的にスタータをオフする。
は例えば12秒後に、噛み合つているスタータが
３台の場合には例えば16秒後に、噛み合つてい
るスタータが４台の場合には例えば24秒後に
は、自動的にスタータをオフする。
第２図は第１図図示の同期スイツチ回路部の一
実施例構成を示している。図中の符号Ｂ，Mi，
ST，Acc，Ci，Siは第１図に対応している。ま
た１１は多数決回路、１２はモノステーブル・マ
ルチ、１３−１ないし１３−４は夫々Ｄ型フリツ
プ・フロツプを表している。
実施例構成を示している。図中の符号Ｂ，Mi，
ST，Acc，Ci，Siは第１図に対応している。ま
た１１は多数決回路、１２はモノステーブル・マ
ルチ、１３−１ないし１３−４は夫々Ｄ型フリツ
プ・フロツプを表している。
第１図図示のアクセレレーシヨン・ポジシヨン
９がオンされると、第２図図示の右側下方におけ
る電圧Vccが所定の電圧を発する。そして、スタ
ータ・ポジシヨン８がオンされると、第２図図示
の左側下方におけるモノステーブル・マルチ１２
がトリガしてパルスを発する。このパルスによつ
て、フリツプ・フロツプ１３−１ないし１３−４
がセツトされ、第２図図示中央部に位置するトラ
ンジスタT1がオンしてコンデンサCS1を放電す
る。
９がオンされると、第２図図示の右側下方におけ
る電圧Vccが所定の電圧を発する。そして、スタ
ータ・ポジシヨン８がオンされると、第２図図示
の左側下方におけるモノステーブル・マルチ１２
がトリガしてパルスを発する。このパルスによつ
て、フリツプ・フロツプ１３−１ないし１３−４
がセツトされ、第２図図示中央部に位置するトラ
ンジスタT1がオンしてコンデンサCS1を放電す
る。
各フリツプ・フロツプ１３−１ないし１３−４
はセツトされて、そのＱ出力はＨ，出力はＬと
なり、リレーLY1ないしLY4はオンとなる。これ
によつて、図示右上側の接点LY1−ａないしLY4
−ａとLY1−ｂないしLY4−ｂがオンする。一
方、コンデンサCS1は放電しているので、ノツク
回路NOT１の入力はＨで出力はＬとなり、ナン
ド回路NAND３の出力Ｈとなる。また電源投入
時には、図示右下方に位置するコンデンサCS2は
放電状態のために、バツフアBUFの出力はＨな
ので、アンド回路AND２の入力はＨ，Ｈとなり、
出力はＴとなつて、リレーLYsを付勢する。これ
によつて、端子S1ないしS4にはスタート信号ST
が供給され、各セーフテイ・リレーにおけるエン
ゲージ・スイツチ２−１ないし２−４の部分にお
いて、端子Ｂ−Ｃ間がオンされる。
はセツトされて、そのＱ出力はＨ，出力はＬと
なり、リレーLY1ないしLY4はオンとなる。これ
によつて、図示右上側の接点LY1−ａないしLY4
−ａとLY1−ｂないしLY4−ｂがオンする。一
方、コンデンサCS1は放電しているので、ノツク
回路NOT１の入力はＨで出力はＬとなり、ナン
ド回路NAND３の出力Ｈとなる。また電源投入
時には、図示右下方に位置するコンデンサCS2は
放電状態のために、バツフアBUFの出力はＨな
ので、アンド回路AND２の入力はＨ，Ｈとなり、
出力はＴとなつて、リレーLYsを付勢する。これ
によつて、端子S1ないしS4にはスタート信号ST
が供給され、各セーフテイ・リレーにおけるエン
ゲージ・スイツチ２−１ないし２−４の部分にお
いて、端子Ｂ−Ｃ間がオンされる。
スタータ１−１ないし１−４が正しく噛み合う
と、夫々の端子M1ないしM4には、Ｃ端子の電圧
が分圧された約0.8Vの電圧が現れる。この電圧
が、第２図図示左上方に位置するコンパレータ
CMP１ないしCMP４によつて検出される。各コ
ンパレータの出力はナンド回路NAND１に入力
され、４個のスタータがすべて正しく噛み合つた
場合には、ナンド回路NAND１の出力がＬとな
る。したがつて，ナンド回路NAND２の出力が
Ｈ、さらにアンド回路AND１の出力をＨとして、
リレーLYMを駆動し、各メイン・リレー駆動コイ
ルにバツテリ電圧を供給する。一方、ナンド回路
NAND２の出力によつて、トランジスタT2がオ
ンし、抵抗R2を介してコンデンサCS2に対する充
電がスタートする。抵抗R2とコンデンサCS2との
時定数によつて、約20秒で、バツフアBUFの出
力はＬとなり、アンド回路AND１、AND２の出
力をＬとして、リレーLYM，LYSをオフし、各ス
タータへの給電を停止する。
と、夫々の端子M1ないしM4には、Ｃ端子の電圧
が分圧された約0.8Vの電圧が現れる。この電圧
が、第２図図示左上方に位置するコンパレータ
CMP１ないしCMP４によつて検出される。各コ
ンパレータの出力はナンド回路NAND１に入力
され、４個のスタータがすべて正しく噛み合つた
場合には、ナンド回路NAND１の出力がＬとな
る。したがつて，ナンド回路NAND２の出力が
Ｈ、さらにアンド回路AND１の出力をＨとして、
リレーLYMを駆動し、各メイン・リレー駆動コイ
ルにバツテリ電圧を供給する。一方、ナンド回路
NAND２の出力によつて、トランジスタT2がオ
ンし、抵抗R2を介してコンデンサCS2に対する充
電がスタートする。抵抗R2とコンデンサCS2との
時定数によつて、約20秒で、バツフアBUFの出
力はＬとなり、アンド回路AND１、AND２の出
力をＬとして、リレーLYM，LYSをオフし、各ス
タータへの給電を停止する。
４個のスタータのうちの少なくとも１つが正し
く噛み合わなかつた場合には、ナンド回路
NAND１の出力はＬのままとなる。第２図図示
左上方に示す如く、コンパレータCMP１ないし
CMP４の出力は多数決回路１１に入力されてお
り、図示入力端子Ａ，Ｂ，Ｃ，Ｄ，Ｅのうち３個
以上がＨならばＺ出力はＨとなり、２つ以下なら
ばＬとなる。ただ入力端子ＥがＨに固定されてい
るので、入力ＡないしＤのうち２つ以上Ｈならば
Ｚ出力はＨとなる。
く噛み合わなかつた場合には、ナンド回路
NAND１の出力はＬのままとなる。第２図図示
左上方に示す如く、コンパレータCMP１ないし
CMP４の出力は多数決回路１１に入力されてお
り、図示入力端子Ａ，Ｂ，Ｃ，Ｄ，Ｅのうち３個
以上がＨならばＺ出力はＨとなり、２つ以下なら
ばＬとなる。ただ入力端子ＥがＨに固定されてい
るので、入力ＡないしＤのうち２つ以上Ｈならば
Ｚ出力はＨとなる。
今、１つのスタータのみしか噛み合わなかつた
か１つも噛み合わなかつたとすると、Ｚ出力はＬ
であり、ノツト回路NOT２の出力はＨとなる。
各エンゲージ・スイツチの部分で端子C1ないし
C4に電圧が印加されたとき、第２図図示中央部
に位置するトランジスタ・アレーTRYをオンし、
抵抗R1を介してコンデンサCS1への充電が開始す
る。そして、約0.5秒経過して、ノツト回路NOT
１の出力はＨとなる。ノツト回路NOT１の出力
とノツト回路NOT２の出力はナンド回路NAND
３の入力となつているので、噛み合つたスタータ
が１個以下の場合には、約0.5秒後に、ナンド回
路NAND３の出力はＬとなつて、アンド回路
AND２の出力をＬとし、各エンゲージ・スイツ
チ２−１ないし２−４における端子SW1ないし
SW4（第１図参照）への給電を止める。また２つ
以上噛み合つている場合には、ノツト回路NOT
２の出力はＬとなり、約0.5秒後にノツト回路
NOT１の出力がＨとなつても、ナンド回路
NAND３の出力そしてアンド回路AND２の出力
はＨを維持している。
か１つも噛み合わなかつたとすると、Ｚ出力はＬ
であり、ノツト回路NOT２の出力はＨとなる。
各エンゲージ・スイツチの部分で端子C1ないし
C4に電圧が印加されたとき、第２図図示中央部
に位置するトランジスタ・アレーTRYをオンし、
抵抗R1を介してコンデンサCS1への充電が開始す
る。そして、約0.5秒経過して、ノツト回路NOT
１の出力はＨとなる。ノツト回路NOT１の出力
とノツト回路NOT２の出力はナンド回路NAND
３の入力となつているので、噛み合つたスタータ
が１個以下の場合には、約0.5秒後に、ナンド回
路NAND３の出力はＬとなつて、アンド回路
AND２の出力をＬとし、各エンゲージ・スイツ
チ２−１ないし２−４における端子SW1ないし
SW4（第１図参照）への給電を止める。また２つ
以上噛み合つている場合には、ノツト回路NOT
２の出力はＬとなり、約0.5秒後にノツト回路
NOT１の出力がＨとなつても、ナンド回路
NAND３の出力そしてアンド回路AND２の出力
はＨを維持している。
コンパレータCMD１ないしCMP４の出力は、
フリツプ・フロツプ１３−１ないし１３−４のＤ
入力にも接続されている。このために、上述のト
ランジスタ・アレーTRYがオンして約0.5秒後に
ノツト回路NOT１の出力がＨとなると、その立
ち上がりで各フリツプ・フロツプ１３−１ないし
１３−４はＤ入力状態をＱ出力に反映する。即
ち、正しく噛み合つたスタータに対応するフリツ
プ・フロツプ１３−ｉのＱ出力はＨのままとな
り、噛み合いを失敗したものに対応するフリツ
プ・フロツプ１３−ｉのＱ出力はＬとなる。した
がつて、噛み合いを失敗したものに対応するリレ
ーLYiが解消され、これに対応する接点LYi−ａ
とLYi−ｂ（第２図図示右上）がオフし、スター
タへの給電は停止される。なお、フリツプ・フロ
ツプ１３−ｉの出力はＱ出力を反転したもので
あるので、噛み合いを失敗したスタータに対応す
るフリツプ・フロツプの出力はＨとなつて、モ
ニタ用のトランジスタT4ないしT7のいずれかを
オンし、発光ダイオードLEDを駆動する。この
とき、オンしたトランジスタに対応して、図示の
抵抗R4ないしR7のいずれかを介して、コンデン
サCS2に対する充電回路が形成され、充電時定数
が、抵抗R2のみの場合合にくらべて小となる。
フリツプ・フロツプ１３−１ないし１３−４のＤ
入力にも接続されている。このために、上述のト
ランジスタ・アレーTRYがオンして約0.5秒後に
ノツト回路NOT１の出力がＨとなると、その立
ち上がりで各フリツプ・フロツプ１３−１ないし
１３−４はＤ入力状態をＱ出力に反映する。即
ち、正しく噛み合つたスタータに対応するフリツ
プ・フロツプ１３−ｉのＱ出力はＨのままとな
り、噛み合いを失敗したものに対応するフリツ
プ・フロツプ１３−ｉのＱ出力はＬとなる。した
がつて、噛み合いを失敗したものに対応するリレ
ーLYiが解消され、これに対応する接点LYi−ａ
とLYi−ｂ（第２図図示右上）がオフし、スター
タへの給電は停止される。なお、フリツプ・フロ
ツプ１３−ｉの出力はＱ出力を反転したもので
あるので、噛み合いを失敗したスタータに対応す
るフリツプ・フロツプの出力はＨとなつて、モ
ニタ用のトランジスタT4ないしT7のいずれかを
オンし、発光ダイオードLEDを駆動する。この
とき、オンしたトランジスタに対応して、図示の
抵抗R4ないしR7のいずれかを介して、コンデン
サCS2に対する充電回路が形成され、充電時定数
が、抵抗R2のみの場合合にくらべて小となる。
一方、ノツト回路NOT１がＨとなつたとき、
アンド回路AND３の入力はＨ，Ｈとなつて、出
力はＨとなる。このＨの状態は抵抗R3とコンデ
ンサCS3との時定数によつて約0.5秒で準備状態と
なり、ノツト回路NOT３の出力はＬとなる。こ
のとき、接点LY1−ａないしLY4−ａのうち、噛
み合わなかつたスタータに対応する接点は既にオ
フしているために、噛み合つているスタータに対
応するメイン・リレーのみが駆動されることとな
る。
アンド回路AND３の入力はＨ，Ｈとなつて、出
力はＨとなる。このＨの状態は抵抗R3とコンデ
ンサCS3との時定数によつて約0.5秒で準備状態と
なり、ノツト回路NOT３の出力はＬとなる。こ
のとき、接点LY1−ａないしLY4−ａのうち、噛
み合わなかつたスタータに対応する接点は既にオ
フしているために、噛み合つているスタータに対
応するメイン・リレーのみが駆動されることとな
る。
コンデンサCS2に対する充電時定数は、コンデ
ンサCS2自体と抵抗R2と抵抗R4ないしR7とで定
まる。上述の如く、４個のスタータがすべて噛み
合つている場合には、フリツプ・フロツプ１３−
１ないし１３−４のＱ出力はＨのままであり、
出力はＬのままである。したがつて、モニタ用の
発光ダイオードLEDは駆動されず、また抵抗R4
ないしR7には電流が流れない。この場合に、抵
抗R2とコンデンサCS2とによる時定数は約20秒に
設定されている。噛み合いの失敗したスタータが
あると、当該スタータに対応する発光ダイオード
LEDが駆動されると共に抵抗R4ないしR7に電流
が流れる。抵抗R4ないしR7の値がすべて等しく
Ｒであるとすると、３個のスタータが噛み合つた
場合の時定数は R2・Ｒ／R2＋６Ｃ となり、２個のスタータが噛み合つた場合の時定
数は R2・（Ｒ／２）／R2＋（Ｒ／２）Ｃ となる。前者は約15秒に設定され、後者は約10秒
に設定されている。これら時定数によつて定まる
時間にコンデンサCS2が充電されると、バツテリ
BUFの出力はＬとなり、アンド回路AND１、
AND２の出力をＬとして、リレーLYM、LYSが
オフされる。
ンサCS2自体と抵抗R2と抵抗R4ないしR7とで定
まる。上述の如く、４個のスタータがすべて噛み
合つている場合には、フリツプ・フロツプ１３−
１ないし１３−４のＱ出力はＨのままであり、
出力はＬのままである。したがつて、モニタ用の
発光ダイオードLEDは駆動されず、また抵抗R4
ないしR7には電流が流れない。この場合に、抵
抗R2とコンデンサCS2とによる時定数は約20秒に
設定されている。噛み合いの失敗したスタータが
あると、当該スタータに対応する発光ダイオード
LEDが駆動されると共に抵抗R4ないしR7に電流
が流れる。抵抗R4ないしR7の値がすべて等しく
Ｒであるとすると、３個のスタータが噛み合つた
場合の時定数は R2・Ｒ／R2＋６Ｃ となり、２個のスタータが噛み合つた場合の時定
数は R2・（Ｒ／２）／R2＋（Ｒ／２）Ｃ となる。前者は約15秒に設定され、後者は約10秒
に設定されている。これら時定数によつて定まる
時間にコンデンサCS2が充電されると、バツテリ
BUFの出力はＬとなり、アンド回路AND１、
AND２の出力をＬとして、リレーLYM、LYSが
オフされる。
以上説明した如く、本考案によれば、予め定め
た個数以上のスタータが正しく噛み合つた場合に
は、エンジンを始動すべくスタータを駆動させる
ことが可能となる。そして、正しく噛み合つてい
るスタータの個数に対応して、スタータへの通電
時間を制限するようにし、スタータが過負荷状態
になることを防いでいる。
た個数以上のスタータが正しく噛み合つた場合に
は、エンジンを始動すべくスタータを駆動させる
ことが可能となる。そして、正しく噛み合つてい
るスタータの個数に対応して、スタータへの通電
時間を制限するようにし、スタータが過負荷状態
になることを防いでいる。
第１図は本考案の原理構成図、第２図は第１図
図示の同期スイツチ回路部の一実施例構成、第３
図は本考案の前提として考慮した構成を示す。 図中、１−ｉはスタータ、２−ｉはエンゲー
ジ・スイツチ、３−ｉはメイン・リレー、５はバ
ツテリ、８はキー・スイツチのスタータ・ポジジ
ヨン、１０は同期スイツチ回路部、１１は多数決
回路を表している。
図示の同期スイツチ回路部の一実施例構成、第３
図は本考案の前提として考慮した構成を示す。 図中、１−ｉはスタータ、２−ｉはエンゲー
ジ・スイツチ、３−ｉはメイン・リレー、５はバ
ツテリ、８はキー・スイツチのスタータ・ポジジ
ヨン、１０は同期スイツチ回路部、１１は多数決
回路を表している。
Claims (1)
- 対応して設けられたメイン・リレーを介してバ
ツテリ電源が供給される複数個のスタータと、こ
れらのスタータを始動させるためのキー・スイツ
チと、該キー・スイツチの投入により補助トルク
を発生させ、スタータのピニオンの噛み合わせが
正規に行われたとき上記メイン・リレーをそれぞ
れ付勢するエンゲージ・スイツチとを備え、複数
個のスタータでエンジンを駆動させるスタータ並
列運転スイツチ装置において、スタータのピニオ
ンの噛も合わせが正規に行われたときエンゲー
ジ・スイツチに現れる端子電圧を基に、各スター
タに対で設けられているエンゲージ・スイツチの
動作で全スタータのピニオンの正規の噛み合わせ
完了動作をチエツクする多数決回路を設けると共
に、該多数決回路からの出力に対応して、予め定
めた設定条件の下での駆動態様に応じて、エンジ
ンを駆動するようにしたことを特徴とするスター
タ並列運転スイツチ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10180786U JPH03523Y2 (ja) | 1986-07-02 | 1986-07-02 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10180786U JPH03523Y2 (ja) | 1986-07-02 | 1986-07-02 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS639463U JPS639463U (ja) | 1988-01-22 |
| JPH03523Y2 true JPH03523Y2 (ja) | 1991-01-10 |
Family
ID=30972875
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10180786U Expired JPH03523Y2 (ja) | 1986-07-02 | 1986-07-02 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03523Y2 (ja) |
-
1986
- 1986-07-02 JP JP10180786U patent/JPH03523Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS639463U (ja) | 1988-01-22 |
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