JPH0352424A - 自動利得制御回路 - Google Patents
自動利得制御回路Info
- Publication number
- JPH0352424A JPH0352424A JP1188147A JP18814789A JPH0352424A JP H0352424 A JPH0352424 A JP H0352424A JP 1188147 A JP1188147 A JP 1188147A JP 18814789 A JP18814789 A JP 18814789A JP H0352424 A JPH0352424 A JP H0352424A
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- JP
- Japan
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- output
- input
- circuit
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Control Of Amplification And Gain Control (AREA)
- Optical Communication System (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概 要〕
光海底中継装置等の受信回路に使用される自動利得制御
回路に関し、 光入力モニタが必要な受信レベル領域で正常に動作する
自動利得制御回路を提供することを目的とし、 光信号を受信して電気信号に変換する受光素子と、受光
素子の出力を入力して、スイッチの出力制御信号により
出力信号レベルが一定となるように増幅する増幅器と、
増幅器の出力を分岐して入力し、入力値が予め設定した
基準値より大の時には出力を増幅器に加え、基準値より
小の時には出力をバイアス供給回路に加えるスイッチと
、スイッチと受光素子の間に接続され、スイッチの出力
を入力して受光素子を駆動するためのバイアスを出力す
るバイアス供給回路とを有する光受信器の自動利得制御
回路において、バイアス供給回路と受光素子の間に挿入
され、バイアス供給回路の出力を入力して、入力が予め
設定した第２の基準値より大の時には入力をそのまま出
力して受光素子に加え、第２の基準値より小の時には出
力しない比較器を設けて構成する。
回路に関し、 光入力モニタが必要な受信レベル領域で正常に動作する
自動利得制御回路を提供することを目的とし、 光信号を受信して電気信号に変換する受光素子と、受光
素子の出力を入力して、スイッチの出力制御信号により
出力信号レベルが一定となるように増幅する増幅器と、
増幅器の出力を分岐して入力し、入力値が予め設定した
基準値より大の時には出力を増幅器に加え、基準値より
小の時には出力をバイアス供給回路に加えるスイッチと
、スイッチと受光素子の間に接続され、スイッチの出力
を入力して受光素子を駆動するためのバイアスを出力す
るバイアス供給回路とを有する光受信器の自動利得制御
回路において、バイアス供給回路と受光素子の間に挿入
され、バイアス供給回路の出力を入力して、入力が予め
設定した第２の基準値より大の時には入力をそのまま出
力して受光素子に加え、第２の基準値より小の時には出
力しない比較器を設けて構成する。
本発明は、光海底中継装置等の受信回路に使用される自
動利得！ＩＪ御回路（以下ＡＧＣ回路と称する）の改良
に関するものである。
動利得！ＩＪ御回路（以下ＡＧＣ回路と称する）の改良
に関するものである。
上記ＡＧＣ回路においては、伝送路、回路等の障害の発
生を早期に検出するために光入力モニタを行っている。
生を早期に検出するために光入力モニタを行っている。
この際、光入力モニタが必要な受信レベル領域で正常に
動作するＡＧＣ回路が要望されている． 〔従来の技術〕 第３図は一例のＤＣ／ＤＣコンバータ（以下ＤＣ／ＤＣ
ＣＯＮＶと称する）の人／出力特性図である。
動作するＡＧＣ回路が要望されている． 〔従来の技術〕 第３図は一例のＤＣ／ＤＣコンバータ（以下ＤＣ／ＤＣ
ＣＯＮＶと称する）の人／出力特性図である。
第４図は一例のアバランシエ・ホトダイオード（以下Ａ
ＰＤと称する）の特性図である。
ＰＤと称する）の特性図である。
第５図は従来例のＡＧＣ回路の構或を示すブロック図で
ある。
ある。
第６図は従来例の光入力に対するＡＧＣ増幅器（以下Ａ
ＧＣアンプと称する）特性、及びＡＰＤバイアス電圧特
性図である。
ＧＣアンプと称する）特性、及びＡＰＤバイアス電圧特
性図である。
第５図においてＡＰＤ １に例えばディジタルの光信号
が入力されると電気信号に変換されて出力される。この
出力がプリアンプ２を介してＡＧＣアンプ３に入力され
て、後述するスイッチの接点７の出力の制御信号により
ＡＧＣアンプ３の出力電圧が一定になるように増幅して
出力する。この出力が識別器（以下ＤＩＳと称する）４
に加えられて、ディジタル信号の“ｌ”と“Ｏ”の識別
が行われた後出力される。
が入力されると電気信号に変換されて出力される。この
出力がプリアンプ２を介してＡＧＣアンプ３に入力され
て、後述するスイッチの接点７の出力の制御信号により
ＡＧＣアンプ３の出力電圧が一定になるように増幅して
出力する。この出力が識別器（以下ＤＩＳと称する）４
に加えられて、ディジタル信号の“ｌ”と“Ｏ”の識別
が行われた後出力される。
上記出力が例えば９：１に分岐されて、１／１０の出力
戒分の方が平均値回路５に加えられディジタル出力の平
均値が求められる。平均値回路５の出力を演算増幅器（
以下オペアンプと称する）６の一方の入力端子に加える
．オペアンプ６の他方の入力端子にはあらかじめ決めた
基準電圧Ｖｒｅｆを加えておく。オペアンブ６において
平均値回路５からの入力と基準電圧Ｖｒｅｆとの比較を
行う。
戒分の方が平均値回路５に加えられディジタル出力の平
均値が求められる。平均値回路５の出力を演算増幅器（
以下オペアンプと称する）６の一方の入力端子に加える
．オペアンプ６の他方の入力端子にはあらかじめ決めた
基準電圧Ｖｒｅｆを加えておく。オペアンブ６において
平均値回路５からの入力と基準電圧Ｖｒｅｆとの比較を
行う。
そしてオペアンプ６の出力をスイッチの接点７に加える
が、オペアンブ６において平均値回路５の出力が基準電
圧Ｖｒｅｆより大の時にはスイッチの接点７を＾ＧＣア
ンプ３の側に切り替えて、平均値回路５の出力がＡＧＣ
アンプ３に制御信号として加えられるようにする。又、
平均値回路５の出力が基準電圧Ｖ ｒｅｆより小の時に
はスイッチの接点７をＤＣ／ＤＣ ＣＯＮＶ８の側に切
り替えて、平均値回路５の出力がＤＣ／ＤＣ ＣＯＮＶ
８に加えられるようにする。
が、オペアンブ６において平均値回路５の出力が基準電
圧Ｖｒｅｆより大の時にはスイッチの接点７を＾ＧＣア
ンプ３の側に切り替えて、平均値回路５の出力がＡＧＣ
アンプ３に制御信号として加えられるようにする。又、
平均値回路５の出力が基準電圧Ｖ ｒｅｆより小の時に
はスイッチの接点７をＤＣ／ＤＣ ＣＯＮＶ８の側に切
り替えて、平均値回路５の出力がＤＣ／ＤＣ ＣＯＮＶ
８に加えられるようにする。
ＡＧＣアンブ３は第６図に示すような利得特性を有する
．＾ＰＤ １への光入力が一定の値Ｓｏ （Ｍ準電圧
Ｖｒｅｆに対応）以上の時には、上述したオペアンブ６
の出力をスイッチの接点７を介してＡＧＣアンプ３に加
えることにより、光入力の増大とともに利得が低下し、
ＡＧＣアンプ３から一定の電圧を出力する。
．＾ＰＤ １への光入力が一定の値Ｓｏ （Ｍ準電圧
Ｖｒｅｆに対応）以上の時には、上述したオペアンブ６
の出力をスイッチの接点７を介してＡＧＣアンプ３に加
えることにより、光入力の増大とともに利得が低下し、
ＡＧＣアンプ３から一定の電圧を出力する。
又、ＡＰＤ ｌへの光入力が一定の値Ｓ０以下の時には
、オペアンプ６の出力がスイッチの接点７を介してＤＣ
／ＤＣ ＣＯＮＶＢに加えられる。ＤＣ／ＤＣ ＣＯＮ
Ｖ８は第３図に示すように、入力の負の電圧の絶対値の
増大とともに出力電圧が増大する特性を有するため、光
入力の減少とともにＤＣ／ＤＣ ＣＯＮＶ８への負の入
力電圧は増大しＤＣ／ＤＣ ＣＯＮν８の出力電圧も増
大する。この出力がＡＰＤ ｌへ加えられ、ＡＰＤ
１のバイアス電圧を増大し、その結果、ＡＰＤ １の増
倍率Ｍも増大して＾ｐｏ ｔの電気信号出力が増大し、
ＡＧＣアンプ３の出力を一定にする。このようにしてＡ
ＧＣ回路の出力を一定にしている。
、オペアンプ６の出力がスイッチの接点７を介してＤＣ
／ＤＣ ＣＯＮＶＢに加えられる。ＤＣ／ＤＣ ＣＯＮ
Ｖ８は第３図に示すように、入力の負の電圧の絶対値の
増大とともに出力電圧が増大する特性を有するため、光
入力の減少とともにＤＣ／ＤＣ ＣＯＮＶ８への負の入
力電圧は増大しＤＣ／ＤＣ ＣＯＮν８の出力電圧も増
大する。この出力がＡＰＤ ｌへ加えられ、ＡＰＤ
１のバイアス電圧を増大し、その結果、ＡＰＤ １の増
倍率Ｍも増大して＾ｐｏ ｔの電気信号出力が増大し、
ＡＧＣアンプ３の出力を一定にする。このようにしてＡ
ＧＣ回路の出力を一定にしている。
尚、スイッチの接点７のＡＧＣアンプ３に対する出力を
ビックアップしてＡＰＤ １への光入力をモニタするこ
とにより、伝送路、回路等の障害に備えるようにしてい
る。
ビックアップしてＡＰＤ １への光入力をモニタするこ
とにより、伝送路、回路等の障害に備えるようにしてい
る。
しかしながら上述の回路構成においては、第４図に示す
ようにＡＰＤ １はバイアス電圧を増大していくとある
値以上で暗電流（Ｉｏ）が増大し、一方、入力信号に対
応する光電流（ＩＬ）は一定ないし減少する特性を有す
る。このため第６図に示すように、光入力が減少した時
ＡＰＤ １のバイアス電圧は増加するが、暗電流も増大
するためＡＧＣアンプ３においてノイズを増幅すること
になり、第６図に示す（ａ）の部分のＡＧＣアンプ３の
利得が一定値だけ減少する。
ようにＡＰＤ １はバイアス電圧を増大していくとある
値以上で暗電流（Ｉｏ）が増大し、一方、入力信号に対
応する光電流（ＩＬ）は一定ないし減少する特性を有す
る。このため第６図に示すように、光入力が減少した時
ＡＰＤ １のバイアス電圧は増加するが、暗電流も増大
するためＡＧＣアンプ３においてノイズを増幅すること
になり、第６図に示す（ａ）の部分のＡＧＣアンプ３の
利得が一定値だけ減少する。
この結果、第６図に示すようにＡＧＣアンプ３の一定の
利得に対して制御電圧が２種類存在することになり、光
入力モニタが正常に機能しないという問題点があった。
利得に対して制御電圧が２種類存在することになり、光
入力モニタが正常に機能しないという問題点があった。
したがって本発明の目的は、光入カモニタが必要な受信
レベル領域で正常に動作する自動利得制御回路を提供す
ることにある。
レベル領域で正常に動作する自動利得制御回路を提供す
ることにある。
上記問題点は第ｌ図に示す回路構成によって解決される
。
。
即ち第ｌ図において、光信号を受信して電気信号に変換
する受光素子１００と、受光素子の出力を入力して、ス
イッチ７００の出力制御信号により出力信号レベルが一
定となるように増幅する増幅器３００と、増幅器の出力
を分岐して入力し、入力値が予め設定した基準値より大
の時には出力を増幅器に加え、基準値より小の時には出
力をバイアス供給回路８００に加えるスイッチ７００と
、スイッチと受光素子の間に接続され、スイッチの出力
を入力して受光素子を駆動するためのバイアスを出力す
るバイアス供給回路８００とを有する光受信器の自動利
得制御回路において、 ９００はバイアス供給回路と受光素子の間に設けられ、
バイアス供給回路の出力を入力して、入力が予め設定し
た第２の基準値より大の時には入力をそのまま出力して
該受光素子に加え、第２の基準値より小の時には出力し
ない比較器である。
する受光素子１００と、受光素子の出力を入力して、ス
イッチ７００の出力制御信号により出力信号レベルが一
定となるように増幅する増幅器３００と、増幅器の出力
を分岐して入力し、入力値が予め設定した基準値より大
の時には出力を増幅器に加え、基準値より小の時には出
力をバイアス供給回路８００に加えるスイッチ７００と
、スイッチと受光素子の間に接続され、スイッチの出力
を入力して受光素子を駆動するためのバイアスを出力す
るバイアス供給回路８００とを有する光受信器の自動利
得制御回路において、 ９００はバイアス供給回路と受光素子の間に設けられ、
バイアス供給回路の出力を入力して、入力が予め設定し
た第２の基準値より大の時には入力をそのまま出力して
該受光素子に加え、第２の基準値より小の時には出力し
ない比較器である。
第ｌ図において、比較器９００に加える第２の基準値と
して、第６図に示すＳＩに対応する電圧を設定する。そ
して比較器９００において、バイアス供給回路８００の
出力を入力して、入力が予め設定した第２の基準値より
大の時には入力をそのまま出力して受光素子１００に加
える。又、入力が第２の基準値より小の時には出力しな
いようにする。
して、第６図に示すＳＩに対応する電圧を設定する。そ
して比較器９００において、バイアス供給回路８００の
出力を入力して、入力が予め設定した第２の基準値より
大の時には入力をそのまま出力して受光素子１００に加
える。又、入力が第２の基準値より小の時には出力しな
いようにする。
この結果、第６図に示す（ａ）の部分が除去され八ＧＣ
アンプ３の一定の利得に対して１種類の制御電圧が対応
するようになり、必要な受信レベル領域で光入力モニタ
を正常に動作させることができる。
アンプ３の一定の利得に対して１種類の制御電圧が対応
するようになり、必要な受信レベル領域で光入力モニタ
を正常に動作させることができる。
第２図は本発明の実施例の＾ＧＣ回路の構威を示すブロ
ック図である． 全図を通じて同一符号は同一対象物を示す。
ック図である． 全図を通じて同一符号は同一対象物を示す。
第２図におイテ、ＡＰＤ １とＤＣ／ＤＣ ＣＯＮＶ
Ｂの間に設けた比較器９の一方の入力端子に加える基準
電圧Ｖｒｅｆ，として、第６図に示すＳ１に対応する電
圧を設定する。比較器９の他方の入力端子にはＤＣ／Ｄ
Ｃ ＣＯＮＶ ８ ノ出力を加える。そして、ＤＣ／Ｄ
Ｃ ＣＯＮＶ８からの入力電圧が基準電圧Ｖ ｒｅｆ
１より大の時にはＤＣ／ＤＣ ＣＯＮＶ８からの入力を
そのまま出力して、ＡＰＤ １に加える。一方、ＤＣ
／ＤＣ ＣＯＮＶ８からの入力電圧が基準電圧Ｖｒｅｆ
，より小の時には、比較器９からは何も出力しない。
Ｂの間に設けた比較器９の一方の入力端子に加える基準
電圧Ｖｒｅｆ，として、第６図に示すＳ１に対応する電
圧を設定する。比較器９の他方の入力端子にはＤＣ／Ｄ
Ｃ ＣＯＮＶ ８ ノ出力を加える。そして、ＤＣ／Ｄ
Ｃ ＣＯＮＶ８からの入力電圧が基準電圧Ｖ ｒｅｆ
１より大の時にはＤＣ／ＤＣ ＣＯＮＶ８からの入力を
そのまま出力して、ＡＰＤ １に加える。一方、ＤＣ
／ＤＣ ＣＯＮＶ８からの入力電圧が基準電圧Ｖｒｅｆ
，より小の時には、比較器９からは何も出力しない。
この結果、第６図に示す（ａ）の部分が除去され、必要
な受信レベル領域で光入力モニタを正常に動作させるこ
とができる。
な受信レベル領域で光入力モニタを正常に動作させるこ
とができる。
以上説明したように本発明によれば、必要な受信レベル
領域で光入力モニタを正常に動作させることができる。
領域で光入力モニタを正常に動作させることができる。
４
第ｌ図は本発明の原理図、
第２図は本発明の実施例のＡＧＣ回路の構成を示すブロ
ック図、 第３図は一例のＤＣ／ＤＣ ＣＯＮＶの入／出力特性図
、第４図は一例のＡＰＤの特性図、 第５図は従来例のＡＧＣ回路の構成を示すブロック図、 第６図は従来例の光入力に対するＡＧＣアンプ特性、及
びＡＰＤバイアス電圧特性図である。 図において ９００は比較器である。 を示す。 ＊発明の原埋ロ 第 １ 図 木発明の実施例のＡＣｒＣ回ｉ｝靖緘 宮示すブロック図 滓 ２ 図 第 ３ 目 第 斗 困
ック図、 第３図は一例のＤＣ／ＤＣ ＣＯＮＶの入／出力特性図
、第４図は一例のＡＰＤの特性図、 第５図は従来例のＡＧＣ回路の構成を示すブロック図、 第６図は従来例の光入力に対するＡＧＣアンプ特性、及
びＡＰＤバイアス電圧特性図である。 図において ９００は比較器である。 を示す。 ＊発明の原埋ロ 第 １ 図 木発明の実施例のＡＣｒＣ回ｉ｝靖緘 宮示すブロック図 滓 ２ 図 第 ３ 目 第 斗 困
Claims (1)
- 【特許請求の範囲】 光信号を受信して電気信号に変換する受光素子（１０
０）と、該受光素子の出力を入力して、スイッチ（７０
０）の出力制御信号により出力信号レベルが一定となる
ように増幅する増幅器（３００）と、該増幅器の出力を
分岐して入力し、該入力値が予め設定した基準値より大
の時には出力を該増幅器に加え、基準値より小の時には
出力をバイアス供給回路（８００）に加えるスイッチ（
７００）と、該スイッチと該受光素子の間に接続され、
該スイッチの出力を入力して該受光素子を駆動するため
のバイアスを出力するバイアス供給回路（８００）とを
有する光受信器の自動利得制御回路において、 該バイアス供給回路と該受光素子の間に挿入され、該バ
イアス供給回路の出力を入力して、入力が予め設定した
第２の基準値より大の時には入力をそのまま出力して該
受光素子に加え、第２の基準値より小の時には出力しな
い比較器（９００）を設けたことを特徴とする自動利得
制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1188147A JPH0352424A (ja) | 1989-07-20 | 1989-07-20 | 自動利得制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1188147A JPH0352424A (ja) | 1989-07-20 | 1989-07-20 | 自動利得制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0352424A true JPH0352424A (ja) | 1991-03-06 |
Family
ID=16218573
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1188147A Pending JPH0352424A (ja) | 1989-07-20 | 1989-07-20 | 自動利得制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0352424A (ja) |
-
1989
- 1989-07-20 JP JP1188147A patent/JPH0352424A/ja active Pending
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