JPH0354057U - - Google Patents
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- Publication number
- JPH0354057U JPH0354057U JP11195689U JP11195689U JPH0354057U JP H0354057 U JPH0354057 U JP H0354057U JP 11195689 U JP11195689 U JP 11195689U JP 11195689 U JP11195689 U JP 11195689U JP H0354057 U JPH0354057 U JP H0354057U
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- JP
- Japan
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- written
- parameter setting
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- detection circuit
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- Prior art date
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- 238000001514 detection method Methods 0.000 claims description 6
- 238000010586 diagram Methods 0.000 description 2
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- Power Sources (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
Description
第１図は本考案の一実施例の構成図、第２図は
従来におけるメモリのバツクアツプ回路の構成例
を示した図である。 １１〜１４……ＳＲＡＭ、２……主電源、３…
…バツクアツプ電源、７……パラメータ設定検出
回路、８……アドレスチエツカー、９……セレク
タ。
従来におけるメモリのバツクアツプ回路の構成例
を示した図である。 １１〜１４……ＳＲＡＭ、２……主電源、３…
…バツクアツプ電源、７……パラメータ設定検出
回路、８……アドレスチエツカー、９……セレク
タ。
Claims (1)
- 【実用新案登録請求の範囲】 複数のＳＲＡＭでメモリ領域を構成し、パラメ
ータが書き込まれるメモリ領域を構成する ＳＭＡＭをバツクアツプ電源に選択的に接続す
るメモリのバツクアツプ回路において、 ＳＲＡＭへのパラメータの書き込みの有無を検
出するパラメータ設定検出回路と、 書き込みアドレスと前記パラメータ設定検出回
路の検出信号をもとに、前記複数のＳＲＡＭのう
ちどのＳＲＡＭに書き込みを行つたかを検知する
アドレスチエツカーと、 このアドレスチエツカーの検知結果をもとに、
書き込みを行つたＳＲＡＭに前記バツクアツプ電
源を接続し、接続状態は電源が切れても保持する
セレクタ、 を具備したことを特徴とするメモリのバツクアツ
プ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11195689U JPH0354057U (ja) | 1989-09-25 | 1989-09-25 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11195689U JPH0354057U (ja) | 1989-09-25 | 1989-09-25 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0354057U true JPH0354057U (ja) | 1991-05-24 |
Family
ID=31660416
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11195689U Pending JPH0354057U (ja) | 1989-09-25 | 1989-09-25 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0354057U (ja) |
-
1989
- 1989-09-25 JP JP11195689U patent/JPH0354057U/ja active Pending
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