JPH0368619B2 - - Google Patents
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- JPH0368619B2 JPH0368619B2 JP21846889A JP21846889A JPH0368619B2 JP H0368619 B2 JPH0368619 B2 JP H0368619B2 JP 21846889 A JP21846889 A JP 21846889A JP 21846889 A JP21846889 A JP 21846889A JP H0368619 B2 JPH0368619 B2 JP H0368619B2
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Description
【発明の詳細な説明】
本発明は、雷サージなどの過電圧から装置を防
護するためのサージ電圧制限回路に関するもので
ある。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a surge voltage limiting circuit for protecting equipment from overvoltages such as lightning surges.
従来、雷サージ防護素子としては放電形避雷器
が使用されたきた。しかし、放電形避雷器は放電
電圧にばらつきがあることから、これに伴つて線
間に高電圧の横サージが発生することがあり、電
子化された装置では、横サージによつて破壊、誤
動作が問題になる。このため横サージを吸収すべ
く、本発明者らは、先に、ダイオードブリツジと
電圧制限素子とサイリスタを主たる構成要素とす
る防護回路を発明した(特願昭55−086499号)。 Conventionally, discharge type arresters have been used as lightning surge protection elements. However, because discharge-type lightning arresters have variations in discharge voltage, high-voltage lateral surges may occur between the lines, and electronic devices may be destroyed or malfunction due to lateral surges. It becomes a problem. Therefore, in order to absorb the lateral surge, the present inventors previously invented a protection circuit whose main components are a diode bridge, a voltage limiting element, and a thyristor (Japanese Patent Application No. 55-086499).
第1図は、前記発明の一実施例である。図にお
いて、1−1〜1−4は線路、2−1,2−2は
放電形避雷器、3−1,3−2はダイオードブリ
ツジ、4はバリスタなどの電圧制限素子、5はサ
イリスタ、6,7,8はコンデンサ、9は定電圧
ダイオード、10は抵抗、11は通信装置、12
は電圧制限回路である。動作原理を簡単に説明す
る。任意の線間に発生した横サージは3−1,3
−2で極性が一定化され、電圧制限回路12に印
加される。電圧制限回路12は、横サージが印加
されると、まず、コンデンサ6がサージ波形の立
上りをわずかに鈍らせ、電圧制限素子4の動作電
圧まで上昇する。ここで、コンデンサ6は信号に
は影響のない静電容量の小さなものである。電圧
制限素子4が動作すると大きな静電容量のコンデ
ンサ7によつて波形の立上りは大きく鈍り、電圧
制限素子4の動作電圧と定電圧ダイオード9の動
作電圧の和の電圧まで上昇する。ここで、定電圧
ダイオード9が動作するとコンデンサ8に電流が
流れ、この電流がサイリスタ5のゲートトリガ電
流より大きい場合にサイリスタ5は点弧し、サー
ジ電圧は電圧制限素子4の動作電圧にまで低下す
る。第2図はサージ吸収波形例を示す。図におい
て、13は印加サージ波形、14はサージ吸収波
形、VVRは電圧制限素子4の動作電圧、VZDは、
定電圧ダイオード9の動作電圧である。 FIG. 1 shows an embodiment of the invention. In the figure, 1-1 to 1-4 are lines, 2-1 and 2-2 are discharge type lightning arresters, 3-1 and 3-2 are diode bridges, 4 is a voltage limiting element such as a varistor, 5 is a thyristor, 6, 7, 8 are capacitors, 9 is a constant voltage diode, 10 is a resistor, 11 is a communication device, 12
is a voltage limiting circuit. The operating principle will be briefly explained. The horizontal surge that occurs between any lines is 3-1, 3
The polarity is made constant at -2 and applied to the voltage limiting circuit 12. In the voltage limiting circuit 12, when a lateral surge is applied, the capacitor 6 first slightly slows the rise of the surge waveform, and the voltage increases to the operating voltage of the voltage limiting element 4. Here, the capacitor 6 has a small capacitance that does not affect the signal. When the voltage limiting element 4 operates, the rise of the waveform is greatly blunted by the capacitor 7 having a large capacitance, and the voltage rises to the sum of the operating voltage of the voltage limiting element 4 and the operating voltage of the constant voltage diode 9. Here, when the constant voltage diode 9 operates, a current flows into the capacitor 8, and when this current is larger than the gate trigger current of the thyristor 5, the thyristor 5 is fired, and the surge voltage is reduced to the operating voltage of the voltage limiting element 4. do. FIG. 2 shows an example of a surge absorption waveform. In the figure, 13 is an applied surge waveform, 14 is a surge absorption waveform, V VR is the operating voltage of the voltage limiting element 4, and VZD is,
This is the operating voltage of the constant voltage diode 9.
この回路では、コンデンサ7は波形の立上りを
鈍らせるために静電容量の大きなものを用いるの
で、波形の立上りが早く高電圧のサージの場合、
定電圧ダイオード9が動作するまでに電圧制限素
子4に流れる電流は数10Aと大きくなることが
ある。一方、バリスタ、定電圧ダイオードなどの
電圧制限素子は動作領域で微分抵抗をもつので、
コンデンサ7に流れる電流によつて電圧制限素子
4の動作電圧は増大することになる。第3図は、
代表的はバリスタの動作抵抗を示すものである。
電圧制限素子4の動作電圧が増大すると、定電圧
ダイオード9が動作するときの電圧制限回路12
の電圧も増大することになる。第4図の破線は、
印加サージ電圧に対する電圧制限回路12の最大
制限電圧特性を示すものである。印加サージ電圧
が増加すると、すなわち、サージの立上りが速く
なるとコンデンサ7に流れる電流は増大するの
で、これに伴い最大制限電圧も上昇する様子がわ
かる。 In this circuit, a capacitor 7 with a large capacitance is used to slow down the rise of the waveform, so in the case of a high voltage surge where the waveform rises quickly,
The current flowing through the voltage limiting element 4 before the constant voltage diode 9 operates may become as large as several tens of amperes. On the other hand, voltage limiting elements such as varistors and voltage regulator diodes have differential resistance in their operating region, so
The operating voltage of the voltage limiting element 4 increases due to the current flowing through the capacitor 7. Figure 3 shows
A typical example is the operating resistance of a varistor.
When the operating voltage of the voltage limiting element 4 increases, the voltage limiting circuit 12 when the constant voltage diode 9 operates
The voltage will also increase. The broken line in Figure 4 is
It shows the maximum limiting voltage characteristics of the voltage limiting circuit 12 with respect to the applied surge voltage. It can be seen that as the applied surge voltage increases, that is, as the surge rises faster, the current flowing through the capacitor 7 increases, and the maximum limit voltage also increases accordingly.
この原因は、波形の立上りを鈍らせるコンデン
サ7の回路と、定電圧ダイオード9とコンデンサ
8から成るサイリスタのゲート回路が、共に電圧
制限素子4に接続されているため、コンデンサ7
に流れる電流によつて、電圧制限素子4の動作電
圧が上昇すると、その上昇分だけ定電圧ダイオー
ド9の動作が遅れることにある。 The reason for this is that the circuit of the capacitor 7 that slows the rise of the waveform and the gate circuit of the thyristor consisting of the constant voltage diode 9 and the capacitor 8 are both connected to the voltage limiting element 4.
When the operating voltage of the voltage limiting element 4 rises due to the current flowing through the voltage limiting element 4, the operation of the voltage regulator diode 9 is delayed by the amount of the rise.
本発明は、サージの立上りを鈍らせるコンデン
サを直列に含む回路とサイリスタのゲートにトリ
ガ電流を供給する回路を別々に構成し、これらを
並列に接続することによつて、立上り峻度抑制回
路に流れる電流が変化しても、サイルスタのゲー
ト回路には、ほぼ一定の電圧でゲートトリガ電流
が供給され、低く安定した最大制限電圧特性が得
られるようにしたものである。 The present invention separately configures a circuit including a capacitor in series that blunts the rise of a surge and a circuit that supplies a trigger current to the gate of a thyristor, and connects them in parallel to create a rise steepness suppression circuit. Even if the flowing current changes, the gate trigger current is supplied to the SILSTAR gate circuit at a substantially constant voltage, so that a low and stable maximum limit voltage characteristic can be obtained.
第5図は、本発明の一実施例である。同図にお
いて、4は第1の電圧制限素子で、サージ電流耐
量の大きいバリスタ等が用いられる。4の動作電
圧は電話の直流電圧である48Vを僅かに超える電
圧である。5はサイリスタである。4と5で主サ
ージ吸収回路を構成する。34は第2の電圧制限
素子である定電圧ダイオードで、動作電圧は電話
のハウラ信号音電圧である約140Vを僅かに超え
るものとする。8はコンデンサで0.1μF程度とす
る。34と8の直列回路がサイリスタのゲート点
弧回路を成す。また、32は動作電圧が電話の絶
縁試験電圧である250Vを僅かに超える定電圧ダ
イオードであり、もう1つのゲート点弧回路を成
す。15は定電圧ダイオードで、動作電圧は電話
の直流電圧では48Vを僅かに超える電圧である。
16は0.5μF程度のコンデンサである。15と1
6でサージ電圧立ち上がり峻度制限回路を構成す
る。17は静電容量の小さなコンデンサ、36は
サイリスタ5が点弧する際、コンデンサ16の電
荷を放電するための抵抗、37はコンデンサ8の
電荷を放電するための抵抗、38は定電圧ダイオ
ード34が動作する前にコンデンサ8に変位電流
を流さないためのダイオードで、バリスタ4が動
作したとき4から8へ流れるようとする電流を阻
止する。18はサイリスタ5が動作しなかつたと
き、コンデンサ8および16の電荷を放電させる
ための抵抗で、電話の絶縁試験に影響しないよう
に1MΩ以上の抵抗値のものである。 FIG. 5 is an embodiment of the present invention. In the figure, 4 is a first voltage limiting element, and a varistor or the like having a large surge current resistance is used. The operating voltage of No. 4 is slightly higher than the telephone's DC voltage of 48V. 5 is a thyristor. 4 and 5 constitute the main surge absorption circuit. 34 is a constant voltage diode which is a second voltage limiting element, and its operating voltage is slightly higher than about 140V, which is the telephone howler signal tone voltage. 8 is a capacitor of about 0.1μF. The series circuit of 34 and 8 forms the thyristor gate firing circuit. Further, 32 is a constant voltage diode whose operating voltage slightly exceeds 250V, which is the insulation test voltage for telephones, and constitutes another gate ignition circuit. Reference numeral 15 denotes a constant voltage diode whose operating voltage is slightly higher than 48V in terms of telephone direct current voltage.
16 is a capacitor of about 0.5μF. 15 and 1
6 constitutes a surge voltage rise steepness limiting circuit. 17 is a capacitor with a small capacitance, 36 is a resistor for discharging the charge of the capacitor 16 when the thyristor 5 is fired, 37 is a resistor for discharging the charge of the capacitor 8, and 38 is a constant voltage diode 34. This diode prevents displacement current from flowing through capacitor 8 before operation, and blocks current from flowing from 4 to 8 when varistor 4 operates. 18 is a resistor for discharging the charges in the capacitors 8 and 16 when the thyristor 5 does not operate, and has a resistance value of 1 MΩ or more so as not to affect the insulation test of the telephone.
回路動作の詳細な説明に先立つて、本実施例の
ねらいについて述べる。本発明は、前述のよう
に、雷サージ等の過電圧から主として電子化され
た電子機器を防護するための回路である。電子機
器は過電圧に対して破壊されやすいため、電話で
使用する信号電圧以外の電圧はできるだけ低い電
圧に制限することが望ましい。電話には、従来よ
り知られているように次の信号がある。 Prior to a detailed explanation of the circuit operation, the aim of this embodiment will be described. As mentioned above, the present invention is a circuit mainly for protecting computerized electronic equipment from overvoltages such as lightning surges. Since electronic equipment is easily damaged by overvoltage, it is desirable to limit voltages other than signal voltages used in telephones to as low a voltage as possible. Telephones have the following signals, as is conventionally known:
通話信号:電圧48V以下、周波数は数kHz。 Call signal: Voltage 48V or less, frequency several kHz.
ハウラ信号:電圧は140V、周波数は400Hz。 Howrah signal: Voltage is 140V, frequency is 400Hz.
回線絶縁試験電圧:電圧は250V、直流で印
加され1MΩ以上の抵抗値が必要。 Line insulation test voltage: Voltage is 250V, applied as direct current, and resistance value of 1MΩ or more is required.
一方、回線に侵入するサージは雷サージに代表
されるが、電圧は数kV、時間は数μs〜1ms(周
波数に換算して約1000Hz以上)である。従つて、
信号に影響せずサージのみを効率より吸収するた
めの回路の目標としては、
400Hz以上の電圧に対しては、できれば140V
以上でかつできるだけ低い電圧が動作するこ
と、また、少くとも250Vを僅かに超える電圧
が動作すること。 On the other hand, surges that enter the line are typified by lightning surges, and the voltage is several kV and the time is several μs to 1 ms (approximately 1000 Hz or more in terms of frequency). Therefore,
The goal for a circuit that absorbs only surges without affecting the signal is to use 140V if possible for voltages over 400Hz.
It must operate at a voltage that is higher than that and as low as possible, and at least a voltage that slightly exceeds 250V.
直流に対しては、250V以下で動作しないこ
と。 For direct current, do not operate below 250V.
である。本実施例がこの条件を満たすことを、従
来の回路(第1図)との比較において、以下に述
べる。It is. The fact that this embodiment satisfies this condition will be described below in comparison with a conventional circuit (FIG. 1).
第5図において、発明の主たる部分は、4と5
からなる主サージ吸収回路と、定電圧ダイオード
34とコンデンサ8から成るサイリスタゲート回
路である。なお、第1図の従来の回路ではバリス
タ4と定電圧ダイオード9とコンデンサ8の直列
回路によりゲート回路が構成されている。 In FIG. 5, the main parts of the invention are 4 and 5.
and a thyristor gate circuit consisting of a constant voltage diode 34 and a capacitor 8. In the conventional circuit shown in FIG. 1, a gate circuit is constituted by a series circuit of a varistor 4, a constant voltage diode 9, and a capacitor 8.
動作を以下に述べる。第5図において、ゲート
回路には直列にコンデンサが入つているため、サ
ージ吸収回路の両端に直流が印加されてもサイリ
スタ5は動作せず回路は不導通である。従つて、
上記の250Vの絶縁試験は問題ない。一方、サー
ジが加わつた場合には、コンデンサ8に変位電流
が流れるため、この電流がサイリスタのゲートオ
ン電流以上であればサイリスタは導通する。サイ
リスタのターンオン時間は従来良く知られたよう
にゲート電流に依存する。即ち、ゲート電流が大
きくなる程高速にオンする。サージ吸収用サイリ
スタでは高速な動作が望ましいためゲート電流は
比較的高くなる。本実施例の場合には、100mA
程度の電流が必要である。サージが印加されたと
き、このゲートオン電流をできるだけ少ない遅れ
時間で如何に供給できるかがサージ吸収回路の特
性を決める重要な要素である。 The operation is described below. In FIG. 5, since the gate circuit includes a capacitor in series, even if a direct current is applied to both ends of the surge absorption circuit, the thyristor 5 does not operate and the circuit is non-conductive. Therefore,
There is no problem with the above 250V insulation test. On the other hand, when a surge is applied, a displacement current flows through the capacitor 8, so if this current is equal to or higher than the gate-on current of the thyristor, the thyristor becomes conductive. As is well known in the art, the turn-on time of a thyristor depends on the gate current. That is, the larger the gate current is, the faster it turns on. Since it is desirable for surge absorbing thyristors to operate at high speed, the gate current is relatively high. In the case of this example, 100mA
A certain amount of current is required. When a surge is applied, how this gate-on current can be supplied with as little delay time as possible is an important factor that determines the characteristics of the surge absorption circuit.
本実施例では、ゲート回路は定電圧ダイオード
34とコンデンサ8を用いている。定電圧ダイオ
ードは、サージ電流耐量は小さいが、動作電圧近
傍のインピーダンスは低い利点がある。具体的に
は、動作電圧が140V程度の定電圧ダイオードの
場合、100mA程度の通電による電圧降下は数V
である。従つて、サージ電圧が140Vを僅かに超
えると、サイリスタのゲートには速やかに十分な
電流が流れる。少しの遅れ時間の後サイリスタは
点弧する。サイリスタが点弧すると、主サージ吸
収回路が動作するので、サージ電流はバリスタ4
とサイリスタ5を通過する。従つてサージ電圧は
バリスタ4の電圧に制限される。バリスタ4は第
3図に示したように動作電圧近傍でサージインピ
ーダンスが高い欠点であるが、サージ電流耐量が
高いため大電流を流せる利点がある。48Vを僅か
に超えるような電圧(例えば70〜80V)で動作す
るバリスタを選ぶと、100A程度のサージ電流が
流れた場合の電圧降下は第3図より約2倍の電圧
降下140〜160Vとなる。このように、本実施例に
よれば、140Vを僅かに超えた電圧で主サージ吸
収回路が動作し、サージ電圧を160V程度以下に
制限する。 In this embodiment, the gate circuit uses a constant voltage diode 34 and a capacitor 8. A constant voltage diode has a small surge current capability, but has the advantage of a low impedance near the operating voltage. Specifically, in the case of a constant voltage diode with an operating voltage of about 140V, the voltage drop due to a current of about 100mA is a few volts.
It is. Therefore, when the surge voltage slightly exceeds 140V, sufficient current quickly flows through the gate of the thyristor. After a short delay time the thyristor fires. When the thyristor fires, the main surge absorption circuit operates, so the surge current is absorbed by the varistor 4.
and passes through thyristor 5. Therefore, the surge voltage is limited to the voltage of the varistor 4. As shown in FIG. 3, the varistor 4 has the disadvantage of high surge impedance near the operating voltage, but has the advantage of being able to flow a large current due to its high surge current resistance. If you choose a varistor that operates at a voltage slightly over 48V (for example, 70 to 80V), the voltage drop when a surge current of about 100A flows will be 140 to 160V, which is about twice as much as shown in Figure 3. . As described above, according to this embodiment, the main surge absorption circuit operates at a voltage slightly exceeding 140V, and limits the surge voltage to about 160V or less.
一方、第1図に示す従来の回路では、ゲート回
路に主サージ回路を構成するバリスタ4が用いら
れている。即ち、サイリスタを点弧させるために
は、4と9が動作しなければならない。バリスタ
4は第3図に示し、また上記のように動作電圧近
傍のインピーダンスが高い欠点がある。従つて、
サイリスタの動作に必要な100mAの電流が流れ
る間にバリスタの電圧は第3図に示すように数10
%上昇する。更に、サイリスタが点弧するまでの
遅れ時間にバリスタの電圧は更に上昇する。この
ようにして、サージ電圧が上がるに従つて、即ち
波形の立ち上がりが急峻になるに従つて、吸収電
圧は第4図の破線で示すように上昇ることとな
る。 On the other hand, in the conventional circuit shown in FIG. 1, a varistor 4 constituting a main surge circuit is used in the gate circuit. That is, 4 and 9 must operate in order to fire the thyristor. The varistor 4 is shown in FIG. 3, and has the drawback of high impedance near the operating voltage as described above. Therefore,
While the 100 mA current necessary for thyristor operation flows, the voltage of the varistor increases by several tens of meters as shown in Figure 3.
%Rise. Furthermore, during the delay time until the thyristor fires, the voltage across the varistor further increases. In this way, as the surge voltage increases, that is, as the rise of the waveform becomes steeper, the absorbed voltage increases as shown by the broken line in FIG. 4.
次に、第5図に示す本実施例の回路構成の機能
について第6図を用いて説明する。第6図は第5
図の回路の動作によるサージ吸収波形を示すもの
である(第6図はサージ電流が50A程度の場合で
ある)。第6図において、13はサージ電圧であ
る。サージが加わると、先ずコンデンサ17と1
6の直列回路が動作し波形を少し鈍らせる。サー
ジ電圧が定電圧ダイオード15の動作電圧(48V
を僅かに超える電圧)に達すると、定電圧ダイオ
ード15と静電容量の大きなコンデンサ16の直
列回路が動作し波形を大きく鈍らせる。更に電圧
が上昇し、定電圧ダイオード34が、140Vを僅
かに超える電圧で動作すると、サイリスタのゲー
トに電流が流れ、少しの遅れの時間の後サイリス
タ5は動作する。サイリスタ5が動作するとバリ
スタ4にサージ電流が流れる。サージ電流が50A
程度とすると、第3図より制限電圧はバリスタの
動作電圧の1.5倍程度となる。即ち、動作電圧が
70〜80Vのバリスタを用いている制限電圧は
120V程度に下がる。第3図でVVRZの電圧である。
また、サイリスが導通すると、コンデンサ8に充
電された電荷は38,37,5の経路で放電され
る。更に、コンデンサ16に充電された電荷は1
5,4,5の経路で放電される。サージが去る
と、本回路に印加される電圧は電話の直流電圧の
みとなる。即ち、48V程度となるためバリスタ4
はオフ状態になる。従つて、サイリスタ5には電
流が流れなくなり、サイリスタもオフ状態に戻
る。 Next, the functions of the circuit configuration of this embodiment shown in FIG. 5 will be explained using FIG. 6. Figure 6 is the 5th
This figure shows a surge absorption waveform due to the operation of the circuit shown in the figure (Figure 6 shows the case where the surge current is about 50A). In FIG. 6, 13 is a surge voltage. When a surge is applied, capacitors 17 and 1 are first
The series circuit of 6 operates and makes the waveform a little dull. The surge voltage is the operating voltage of the voltage regulator diode 15 (48V
When the voltage slightly exceeds 100 Ω, the series circuit of the constant voltage diode 15 and the capacitor 16 with a large capacitance operates, greatly dulling the waveform. When the voltage increases further and the constant voltage diode 34 operates at a voltage slightly above 140V, current flows through the gate of the thyristor and after a short delay time the thyristor 5 operates. When the thyristor 5 operates, a surge current flows through the varistor 4. Surge current is 50A
As shown in FIG. 3, the limiting voltage is about 1.5 times the operating voltage of the varistor. That is, the operating voltage
The limiting voltage using a 70-80V varistor is
It drops to about 120V. In Figure 3, it is the voltage of V VRZ .
Further, when the silis becomes conductive, the electric charge charged in the capacitor 8 is discharged through the paths 38, 37, and 5. Furthermore, the electric charge charged in the capacitor 16 is 1
It is discharged along the route 5, 4, 5. When the surge subsides, the only voltage applied to the circuit is the telephone's DC voltage. In other words, the voltage is about 48V, so varistor 4
is turned off. Therefore, no current flows through the thyristor 5, and the thyristor also returns to its off state.
第5図の回路において、32は250Vを僅かに
超える電圧が動作する定電圧ダイオードである。
この回路は、例えば、電話回路にサージ以外の直
流の過電圧が印加された場合等に、本回路を動作
状態にし、電子化電子機器を防護するためのもの
である。 In the circuit of FIG. 5, 32 is a constant voltage diode that operates at a voltage slightly over 250V.
This circuit is for activating the circuit and protecting the computerized electronic equipment, for example, when a direct current overvoltage other than a surge is applied to the telephone circuit.
本発明において、第2の電圧制限素子は1つの
定電圧ダイオードとは限る必要はなく、複数の定
電圧ダイオードを直列に接続してもよい。第7図
はこのような実施例である。第7図において、9
は定電圧ダイオードである。9の動作電圧は15
と9の直列回路の動作電圧が140Vを僅かに超え
るように設定する。即ち、定電圧ダイオード15
の動作電圧を60V程度とすると、定電圧ダイオー
ド9は80V程度で動作するように設定する。ゲー
ト回路は15と30と31と33と9と8の直列
回路で構成される。動作は第5図と同様であるの
で簡単に説明する。先ず、サージが加わると、1
5と16の直列回路が動作し波形を鈍らせる。次
に、電圧が140Vを僅かに超えると上記のゲート
回路が動作し、サイリスタが導通し、バリスタの
制限電圧になる。 In the present invention, the second voltage limiting element is not limited to one constant voltage diode, and a plurality of constant voltage diodes may be connected in series. FIG. 7 shows such an embodiment. In Figure 7, 9
is a constant voltage diode. The operating voltage of 9 is 15
Set the operating voltage of the series circuit of and 9 to slightly exceed 140V. That is, the constant voltage diode 15
Assuming that the operating voltage of is about 60V, the voltage regulator diode 9 is set to operate at about 80V. The gate circuit is composed of a series circuit of 15, 30, 31, 33, 9, and 8. Since the operation is similar to that shown in FIG. 5, it will be briefly explained. First, when a surge is added, 1
The series circuit of 5 and 16 operates to dull the waveform. Next, when the voltage slightly exceeds 140V, the gate circuit described above is activated, the thyristor becomes conductive, and the voltage becomes the varistor limit voltage.
本発明は、サージの立ち上がりを低い電圧で鈍
らせることができ、また、印加サージ電圧が上昇
しても最大制限電圧を低く抑えることができるた
め、低い電圧がサージ電圧を制限する必要がある
PNPNスイツチを使用する通信装置へ適用した
場合、信頼性向上に効果がある。 According to the present invention, the rise of a surge can be blunted with a low voltage, and even if the applied surge voltage increases, the maximum limiting voltage can be kept low, so a low voltage is necessary to limit the surge voltage.
When applied to communication equipment that uses a PNPN switch, it is effective in improving reliability.
第1図は従来のサージ防護回路、第2図は第1
図のサージ吸収波形、第3図はバリスタの電圧・
電流特性、第4図は最大制限電圧特性、第5図は
本発明の一実施例、第6図は第5図のサージ吸収
波形、第7図は本発明の他の実施例である。
1−1〜1−4……線路、2−1,2−2……
放電形避雷器、3−1,3−2……ダイオードブ
リツジ、4……電圧制限素子(バリスタ)、5…
…サイリスタ、6,7,8,16,17……コン
デンサ、9,15,32,34……電圧制限素子
(定電圧ダイオード)、10,18,30,33,
36,37……抵抗、11……通信装置、12…
…電圧制限回路、13……印加サージ波形、14
……サージ吸収波形、31,35,38……ダイ
オード。
Figure 1 shows the conventional surge protection circuit, Figure 2 shows the 1st surge protection circuit.
Figure 3 shows the surge absorption waveform, and Figure 3 shows the varistor voltage and
4 shows the maximum limiting voltage characteristic, FIG. 5 shows an embodiment of the present invention, FIG. 6 shows the surge absorption waveform of FIG. 5, and FIG. 7 shows another embodiment of the present invention. 1-1 to 1-4...Railway, 2-1, 2-2...
Discharge type lightning arrester, 3-1, 3-2... diode bridge, 4... voltage limiting element (varistor), 5...
...Thyristor, 6,7,8,16,17...Capacitor, 9,15,32,34...Voltage limiting element (constant voltage diode), 10,18,30,33,
36, 37...Resistor, 11...Communication device, 12...
...Voltage limiting circuit, 13... Applied surge waveform, 14
... Surge absorption waveform, 31, 35, 38... Diode.
Claims (1)
されたサイリスタ5とからなる主サージ吸収回路
と、前記サイリスタの点弧回路と、を有するサー
ジ吸収回路であつて、前記点弧回路は、該動作開
始電圧が前記第1の電圧制限素子の制限電圧より
も高い第2の電圧制限素子34とコンデンサ8の
直列回路を有して構成され、前記点弧回路は、一
端が前記第1の電圧制限素子のサイリスタが接続
されていない側の端子に接続され、他端が前記サ
イリスタのゲート端子に接続されていることを特
徴とするサージ電圧制限回路。1 A surge absorption circuit comprising a main surge absorption circuit consisting of a first voltage limiting element 4 and a thyristor 5 connected in series to the element, and an ignition circuit for the thyristor, wherein the ignition circuit is , the ignition circuit has a series circuit including a second voltage limiting element 34 whose operation start voltage is higher than the limiting voltage of the first voltage limiting element and a capacitor 8, and one end of the ignition circuit is connected to the first voltage limiting element. A surge voltage limiting circuit characterized in that the voltage limiting element is connected to a terminal on the side to which the thyristor is not connected, and the other end is connected to the gate terminal of the thyristor.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21846889A JPH0284017A (en) | 1989-08-28 | 1989-08-28 | Surge voltage limiter |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21846889A JPH0284017A (en) | 1989-08-28 | 1989-08-28 | Surge voltage limiter |
Related Parent Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17118681A Division JPS5872336A (en) | 1981-10-26 | 1981-10-26 | Surge voltage limiting circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0284017A JPH0284017A (en) | 1990-03-26 |
| JPH0368619B2 true JPH0368619B2 (en) | 1991-10-29 |
Family
ID=16720391
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21846889A Granted JPH0284017A (en) | 1989-08-28 | 1989-08-28 | Surge voltage limiter |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0284017A (en) |
-
1989
- 1989-08-28 JP JP21846889A patent/JPH0284017A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0284017A (en) | 1990-03-26 |
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