JPH0370279A - Ｔｆｔアクティブマトリクス液晶パネルの駆動方法 - Google Patents
Ｔｆｔアクティブマトリクス液晶パネルの駆動方法Info
- Publication number
- JPH0370279A JPH0370279A JP20650789A JP20650789A JPH0370279A JP H0370279 A JPH0370279 A JP H0370279A JP 20650789 A JP20650789 A JP 20650789A JP 20650789 A JP20650789 A JP 20650789A JP H0370279 A JPH0370279 A JP H0370279A
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- JP
- Japan
- Prior art keywords
- liquid crystal
- line
- driver
- tft
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- Pending
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- Video Image Reproduction Devices For Color Tv Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明はＴ Ｆ Ｔ （Ｔｈｉｎ Ｆｉｌｍ Ｔｒａ
ｎｓｉｓｔｏｒ）アクティブマトリクス液晶パネルの駆
動方法に関するものである。
ｎｓｉｓｔｏｒ）アクティブマトリクス液晶パネルの駆
動方法に関するものである。
第３図は従来のＴＦＴアクティブマトリクス液晶パネル
の等価回路図である０図において、１はマトリクス状に
配された液晶セル、２は各液晶セル１と並列になされて
いる記憶用コンデンサ、３は各液晶セルｌ毎にその一方
の電極（ドレイン電極あるいは画素電極）に接続されて
設けられている電界効果トランジスタ（ＦＥＴあるいは
ＴＦＴ）であって、これら３つの素子にて一画素を構成
している。４はマトリクスの各列毎にＦＥＴ３の入力電
極（ソース電極）に共通に接続された複数のＸｔ極、５
はマトリクスの各行毎にＦＥＴ３のゲート電極に共通接
続された複数のＹ電極である。
の等価回路図である０図において、１はマトリクス状に
配された液晶セル、２は各液晶セル１と並列になされて
いる記憶用コンデンサ、３は各液晶セルｌ毎にその一方
の電極（ドレイン電極あるいは画素電極）に接続されて
設けられている電界効果トランジスタ（ＦＥＴあるいは
ＴＦＴ）であって、これら３つの素子にて一画素を構成
している。４はマトリクスの各列毎にＦＥＴ３の入力電
極（ソース電極）に共通に接続された複数のＸｔ極、５
はマトリクスの各行毎にＦＥＴ３のゲート電極に共通接
続された複数のＹ電極である。
また６はＹ電極５に順次走査パルスを印加する走査回路
、７は映像信号をサンプリングホールドすることにより
、１水平走査線分の映像信号をＸ電極数の並列の映像信
号に変換し、Ｘ電極４に印加する直／並列変換回路であ
り、９は直／並列変換回路７に交流化映像信号を供給す
るため、映像信号を交流化する各Ｒ，Ｇ、 Ｂの交流化
回路である。８は全ての液晶セル１の他方の電極に共通
接続された共通電極である。
、７は映像信号をサンプリングホールドすることにより
、１水平走査線分の映像信号をＸ電極数の並列の映像信
号に変換し、Ｘ電極４に印加する直／並列変換回路であ
り、９は直／並列変換回路７に交流化映像信号を供給す
るため、映像信号を交流化する各Ｒ，Ｇ、 Ｂの交流化
回路である。８は全ての液晶セル１の他方の電極に共通
接続された共通電極である。
第５図は第３図の各液晶セル上に配されたＲｌＧ、Ｂの
画素形状及び画素配列を示すものである。
画素形状及び画素配列を示すものである。
この図で、実線枠がほぼ同じ時刻でサンプリング表示さ
れる単位（１絵素）を示しており、この１つの駆動単位
（１絵素）がＲ，Ｇ、Ｂの各１画素よりなっている。
れる単位（１絵素）を示しており、この１つの駆動単位
（１絵素）がＲ，Ｇ、Ｂの各１画素よりなっている。
次に同図の表示装置を駆動する方法について説明する。
今、Ｙ電極の１行目の電極をＹｌとすると、−Ｙ電極５
の各電極、例えばＹ１〜Ｙ４の電極には第４図のＹ ｌ
”’ Ｙ ａのようなタイミングの波形信号が走査回路
６により印加されている。この走査パルスがＦＥＴ３の
ゲートに加わるとその選択された行の総てのＦＥＴ３は
オン状態となり、Ｘ電極４から並列映像信号に応じた電
荷がＦＥＴ３を介して記憶用コンデンサ２に充電される
。そして、ＦＥＴ３がオフ状態になっても、記憶用コン
デンサ２に蓄えられた電荷により液晶に映像信号に対応
した電圧が印加され続けるため、各液晶セルの透過光が
映像信号により制御され表示できることになる。また、
第５図に示したような駆動単位、例えばＲ，Ｇ、Ｂを同
時刻でサンプリングし、表示するというような方法は、
直／並列変換回路７へのサンプリングクロックの与え方
等によりコントロールできる。
の各電極、例えばＹ１〜Ｙ４の電極には第４図のＹ ｌ
”’ Ｙ ａのようなタイミングの波形信号が走査回路
６により印加されている。この走査パルスがＦＥＴ３の
ゲートに加わるとその選択された行の総てのＦＥＴ３は
オン状態となり、Ｘ電極４から並列映像信号に応じた電
荷がＦＥＴ３を介して記憶用コンデンサ２に充電される
。そして、ＦＥＴ３がオフ状態になっても、記憶用コン
デンサ２に蓄えられた電荷により液晶に映像信号に対応
した電圧が印加され続けるため、各液晶セルの透過光が
映像信号により制御され表示できることになる。また、
第５図に示したような駆動単位、例えばＲ，Ｇ、Ｂを同
時刻でサンプリングし、表示するというような方法は、
直／並列変換回路７へのサンプリングクロックの与え方
等によりコントロールできる。
なお、液晶に同極性の電圧を印加し続けると、寿命が短
くなるという問題があるため、液晶に印加する電圧の極
性が逆になっても、はぼ同じ透過光特性を有しているこ
とを利用して、共通電極８の電位に対して画素電極の電
位がＮＴＳＣ信号のフィールド周期（パネルでの表示原
理上では、）しかしながら、正確には上記交流化の際、
その極性によって若干の透過光特性の相違があり、この
ため、フィールド周期（６０Ｈｚ）で明るい画面と暗い
画面が繰り返されることになり、結果的にフレーム周期
（３０Ｈｚ）のフリッカが生じることになる。
くなるという問題があるため、液晶に印加する電圧の極
性が逆になっても、はぼ同じ透過光特性を有しているこ
とを利用して、共通電極８の電位に対して画素電極の電
位がＮＴＳＣ信号のフィールド周期（パネルでの表示原
理上では、）しかしながら、正確には上記交流化の際、
その極性によって若干の透過光特性の相違があり、この
ため、フィールド周期（６０Ｈｚ）で明るい画面と暗い
画面が繰り返されることになり、結果的にフレーム周期
（３０Ｈｚ）のフリッカが生じることになる。
従来、この種の大画面のフリッカの対策として、例えば
第５図に示すように正極性あるいは負極性でドライブす
る画素を図中の斜線部と無斜線部に分割して大画面プリ
ン力を低減していた。すなわち、何の対策も行わない場
合、６０Ｈｚで画面全体が明／暗と変化するが、上記の
ような対策を行なうと、画面の部分領域では同じ＜６０
Ｈｚでそれぞれ明／暗を繰り返しているが、明／暗のＮ
域が画面内に分散されているため、視覚的なＬＰ（ロー
パス）効果が働き、明／暗の平均輝度として認知される
訳である。しかしながら、このような対策では、少し近
づくと縦に規則正しく縞模様が発生するため、知覚され
やすいという問題があった。そこで、第２図に示したよ
うに、ゲートライン単位でも交流化の極性を変えること
が考えられたが、このようにゲートライン周期で反転さ
せると、Ｘ電極に供給すべき信号がＩＨ（１水平期間二
Ｔ■の場合６３．５μ５ｅｃ）周期となり、その基本周
波数が従来の３０Ｈｚから、１５ＫＨｚと極端に高くな
る。Ｘｔ極はパネルの縦方向にパスラインとして端から
端まで配線されており、その分布容量も相当なものとな
っている。従って上記のように信号の周波数が高くなる
と、その分布容量分も含め、ＩＨ期間内でドライブする
ことがドライバの駆動能力の点で極めて難しく、第２図
のようなフリッカ対策は困難であった。
第５図に示すように正極性あるいは負極性でドライブす
る画素を図中の斜線部と無斜線部に分割して大画面プリ
ン力を低減していた。すなわち、何の対策も行わない場
合、６０Ｈｚで画面全体が明／暗と変化するが、上記の
ような対策を行なうと、画面の部分領域では同じ＜６０
Ｈｚでそれぞれ明／暗を繰り返しているが、明／暗のＮ
域が画面内に分散されているため、視覚的なＬＰ（ロー
パス）効果が働き、明／暗の平均輝度として認知される
訳である。しかしながら、このような対策では、少し近
づくと縦に規則正しく縞模様が発生するため、知覚され
やすいという問題があった。そこで、第２図に示したよ
うに、ゲートライン単位でも交流化の極性を変えること
が考えられたが、このようにゲートライン周期で反転さ
せると、Ｘ電極に供給すべき信号がＩＨ（１水平期間二
Ｔ■の場合６３．５μ５ｅｃ）周期となり、その基本周
波数が従来の３０Ｈｚから、１５ＫＨｚと極端に高くな
る。Ｘｔ極はパネルの縦方向にパスラインとして端から
端まで配線されており、その分布容量も相当なものとな
っている。従って上記のように信号の周波数が高くなる
と、その分布容量分も含め、ＩＨ期間内でドライブする
ことがドライバの駆動能力の点で極めて難しく、第２図
のようなフリッカ対策は困難であった。
次に第３図の直／並列変換回路７（ソースライントライ
バ）のｍ威について説明する。第６図はその構成国であ
り、１ライン分の交流化映像信号をＸ電極数分に分割し
てそれぞれの電位を保持するサンプル／ホールド回路（
Ｓ／Ｈ）１０と、その各出力のドライブを制御し、かつ
ドライブ能力を上げるための時分割型ドライバ１１から
戒っている０通常、第６図のようなソースドライバでは
、１ライン分の映像信号をＩＨの有効映像期間、Ｓ／Ｈ
Ｌ、その帰線期間にドライバに供給されるアウトプット
イネーブル信号ＯＥの制御に基づき、−斉にドライブさ
れることになる。このため、実線のドライブ期間が帰線
期間である１０μｓｅｃ程度（ＴＶの場合）しかないた
め、この間に記憶用コンデンサ２にチャージあるいはデ
ィスチャージする必要性から、ＴＦＴ３のＩ。Ｎ（オン
電流）としてはかなり高いものが要求されることとなっ
た。そしてこのオン電流は、一般に使用されている低消
費電力で均一に底膜できる特徴を有するａ−３ｉをチャ
ンネル材料として形成されたＴＦＴではその実現は困難
であった。
バ）のｍ威について説明する。第６図はその構成国であ
り、１ライン分の交流化映像信号をＸ電極数分に分割し
てそれぞれの電位を保持するサンプル／ホールド回路（
Ｓ／Ｈ）１０と、その各出力のドライブを制御し、かつ
ドライブ能力を上げるための時分割型ドライバ１１から
戒っている０通常、第６図のようなソースドライバでは
、１ライン分の映像信号をＩＨの有効映像期間、Ｓ／Ｈ
Ｌ、その帰線期間にドライバに供給されるアウトプット
イネーブル信号ＯＥの制御に基づき、−斉にドライブさ
れることになる。このため、実線のドライブ期間が帰線
期間である１０μｓｅｃ程度（ＴＶの場合）しかないた
め、この間に記憶用コンデンサ２にチャージあるいはデ
ィスチャージする必要性から、ＴＦＴ３のＩ。Ｎ（オン
電流）としてはかなり高いものが要求されることとなっ
た。そしてこのオン電流は、一般に使用されている低消
費電力で均一に底膜できる特徴を有するａ−３ｉをチャ
ンネル材料として形成されたＴＦＴではその実現は困難
であった。
この問題を解決するために、第７図のような構成のドラ
イバが考えられる。この構成では、３７８回路を図中１
２．１３に示すように２ライン分持っており、各ビット
の出力は選択型ドライバ１４においてこれに供給される
ＳＷ信号なる制御信号に基づき、３７８回路の１と２を
選択する。従って、Ｓ／Ｈ１がサンプリングしているＩ
Ｈ期間は、そのＩＨ前のＳ／Ｈした結果をＳ／Ｈ２によ
りドライブすることができ、更に次のＩＨ期間には先は
どＳ／Ｈした結果をＳ／Ｈ１でドライブし、Ｓ／Ｈ２は
サンプリング用にまわすことにより、常に１Ｈ３ｔＪＩ
間ドライブできる。この結果、ＴＦＴに対する制限が緩
和されることになるが、このような構成とすることはソ
ースドライバ皐２ライン分の３７８回路が必要となるこ
とから、大規模。
イバが考えられる。この構成では、３７８回路を図中１
２．１３に示すように２ライン分持っており、各ビット
の出力は選択型ドライバ１４においてこれに供給される
ＳＷ信号なる制御信号に基づき、３７８回路の１と２を
選択する。従って、Ｓ／Ｈ１がサンプリングしているＩ
Ｈ期間は、そのＩＨ前のＳ／Ｈした結果をＳ／Ｈ２によ
りドライブすることができ、更に次のＩＨ期間には先は
どＳ／Ｈした結果をＳ／Ｈ１でドライブし、Ｓ／Ｈ２は
サンプリング用にまわすことにより、常に１Ｈ３ｔＪＩ
間ドライブできる。この結果、ＴＦＴに対する制限が緩
和されることになるが、このような構成とすることはソ
ースドライバ皐２ライン分の３７８回路が必要となるこ
とから、大規模。
複雑となる上、液晶デイスプレィはその特質さ。
、コンパクトな形態を要求されることから、ソースライ
ントライバも高集積化し、その出力ビツト数を増やすこ
とにより、ドライバＩＣの実装個数を低減しようという
方向と相反することとなるという問題があった。
ントライバも高集積化し、その出力ビツト数を増やすこ
とにより、ドライバＩＣの実装個数を低減しようという
方向と相反することとなるという問題があった。
従来のＴＦＴアクティブマトリクス液晶パネルの駆動方
法は以上のような方法となっていたので、フリッカが目
立つ、ＴＦＴに対する要求スペックが厳しい、ソースド
ライバのＬＳＩ化が困難等の問題が山積みされていた。
法は以上のような方法となっていたので、フリッカが目
立つ、ＴＦＴに対する要求スペックが厳しい、ソースド
ライバのＬＳＩ化が困難等の問題が山積みされていた。
この発明は上記のような問題点を解消するためになされ
たもので、シンプルなドライバで、ＴＦＴに対する要求
スペックも厳しくなく、フリッカ対策についても効果的
にこれを達成できるＴＦＴアクティブマトリクス液晶パ
ネルの駆動方法を得ることを目的とする。
たもので、シンプルなドライバで、ＴＦＴに対する要求
スペックも厳しくなく、フリッカ対策についても効果的
にこれを達成できるＴＦＴアクティブマトリクス液晶パ
ネルの駆動方法を得ることを目的とする。
この発明に係るＴＦＴパネルの駆動方法は、Ｘ電極（ソ
ースパスライン）を偶数ラインと奇数ラインでそれぞれ
独立となるように配線し、この偶数ラインと奇数ライン
にそれぞれ別のソースドライバを接続し、更に、交流化
する際の極性は上記偶数ラインと奇数ラインで逆極性の
関係となるようにしたものである。
ースパスライン）を偶数ラインと奇数ラインでそれぞれ
独立となるように配線し、この偶数ラインと奇数ライン
にそれぞれ別のソースドライバを接続し、更に、交流化
する際の極性は上記偶数ラインと奇数ラインで逆極性の
関係となるようにしたものである。
この発明における、ソースラインを偶数ラインと奇数ラ
インに分離して配線し、偶数ラインと奇数ラインでドラ
イバを分割して構成する方法では、シンプルな構成のド
ライバＩＣで、常にＩＨ期間ドライブできるようになる
ことからＴＦＴに対する要求スペックを緩和でき、更に
パネル上でライン周期で交流化の極性が反転していても
ソースパスライン上では反転していないため、ドライブ
能力も小さくてもよい。
インに分離して配線し、偶数ラインと奇数ラインでドラ
イバを分割して構成する方法では、シンプルな構成のド
ライバＩＣで、常にＩＨ期間ドライブできるようになる
ことからＴＦＴに対する要求スペックを緩和でき、更に
パネル上でライン周期で交流化の極性が反転していても
ソースパスライン上では反転していないため、ドライブ
能力も小さくてもよい。
以下、この発明の一実施例を図について説明する。
第１図は本発明の一実施例によるＴＦＴアクティブマト
リクス液晶パネルの駆動方法を実現する構成を示し、こ
れは従来の第５図の画素配列パターンに対応するものと
して、第３図のＸ電極４（ソースパスライン）の各画素
のＴＦＴ３のソース電極に対する配線に関するパネル構
造を、ソースライントライバの接続とともに示している
０図に示すように、各ソースパスラインは偶数ラインと
奇数ラインで、それぞれ分離されて上側と下側に引き出
され、それらにはそれぞれ別のソースライントライバ１
５及び１６が接続されている。
リクス液晶パネルの駆動方法を実現する構成を示し、こ
れは従来の第５図の画素配列パターンに対応するものと
して、第３図のＸ電極４（ソースパスライン）の各画素
のＴＦＴ３のソース電極に対する配線に関するパネル構
造を、ソースライントライバの接続とともに示している
０図に示すように、各ソースパスラインは偶数ラインと
奇数ラインで、それぞれ分離されて上側と下側に引き出
され、それらにはそれぞれ別のソースライントライバ１
５及び１６が接続されている。
この部分以外のＴＦＴパネル及びその周辺の構成は従来
例と同様であるので説明を省略する。
例と同様であるので説明を省略する。
次に動作について説明する。
まず、第１図におけるソースライントライバ１５及び１
６については、第６図のような構成のドライバでよい、
すなわち、例えば今、ある奇数ラインが上側ソースドラ
イバ１５により、ＩＨ前にＳ／Ｈした結果をＩＨ期間ド
ライブされているとすると、この期間の映像信号は下側
ソースライントライバ１６によりＳ／Ｈされる６次のＩ
Ｈ期間は上記の次のライン（偶数ライン）に、上記とは
逆に下側ソースドライバ１６によりＩＨ前にＳ／Ｈされ
た結果がドライブされ、この期間の映像信号は上側ソー
スライントライバ１５によりＳ／Ｈされることになる。
６については、第６図のような構成のドライバでよい、
すなわち、例えば今、ある奇数ラインが上側ソースドラ
イバ１５により、ＩＨ前にＳ／Ｈした結果をＩＨ期間ド
ライブされているとすると、この期間の映像信号は下側
ソースライントライバ１６によりＳ／Ｈされる６次のＩ
Ｈ期間は上記の次のライン（偶数ライン）に、上記とは
逆に下側ソースドライバ１６によりＩＨ前にＳ／Ｈされ
た結果がドライブされ、この期間の映像信号は上側ソー
スライントライバ１５によりＳ／Ｈされることになる。
この過程を繰り返すことにより、第６図のような簡単な
構成のドライバでも常にＩＨ期間、ＴＦＴをドライブで
きることになり、ＴＦＴに対するＩｏｎ等のスペックに
関してその条件を緩和でき、結果的にはパネルの歩留り
向上にも寄与する。
構成のドライバでも常にＩＨ期間、ＴＦＴをドライブで
きることになり、ＴＦＴに対するＩｏｎ等のスペックに
関してその条件を緩和でき、結果的にはパネルの歩留り
向上にも寄与する。
一方フリッカ対策については、１本のソースパスライン
に同極性の信号を１フィールド加えても、そのラインに
相当するＲ又はＧ又はＢの各色信号の極性を、上側ドラ
イバ１５と下側ドライバ１６で逆極性となるようにＶＩ
ＤＥＯ信号を供給すれば、ライン周期で交流化の位相を
変えられることになり、従来例のようなドライバの駆動
能力による制限がなくなる。この結果、第２図に示した
ように、斜線領域と無斜線領域で、交流化の極性を反転
できるため、フリッカ対策についても大きな効果を発揮
する。
に同極性の信号を１フィールド加えても、そのラインに
相当するＲ又はＧ又はＢの各色信号の極性を、上側ドラ
イバ１５と下側ドライバ１６で逆極性となるようにＶＩ
ＤＥＯ信号を供給すれば、ライン周期で交流化の位相を
変えられることになり、従来例のようなドライバの駆動
能力による制限がなくなる。この結果、第２図に示した
ように、斜線領域と無斜線領域で、交流化の極性を反転
できるため、フリッカ対策についても大きな効果を発揮
する。
以上のように、この発明によれば、偶数ラインと奇数ラ
インで独立のソースパスラインを構成し、偶数ラインと
奇数ライン用にそれぞれ独立のソースドライバを接続し
、かつ偶数ラインと奇数ラインで交流化の極性が反対の
信号を供給するようにしたので、簡易な構成のドライバ
で、ＴＦＴに対するスペックを緩和し、更にフリッカに
ついても大巾な低減効果が得られるものが得られる効果
がある。
インで独立のソースパスラインを構成し、偶数ラインと
奇数ライン用にそれぞれ独立のソースドライバを接続し
、かつ偶数ラインと奇数ラインで交流化の極性が反対の
信号を供給するようにしたので、簡易な構成のドライバ
で、ＴＦＴに対するスペックを緩和し、更にフリッカに
ついても大巾な低減効果が得られるものが得られる効果
がある。
第１図は本発明の一実施例によるソースパスラインの配
線構造及びソースドライバの接続形態を示す図、第２図
は本発明の一実施例によるフリッカの低減効果を説明す
る図、第３図は従来のＴＦＴ液晶パネルの等価回路を示
す図、第４図は第３図の走査回路の動作を説明する図、
第５図は従来のフリッカ対策を説明する図、第６図及び
第７図はソースライントライバの構成を説明する図であ
る。 図において、１は液晶セル、２は記憶用コンデンサ、３
はＦＥＴ、４はＸ電極、５はＹ電極、６は走査回路、７
は直／並列変換回路、８は共通電極、９は交流化回路、
１０は１ラインＳ／Ｈ回路、１１は時分割型ドライバ、
１２は上側１ラインＳ／Ｈ回路ｌ、１３は下側１ライン
Ｓ／Ｈ回路２．１４は選択型ドライバ、・ なお図中同一符号は同−又は相当部分を示す。 第１図 ｑ
線構造及びソースドライバの接続形態を示す図、第２図
は本発明の一実施例によるフリッカの低減効果を説明す
る図、第３図は従来のＴＦＴ液晶パネルの等価回路を示
す図、第４図は第３図の走査回路の動作を説明する図、
第５図は従来のフリッカ対策を説明する図、第６図及び
第７図はソースライントライバの構成を説明する図であ
る。 図において、１は液晶セル、２は記憶用コンデンサ、３
はＦＥＴ、４はＸ電極、５はＹ電極、６は走査回路、７
は直／並列変換回路、８は共通電極、９は交流化回路、
１０は１ラインＳ／Ｈ回路、１１は時分割型ドライバ、
１２は上側１ラインＳ／Ｈ回路ｌ、１３は下側１ライン
Ｓ／Ｈ回路２．１４は選択型ドライバ、・ なお図中同一符号は同−又は相当部分を示す。 第１図 ｑ
Claims (1)
- （１）ＴＦＴアクティブマトリクス液晶パネルの駆動方
法において、 各ＴＦＴのデータ入力電極を結ぶデータバスラインを、
その配列的に偶数ラインと奇数ラインで分割して、偶数
ライン及び奇数ラインよりなるそれぞれ独立のデータバ
スラインをそれぞれの独立の駆動回路で駆動し、 液晶を交流駆動する際、その極性を偶数ラインと奇数ラ
インで逆極性になるようにしたことを特徴とするＴＦＴ
アクティブマトリクス液晶パネルの駆動方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20650789A JPH0370279A (ja) | 1989-08-09 | 1989-08-09 | Ｔｆｔアクティブマトリクス液晶パネルの駆動方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20650789A JPH0370279A (ja) | 1989-08-09 | 1989-08-09 | Ｔｆｔアクティブマトリクス液晶パネルの駆動方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0370279A true JPH0370279A (ja) | 1991-03-26 |
Family
ID=16524515
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20650789A Pending JPH0370279A (ja) | 1989-08-09 | 1989-08-09 | Ｔｆｔアクティブマトリクス液晶パネルの駆動方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0370279A (ja) |
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5335700A (en) * | 1992-03-24 | 1994-08-09 | Nissan Motor Co., Ltd. | Weft picking system for a fluid jet loom including a roller type traction device |
| JPH11161246A (ja) * | 1997-09-30 | 1999-06-18 | Samsung Electron Co Ltd | 液晶表示装置及びその駆動方法 |
| KR100336683B1 (ko) * | 1999-07-21 | 2002-05-13 | 가나이 쓰토무 | 액정표시장치 |
| KR100537885B1 (ko) * | 1998-03-12 | 2006-02-28 | 삼성전자주식회사 | 액정 표시 장치 및 그 구동 방법 |
| CN101174389B (zh) | 2006-10-31 | 2011-11-30 | 奇美电子股份有限公司 | 液晶显示器的驱动电路与方法 |
| US8269706B2 (en) | 2004-03-11 | 2012-09-18 | Lg Display Co., Ltd. | Operating unit of liquid crystal display panel and method for operating the same |
| US9275587B2 (en) | 2011-05-18 | 2016-03-01 | Sharp Kabushiki Kaisha | Array substrate, display device, liquid crystal panel, and liquid crystal display device |
-
1989
- 1989-08-09 JP JP20650789A patent/JPH0370279A/ja active Pending
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