JPH0374975B2 - - Google Patents
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- Publication number
- JPH0374975B2 JPH0374975B2 JP60072912A JP7291285A JPH0374975B2 JP H0374975 B2 JPH0374975 B2 JP H0374975B2 JP 60072912 A JP60072912 A JP 60072912A JP 7291285 A JP7291285 A JP 7291285A JP H0374975 B2 JPH0374975 B2 JP H0374975B2
- Authority
- JP
- Japan
- Prior art keywords
- receiver
- switch
- cpu
- signal
- information
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 230000015654 memory Effects 0.000 abstract description 20
- 230000006870 function Effects 0.000 description 9
- 238000010586 diagram Methods 0.000 description 3
- 238000005516 engineering process Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04W—WIRELESS COMMUNICATION NETWORKS
- H04W52/00—Power management, e.g. Transmission Power Control [TPC] or power classes
- H04W52/02—Power saving arrangements
- H04W52/0209—Power saving arrangements in terminal devices
- H04W52/0225—Power saving arrangements in terminal devices using monitoring of external events, e.g. the presence of a signal
- H04W52/0229—Power saving arrangements in terminal devices using monitoring of external events, e.g. the presence of a signal where the received signal is a wanted signal
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04W—WIRELESS COMMUNICATION NETWORKS
- H04W52/00—Power management, e.g. Transmission Power Control [TPC] or power classes
- H04W52/02—Power saving arrangements
- H04W52/0209—Power saving arrangements in terminal devices
- H04W52/0251—Power saving arrangements in terminal devices using monitoring of local events, e.g. events related to user activity
- H04W52/0258—Power saving arrangements in terminal devices using monitoring of local events, e.g. events related to user activity controlling an operation mode according to history or models of usage information, e.g. activity schedule or time of day
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
- Y02D30/00—Reducing energy consumption in communication networks
- Y02D30/70—Reducing energy consumption in communication networks in wireless communication networks
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Circuits Of Receivers In General (AREA)
Description
本発明は、論理回路またはマイクロコンピユー
タを具備して選局する受信機に関するものであ
る。
タを具備して選局する受信機に関するものであ
る。
この種のプログラマブル受信機としては、第３
図にみられるものが知られている。ここには、周
波数およびバンドデータを記憶するメモリ１ａ〜
１ｎが用意されており、各メモリには、周波数コ
ントロールキー３およびバンドキー４により希望
の放送局を呼出した後、ストアキー５と各メモリ
に対応するバクアツプスーシヨンキー２ａ〜２ｎ
を操作することで、周波数データおよびバンドデ
ータがインプツトされる。このように各メモリに
データをセツトした後に受信機の電源スイツチ８
をオフした後、再度オンすると、タイミング回路
９を通つてCPU７に、電源オンの情報のトリガ
がインプツトされる。このときCPU７は、メモ
リ１ａを解読し、その内容の放送局を受信できる
ようなデータを作つてシフトレジスタ１０に送
る。上記データは、更にラツチ回路１１を介して
デコーダ１２へ、更にPLL回路１３に入力され
る。上記PLL回路１３は、与えられたデータに
応じて電圧制御発振器１４を制御し、フロントエ
ンド１５が制御される。この結果、メモリ１ａに
データとして記憶された通りの放送局を受信する
ことができる。この後、電源スイツチ８をオン→
オフする毎に、メモリ１ｂ，……１ｎのデータを
次々に呼出して、受信機はオフ→オンを次々に繰
返し、予めメモリされた放送局を次々と呼出すこ
とができる。なお、電源スイツチ８がプログラム
タイマなどによつてコントロールされている場合
には、希望時刻に希望放送局が次々と呼出される
ことになる。
図にみられるものが知られている。ここには、周
波数およびバンドデータを記憶するメモリ１ａ〜
１ｎが用意されており、各メモリには、周波数コ
ントロールキー３およびバンドキー４により希望
の放送局を呼出した後、ストアキー５と各メモリ
に対応するバクアツプスーシヨンキー２ａ〜２ｎ
を操作することで、周波数データおよびバンドデ
ータがインプツトされる。このように各メモリに
データをセツトした後に受信機の電源スイツチ８
をオフした後、再度オンすると、タイミング回路
９を通つてCPU７に、電源オンの情報のトリガ
がインプツトされる。このときCPU７は、メモ
リ１ａを解読し、その内容の放送局を受信できる
ようなデータを作つてシフトレジスタ１０に送
る。上記データは、更にラツチ回路１１を介して
デコーダ１２へ、更にPLL回路１３に入力され
る。上記PLL回路１３は、与えられたデータに
応じて電圧制御発振器１４を制御し、フロントエ
ンド１５が制御される。この結果、メモリ１ａに
データとして記憶された通りの放送局を受信する
ことができる。この後、電源スイツチ８をオン→
オフする毎に、メモリ１ｂ，……１ｎのデータを
次々に呼出して、受信機はオフ→オンを次々に繰
返し、予めメモリされた放送局を次々と呼出すこ
とができる。なお、電源スイツチ８がプログラム
タイマなどによつてコントロールされている場合
には、希望時刻に希望放送局が次々と呼出される
ことになる。
【発明が解決しようとする問題点】
しかしながら、上記受信機で制御できるのは、
受信機自体についてであり、FM／AMチユーナ
での選局のみである。従つて、例えば上記受信機
で所定時間希望局Ａを受信した後、TVチユーナ
で放送局Ｂを受信したいとする時には、上記受信
機とTVチユーナとを切換える装置が必要にな
る。 本発明は、上記事情に基づいてなされたもの
で、内部に切換スイツチを設けて、受信機による
信号と、他機器によりの信号を電源スイツチのオ
ン→オフをトリガとして次々に切換えられるよう
にしたプログラマブル受信機を提供しようとする
ものである。
受信機自体についてであり、FM／AMチユーナ
での選局のみである。従つて、例えば上記受信機
で所定時間希望局Ａを受信した後、TVチユーナ
で放送局Ｂを受信したいとする時には、上記受信
機とTVチユーナとを切換える装置が必要にな
る。 本発明は、上記事情に基づいてなされたもの
で、内部に切換スイツチを設けて、受信機による
信号と、他機器によりの信号を電源スイツチのオ
ン→オフをトリガとして次々に切換えられるよう
にしたプログラマブル受信機を提供しようとする
ものである。
この目的のため、本発明は、各種放送局を受信
する受信部からの信号又は外部入力による他の再
生機器からの信号の取り込むべき情報を格納する
情報格納手段と、この情報格納手段に前記情報を
入力する情報入力手段と、受信機本体の電源がオ
ン／オフされる毎に前記情報格納手段から前記情
報を読み出す情報読出手段と、この情報読出手段
によつて読み出された情報に基づき、前記各種放
送局を受信する受信部からの信号又は外部入力に
よる他の再生機器からの信号を取り込む信号取込
手段とを具備することを特徴とするものである。
する受信部からの信号又は外部入力による他の再
生機器からの信号の取り込むべき情報を格納する
情報格納手段と、この情報格納手段に前記情報を
入力する情報入力手段と、受信機本体の電源がオ
ン／オフされる毎に前記情報格納手段から前記情
報を読み出す情報読出手段と、この情報読出手段
によつて読み出された情報に基づき、前記各種放
送局を受信する受信部からの信号又は外部入力に
よる他の再生機器からの信号を取り込む信号取込
手段とを具備することを特徴とするものである。
以下、本発明の実施例を第１図および第２図を
参照して具体的に説明する。 第１図において符号１０１ａ〜１０１ｎはメモ
リで、フアクシヨンデータ、バンドデータ、周波
数データが格納される。１０３はフアンクシヨン
キーで、これを操作することにより切換スイツチ
１２１が制御される。上記切換スイツチ１２１
は、受信機出力と、EXT入力(A)１１９、EXT入
力(B)１２０を切換え、いずれかの信号を出力１０
２にもたらすためのものである。バンドキー１０
４は、受信機が複数のバンドで受信できる場合
に、そのバンドを切換えるためのものである。周
波数コントロールキー１０５は、受信機で受信さ
れる周波数を調節するためのものである。ウエイ
クアツプキー１０２ａ〜１０２ｎとストアキー１
０６とは、フアンクシヨンキー１０３、バンドキ
ー１０４および周波数コントロールキー１０５に
より調節されたフアンクシヨン、バンドおよび周
波数のデータをメモリ１０１ａ〜１０１ｎに格納
するためのキーである。バンドおよび周波数のデ
ータは、予めCPU１０８内のROMに保持されて
おり、これらのデータをメモリ１０１ａ〜１０１
ｎのいずれかに格納する場合には、バンドキー１
０４および周波数コントロールキー１０５によつ
て任意のバンドおよび周波数を選択し、ウエイク
アツプキー１０２ａ〜１０２ｎのいずれかを操作
する。これにより、このウエイクアツプキー１０
２ａ〜１０２ｎに対応したメモリ１０１ａ〜１０
１ｎに、予めCPU１０８内に保持されているデ
ータが格納される。 また、CPU１０８内にはEXT入力(A)１１９又
はEXT入力(B)１２０についてのフアンクシヨン
データも保持されており、これらの切換えを行う
場合には、フアンクシヨンキー１０３を操作して
格納されているデータを読み出した後、ウエイク
アツプキー１０２ａ〜１０２ｎのいずれかを操作
する。これにより、このウエイクアツプキー１０
２ａ〜１０２ｎに対応したメモリ１０１ａ〜１０
１ｎに、予めCPU１０８内に保持されているフ
アンクシヨンデータが格納される。 PLL回路１１４は、CPU１０８によりシフト
レジスタ１１１、ラツチ回路１１２、デコーダ(A)
１１３を通して制御される。上記PLL回路１１
４により、受信周波数が制御され（電圧制御発振
器１１５およびフロントエンド１１６が制御さ
れ）、受信機は当該放送局を受信する。 電源スイツチ１０９をオン→オフすることによ
り、タイミング回路１１０を通してCPU１０８
にトリガが送られ、このトリガによりCPU１０
８は、先ずメモリ１０１ａを押し出し、このデー
タよりPLL回路１１４および切換スイツチ１２
１をメモリ内容により制御する。次に、再び電源
スイツチ１０９をオフ→オンするとトリガが出
て、CPU１０８は、メモリ１０１ｂを呼出し、
その内容によりPLL回路１１４および切換スイ
ツチ１２１を制御する。同様にCPU１０８は、
トリガが来る毎に、メモリを順次呼出す。 例えば、メモリ１０１ａにEXT入力(A)１２０
を選択するデータが、メモリ１０１ｂに受信機に
より放送局αを選択するデータが入つているとす
ると、１度、電源スイツチ１０９をオフ→オンす
ると切換スイツチ１２１は、Ａに投入される。次
に、電源スイツチ１０９をオフ→オンすると、今
度は切換スイツチ１２１は、Ｃに投入され、
PLL回路１１４は、放送局αに同調するように
制御動作することになる。 なお、図中符号１０７は各キー入力のためにの
エンコーダ、１１７は中間周波数増幅器、１１８
はマルチプレクサ、１２３はCPU１０８からの
信号をデーコードして切換スイツチ１２１に与え
るデコーダである。 このような構成の受信機Ｘは、第２図のような
組合せで使用される。ここで符号Ｙ，Ｚは他の機
器であり、上記機器Ｙ，Ｚおよび受信機Ｘは、タ
イマＴにより電源のオン／オフ制御をうける。タ
イマＴが、時間により電源のオン／オフを次々に
繰返すように設定されていれば、受信機Ｘよりの
出力は、受信機より受信される任意の放送局およ
び機器Ｙ，Ｚの出力を、次々に切換える。 なお、上述の実施例では、制御部を複数の論理
回路につて構成したが、マイクロコンピユータで
制御する構成にしてもよい、また、切換えられる
信号は、映像、音声またはその両方のいずれでも
よい。
参照して具体的に説明する。 第１図において符号１０１ａ〜１０１ｎはメモ
リで、フアクシヨンデータ、バンドデータ、周波
数データが格納される。１０３はフアンクシヨン
キーで、これを操作することにより切換スイツチ
１２１が制御される。上記切換スイツチ１２１
は、受信機出力と、EXT入力(A)１１９、EXT入
力(B)１２０を切換え、いずれかの信号を出力１０
２にもたらすためのものである。バンドキー１０
４は、受信機が複数のバンドで受信できる場合
に、そのバンドを切換えるためのものである。周
波数コントロールキー１０５は、受信機で受信さ
れる周波数を調節するためのものである。ウエイ
クアツプキー１０２ａ〜１０２ｎとストアキー１
０６とは、フアンクシヨンキー１０３、バンドキ
ー１０４および周波数コントロールキー１０５に
より調節されたフアンクシヨン、バンドおよび周
波数のデータをメモリ１０１ａ〜１０１ｎに格納
するためのキーである。バンドおよび周波数のデ
ータは、予めCPU１０８内のROMに保持されて
おり、これらのデータをメモリ１０１ａ〜１０１
ｎのいずれかに格納する場合には、バンドキー１
０４および周波数コントロールキー１０５によつ
て任意のバンドおよび周波数を選択し、ウエイク
アツプキー１０２ａ〜１０２ｎのいずれかを操作
する。これにより、このウエイクアツプキー１０
２ａ〜１０２ｎに対応したメモリ１０１ａ〜１０
１ｎに、予めCPU１０８内に保持されているデ
ータが格納される。 また、CPU１０８内にはEXT入力(A)１１９又
はEXT入力(B)１２０についてのフアンクシヨン
データも保持されており、これらの切換えを行う
場合には、フアンクシヨンキー１０３を操作して
格納されているデータを読み出した後、ウエイク
アツプキー１０２ａ〜１０２ｎのいずれかを操作
する。これにより、このウエイクアツプキー１０
２ａ〜１０２ｎに対応したメモリ１０１ａ〜１０
１ｎに、予めCPU１０８内に保持されているフ
アンクシヨンデータが格納される。 PLL回路１１４は、CPU１０８によりシフト
レジスタ１１１、ラツチ回路１１２、デコーダ(A)
１１３を通して制御される。上記PLL回路１１
４により、受信周波数が制御され（電圧制御発振
器１１５およびフロントエンド１１６が制御さ
れ）、受信機は当該放送局を受信する。 電源スイツチ１０９をオン→オフすることによ
り、タイミング回路１１０を通してCPU１０８
にトリガが送られ、このトリガによりCPU１０
８は、先ずメモリ１０１ａを押し出し、このデー
タよりPLL回路１１４および切換スイツチ１２
１をメモリ内容により制御する。次に、再び電源
スイツチ１０９をオフ→オンするとトリガが出
て、CPU１０８は、メモリ１０１ｂを呼出し、
その内容によりPLL回路１１４および切換スイ
ツチ１２１を制御する。同様にCPU１０８は、
トリガが来る毎に、メモリを順次呼出す。 例えば、メモリ１０１ａにEXT入力(A)１２０
を選択するデータが、メモリ１０１ｂに受信機に
より放送局αを選択するデータが入つているとす
ると、１度、電源スイツチ１０９をオフ→オンす
ると切換スイツチ１２１は、Ａに投入される。次
に、電源スイツチ１０９をオフ→オンすると、今
度は切換スイツチ１２１は、Ｃに投入され、
PLL回路１１４は、放送局αに同調するように
制御動作することになる。 なお、図中符号１０７は各キー入力のためにの
エンコーダ、１１７は中間周波数増幅器、１１８
はマルチプレクサ、１２３はCPU１０８からの
信号をデーコードして切換スイツチ１２１に与え
るデコーダである。 このような構成の受信機Ｘは、第２図のような
組合せで使用される。ここで符号Ｙ，Ｚは他の機
器であり、上記機器Ｙ，Ｚおよび受信機Ｘは、タ
イマＴにより電源のオン／オフ制御をうける。タ
イマＴが、時間により電源のオン／オフを次々に
繰返すように設定されていれば、受信機Ｘよりの
出力は、受信機より受信される任意の放送局およ
び機器Ｙ，Ｚの出力を、次々に切換える。 なお、上述の実施例では、制御部を複数の論理
回路につて構成したが、マイクロコンピユータで
制御する構成にしてもよい、また、切換えられる
信号は、映像、音声またはその両方のいずれでも
よい。
本発明は、以上詳述したようになり、プログラ
マブル受信機において、受信機自体で受信される
放送局および外部入力を、電源スイツチのオン／
オフを繰返すことで、他にプリアンプ、スイツチ
ヤなどの装置を用いずに次々に切換えることが可
能で、高い汎用性を発揮できる。
マブル受信機において、受信機自体で受信される
放送局および外部入力を、電源スイツチのオン／
オフを繰返すことで、他にプリアンプ、スイツチ
ヤなどの装置を用いずに次々に切換えることが可
能で、高い汎用性を発揮できる。
第１図は本発明の一実施例を示すブロツク図、
第２図は同応用例を示す図、第３図は従来例を示
すブロツク図である。 １０１ａ〜１０１ｎ……メモリ、１０２ａ〜１
０２ｎ……ウエイクアツプキー、１０３……フア
ンクシヨンキー、１０４……バンドキー、１０５
……周波数コントロールキー、１０６……ストア
キー、１０７……エンコーダ、１０８……CPU、
１０９……電源スイツチ、１１０……タイミング
回路、１１１……シフトレジスタ、１１２……ラ
ツチ回路、１１３……デコーダ、１１４……
PLL回路、１１５……電圧制御発振器、１１６
……フロントエンド、１１７……中間周波数増幅
器、１１８……マルチプレクサ、１１９……
EXT入力(A)、１２０……EXT入力(B)、１２１…
…切換スイツチ、１２２……出力、１２３……デ
コーダ。
第２図は同応用例を示す図、第３図は従来例を示
すブロツク図である。 １０１ａ〜１０１ｎ……メモリ、１０２ａ〜１
０２ｎ……ウエイクアツプキー、１０３……フア
ンクシヨンキー、１０４……バンドキー、１０５
……周波数コントロールキー、１０６……ストア
キー、１０７……エンコーダ、１０８……CPU、
１０９……電源スイツチ、１１０……タイミング
回路、１１１……シフトレジスタ、１１２……ラ
ツチ回路、１１３……デコーダ、１１４……
PLL回路、１１５……電圧制御発振器、１１６
……フロントエンド、１１７……中間周波数増幅
器、１１８……マルチプレクサ、１１９……
EXT入力(A)、１２０……EXT入力(B)、１２１…
…切換スイツチ、１２２……出力、１２３……デ
コーダ。
Claims (1)
- 【特許請求の範囲】 １ 各種放送局を受信する受信部からの信号又は
外部入力による他の再生機器からの信号の取り込
むべき情報を格納する情報格納手段と、 この情報格納手段に前記情報を入力する情報入
力手段と、 受信機本体の電源がオン／オフされる毎に前記
情報格納手段から前記情報を読み出す情報読出手
段と、 この情報読出手段によつて読み出された情報に
基づき、前記各種放送局を受信する受信部からの
信号又は外部入力による他の再生機器からの信号
を取り込む信号取込手段と を具備することを特徴とする受信機。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60072912A JPS61230527A (ja) | 1985-04-05 | 1985-04-05 | 受信機 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60072912A JPS61230527A (ja) | 1985-04-05 | 1985-04-05 | 受信機 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61230527A JPS61230527A (ja) | 1986-10-14 |
| JPH0374975B2 true JPH0374975B2 (ja) | 1991-11-28 |
Family
ID=13503030
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60072912A Granted JPS61230527A (ja) | 1985-04-05 | 1985-04-05 | 受信機 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61230527A (ja) |
-
1985
- 1985-04-05 JP JP60072912A patent/JPS61230527A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61230527A (ja) | 1986-10-14 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |