JPH04100291A - 半導体装置の製造方法および、光半導体装置の製造方法 - Google Patents
半導体装置の製造方法および、光半導体装置の製造方法Info
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- JPH04100291A JPH04100291A JP21862190A JP21862190A JPH04100291A JP H04100291 A JPH04100291 A JP H04100291A JP 21862190 A JP21862190 A JP 21862190A JP 21862190 A JP21862190 A JP 21862190A JP H04100291 A JPH04100291 A JP H04100291A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
光半導体装置の製造方法に係り、特にモノリシック型外
部変調器付半導体レーザの製造方法に関製造が容易で歩
留りが高く、かつ波長制御性を向上させる製造方法の提
供を目的とし 半導体基板の所定の領域を覆う第1のマスクを形成した
後該半導体基板をエツチングし1表面が該所定の領域よ
り低い第1の領域を形成する工程と、該所定の領域を第
2の領域とし、該第1の領域に第2のマスクを形成して
該第2の領域に接続する帯状の第1の領域を露出した後
、該帯状の第1の領域と該第2の領域に同時にエピタキ
シャル成長を行い、該帯状の第1の領域に第1のエピタ
キシャル層、該第2の領域に第2のエピタキシャル層を
形成する工程とを有し、該第1のエピタキシャル層の厚
さは該第2のエピタキシャル層の厚さより大きく、該第
2のエピタキシャル層の高さは該第1のエピタキシャル
層の一部の高さと実質的に等しく形成する光半導体装置
の製造方法により構成する。
部変調器付半導体レーザの製造方法に関製造が容易で歩
留りが高く、かつ波長制御性を向上させる製造方法の提
供を目的とし 半導体基板の所定の領域を覆う第1のマスクを形成した
後該半導体基板をエツチングし1表面が該所定の領域よ
り低い第1の領域を形成する工程と、該所定の領域を第
2の領域とし、該第1の領域に第2のマスクを形成して
該第2の領域に接続する帯状の第1の領域を露出した後
、該帯状の第1の領域と該第2の領域に同時にエピタキ
シャル成長を行い、該帯状の第1の領域に第1のエピタ
キシャル層、該第2の領域に第2のエピタキシャル層を
形成する工程とを有し、該第1のエピタキシャル層の厚
さは該第2のエピタキシャル層の厚さより大きく、該第
2のエピタキシャル層の高さは該第1のエピタキシャル
層の一部の高さと実質的に等しく形成する光半導体装置
の製造方法により構成する。
また、前記第1のエピタキシャル層は第1の量子井戸構
造を含み、前記第2のエピタキシャル層は第2の量子井
戸構造を含み、該第1の量子井戸構造をレーザの発光部
のコアとし、該第2の量子井戸構造を光変調部のコアと
する光半導体装置の製造方法により構成する。
造を含み、前記第2のエピタキシャル層は第2の量子井
戸構造を含み、該第1の量子井戸構造をレーザの発光部
のコアとし、該第2の量子井戸構造を光変調部のコアと
する光半導体装置の製造方法により構成する。
本発明は光半導体装置の製造方法に係り、特にモノリシ
ック型外部変調器付半導体レーザの製造方法に関する。
ック型外部変調器付半導体レーザの製造方法に関する。
将来の超高速伝送の光通信用素子として、波長チャーピ
ングの少ないレーザ素子が要求されている。従来からか
かる要求に応える素子として、外部変調器付分布帰還型
レーザが提案されている。
ングの少ないレーザ素子が要求されている。従来からか
かる要求に応える素子として、外部変調器付分布帰還型
レーザが提案されている。
第5図は従来の外部変調器付分布帰還型レーザを説明す
るための断面図で、 la、 lbは半導体基板。
るための断面図で、 la、 lbは半導体基板。
6aはレーザ領域の多重量子井戸構造、 6bは変調器
領域の多重量子井戸構造+ 7a、 7bは導波層、1
0はクラッド層、8は回折格子、11はコンタクト層。
領域の多重量子井戸構造+ 7a、 7bは導波層、1
0はクラッド層、8は回折格子、11はコンタクト層。
15は保護膜、16はP電極、17はn電極、19はエ
ツチングストップ層を表す。
ツチングストップ層を表す。
レーザ領域の多重量子井戸構造6aと変調器領域の多重
量子井戸構造6bの形成は次のようにする。
量子井戸構造6bの形成は次のようにする。
まず、レーザ領域の多重量子井戸構造6aの積層を、M
OVPE法またはMBE法で全面に成長する。その構成
は1例えば次の如くである。
OVPE法またはMBE法で全面に成長する。その構成
は1例えば次の如くである。
InGaAsP(波長1−3 μm) 80人 5層I
nGaAs 80人 4層次に、変
調器領域に形成されているこの積層をエツチングにより
除去し、レーザ領域をマスクして変調器領域に多重量子
井戸構造6bをMOVPE法またはMBE法で成長する
。その構成は9例えば次の如くである。
nGaAs 80人 4層次に、変
調器領域に形成されているこの積層をエツチングにより
除去し、レーザ領域をマスクして変調器領域に多重量子
井戸構造6bをMOVPE法またはMBE法で成長する
。その構成は9例えば次の如くである。
InGaAsP(波長1.3 um) 80人 5層I
r1l;aAs 60人 4層変調器
領域の多重量子井戸構造6bの繰り返し周期の距離はレ
ーザ領域の多重量子井戸構造6aのそれより短い。
r1l;aAs 60人 4層変調器
領域の多重量子井戸構造6bの繰り返し周期の距離はレ
ーザ領域の多重量子井戸構造6aのそれより短い。
第4図は多重量子井戸構造のエネルギー準位を示す図で
、(a)はレーザ領域、(b)は変調器領域である。
、(a)はレーザ領域、(b)は変調器領域である。
変調器領域の多重量子井戸構造6bの量子準位間のエネ
ルギーギャップE□はレーザ領域の多重量子井戸構造6
aのエネルギーギャップEgIより大きくなっている。
ルギーギャップE□はレーザ領域の多重量子井戸構造6
aのエネルギーギャップEgIより大きくなっている。
そして、変調器領域に電圧を印加した時、変調器領域の
多重量子井戸構造6bのエネルギーギャップがレーザ領
域の多重量子井戸構造6aのそれと等しくなるように調
節される。
多重量子井戸構造6bのエネルギーギャップがレーザ領
域の多重量子井戸構造6aのそれと等しくなるように調
節される。
ところが、レーザ領域の多重量子井戸構造6aと変調器
領域の多重量子井戸構造6bは独立に形成するので、波
長を合わせるために、また光結合を良くするためには、
製造過程で厳密な制御が必要となり1歩留りが落ちると
いう問題がある。また成長回数が複数回になるため歩留
りがさらに落ちスルーブツトが低いといった問題があっ
た。
領域の多重量子井戸構造6bは独立に形成するので、波
長を合わせるために、また光結合を良くするためには、
製造過程で厳密な制御が必要となり1歩留りが落ちると
いう問題がある。また成長回数が複数回になるため歩留
りがさらに落ちスルーブツトが低いといった問題があっ
た。
本発明は、レーザ領域の量子井戸構造6aと変調器領域
の量子井戸構造6bを同時にエピタキシャル成長するこ
とにより成長回数を減らし、かつ波長の制御性を向上さ
せる歩留りのよい製造方法を提供することを目的とする
。
の量子井戸構造6bを同時にエピタキシャル成長するこ
とにより成長回数を減らし、かつ波長の制御性を向上さ
せる歩留りのよい製造方法を提供することを目的とする
。
第1図(a)〜(c)は本発明の詳細な説明するための
図で、1は半導体基板、 laは第1の領域、 lbは
第2の領域、2は第1のマスク、3は第2のマスク、
4a、 5a、 6a、 7aは第1のエピタキシャル
層で6aは第1の量子井戸構造、 4b、 5b、 6
b、 7bは第2のエピタキシャル層で6bは第2の量
子井戸構造を表す。
図で、1は半導体基板、 laは第1の領域、 lbは
第2の領域、2は第1のマスク、3は第2のマスク、
4a、 5a、 6a、 7aは第1のエピタキシャル
層で6aは第1の量子井戸構造、 4b、 5b、 6
b、 7bは第2のエピタキシャル層で6bは第2の量
子井戸構造を表す。
上記課題は、半導体基板1の所定の領域1bを覆う第1
のマスク2を形成した後該半導体基板1をエツチングし
1表面が該所定の領域ibより低い第1の領域1aを形
成する工程と、該所定の領域1bを第2の領域とし、該
第1の領域1aに第2のマスク3を形成して該第2の領
域1bに接続する帯状の第1の領域1cを露出した後、
該帯状の第1の領域1cと該第2の領域1bに同時にエ
ピタキシャル成長を行い、該帯状の第1の領域1cに第
1のエピタキシャル層4a+ 5a+ 6a+ 7a+
該第2の領域1bに第2のエピタキシャル層4b、 5
b、 6b、 7bを形成する工程とを有し、該第1の
エピタキシャル層4a+ 5a+ 6a。
のマスク2を形成した後該半導体基板1をエツチングし
1表面が該所定の領域ibより低い第1の領域1aを形
成する工程と、該所定の領域1bを第2の領域とし、該
第1の領域1aに第2のマスク3を形成して該第2の領
域1bに接続する帯状の第1の領域1cを露出した後、
該帯状の第1の領域1cと該第2の領域1bに同時にエ
ピタキシャル成長を行い、該帯状の第1の領域1cに第
1のエピタキシャル層4a+ 5a+ 6a+ 7a+
該第2の領域1bに第2のエピタキシャル層4b、 5
b、 6b、 7bを形成する工程とを有し、該第1の
エピタキシャル層4a+ 5a+ 6a。
7aの厚さは該第2のエピタキシャル層4b、 5b、
6b。
6b。
7bの厚さより大きく、該第2のエピタキシャル層4b
、 5b、 6b、 7bの高さは該第1のエピタキシ
ャル層4a、 5a、 6a、 7aの一部の高さと実
質的に等しく形成する光半導体装置の製造方法によって
解決される。
、 5b、 6b、 7bの高さは該第1のエピタキシ
ャル層4a、 5a、 6a、 7aの一部の高さと実
質的に等しく形成する光半導体装置の製造方法によって
解決される。
また、半導体基板1の第1の領域1aに該第1の領域1
aを帯状に露出するマスク3を形成し、該マスク3をマ
スクにして該第1の領域1a及びそれに連続する第2の
領域1bをエツチングし、該第1の領域1aに底面がエ
ツチングされた第2の領域1bの表面より低い溝1dを
形成し、つづいて該溝1d及び該第2の領域1bに同時
にエピタキシャル成長を行い、該溝1dに第1のエピタ
キシャル層4a、 5a、 6a。
aを帯状に露出するマスク3を形成し、該マスク3をマ
スクにして該第1の領域1a及びそれに連続する第2の
領域1bをエツチングし、該第1の領域1aに底面がエ
ツチングされた第2の領域1bの表面より低い溝1dを
形成し、つづいて該溝1d及び該第2の領域1bに同時
にエピタキシャル成長を行い、該溝1dに第1のエピタ
キシャル層4a、 5a、 6a。
7a、該第2の領域1bに第2のエピタキシャル層4b
。
。
5b、 6b、 7bを形成する工程を有し、該第1の
エピタキシャル層4a、 5a、 6a、 7aの厚さ
は該第2のエピタキシャル層4b、 5b、 6b、
7bの厚さより太き(。
エピタキシャル層4a、 5a、 6a、 7aの厚さ
は該第2のエピタキシャル層4b、 5b、 6b、
7bの厚さより太き(。
該第2のエピタキシャル層4b、 5b、 6b、 7
bの高さは該第1のエピタキシャル層4a、 5a+
6a、 7aの一部の高さと実質的に等しく形成する光
半導体装置の製造方法によって解決される。
bの高さは該第1のエピタキシャル層4a、 5a+
6a、 7aの一部の高さと実質的に等しく形成する光
半導体装置の製造方法によって解決される。
また、前記第1のエピタキシャル層4a、 5a、 6
a。
a。
7aはダブルヘテロ構造で第1の量子井戸構造6aを含
み、前記第2のエピタキシャル層4b、 5b、 6b
。
み、前記第2のエピタキシャル層4b、 5b、 6b
。
7bはダブルヘテロ構造で第2の量子井戸構造6bを含
み、該第1の量子井戸構造6aの厚さは該第2の量子井
戸構造6bの厚さより大きく、該第2の量子井戸構造6
bの高さは該第1の量子井戸構造6aの一部の高さと等
しく、該第1の量子井戸構造6aをレーザの発光部のコ
アとし、該第2の量子井戸構造6bを光変調部のコアと
する光半導体装置の製造方法によって解決される。
み、該第1の量子井戸構造6aの厚さは該第2の量子井
戸構造6bの厚さより大きく、該第2の量子井戸構造6
bの高さは該第1の量子井戸構造6aの一部の高さと等
しく、該第1の量子井戸構造6aをレーザの発光部のコ
アとし、該第2の量子井戸構造6bを光変調部のコアと
する光半導体装置の製造方法によって解決される。
〔作用]
選択マスクを用いた選択成長によれば、成長速度が非常
に変化する。また9選択マスクを用いれば、エツチング
速度も非常に変化する。
に変化する。また9選択マスクを用いれば、エツチング
速度も非常に変化する。
帯状の第1の領域1cでの成長速度は、その幅及び選択
マスク3の覆う面積を変えることにより制御することが
できる。従って、この成長速度の違いを利用して、第1
の量子井戸構造6aと第2の量子井戸構造6bの厚さの
割合を変えることができる。
マスク3の覆う面積を変えることにより制御することが
できる。従って、この成長速度の違いを利用して、第1
の量子井戸構造6aと第2の量子井戸構造6bの厚さの
割合を変えることができる。
これにより、第1の量子井戸構造6aの量子準位間のエ
ネルギーギャップと第2の量子井戸構造6bの量子準位
間のエネルギーギャップの比を制御することが容易であ
る。
ネルギーギャップと第2の量子井戸構造6bの量子準位
間のエネルギーギャップの比を制御することが容易であ
る。
しかも、初めに第1の領域1aの表面の高さを第2の領
域1bの表面より低く形成しであるため、帯状の第1の
領域1cと第2の領域1bへ同時にエピタキシャル成長
することにより、第1の量子井戸構造6aと第2の量子
井戸構造6bの高さを揃えるように調節することができ
る。このようにすれば、第1の量子井戸構造6aと第2
の量子井戸構造6bの光結合性がよくなる。
域1bの表面より低く形成しであるため、帯状の第1の
領域1cと第2の領域1bへ同時にエピタキシャル成長
することにより、第1の量子井戸構造6aと第2の量子
井戸構造6bの高さを揃えるように調節することができ
る。このようにすれば、第1の量子井戸構造6aと第2
の量子井戸構造6bの光結合性がよくなる。
初めに第1の領域1aと第2の領域1bに段差を形成す
るため2選択マスク3を用いることもできる。
るため2選択マスク3を用いることもできる。
帯状の第1の領域1cを露出するマスクを用いてエツチ
ングすると、マスクの影響で帯状の第1の領域1cがマ
スクの影響がない第2の領域1bに比べてエツチング速
度が大きくなり、第1の領域1aと第2の領域1bに段
差が形成されるのである。
ングすると、マスクの影響で帯状の第1の領域1cがマ
スクの影響がない第2の領域1bに比べてエツチング速
度が大きくなり、第1の領域1aと第2の領域1bに段
差が形成されるのである。
さらに、第1の量子井戸構造6aと第2の量子井戸構造
6bは一回の成長で得られるから、工程が簡単で歩留り
がよ(、スルーブツトが向上する。
6bは一回の成長で得られるから、工程が簡単で歩留り
がよ(、スルーブツトが向上する。
第1の量子井戸構造6aをレーザの発光部のコアとし、
第2の量子井戸構造6bを光変調部のこコアとすれば、
良好な外部変調器付半導体レーザが得られる。
第2の量子井戸構造6bを光変調部のこコアとすれば、
良好な外部変調器付半導体レーザが得られる。
第2図(a)〜(m)は
ための図であり、以下。
ら説明する。
実施例の工程を説明する
これらの図を参照しなが
第2図(a)参照
半導体基板1として、n・−InP基板を用いる。
第1のマスク2を第2の領域1bに形成する。第1のマ
スク2は5iOzをスパッタして形成し、n゛−InP
基板1との密着性は低い。第2の領域ibは変調器を形
成する領域である。
スク2は5iOzをスパッタして形成し、n゛−InP
基板1との密着性は低い。第2の領域ibは変調器を形
成する領域である。
第1のマスク2をマスクにしてn”−1nP基板1をB
rメタノール でエツチングする。エツチングはマスク
の下まで回り込み、スムースな段差が形成され2表面が
第2の領域1bの表面より低い第1の領域1aが形成さ
れる。段差は約0.1 μmである。第1の領域1aは
レーザを形成する領域である。
rメタノール でエツチングする。エツチングはマスク
の下まで回り込み、スムースな段差が形成され2表面が
第2の領域1bの表面より低い第1の領域1aが形成さ
れる。段差は約0.1 μmである。第1の領域1aは
レーザを形成する領域である。
第2図(b)参照
第1の領域1aに第2のマスク3を形成する。
第2のマスク3は熱CVD法によりSiO□を堆積し1
選択成長マスクとしてエツチング成形する。
選択成長マスクとしてエツチング成形する。
露出する帯状の第1の領域1cの幅は30μmであり、
その両側の第2のマスク3の幅は100μmである。
その両側の第2のマスク3の幅は100μmである。
第2図(c)参照
MOCVD法により、成長温度590°Cで、帯状の第
1の領域1cと第2の領域1bに同時に連続的にエピタ
キシャル成長を行う。第2図(c)は成長後のA−A断
面図を示す。
1の領域1cと第2の領域1bに同時に連続的にエピタ
キシャル成長を行う。第2図(c)は成長後のA−A断
面図を示す。
0.1 μm
(4a) 4b バッファ層 n”−InP(5a
) 5b 導波層 Siドープn−1nGaAsP(
発光波長1.3μm) 200人 (6a) 6b 多重量子井戸構造 (発光波長1.3μm) アンドープInGaAsP 60人 6層アンドープ
InGaAs 60人 5層(7a) 7b 導波
層 Znドープp−1nGaAsP(発光波長1.3μ
m) 0.14μm6aは第1の多重量子井戸構造、
6bは第2の多重量子井戸構造であり、 4a〜7a
は帯状の第1の領域1cへの成長、 4b〜7bは第2
の領域1bへの成長であり、さらに、上に示した厚さは
第2の領域lb上のものである。帯状の第1の領域1c
上での厚さは。
) 5b 導波層 Siドープn−1nGaAsP(
発光波長1.3μm) 200人 (6a) 6b 多重量子井戸構造 (発光波長1.3μm) アンドープInGaAsP 60人 6層アンドープ
InGaAs 60人 5層(7a) 7b 導波
層 Znドープp−1nGaAsP(発光波長1.3μ
m) 0.14μm6aは第1の多重量子井戸構造、
6bは第2の多重量子井戸構造であり、 4a〜7a
は帯状の第1の領域1cへの成長、 4b〜7bは第2
の領域1bへの成長であり、さらに、上に示した厚さは
第2の領域lb上のものである。帯状の第1の領域1c
上での厚さは。
上に示した値の約1.3倍となる。
第1の多重量子井戸構造6aと第2の多重量子井戸構造
6bの中心はほぼ同じ高さとなる。
6bの中心はほぼ同じ高さとなる。
第2図(d)参照
第2のマスク3を剥離し、導波層7aにピッチ2400
人の1次回折格子8を形成する。
人の1次回折格子8を形成する。
第2図(e)参照
第2の領域1bに第3のマスク9を形成する。
第3のマスク9は熱CVD法により5iOzを堆積し1
選択成長マスクとしてエツチング成形する。
選択成長マスクとしてエツチング成形する。
露出する帯状の第2の領域の幅は30μmであり、その
両側の第2のマスク3の幅は100μmである。第2図
(e)はその状態の斜視図である。
両側の第2のマスク3の幅は100μmである。第2図
(e)はその状態の斜視図である。
第2図(f)参照
全面に厚さ1.0μmのZnドープp−InPクラッド
層10を成長し2次いで、厚さ0.2μmのZnドープ
p”−1nGaAsP(発光波長1.3μm)のキャッ
プ層11を成長する。ただし、この厚さは第1の領域l
a上の厚さで、第2の領域lb上での厚さはこの値の約
1゜3倍となる。
層10を成長し2次いで、厚さ0.2μmのZnドープ
p”−1nGaAsP(発光波長1.3μm)のキャッ
プ層11を成長する。ただし、この厚さは第1の領域l
a上の厚さで、第2の領域lb上での厚さはこの値の約
1゜3倍となる。
第2図(g)参照
この図は上面図である。上面に第1の領域(レーザ領域
)と第2の領域(変調器領域)の間に幅300 μmの
窓をもつ5iOzの第4のマスク12を形成する。
)と第2の領域(変調器領域)の間に幅300 μmの
窓をもつ5iOzの第4のマスク12を形成する。
第2図(h)参照
第4のマスク12をマスクにしてキャップ層11をを選
択エツチングによって除去する。
択エツチングによって除去する。
第2図(i)参照
この図は上面図である。上面に第1の領域(レーザ領域
)と第2の領域(変調器領域)にまたがり、第1のエピ
タキシャル層及び第1のエピタキシャル層の上に2幅3
0μmの幅のストライブ状のSiO□の第5のマスク1
3を形成する。
)と第2の領域(変調器領域)にまたがり、第1のエピ
タキシャル層及び第1のエピタキシャル層の上に2幅3
0μmの幅のストライブ状のSiO□の第5のマスク1
3を形成する。
第2図(D参照
この図はB−B断面図である。第5のマスク13をマス
クにして、n′″−1nP基板1までメサエッチングを
行う。
クにして、n′″−1nP基板1までメサエッチングを
行う。
第2図(k)参照
メサエッチングした場所にMOVPE法により高抵抗の
FeドープInP 14を埋込み成長する。
FeドープInP 14を埋込み成長する。
第2図(1)参照
埋込み層14の上にSin、の保護膜15をつけ、レー
ザ領域と変調器領域にコンタクトホールを形成し。
ザ領域と変調器領域にコンタクトホールを形成し。
Ti/Pt/Auのp電極16を形成する。また、裏面
にはAuGe/八Uのnへ極17を形成する。
にはAuGe/八Uのnへ極17を形成する。
第2図(w+)参照
この図はA−A断面図である。へき開によって端面を形
成し、その端面に無反射コート膜18を形成する。
成し、その端面に無反射コート膜18を形成する。
このようにして、モノリシック型外部変調器付分布帰還
型レーザが作製できた。
型レーザが作製できた。
第3図(a)、 (b)は他の実施例の工程を説明する
ための図である。
ための図である。
この例は第1の領域1aと第2の領域1bに段差を形成
するのに前述の第2のマスク3を使用するものである。
するのに前述の第2のマスク3を使用するものである。
第3図(a)参照
半導体基板1にマスク3を形成する。マスク3は熱CV
D法によりSiO□を堆積し9選択成長マスクとしてエ
ツチング成形する。露出する帯状の第1の領域1cの幅
は30μmであり、その両側の第2のマスク3の幅は1
00μmである。
D法によりSiO□を堆積し9選択成長マスクとしてエ
ツチング成形する。露出する帯状の第1の領域1cの幅
は30μmであり、その両側の第2のマスク3の幅は1
00μmである。
第3図(b)参照
マスク3をマスクにして帯状の第1の領域1cと第2の
領域1bをエツチングする。
領域1bをエツチングする。
帯状の第1の領域1cでは第2の領域1bよりエツチン
グ速度が大きく、エツチングされた第2の領域1bの表
面より深くエツチングされ、溝1dが形成される。
グ速度が大きく、エツチングされた第2の領域1bの表
面より深くエツチングされ、溝1dが形成される。
それ以降の工程は、前述の実施例の第2図(c)〜(a
+)の工程と同様である。
+)の工程と同様である。
この実施例では第1の領域1aと第2の領域1bに段差
を形成するマスクと、第1の領域1aと第2の領域1b
にエピタキシャル成長を行うマスクを共用できるから工
数削減のメリットがある。
を形成するマスクと、第1の領域1aと第2の領域1b
にエピタキシャル成長を行うマスクを共用できるから工
数削減のメリットがある。
なお、基板としてGaAs基板を用いることができるの
は勿論である。本発明者の実験結果によれば、GaAs
基板に同じ<GaAsを成長する場合、 5iOz選択
成長マスクの幅を500μm、マスク間の間隔を10μ
mとし、TEGとAsH,の供給比を1:40.成長温
度を690″Cとすれば。
は勿論である。本発明者の実験結果によれば、GaAs
基板に同じ<GaAsを成長する場合、 5iOz選択
成長マスクの幅を500μm、マスク間の間隔を10μ
mとし、TEGとAsH,の供給比を1:40.成長温
度を690″Cとすれば。
幅10μmのストライブ領域での成長速度は3選択成長
マスクの影響が全くない領域での成長速度のほぼ10倍
である。
マスクの影響が全くない領域での成長速度のほぼ10倍
である。
以上説明したように2本発明によれば、モノリシック型
外部変調器付分布帰還型レーザを歩留りよく製造するこ
とができる。初めに半導体基板に段差を設け2段差の両
側に作るレーザ発光部と光変調部に同時にエピタキシャ
ル成長を行うことにより、レーザ発光部と光変調部の光
結合をよくすることができる。
外部変調器付分布帰還型レーザを歩留りよく製造するこ
とができる。初めに半導体基板に段差を設け2段差の両
側に作るレーザ発光部と光変調部に同時にエピタキシャ
ル成長を行うことにより、レーザ発光部と光変調部の光
結合をよくすることができる。
本発明は今後の超高速伝送の光通信用素子の発展に寄与
するところが大きい。
するところが大きい。
第1図(a)〜(c)は本発明の詳細な説明するための
図。 第2図(a)〜(m)は実施例の工程を説明するための
図。 第3図(a)、 (b)は他の実施例の工程を説明する
ための図。 第4図は多重量子井戸構造のエネルギー準位を示す図。 第5図は従来の外部変調器付分布帰還型レーザを説明す
るための断面図 である。 図において。 1は半導体基板であってn ” −InPlaは第1の
領域であってレーザ領域。 1bは第2の領域であって変調器領域。 1cは帯状の第1の領域。 1dは溝。 2は第1のマスクであってSiO□ 3はマスクであり第2のマスクであってStO□。 4a+ 4bはバッファ層であってn−1nP。 5a、 5bは導波層であってn −1nGaAsP
。 6aは第1の量子井戸構造であり第1の多重量子井戸構
造であってアンドープMQW。 6bは第2の量子井戸構造であり第2の多重量子井戸構
造であってアンドープMQW。 7a、 7bは導波層であってp−InGaAsP。 8は回折格子。 9は第3のマスクであってSfO□。 10はクラッド層であってp−InP。 11はキー? ツブ層であってp ” −InGaAs
P+12は第4のマスクであって5ift。 13は第5のマスクであってSiO□。 14は埋込み層であってFeドープInP。 15は保護膜であって5iOz。 16はp電極であってTi/Pt/Au。 17はn電極であってAuGe/Au。 18は無反射コート膜。 本発明の原理¥説明するたのの図 第 1 図 y2.5iOz 大諦枦1の工程文説明フ゛るための間 第2図(℃の1) 笑施伊jの工程R旋用するための同 第′2図(での3〕 尖沸夕jの」呈亥綻明すづたυつの図 第2凹(での2) (j) (k) 芙#jの工程宮沈明するたOの囚 第2図(での4) (d) イ也の実施タリの工程営悦明fるたのの口伝導帯 伏導苧
図。 第2図(a)〜(m)は実施例の工程を説明するための
図。 第3図(a)、 (b)は他の実施例の工程を説明する
ための図。 第4図は多重量子井戸構造のエネルギー準位を示す図。 第5図は従来の外部変調器付分布帰還型レーザを説明す
るための断面図 である。 図において。 1は半導体基板であってn ” −InPlaは第1の
領域であってレーザ領域。 1bは第2の領域であって変調器領域。 1cは帯状の第1の領域。 1dは溝。 2は第1のマスクであってSiO□ 3はマスクであり第2のマスクであってStO□。 4a+ 4bはバッファ層であってn−1nP。 5a、 5bは導波層であってn −1nGaAsP
。 6aは第1の量子井戸構造であり第1の多重量子井戸構
造であってアンドープMQW。 6bは第2の量子井戸構造であり第2の多重量子井戸構
造であってアンドープMQW。 7a、 7bは導波層であってp−InGaAsP。 8は回折格子。 9は第3のマスクであってSfO□。 10はクラッド層であってp−InP。 11はキー? ツブ層であってp ” −InGaAs
P+12は第4のマスクであって5ift。 13は第5のマスクであってSiO□。 14は埋込み層であってFeドープInP。 15は保護膜であって5iOz。 16はp電極であってTi/Pt/Au。 17はn電極であってAuGe/Au。 18は無反射コート膜。 本発明の原理¥説明するたのの図 第 1 図 y2.5iOz 大諦枦1の工程文説明フ゛るための間 第2図(℃の1) 笑施伊jの工程R旋用するための同 第′2図(での3〕 尖沸夕jの」呈亥綻明すづたυつの図 第2凹(での2) (j) (k) 芙#jの工程宮沈明するたOの囚 第2図(での4) (d) イ也の実施タリの工程営悦明fるたのの口伝導帯 伏導苧
Claims (1)
- 【特許請求の範囲】 〔1〕半導体基板(1)の所定の領域(1b)を覆う第
1のマスク(2)を形成した後該半導体基板(1)をエ
ッチングし、表面が該所定の領域(1b)より低い第1
の領域(1a)を形成する工程と、 該所定の領域(1b)を第2の領域(1b)とし、該第
1の領域(1a)に第2のマスク(3)を形成して該第
2の領域(1b)に接続する帯状の第1の領域(1c)
を露出した後、該帯状の第1の領域(1c)と該第2の
領域(1b)に同時にエピタキシャル成長を行い、該帯
状の第1の領域(1c)に第1のエピタキシャル層(4
a、5a、6a、7a)、該第2の領域(1b)に第2
のエピタキシャル層(4b、5b、6b、7b)を形成
する工程とを有し、 該第1のエピタキシャル層(4a、5a、6a、7a)
の厚さは該第2のエピタキシャル層(4b、5b、6b
、7b)の厚さより大きく、該第2のエピタキシャル層
(4b、5b、6b、7b)の高さは該第1のエピタキ
シャル層(4a、5a、6a、7a)の一部の高さと実
質的に等しく形成することを特徴とする光半導体装置の
製造方法。 〔2〕半導体基板(1)の第1の領域(1a)に該第1
の領域(1a)を帯状に露出するマスク(3)を形成し
、該マスク(3)をマスクにして該第1の領域(1a)
及びそれに連続する第2の領域(1b)をエッチングし
、該第1の領域(1a)に底面がエッチングされた第2
の領域(1b)の表面より低い溝(1d)を形成し、つ
づいて該溝(1d)及び該第2の領域(1b)に同時に
エピタキシャル成長を行い、該溝(1d)に第1のエピ
タキシャル層(4a、5a、6a、7a)、該第2の領
域(1b)に第2のエピタキシャル層(4b、5b、6
b、7b)を形成する工程を有し、 該第1のエピタキシャル層(4a、5a、6a、7a)
の厚さは該第2のエピタキシャル層(4b、5b、6b
、7b)の厚さより大きく、該第2のエピタキシャル層
(4b、5b、6b、7b)の高さは該第1のエピタキ
シャル層(4a、5a、6a、7a)の一部の高さと実
質的に等しく形成することを特徴とする光半導体装置の
製造方法。 〔3〕前記第1のエピタキシャル層(4a、5a、6a
、7a)はダブルヘテロ構造で第1の量子井戸構造(6
a)を含み、前記第2のエピタキシャル層(4b、5b
、6b、7b)はダブルヘテロ構造で第2の量子井戸構
造(6b)を含み、該第1の量子井戸構造(6a)の厚
さは該第2の量子井戸構造(6b)の厚さより大きく、
該第2の量子井戸構造(6b)の高さは該第1の量子井
戸構造(6a)の一部の高さと等しく、該第1の量子井
戸構造(6a)をレーザの発光部のコアとし、該第2の
量子井戸構造(6b)を光変調部のコアとすることを特
徴とする請求項1或いは請求項2記載の光半導体装置の
製造方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21862190A JP2890745B2 (ja) | 1990-08-20 | 1990-08-20 | 半導体装置の製造方法および、光半導体装置の製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21862190A JP2890745B2 (ja) | 1990-08-20 | 1990-08-20 | 半導体装置の製造方法および、光半導体装置の製造方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04100291A true JPH04100291A (ja) | 1992-04-02 |
| JP2890745B2 JP2890745B2 (ja) | 1999-05-17 |
Family
ID=16722825
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| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21862190A Expired - Fee Related JP2890745B2 (ja) | 1990-08-20 | 1990-08-20 | 半導体装置の製造方法および、光半導体装置の製造方法 |
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|---|---|
| JP (1) | JP2890745B2 (ja) |
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|---|---|---|---|---|
| JPH0529602A (ja) * | 1991-07-22 | 1993-02-05 | Hitachi Ltd | 半導体光集積素子及びその製造方法 |
| EP0498736A3 (en) * | 1991-02-08 | 1993-04-14 | Fujitsu Limited | Dfb laser diode having a modified profile of linewidth enhancement factor |
| JPH05243551A (ja) * | 1992-02-28 | 1993-09-21 | Hitachi Ltd | 半導体光集積素子 |
| EP0602579A1 (en) * | 1992-12-15 | 1994-06-22 | Mitsubishi Denki Kabushiki Kaisha | Semiconductor laser and method of making the semiconductor laser |
| JPH06260727A (ja) * | 1993-01-07 | 1994-09-16 | Nec Corp | 光半導体素子およびその製造方法 |
| EP0606093A3 (en) * | 1993-01-07 | 1994-10-19 | Nec Corp | Integrated semiconductor optical device and manufacturing method. |
| EP0661783A1 (en) * | 1993-12-28 | 1995-07-05 | Nec Corporation | Method for fabricating semiconductor light integrated circuit |
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| US5580818A (en) * | 1994-04-28 | 1996-12-03 | Nec Corporation | Fabrication process for semiconductor optical device |
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| EP0703476A3 (en) * | 1994-06-29 | 1997-10-15 | Nec Corp | Integrated light-sensitive semiconductor component with an optical waveguide |
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| US6084901A (en) * | 1996-12-17 | 2000-07-04 | Nec Corporation | Semiconductor laser device |
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| WO2011105066A1 (ja) * | 2010-02-26 | 2011-09-01 | 住友化学株式会社 | 半導体基板、半導体デバイスおよび半導体基板の製造方法 |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2008069432A1 (en) * | 2006-12-05 | 2008-06-12 | Electronics And Telecommunications Research Institute | Mask pattern for selective area growth of semiconductor layer and selective area growth method using the mask pattern for semiconductor layer |
-
1990
- 1990-08-20 JP JP21862190A patent/JP2890745B2/ja not_active Expired - Fee Related
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| KR100329681B1 (ko) * | 1993-08-04 | 2002-08-14 | 가부시끼가이샤 히다치 세이사꾸쇼 | 반도체광집적회로및그제조방법 |
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| JP2011199268A (ja) * | 2010-02-26 | 2011-10-06 | Sumitomo Chemical Co Ltd | 半導体基板、半導体デバイスおよび半導体基板の製造方法 |
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|---|---|
| JP2890745B2 (ja) | 1999-05-17 |
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