JPH04107940A - 半導体装置及びその構成部品 - Google Patents

半導体装置及びその構成部品

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JPH04107940A
JPH04107940A JP2225058A JP22505890A JPH04107940A JP H04107940 A JPH04107940 A JP H04107940A JP 2225058 A JP2225058 A JP 2225058A JP 22505890 A JP22505890 A JP 22505890A JP H04107940 A JPH04107940 A JP H04107940A
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bonding wire
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impedance
bonding
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Sadayuki Daikuhara
大工原 貞行
Norio Nakazato
典生 中里
Chiyoshi Kamata
千代士 鎌田
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Renesas Eastern Japan Semiconductor Inc
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Hitachi Ltd
Hitachi Tohbu Semiconductor Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は半導体装置の信号伝送インピーダンスの整合を
図ると共に使用周波数を高める技術、特に、ギガヘルツ
域の周波数でのインピーダンス整合及び動作を可能にす
るために用いて効果のある技術に関するものである。
σ従来の技術] 一般に、リードフレームを用いた半導体装置は、リード
フレームと半導体チップとの間の電気的接続をワイヤボ
ンディングにより行っている。このような構造では、ボ
ンディングワイヤがチップ内のパターンの長さに比べて
長いため、例えば、数ギガヘルツ域の周波数になるとボ
ンディングワイヤに形成されるインダクタンスが無視で
きなくなり、このインダクタンスと浮遊静電容量とによ
って周波数特性が決定される。
従来より、ボンディングワイヤのインダクタンスを低減
する技術として、次のようなものが知られている。
■ボンディングワイヤの長さを短縮する。
■ワイヤ径を太くする。
■ワイヤ数を増やす。すなわち、複数のワイヤを並列接
続する。
なお、この種の技術については、例えば、GaAsIC
Symposium TfliC)INrCAL DI
GεST (ガ!J’7ムー7シニード・アイシー・シ
ンポジウム テクニカル・ダイジェスト) Novem
ber 6−9.1988  (1988・  年11
月発行)に記載がある。
ところで、本発明者は、半導体装置の超高周波域におけ
る周波数特性の劣化及び入・出力インピーダンスの不整
合の問題について検討した。
以下は、本発明者によって検討された技術であり、その
概要は次の通りである。
例えば、通信などのインターフェースに用いられる半導
体装置は、8ビツト、16ビツトなどのパラレル信号を
シリアル信号に変換するように構成されているが、上記
したように7リアル信号ラインにボンディングワイヤを
用いた場合、ライン中にインダクタンスが直列挿入され
るたぬ、その等価回路は第7図の如くになる。
すなわち、リードlのバッド2とチップ3との間はボン
ディングワイヤによって接続されるが、このボンディン
グワイヤ4がインダクタンスLを持っている。また、パ
ッケージ7のパッド5とアースライン(または電源ライ
ン)との間には浮遊静電容量6 (C)が生じている。
周波数の上限を高くするにはL及びCは小さいほど良い
結果が得られるが、これらを0にすることはできない。
このインダクタンスLと浮遊静電窓16  (C)がロ
ーパスフィルタを形成し、このLとCから遮断周波数及
びインピーダンスが決定される。通常、インピーダンス
は5oΩに設定されので、インピーダンス2は次のよう
に表される。
2=帽;7こ 信号伝送においては、不整合による伝送損失やノイズの
混入の影響が重視されるから、インピーダンス2を指定
値(この場合、5DΩ)にしなければならない。したが
って、インダクタンス4及び浮遊静電容量6は、インピ
ーダンスZを決めることのみを考えて決定し、最高周波
数の決定を配慮して決めることはない。つまり、遮断周
波数は、インピーダンスZを決めるために出されたしと
Cから一義的に定まることになる。
〔発明が解決しようとする課題〕
ところが、前記の如くボンディングワイヤのLと浮遊静
電容量を用いて信号伝送用のインピーダンスを形成する
半導体装置においては、インピーダンスを設計値にする
とL及びCの値が大きくなり、使用可能な最高周波数が
低くなるという問題のあることが本発明者によって見い
出された。
将来、大量のデータを扱うことが予想され、このために
、例えば光通借及び超高周波(10〜20ギガヘルツ)
を用いたシステムが考えられるが、現状では数ギガヘル
ツが限度である。
また、従来においては、周波数が高いた於に、ワイヤの
微妙な形崩れや長さの違い、或いは多層間のばらつきな
どによってLやCに差異が生じるが、これを調整する手
段などがないため、インピーダンスを設計値に一致させ
ることが難しく、例えば第8図に示すように、インピー
ダンスが部分的(ここではボンディングワイヤ4の部分
)に不整合になりやすい。
そこで、本発明の目的は、ワイヤボンディングを用いな
がら、インピーダンス整合及び最高周波数を高くするこ
とが可能な技術を提供することにある。
本発明の前記目的と新規な特徴は、本明細書の記述及び
添付図面から胡らかになるであろう。
〔課題を解決するための手段〕
本願において開示される発明のうち、代表的なものの概
要を簡単に説明すれば、以下の通りである。
すなわち、リードフレーム側のパッドと半導体チップ側
のパッドとを信号伝送用ボンディングワイヤによって接
続して超高周波信号の伝送路を形成する半導体装置であ
って、前記信号伝送用ボンディングワイヤのインダクタ
ンス及び前記信号伝送用ボンディングワイヤの端部の対
地静電容量を伝送インピーダンスに整合させる調整手段
を設けるものである。
〔作用〕
上記した手段によれば、リードフレーム側または半導体
チップ側に設けられた調整用ボンディングパッドは、信
号伝送路に対し静電容量を増加させるように機能する。
したがって、信号伝送用ボンディングワイヤのインダク
タンスによって伝送インピーダンスが上がっても、これ
を下げるように作用し、ボンディングワイヤ部分のイン
ピーダンスをその前後の信号伝送路のインピーダンスに
一致させることができ、しかも周波数特性を劣化させる
ことがない。
〔実施例1〕 第1図は本発明による半導体装置の主要部を示す平面図
である。
第1図に示すように、超高周波信号を伝送するパッド2
はパッケージ7側に設けられ、チップ3側に設けられた
パッド5 (超高周波信号の入・出力用)に隣接させて
調整用ボンディングパッド8が配設されている。パッド
2とパッド5の間には金線による信号伝送用のボンディ
ングワイヤ4がボンディング接続され、パッド2と調整
用ボンディングパッド8の間には調整用ボンディングワ
イヤ9がボンディング接続されている。
第2図は第1図の構成の等価回路を示し、パッド2には
ボンディングワイヤ4によるインダクタンスL1  と
浮遊静電容量6 (C,)による回路に対し、調整用ボ
ンディングワイヤ9による第2のインダクタンスL、及
びパッド2と調整用ボンディングパッド8の間に形成さ
れる浮遊静電容量10  (C2>による回路が付加さ
れた形になる。なお、第2図においては、外部回路との
接続のための50Ωの伝送線11がパッド2に接続され
ている。なお、リードが長くなると、インピーダンスが
規定値(50Ω)から外れるが、これに対しては、リー
ドにマイクロストリップラインを形成してインピーダン
スを規定値になるようにしている。
調整用ボンディングワイヤ9を設けたことにより、パッ
ド2からチップ側を見たインピーダンスZ0 は次のよ
うになる。
Zo = Zl  ・Z2 / Zl +Zxただし、 2、=  4刀=7でE、   = 43=7でTここ
で、zl を大まかに設定し、微調整をz2により行う
ようにする。この場合、インピーダンスの調整は、調整
用ボンディングワイヤ9の長さ及び径を変えることによ
り行うことができる。
このようなインピーダンス調整手段を設けたことにより
、外部から見た半導体装置のインピーダンスは、第3図
に示すように一定値を示し、乱れを生じることはない。
そして、信号の通過経路にはインダクタンスし2 が挿
入されないので最高使用周波数を高くすることができる
また、調整用ボンディングパッド8を設けることにより
、従来のようにワイヤの長さ、径などを調整する方法に
比べて仕様変更などに容易に対処することができるよう
になる。
なあ、第8図に示すようなインピーダンス特性の場合、
これを調整するためにはパッド5の面積を増大し、対地
静電容量を増やすことにより解決するが、これでは微妙
な調整が困難であるばかりでなく、自由度もないため、
実用的ではない。
〔実施例2〕 第41!lは本発明の第2実施例の主要部を示す平面図
である。
本実施例は、第1図の構成における調整用ボンディング
パッド8を除去し、パッド5の面積を約2倍に拡大し、
パッド2に隣接させて調整用ボンディングパッド12を
設ける構成にしたところに特徴がある。この場合、調整
用ボンディングワイヤ9は、パッド5と調整用ボンディ
ングパッド12の間に接続される。
このように、インダクタンスL1 が大きくなる傾向に
より高くなったインピーダンスが、パッケージ7の面積
の拡大による浮遊静電容量の増加により、インピーダン
ス整合を取ることが可能になる。
〔実施例3〕 第5図は本発明の第3実施例の主要部を示す平面図であ
る。
本実施例は、第2図の構成の特徴部分と4図の構成の特
徴部分を兼ね備えたところに特徴がある。
すなわち、浮遊静電容量をパッケージ側とチップ側に1
個づつ配した構成を持ち、チップ3側には面積を拡大し
たパッド5に隣接して調整用ボンディングパッド8を設
け、リード側にはパッド2に隣接させて調整用ボンディ
ングパッド12を設ける。そして、パッド5と調整用ボ
ンディングパッド12及びパッド2との間に第1の調整
用ボンディングワイヤ9aを接続し、パッド2と調整用
ボンディングパッド8間に第2の調整用ボンディングワ
イヤ9bを接続する。
第6図は第5図の構成の等価回路図を示している。
パッド2とパッド5の間にボンディングワイヤ4による
インダクタンスLl、パッド5と調整用ボンディングパ
ッド12の間に調整用ボンディングワイヤ9aによるイ
ンダクタンスL3 、パッド2と調整用ボンディングパ
ッド8の間に調整用ボンディングワイヤ9bによるイン
ダクタンスL2の各々が形成される。
さらに、パッド5、調整用ボンディングパッド8、及び
調整用ボンディングパッド12の各々とアース(または
グランド)間には、静電容量C1、C2、C3の各々が
形成される。
この構成では、調整用インピーダンス回路が2段になる
ため、インピーダンス調整を微細に行うことが可能にな
る。
以上、本発明者によってなされた発明を実施例に基づき
具体的に説明したが、本発明は前記実施例に限定される
ものではなく、その要旨を逸脱しない範囲で種々変更可
能であることは言うまでもない。
〔発明の効果〕
本願において開示される発明のうち、代表的なものによ
って得られる効果を簡単に説明すれば、下記の通りであ
る。
すなわち、リードフレーム側のパッドと半導体チップ側
のパッドとを信号伝送用ボンディングワイヤによって接
続して超高周波信号の伝送路を形成する半導体装置であ
って、前記信号伝送用ボンディングワイヤのインダクタ
ンス及び前記信号伝送用ボンディングワイヤの端部の対
地静電容量を伝送インピーダンスに整合させる調整手段
を設けるようにしたので、ボンディングワイヤ部分のイ
ンピーダンスをその前後の信号伝送路のインピーダンス
に一致させることができ、信号の劣化を抑え、かつ周波
数特性を劣化させることがない。また、パッケージ設計
の自由度を向上させることもできる。
【図面の簡単な説明】
第1図は本発明による半導体装置の主要部を示す平面図
、 第2図は第1図の構成の等価回路、 第3図は本発明による信号伝送路のインピーダンス特性
図、 第4図は本発明の第2実施例の主要部を示す平面図、 第5図は本発明の第3実施例の主要部を示す平面図、 第6図は第5図の構成の等価回路図、 第7図は従来の半導体装置の超高周波域における等価回
路図、 第8図は第7図の構成のインピーダンス特性図である。 1 ・ ・ ・ リード、2・ ・ ・パッド、3 ・
 ・ ・チップ、4・・・ボンディングワイヤ、5・・
・ノぜラド、6・・・浮遊静電容量、7・・・パッケー
ジ、8・・・調整用ボンディングパッド、9,9a、9
b・・・調整用ボンディングワイヤ、10・・・浮遊静
電容量、11・・・伝送線、12・・・調整用ボンディ
ングパッド。 第1図 4:ホンディングワイヤ  9:調整用ボンディングワ
イヤ第2図 6.10:浮遊静電容量    11:伝送線第3図 ワイヤ4の区間        第 4 図第5図 第6図

Claims (1)

  1. 【特許請求の範囲】 1、リードフレーム側のパッドと半導体チップ側のパッ
    ドとを信号伝送用ボンディングワイヤによって接続して
    超高周波信号の伝送路を形成する半導体装置であって、
    前記信号伝送用ボンディングワイヤのインダクタンス及
    び前記信号伝送用ボンディングワイヤの端部の対地静電
    容量を伝送インピーダンスに整合させる調整手段を設け
    たことを特徴とする半導体装置。 2、前記調整手段は、前記リード部または前記半導体チ
    ップの一方に調整用ボンディングパッドを設け、このパ
    ッドと前記信号伝送用のボンディングワイヤの何れか一
    端との間に調整用ボンディングワイヤを接続するもので
    あることを特徴とする請求項1記載の半導体装置。 3、前記調整手段は、前記リード部および前記半導体チ
    ップの各々に調整用ボンディングパッドを設け、前記調
    整用ボンディングワイヤの前記調整用ボンディングパッ
    ドに接続されていない側を前記信号伝送用ボンディング
    ワイヤの遠方側端に接続するものであることを特徴とす
    る請求項1記載の半導体装置。 4、前記半導体チップの前記信号伝送用ボンディングワ
    イヤが接続されるパッドに隣接させて、インピーダンス
    調整用のボンディングパッドを設けたことを特徴とする
    半導体チップ。 5、前記リードフレームの信号伝送用のパッドに隣接さ
    せて、インピーダンス調整用のボンディングパッドを設
    けたことを特徴とするリードフレーム。
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Cited By (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6448865B1 (en) 1999-02-25 2002-09-10 Formfactor, Inc. Integrated circuit interconnect system
US6459343B1 (en) * 1999-02-25 2002-10-01 Formfactor, Inc. Integrated circuit interconnect system forming a multi-pole filter
US6501343B2 (en) 1999-02-25 2002-12-31 Formfactor, Inc. Integrated circuit tester with high bandwidth probe assembly
US6538538B2 (en) * 1999-02-25 2003-03-25 Formfactor, Inc. High frequency printed circuit board via
EP1316996A2 (en) 2001-11-30 2003-06-04 Fujitsu Limited Semiconductor device
US6606014B2 (en) 1999-02-25 2003-08-12 Formfactor, Inc. Filter structures for integrated circuit interfaces
WO2004010501A1 (de) * 2002-07-12 2004-01-29 Infineon Technologies Ag Integrierte schaltungsanordnung
US6816031B1 (en) 2001-12-04 2004-11-09 Formfactor, Inc. Adjustable delay transmission line
JP2004328190A (ja) * 2003-04-23 2004-11-18 Renesas Technology Corp 高周波電力増幅モジュール
DE102005008195A1 (de) * 2005-02-23 2006-08-24 Atmel Germany Gmbh Hochfrequenzanordnung
US7737553B2 (en) 2004-10-06 2010-06-15 Panasonic Corporation Semiconductor device
JP2011100828A (ja) * 2009-11-05 2011-05-19 Renesas Electronics Corp 半導体装置及びその製造方法
JP2011103399A (ja) * 2009-11-11 2011-05-26 Canon Inc 半導体装置

Cited By (22)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007189241A (ja) * 1999-02-25 2007-07-26 Formfactor Inc 集積回路の相互接続システム
US6459343B1 (en) * 1999-02-25 2002-10-01 Formfactor, Inc. Integrated circuit interconnect system forming a multi-pole filter
US6501343B2 (en) 1999-02-25 2002-12-31 Formfactor, Inc. Integrated circuit tester with high bandwidth probe assembly
US6538538B2 (en) * 1999-02-25 2003-03-25 Formfactor, Inc. High frequency printed circuit board via
US6448865B1 (en) 1999-02-25 2002-09-10 Formfactor, Inc. Integrated circuit interconnect system
US6606014B2 (en) 1999-02-25 2003-08-12 Formfactor, Inc. Filter structures for integrated circuit interfaces
JP2003526901A (ja) * 1999-02-25 2003-09-09 フォームファクター,インコーポレイテッド 集積回路の相互接続システム
US6661316B2 (en) 1999-02-25 2003-12-09 Formfactor, Inc. High frequency printed circuit board via
EP1316996A3 (en) * 2001-11-30 2005-02-02 Fujitsu Limited Semiconductor device
EP1316996A2 (en) 2001-11-30 2003-06-04 Fujitsu Limited Semiconductor device
US6816031B1 (en) 2001-12-04 2004-11-09 Formfactor, Inc. Adjustable delay transmission line
US7057474B2 (en) 2001-12-04 2006-06-06 Formfactor, Inc. Adjustable delay transmission lines
US7239220B2 (en) 2001-12-04 2007-07-03 Formfactor, Inc. Adjustable delay transmission line
US7683738B2 (en) 2001-12-04 2010-03-23 Formfactor, Inc. Adjustable delay transmission line
WO2004010501A1 (de) * 2002-07-12 2004-01-29 Infineon Technologies Ag Integrierte schaltungsanordnung
US7576619B2 (en) 2002-07-12 2009-08-18 Infineon Technologies Ag Integrated circuit arrangement
JP2004328190A (ja) * 2003-04-23 2004-11-18 Renesas Technology Corp 高周波電力増幅モジュール
US7737553B2 (en) 2004-10-06 2010-06-15 Panasonic Corporation Semiconductor device
DE102005008195A1 (de) * 2005-02-23 2006-08-24 Atmel Germany Gmbh Hochfrequenzanordnung
US7605450B2 (en) 2005-02-23 2009-10-20 Atmel Automotive Gmbh High frequency arrangement
JP2011100828A (ja) * 2009-11-05 2011-05-19 Renesas Electronics Corp 半導体装置及びその製造方法
JP2011103399A (ja) * 2009-11-11 2011-05-26 Canon Inc 半導体装置

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