JPH04127550A - Tab形半導体集積回路装置のエージング方法およびそれに用いるエージング用フィルム - Google Patents

Tab形半導体集積回路装置のエージング方法およびそれに用いるエージング用フィルム

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Publication number
JPH04127550A
JPH04127550A JP2249691A JP24969190A JPH04127550A JP H04127550 A JPH04127550 A JP H04127550A JP 2249691 A JP2249691 A JP 2249691A JP 24969190 A JP24969190 A JP 24969190A JP H04127550 A JPH04127550 A JP H04127550A
Authority
JP
Japan
Prior art keywords
aging
film
tab
wiring
integrated circuit
Prior art date
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Pending
Application number
JP2249691A
Other languages
English (en)
Inventor
Kazuhiro Seiki
和裕 清木
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Renesas Eastern Japan Semiconductor Inc
Original Assignee
Hitachi Tokyo Electronics Co Ltd
Hitachi Ltd
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Filing date
Publication date
Application filed by Hitachi Tokyo Electronics Co Ltd, Hitachi Ltd filed Critical Hitachi Tokyo Electronics Co Ltd
Priority to JP2249691A priority Critical patent/JPH04127550A/ja
Publication of JPH04127550A publication Critical patent/JPH04127550A/ja
Pending legal-status Critical Current

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Classifications

    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00—Interconnections or connectors in packages
    • H10W72/701—Tape-automated bond [TAB] connectors

Landscapes

  • Wire Bonding (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、T A B(Tape Automated
 Bon+jing)方式により実装される半導体集積
回路装置のエージング技術に関するものである。
〔従来の技術〕
多ピン、薄形実装に好適なLSI実装方式の一つに、可
撓性フィルムの一面に設けたリード配線の先端(インナ
リード部)にバンブ電極を介して半導体チップを接続す
るTAB (フィルムキャリヤ)がある。
上記TABを組立てるには、まずデバイスホールおよび
スプロケットホールを形成した長尺フィルムの片面に銅
箔をラミネートした後、この銅箔をエツチングしてリー
ド配線を形成し、その表面にメツキを施す。次に、リー
ド配線のインナリード部にバンプ加工した半導体チップ
をボンディングした後、チップをポツティング樹脂で封
止する。
組立てが完成したTABは、プローブ検査およびエージ
ング(バーンイン検査)を経て良品と不良品とに選別さ
れる。上記エージングは、長尺フィルムを1チツプ毎に
裁断するか、または2〜10チップ程度の定尺に裁断し
、それを専用のバーンインソケットに装着して行ってい
る。なお、TABのエージングについては、工業調査会
発行(1990年1月25日)のrTAB技術入門」P
2O7〜P211に記載されている。
〔発明が解決しようとする課題〕
前記のように、TABの組立て工程は、長尺フィルム状
態のまま各工程間を搬送する一貫生産方式を採用してい
るが、その後のエージングは長尺フィルムを短く裁断し
なければならないので、組立て工程および検査工程の一
貫化が妨げられるという問題があった。また、裁断した
フィルムをエージング後に継ぎ合わせる際、フィルムに
位置ずれが生じ易いため、その後プローブ(探針)をテ
ストパッドに接触する際の位置合わせに支障をきたすと
いう問題もあった。
本発明の目的は、TABのエージングを長尺フィルム状
態のままで実施することのできる技術を提供することに
ある。
本発明の前記ならびにその他の目的と新規な特徴は、本
明細書の記述および添付図面から明らかになるであろう
。
〔課題を解決するための手段〕
本願において開示される発明のうち、代表的なものの概
要を簡単に説明すれば、以下のとおりである。
本願の一発明であるTABのエージング方法は、TAB
に電源および信号を供給する配線を形成したエージング
フィルムを用意し、このエージングフィルムをTABの
フィルムに重ね合わせてエージングを行う方法である。
〔作用〕
上記した手段によれば、二−ジングフィルムをTABの
フィルムに重ね合わせることにより、長尺フィルム状態
のままでTABのエージングを行うことができる。
以下、本発明を実施例により説明する。
〔実施例〕
第4図は、本実施例で用いるTABIの平面図である。
TABIは、例えばポリイミド樹脂からなるフィルム2
の一面に形成した複数本のリード配線3の一端(インナ
ーリード部)に第4図では図示しない半導体チップ4を
接続し、この半導体チップ4をエポキシ樹脂などのポツ
ティング樹脂5で封止した構造を有している。上記リー
ド配線3は、例えばCu箔をエツチングしてなり、その
表面にはSnメツキが施されている。また、フィルム2
とリード配線3とは、エポキシ樹脂系の接着剤で接合さ
れている。
チップ4を封止したポツティング樹脂5の周囲にはデバ
イスホール6が開孔されており、このデバイスホール6
を跨ぐようにリード配線3が配置されている。上記デバ
イスホール6の外側には、エージングホール7が開孔さ
れており、このエージングホール7を跨ぐようにエージ
ング電極8が配置されている。上記エージング電極8は
、エージングに必要な電源および信号をチップに供給す
る際に使用するリード配線3をエージングホール7を跨
ぐように延在したものである。フィルム2の周縁部には
、スプロケットホール9が所定の間隔を置いて開孔され
ている。
TABIは、上記した構成単位を長尺のフィルム2の長
手方向に沿って繰り返し形成したもので、通常はリール
に巻いた状態で搬送、保管される。
第5図は、本実施例で用いるエージング用フィルム10
の平面図である。
エージング用フィルムIOは、例えばポリイミド樹脂か
らなり、その−面には前記TABIにエージング用の電
源および信号を供給する配線11が形成されている。上
記配線11は、例えばCu箔をエツチングしてなり、そ
の表面にはカバーシート(図示せず)が被覆されている
。配線11上には、異方性導電体からなる電極12が所
定の間隔を置いて設けられている。電極I2は、それら
の間隔が前記TABIのフィルム2に開孔されたエージ
ングホール7の間隔と一致するように配置されている。
配線11は、エージング用フィルム10の一端に接続さ
れたコネクタ13およびケーブル14を介してエージン
グ装置に接続されるようになっている。エージング用フ
ィルム10の周縁部には、スプロケットホール9が所定
の間隔を置いて開孔されている。上記スプロケットホー
ル9は、それらの内径および間隔が前記TABIのフィ
ルム2に開孔されたスプロケットホール9の内径および
間隔と一致するように開孔されている。
ニーシンク用フィルム10は、長尺のフィルムからなり
、通常はリールに巻いた状態で搬送、保管される。
次に、上記エージング用フィルム10を用いたTABI
のエージング方法を第1図〜第3図により説明する。
第3図に示すように、リール16aに巻かれた状態でエ
ージング装置15に装着されたTAB 1は、所定の速
度で送り出され、ローラ17a、27b、17cを経て
もう一つのリール16bに巻き取られる。一方、エージ
ング用フィルム10は、ローラ17a、17b、17c
、17d、17e。
17f、17gの間を所定の速度で移動する。上記ロー
ラ17a 〜17d間では、TAB1とエージング用フ
ィルム10とは、互いに重なり合った状態で移動する。
このとき、第1図および第2図に示すように、TABI
のエージング電極8とエージング用フィルム10の電極
12とが接触するように位置合わせが行われる。この位
置合わせは、例えばTABIのスプロケットホール9と
エージング用フィルム10のスプロケットホール9とを
重ね合わせることによって行う。
このようにして、TABIとエージング用フィルム10
とがローラ17aからローラ17dまで移動する間、エ
ージング用フィルムlOの配線11、電極12およびT
ABIのエージング電極8を通じてチップ4に電源およ
び信号が供給され、エージングが行われる。エージング
時間は、ローラ17a〜17gの回転速度を調整するこ
とにより、所望の時間に設定することができる。
このように、本実施例によれば、TAB 1のエージン
グを長尺フィルム状態のまま実施することができるので
、TABIの組立て工程および検査工程を一貫化するこ
とができ、TAB 1の製造コストを低減することがで
きる。また、エージング時に裁断したTABIのフィル
ム2をその後再び継ぎ合わせる従来のエージング方法の
ように、エージング後にプローブ検査を行う際、位置合
わせに支障をきたすこともないので、TAB 1の検査
工程の信頼性が向上する。
以上、本発明者によってなされた発明を実施例に基づき
具体的に説明したが、本発明は前記実施例に限定される
ものではなく、その要旨を逸脱しない範囲で種々変更可
能であることはいうまでもない。
前記実施例では、異方性導電体からなる電極を介してエ
ージング用フィルムの配線とTABのエージング電極と
を接続したが、上記配線とエージング電極との接続は、
任意の方法で行うことができる。
〔発明の効果〕
本願において開示される発明のうち、代表的なものによ
って得られる効果を簡単に説明すれば、次のとおりであ
る。
TABのエージングを行うに際し、上記TABに電源お
よび信号を供給する配線を形成したエージング用フィル
ムを上記TABのフィルムに重ね合わせる本発明によれ
ば、長尺フィルム状態のままでTABのエージングを行
うことができるので、TABの組立て工程および検査工
程が一貫化され、TABの製造コストを低減することが
できる。
【図面の簡単な説明】
第1図は、本発明の一実施例であるTABのエージング
方法を示す要部平面図、 第2図は、第1図の■−■線における断面図、第3図は
、このエージング方法に用いるエージング装置の要部概
略図、 第4図は、このエージング方法に用いるTABの要部平
面図、 第5図は、このエージング方法に用いるエージング用フ
ィルムの要部平面図である。 1・・・TAB、2・・・フィルム、3・・・リード配
線、4・・・半導体チップ、5・・・ボッティング樹脂
、6・・・デバイスホール、7・・・エージングホール
、8・・・エージング電極、9・・・スフロケットホー
ル、10・・・エージングホールム、11・・・配線、
12・・・電極、13・・・コネクタ、14・・・ケー
ブル、15・・・エージング装置、16a、16b・・
・リール、17a〜17g・ ・ ・ローラ。 代理人 弁理士 筒 井 大 和

Claims (1)

  1. 【特許請求の範囲】 1、フィルムに形成したリード配線の一端に半導体チッ
    プを接続するとともに、前記半導体チップをポッティン
    グ樹脂で封止した構造を有するTABのエージングを行
    うに際し、前記TABに電源および信号を供給する配線
    を形成したエージング用フィルムを前記TABのフィル
    ムに重ね合わせることを特徴とするTAB形半導体集積
    回路装置のエージング方法。 2、エージング用フィルムに形成した異方性導電体から
    なる電極を介して前記エージング用フィルムの配線とT
    ABのリード配線とを電気的に接続することを特徴とす
    る請求項1記載のTAB形半導体集積回路装置のエージ
    ング方法。 3、TABに電源および信号を供給する配線が形成され
    てなることを特徴とする請求項1記載のエージング方法
    に用いるエージング用フィルム。
JP2249691A 1990-09-19 1990-09-19 Tab形半導体集積回路装置のエージング方法およびそれに用いるエージング用フィルム Pending JPH04127550A (ja)

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JP2249691A JPH04127550A (ja) 1990-09-19 1990-09-19 Tab形半導体集積回路装置のエージング方法およびそれに用いるエージング用フィルム

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JPH04127550A true JPH04127550A (ja) 1992-04-28

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JP2249691A Pending JPH04127550A (ja) 1990-09-19 1990-09-19 Tab形半導体集積回路装置のエージング方法およびそれに用いるエージング用フィルム

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JP (1) JPH04127550A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0644579A3 (en) * 1993-09-17 1996-03-06 Toshiba Kk Tempering device for semiconductor components.

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0644579A3 (en) * 1993-09-17 1996-03-06 Toshiba Kk Tempering device for semiconductor components.

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