JPH0412764U - - Google Patents
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- Publication number
- JPH0412764U JPH0412764U JP5399390U JP5399390U JPH0412764U JP H0412764 U JPH0412764 U JP H0412764U JP 5399390 U JP5399390 U JP 5399390U JP 5399390 U JP5399390 U JP 5399390U JP H0412764 U JPH0412764 U JP H0412764U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- synchronization signal
- clamp
- buffer amplification
- amplifier circuit
- Prior art date
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- Pending
Links
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Landscapes
- Synchronizing For Television (AREA)
- Picture Signal Circuits (AREA)
Description
第１図は本考案の一実施例を示すクランプ回路
を付加した同期分離回路の電気回路図、第２図は
同第１図の動作波形図である。 １ａ，１ｂはクランプ回路、２ａ，２ｂは結合
コンデンサ、３ａ，４ａ，３ｂ，４ｂはクランプ
電圧設定用抵抗、５ａ，５ｂはピーククランプ用
ダイオード、１３ａ，１３ｂはバツフア増幅用ト
ランジスタ、１９は同期分離用ＩＣである。
を付加した同期分離回路の電気回路図、第２図は
同第１図の動作波形図である。 １ａ，１ｂはクランプ回路、２ａ，２ｂは結合
コンデンサ、３ａ，４ａ，３ｂ，４ｂはクランプ
電圧設定用抵抗、５ａ，５ｂはピーククランプ用
ダイオード、１３ａ，１３ｂはバツフア増幅用ト
ランジスタ、１９は同期分離用ＩＣである。
Claims (1)
- テレビ受信機等において、映像信号を第１のバ
ツフア増幅回路と第２のバツフア増幅回路とに接
続し、同第１と第２のバツフア増幅回路出力とを
それぞれ結合コンデンサを介して電源電圧の抵抗
分割電圧をクランプ電圧とする第１のピーククラ
ンプ回路と第２のピーククランプ回路とに接続し
、同第１と第２のピーククランプ回路出力をそれ
ぞれ高利得、高入力インピーダンスの第１の増幅
回路と第２の増幅回路とに接続し、同第１と第２
の増幅回路出力とをそれぞれフイルタを通して同
期信号分離用ＩＣの水平同期信号用入力端子と垂
直同期信号用入力端子とに分離接続してなる低域
ひずみ（垂直周期のサグ）映像信号の補正と水平
及び垂直同期信号の分離特性との改善を特徴とす
る同期分離回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5399390U JPH0412764U (ja) | 1990-05-23 | 1990-05-23 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5399390U JPH0412764U (ja) | 1990-05-23 | 1990-05-23 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0412764U true JPH0412764U (ja) | 1992-01-31 |
Family
ID=31575662
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5399390U Pending JPH0412764U (ja) | 1990-05-23 | 1990-05-23 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0412764U (ja) |
-
1990
- 1990-05-23 JP JP5399390U patent/JPH0412764U/ja active Pending
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