JPH04140182A - プリンタ装置 - Google Patents
プリンタ装置Info
- Publication number
- JPH04140182A JPH04140182A JP26201390A JP26201390A JPH04140182A JP H04140182 A JPH04140182 A JP H04140182A JP 26201390 A JP26201390 A JP 26201390A JP 26201390 A JP26201390 A JP 26201390A JP H04140182 A JPH04140182 A JP H04140182A
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- JP
- Japan
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- data
- fifo
- signal
- turned
- host computer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000012545 processing Methods 0.000 abstract description 15
- 230000005540 biological transmission Effects 0.000 abstract description 11
- 238000007639 printing Methods 0.000 abstract description 6
- 238000004891 communication Methods 0.000 abstract description 5
- 238000011161 development Methods 0.000 abstract description 3
- 238000000034 method Methods 0.000 description 9
- 238000010586 diagram Methods 0.000 description 3
- 238000007599 discharging Methods 0.000 description 3
- 230000008676 import Effects 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 1
- 230000003247 decreasing effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- 238000012544 monitoring process Methods 0.000 description 1
- 239000002699 waste material Substances 0.000 description 1
Landscapes
- Accessory Devices And Overall Control Thereof (AREA)
- Record Information Processing For Printing (AREA)
- Image Input (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（イ）産業上の利用分野
本発明はプリンタ装置にかかり、上位装置であるホスト
コンピュータから送られて来る印刷データを１ページ毎
にページメモリ上にビットマツプ展開した後、そのイメ
ージデータをエンジン側へビデオ信号として送出し、そ
の信号に応じて用紙上にラスクスキャンすることによっ
て印刷する、いわゆるページプリンタに関するものであ
る。
コンピュータから送られて来る印刷データを１ページ毎
にページメモリ上にビットマツプ展開した後、そのイメ
ージデータをエンジン側へビデオ信号として送出し、そ
の信号に応じて用紙上にラスクスキャンすることによっ
て印刷する、いわゆるページプリンタに関するものであ
る。
（ロ）従来の技術
第２図に示したような従来のプリンタ装置に於いては、
上位装置であるホストコンピュータから送られて来る印
刷データは、まず８２５５などの専用ＩＣによって構成
されるインタフェース（１１）に入力され、データが着
信する度にマイクロプロセッサなどからなるＣＰＵ（１
２）に割り込み（２０）を掛けて、そのＩＣより読み取
ったデータをシステムランダムアクセスメモリ（以下、
ＲＡＭという、 ） （１３）内のコードバッファに格
納するという方式で取り込んでいた。
上位装置であるホストコンピュータから送られて来る印
刷データは、まず８２５５などの専用ＩＣによって構成
されるインタフェース（１１）に入力され、データが着
信する度にマイクロプロセッサなどからなるＣＰＵ（１
２）に割り込み（２０）を掛けて、そのＩＣより読み取
ったデータをシステムランダムアクセスメモリ（以下、
ＲＡＭという、 ） （１３）内のコードバッファに格
納するという方式で取り込んでいた。
尚、（１７）はビデオインターフェース、（１８）はプ
リンタエンジンである。
リンタエンジンである。
しかし、この方式ではデータが来る度に割り込みが掛か
るため、そのオーバーヘッドが大きくなり、まｊｓｃＰ
Ｕがビットマツプデータの吐き出し作業やエンジン側の
制御などの優先順位の高い処理を行なっている時はホス
ト側からの送出が待たされることになり、印刷データの
通信方式としては効率の悪いものとなっていた。
るため、そのオーバーヘッドが大きくなり、まｊｓｃＰ
Ｕがビットマツプデータの吐き出し作業やエンジン側の
制御などの優先順位の高い処理を行なっている時はホス
ト側からの送出が待たされることになり、印刷データの
通信方式としては効率の悪いものとなっていた。
この点を改善したものとして、印刷データが制御コード
かイメージデータかを判断して、イメージデータの時は
ある所定数のデータを連続してハードウェアで取り込む
方式も提案されている（特開平２−２９３７５に詳しい
）。
かイメージデータかを判断して、イメージデータの時は
ある所定数のデータを連続してハードウェアで取り込む
方式も提案されている（特開平２−２９３７５に詳しい
）。
（ハ）発明が解決しようとする課題
ところが一般的には、印刷データとしてアスキー（ＡＳ
Ｃ） ＩＩコードが送信されて来るケースが最も多く、
その場合制御コードの後に来るＡＳＣｎコードの数は指
定されないことがほとんどである。そのため、この方式
では制御コードの後に来るデータ数が指定されるケース
、例えば階調データで送られて来るようなケースに限ら
れるため、あまり汎用性のあるものとは言えない。
Ｃ） ＩＩコードが送信されて来るケースが最も多く、
その場合制御コードの後に来るＡＳＣｎコードの数は指
定されないことがほとんどである。そのため、この方式
では制御コードの後に来るデータ数が指定されるケース
、例えば階調データで送られて来るようなケースに限ら
れるため、あまり汎用性のあるものとは言えない。
本発明はこのような従来例に見られる問題点に鑑みてな
されたもので、効率の良い印刷装置を提供することをそ
の課題とする。
されたもので、効率の良い印刷装置を提供することをそ
の課題とする。
（ニ）ＨＩＭを解決するための手段
本発明は、上位装置から送られて来る画像データを入力
するＦＩＦＯメモリと、そのＦＩＦＯメモリ内にデータ
が格納されている状態をＣＰＵに伝達する手段と、その
状態によって上位装置へのコントロール信号を制御する
手段とからなる上位装置とのインタフェースを有するこ
とを特徴とする。 （ホ）作用 本発明は、ホストからの印刷データを逐次ＦＩＦＤメモ
リへと入力し、ＣＰＵがエンプティフラグによってＦＩ
ＦＯ内のデータの存在を確認しながら、そのデータをＦ
ＩＦＯから読み出してコードバッファへと格納して行く
、そして、ＦＩＦＯメモリがフルになった時には、ビジ
ィ信号をＯＮさせてホストからのデータ送信を一旦優止
させると同時に割り込みを掛けてＣＰＵにその旨を知ら
せる。さらにＣＰＵがＦＩＦＯからデータを読み取るこ
とによって空白ができれば、今度はビジィ信号をＯＦＦ
して再びホストがデータ送信可能な状態にする。
するＦＩＦＯメモリと、そのＦＩＦＯメモリ内にデータ
が格納されている状態をＣＰＵに伝達する手段と、その
状態によって上位装置へのコントロール信号を制御する
手段とからなる上位装置とのインタフェースを有するこ
とを特徴とする。 （ホ）作用 本発明は、ホストからの印刷データを逐次ＦＩＦＤメモ
リへと入力し、ＣＰＵがエンプティフラグによってＦＩ
ＦＯ内のデータの存在を確認しながら、そのデータをＦ
ＩＦＯから読み出してコードバッファへと格納して行く
、そして、ＦＩＦＯメモリがフルになった時には、ビジ
ィ信号をＯＮさせてホストからのデータ送信を一旦優止
させると同時に割り込みを掛けてＣＰＵにその旨を知ら
せる。さらにＣＰＵがＦＩＦＯからデータを読み取るこ
とによって空白ができれば、今度はビジィ信号をＯＦＦ
して再びホストがデータ送信可能な状態にする。
而して、印刷データの取り込みよりも優先度の高い、例
えばビットマツプデータの吐き出し作業やエンジン制御
などの処理が発生した時には、必ずホストからのデータ
送信を停止させて、その処理が完了するまで待たせると
いった従来の欠点が無くなり、また優先すべき処理がな
い時はＣＰＵはＦＩＦＯ内に溜ったデータを連続してコ
ードバッファに格納することが出来るため、印刷データ
受信の際の割り込み処理のオーバーヘッドも軽減でき、
効率の良いデータ通信を行なうことが可能になった。
えばビットマツプデータの吐き出し作業やエンジン制御
などの処理が発生した時には、必ずホストからのデータ
送信を停止させて、その処理が完了するまで待たせると
いった従来の欠点が無くなり、また優先すべき処理がな
い時はＣＰＵはＦＩＦＯ内に溜ったデータを連続してコ
ードバッファに格納することが出来るため、印刷データ
受信の際の割り込み処理のオーバーヘッドも軽減でき、
効率の良いデータ通信を行なうことが可能になった。
（へ）実施例
第１図は本発明の具体的実施例のうち、ホストインタフ
ェースの部分を中心とした構成図を示したものである。
ェースの部分を中心とした構成図を示したものである。
そのインタフェースはホストコンピュータから印刷デー
タを入力する、あるいは各コントロール信号を入出力す
るバッファ部（２２）、印刷データを５１２バイト入力
できるＦＩＦＯメモリ（２３）、各コントロール信号を
制御するコントロール部（２４）によって構成されてい
る。
タを入力する、あるいは各コントロール信号を入出力す
るバッファ部（２２）、印刷データを５１２バイト入力
できるＦＩＦＯメモリ（２３）、各コントロール信号を
制御するコントロール部（２４）によって構成されてい
る。
以下、第１図に沿ってこの実施例について説明する。
まず、電源投入直後しばらくはエンジン側はまだ印刷準
備期間中のため、ＣＰＵはホストへの出力制御信号（２
８）を印刷データ送信禁止の状態（ビジィ信号はＯＮ、
セレクト信号は０ＦＦ）にセットしている。これらの信
号のうち、コントロール部に於いてはセレクト信号はＣ
ＰＵからセットされるデータ（３２）をそのまま、ビジ
ィ信号はＦＩＦＯ内が満杯かどうかのフル信号（３１）
とＣＰＵがセットしたデータとのＯＲをそれぞれ出力す
るようになっている。そして、エンジン印刷可能な状態
になるとＣＰＵはビジィ用データをＯＦＦ Ｌ、さらに
ＦＩＦＯ内は空（エンプティ）となっていてフル信号は
ＯＦＦしているため、最終的なビジィ信号はＯＦＦにな
る。またセレクト信号はＣＰＵがコントロール部を経由
して直接ＯＮさせ、これによってホスト側がデータ送信
可能な状態となる。
備期間中のため、ＣＰＵはホストへの出力制御信号（２
８）を印刷データ送信禁止の状態（ビジィ信号はＯＮ、
セレクト信号は０ＦＦ）にセットしている。これらの信
号のうち、コントロール部に於いてはセレクト信号はＣ
ＰＵからセットされるデータ（３２）をそのまま、ビジ
ィ信号はＦＩＦＯ内が満杯かどうかのフル信号（３１）
とＣＰＵがセットしたデータとのＯＲをそれぞれ出力す
るようになっている。そして、エンジン印刷可能な状態
になるとＣＰＵはビジィ用データをＯＦＦ Ｌ、さらに
ＦＩＦＯ内は空（エンプティ）となっていてフル信号は
ＯＦＦしているため、最終的なビジィ信号はＯＦＦにな
る。またセレクト信号はＣＰＵがコントロール部を経由
して直接ＯＮさせ、これによってホスト側がデータ送信
可能な状態となる。
このような状態で印刷データが送られて来ると、ホスト
からのストローブ信号はそのままＦＩＦＯへの書き込み
パルス（２９）となってＦＩＦＯヘデータが入力され、
その結果エンプティフラグ（３０）はＯＦＦする。
からのストローブ信号はそのままＦＩＦＯへの書き込み
パルス（２９）となってＦＩＦＯヘデータが入力され、
その結果エンプティフラグ（３０）はＯＦＦする。
ＣＰＵは印刷データ入力よりも優先すべき処理がない時
（主に印刷データ待ち）は、このエンブティフラグを見
てデータが存在することを確認し、中に収まっているデ
ータを読み取ってシステムＲＡＭ内のフードバッファ領
域へ格納する。そして、ページメモリ上へビットマツプ
展開できるデータが生じると、例えばそのデータがＡＳ
ＣＩＩコードの場合それに対応したフォントデータをフ
ォントメモリより取り出してページメモリ上に描画する
。この描画処理に要する時間が短ければ、受信したデー
タを次々とＦＩＦＯを経由して取り込みながら、描画処
理して行くことが出来る。逆に、描画処理に時間がかか
る時はデータはＦＩＦＯへ溜って行くが、満杯になって
フル信号がＯＮＬない限りホストからのデータ送出は許
される。もし、その処理がある程度続くことによってＦ
ＩＦＯがフルになるとフル信号がＯＮＬ、コントロール
部（２４）はビジィ信号をＯＮさせてホストからのデー
タ送信を一時的にストップさせる。それと同時にＣＰＵ
にも割り込み（３４）が掛かり、ＣＰＵはこの割り込み
を受けて、ＦＩＦＯに溜った５１２バイトのデータを一
度に連続してコードバッファへ取り込む。従って、ＦＩ
ＦＯより１個でもデータが読み出されればフル信号はＯ
ＦＦされるため、今度はコントロール部はビジィ信号を
ＯＦＦ して再びホストのデータ送信を可能にする。
（主に印刷データ待ち）は、このエンブティフラグを見
てデータが存在することを確認し、中に収まっているデ
ータを読み取ってシステムＲＡＭ内のフードバッファ領
域へ格納する。そして、ページメモリ上へビットマツプ
展開できるデータが生じると、例えばそのデータがＡＳ
ＣＩＩコードの場合それに対応したフォントデータをフ
ォントメモリより取り出してページメモリ上に描画する
。この描画処理に要する時間が短ければ、受信したデー
タを次々とＦＩＦＯを経由して取り込みながら、描画処
理して行くことが出来る。逆に、描画処理に時間がかか
る時はデータはＦＩＦＯへ溜って行くが、満杯になって
フル信号がＯＮＬない限りホストからのデータ送出は許
される。もし、その処理がある程度続くことによってＦ
ＩＦＯがフルになるとフル信号がＯＮＬ、コントロール
部（２４）はビジィ信号をＯＮさせてホストからのデー
タ送信を一時的にストップさせる。それと同時にＣＰＵ
にも割り込み（３４）が掛かり、ＣＰＵはこの割り込み
を受けて、ＦＩＦＯに溜った５１２バイトのデータを一
度に連続してコードバッファへ取り込む。従って、ＦＩ
ＦＯより１個でもデータが読み出されればフル信号はＯ
ＦＦされるため、今度はコントロール部はビジィ信号を
ＯＦＦ して再びホストのデータ送信を可能にする。
上述したように、印刷データを受信して行くことによっ
て、１ペ一ジ分のビットマツプデータの作成が完了すれ
ば、印字動作へと移行すべくエンジン側をスタートさせ
、ビットマツプデータの吐き出しを開始する。この時Ｆ
ＩＦＯがフルでなければ依然ホストからのデータ受信は
可能な状態となっている。つまり、エンジンスタート後
はビットマツプデータの吐き出しやエンジン制御などの
優先度の高い割り込み処理が度々発生するが、コントロ
ール部がＦＩＦＯのフル信号を監視しながら自動的にデ
ータをＦＩＦＯへと取り込むように制御するわけである
。
て、１ペ一ジ分のビットマツプデータの作成が完了すれ
ば、印字動作へと移行すべくエンジン側をスタートさせ
、ビットマツプデータの吐き出しを開始する。この時Ｆ
ＩＦＯがフルでなければ依然ホストからのデータ受信は
可能な状態となっている。つまり、エンジンスタート後
はビットマツプデータの吐き出しやエンジン制御などの
優先度の高い割り込み処理が度々発生するが、コントロ
ール部がＦＩＦＯのフル信号を監視しながら自動的にデ
ータをＦＩＦＯへと取り込むように制御するわけである
。
このようにコントロール部は、ＦＩＦＯの状態によって
ビジィ信号の制御を行なっているが、既に述べたように
ＣＰＵからのデータ入力によっても制御できるようにな
っており、例えば用紙切れやジャムなどのエンジン側の
各種状況に応じて、ＣＰＬＩがコントロール部にデータ
をセットすることによってビジィ信号、そしてさらには
ペーパーエンドやセレクト信号などの各コントロール信
号の制御も行なうことが可能になっている。
ビジィ信号の制御を行なっているが、既に述べたように
ＣＰＵからのデータ入力によっても制御できるようにな
っており、例えば用紙切れやジャムなどのエンジン側の
各種状況に応じて、ＣＰＬＩがコントロール部にデータ
をセットすることによってビジィ信号、そしてさらには
ペーパーエンドやセレクト信号などの各コントロール信
号の制御も行なうことが可能になっている。
本実施例では、データの取り込み、ページメモリ上への
ビットマツプ展開、ビットマツプデータの吐き出し作業
、エンジン側の制御等の全ての処理を１つのＣＰＵが受
は持っているが、描画専用のＩＣを搭載してそれにビッ
トマツプ展開やビットマツプデータの吐き出し処理など
を任せれば、さらに効率の良いシステムが構築できるこ
とは熱論である。
ビットマツプ展開、ビットマツプデータの吐き出し作業
、エンジン側の制御等の全ての処理を１つのＣＰＵが受
は持っているが、描画専用のＩＣを搭載してそれにビッ
トマツプ展開やビットマツプデータの吐き出し処理など
を任せれば、さらに効率の良いシステムが構築できるこ
とは熱論である。
また、ここではＦＩＦＯメモリの容量を５１２バイトと
していたが、この容量はホスト側の送信スピードやプリ
ンタ側の処理能力に応じて増減させれば良い。例えばホ
ストの送信スピードに比してプリンタ側の処理能力に十
分余裕がある時は容量を減らせば良い。さらにこの場合
エンプティフラグがＯＦＦ した時に割り込み（３３）
がかかるようにして置けば、データが着信する度に割り
込みのかかる従来と同じ方式を取ることも可能である。
していたが、この容量はホスト側の送信スピードやプリ
ンタ側の処理能力に応じて増減させれば良い。例えばホ
ストの送信スピードに比してプリンタ側の処理能力に十
分余裕がある時は容量を減らせば良い。さらにこの場合
エンプティフラグがＯＦＦ した時に割り込み（３３）
がかかるようにして置けば、データが着信する度に割り
込みのかかる従来と同じ方式を取ることも可能である。
そして、エンジン制御などの優先すべき割り込み処理が
頻繁に生じるようなケースには、容量を大きく設定して
置けばホスト側を待たせる率も減ることになる。
頻繁に生じるようなケースには、容量を大きく設定して
置けばホスト側を待たせる率も減ることになる。
さらに、印刷データの種類に応じて容量の設定を行なっ
ても良い。先に述べたようなＡＳＣＩ［コードの場合は
描画時間が比較的短くて済むが、印刷データがビットイ
メージの時は描画処理の時間が長い。従ってこの場合Ｆ
ＩＦＯの容量を大きめに設定して置けば効率の良いデー
タ通信を行なうことが可能となる。
ても良い。先に述べたようなＡＳＣＩ［コードの場合は
描画時間が比較的短くて済むが、印刷データがビットイ
メージの時は描画処理の時間が長い。従ってこの場合Ｆ
ＩＦＯの容量を大きめに設定して置けば効率の良いデー
タ通信を行なうことが可能となる。
（ト）発明の効果
以上述べたように本発明によれば、ホストインタフェー
スにＦＩＦＯメモリを採用して、印刷データ受信時のオ
ーバーヘッドを減らし、且つプリンタ側の処理のための
ホスト側のデータ送信を待たせるといったような無駄を
無くすことによって、効率の良い通信方式を構築するこ
とが可能となった。
スにＦＩＦＯメモリを採用して、印刷データ受信時のオ
ーバーヘッドを減らし、且つプリンタ側の処理のための
ホスト側のデータ送信を待たせるといったような無駄を
無くすことによって、効率の良い通信方式を構築するこ
とが可能となった。
第１１５Ｕは本発明の実施例のインタフェース部の構成
図、第２図は従来例の構成図である。 ２５、システムバス、２ｏ；割り込み信号、２２・バッ
ファ部、２３；ＦＩＦＯメモリ、２４：コントロール部
、２６；受信データ、２７；入力制御信号、２８；出力
制御信号、２９；ストローブ信号（ライトパルス）、３
０：エンプティフラグ信号、 ３１；フルフラグ信号、 ３２・コントロール部への入力データ、３３；エンプテ
ィフラグによる割り込み信号、３４；フルフラグによる
割り込み信号。 第２ 図
図、第２図は従来例の構成図である。 ２５、システムバス、２ｏ；割り込み信号、２２・バッ
ファ部、２３；ＦＩＦＯメモリ、２４：コントロール部
、２６；受信データ、２７；入力制御信号、２８；出力
制御信号、２９；ストローブ信号（ライトパルス）、３
０：エンプティフラグ信号、 ３１；フルフラグ信号、 ３２・コントロール部への入力データ、３３；エンプテ
ィフラグによる割り込み信号、３４；フルフラグによる
割り込み信号。 第２ 図
Claims (1)
- （１）上位装置から送られて来る画像データを入力する
ＦＩＦＯメモリと、そのＦＩＦＯメモリ内にデータが格
納されている状態をＣＰＵに伝達する手段と、その状態
によって上位装置へのコントロール信号を制御する手段
とからなる上位装置とのインタフェースを有することを
特徴とするプリンタ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26201390A JPH04140182A (ja) | 1990-09-30 | 1990-09-30 | プリンタ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26201390A JPH04140182A (ja) | 1990-09-30 | 1990-09-30 | プリンタ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04140182A true JPH04140182A (ja) | 1992-05-14 |
Family
ID=17369811
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP26201390A Pending JPH04140182A (ja) | 1990-09-30 | 1990-09-30 | プリンタ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04140182A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012161097A (ja) * | 2000-01-21 | 2012-08-23 | Harusaki Technologies Llc | 画像形成アレイ用ホストインタフェース |
-
1990
- 1990-09-30 JP JP26201390A patent/JPH04140182A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012161097A (ja) * | 2000-01-21 | 2012-08-23 | Harusaki Technologies Llc | 画像形成アレイ用ホストインタフェース |
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