JPH04152437A - Ｃｐｕ暴走検出回路 - Google Patents
Ｃｐｕ暴走検出回路Info
- Publication number
- JPH04152437A JPH04152437A JP2278071A JP27807190A JPH04152437A JP H04152437 A JPH04152437 A JP H04152437A JP 2278071 A JP2278071 A JP 2278071A JP 27807190 A JP27807190 A JP 27807190A JP H04152437 A JPH04152437 A JP H04152437A
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- JP
- Japan
- Prior art keywords
- cpu
- timer
- circuit
- reset
- signal
- Prior art date
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- Pending
Links
- 238000001514 detection method Methods 0.000 claims description 9
- 239000003990 capacitor Substances 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 5
- 239000013256 coordination polymer Substances 0.000 description 4
- 238000011144 upstream manufacturing Methods 0.000 description 1
Landscapes
- Debugging And Monitoring (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はマイクロプロセッサ（ＭＰＵ＞を含むＣＰＵ
（中央処理装置１Ｆ）の暴走検出回路に間する。
（中央処理装置１Ｆ）の暴走検出回路に間する。
一般にＣＰＵの暴走は、外来雑音等の要因で本来のプロ
グラムが誤った解釈のもとで実行されることにより正常
な動作が不可能となってしまうので、早急に復旧する必
要がある。
グラムが誤った解釈のもとで実行されることにより正常
な動作が不可能となってしまうので、早急に復旧する必
要がある。
従来、この種の暴走検出回路は、リセット後−定時間経
過時にＣＰＵリセット信号を発生するタイマー回路に対
して、ＣＰＵのＩ１０端子からタイマーリセット信号を
入力して、ＣＰＵリセット信号を止めておき、タイマー
リセット信号が出なくなった場合をＣＰＵ暴走状態と判
断して、タイマー回路からＣＰしリセット信号を出力し
ていた。
過時にＣＰＵリセット信号を発生するタイマー回路に対
して、ＣＰＵのＩ１０端子からタイマーリセット信号を
入力して、ＣＰＵリセット信号を止めておき、タイマー
リセット信号が出なくなった場合をＣＰＵ暴走状態と判
断して、タイマー回路からＣＰしリセット信号を出力し
ていた。
第３図は従来の暴走検出回路を示し、タイマーリセット
入力端子２．クロック入力端子３及びＣＰＵリセット出
力端子４を有するタイマー回路１からなる０本図の回路
は、第４図に示すように、タイマーリセット入力信号と
してのリセットバルスがなくなると、一定時間（τ）後
にＣＰＵリセット信号が出力される。
入力端子２．クロック入力端子３及びＣＰＵリセット出
力端子４を有するタイマー回路１からなる０本図の回路
は、第４図に示すように、タイマーリセット入力信号と
してのリセットバルスがなくなると、一定時間（τ）後
にＣＰＵリセット信号が出力される。
上述した従来のＣＰＵ暴走検出回路は、ＣＰＵのＩ１０
端子とタイマーリセット入力端子が直結されているため
、ＣＰＵの■／○端子から、第４図に示すような、タイ
マーリセットパルスが出力されなくなる暴走状態の場合
は、正常に機能し暴走状態検出可能である。しかし、Ｃ
ＰＵのＩ１０端子出力信号が第５図に示すようなタイマ
ーリセット条件の出力レベルで固定される暴走状態の場
合、タイマー回路が停止してしまい、ＣＰＵリセット信
号が出力されないことにより暴走状態が検出不可能とい
う欠点がある。
端子とタイマーリセット入力端子が直結されているため
、ＣＰＵの■／○端子から、第４図に示すような、タイ
マーリセットパルスが出力されなくなる暴走状態の場合
は、正常に機能し暴走状態検出可能である。しかし、Ｃ
ＰＵのＩ１０端子出力信号が第５図に示すようなタイマ
ーリセット条件の出力レベルで固定される暴走状態の場
合、タイマー回路が停止してしまい、ＣＰＵリセット信
号が出力されないことにより暴走状態が検出不可能とい
う欠点がある。
本発明のＣＰＵ暴走検出回路は、ＣＰＵからのタイマー
リセット信号が所定時間以上消滅した場合にＣＰしリセ
ット信号を発生するＣＰＵ暴走検出回路において、タイ
マーリセット信号入力部にコンデンサと抵抗とから成る
微分回路を備えている。
リセット信号が所定時間以上消滅した場合にＣＰしリセ
ット信号を発生するＣＰＵ暴走検出回路において、タイ
マーリセット信号入力部にコンデンサと抵抗とから成る
微分回路を備えている。
また、上記構成において、前記微分回路が、前記タイマ
ーリセット信号入力部への負電圧の印加を防止するダイ
オードを含んでいる構成とすることができる。
ーリセット信号入力部への負電圧の印加を防止するダイ
オードを含んでいる構成とすることができる。
次に、本発明について図面を参照して説明する。
第１図（ａ＞は本発明の一実施例を示すブロック図であ
る。従来と同様の、タイマーリセット入力端子２．クロ
ック入力端子３及びＣＰしリセット出力端子４を有する
タイマー回路１と、このタイマーリセット入力端子２の
前段に接続された微分回路６及び微分回路大力端子５を
有している。
る。従来と同様の、タイマーリセット入力端子２．クロ
ック入力端子３及びＣＰしリセット出力端子４を有する
タイマー回路１と、このタイマーリセット入力端子２の
前段に接続された微分回路６及び微分回路大力端子５を
有している。
この微分回路６は、コンデンサ６ａと、抵抗６ｂと、タ
イマーリセット入力端子６に負電圧を印加させないため
のタイマー回路の保護を目的とするダイオード６ｃとに
より構成されている。
イマーリセット入力端子６に負電圧を印加させないため
のタイマー回路の保護を目的とするダイオード６ｃとに
より構成されている。
次に、動作を説明する。
第４図に示したようなタイマーリセット入力端子信号が
、微分回路入力端子５に加えられた場合には、第４図に
示したＣＰＵリセット信号が同様に出力される。
、微分回路入力端子５に加えられた場合には、第４図に
示したＣＰＵリセット信号が同様に出力される。
第５図に示したようなタイマーリセット入力端子信号が
微分回路入力端子５に加えられた場合、微分回路６によ
り信号が微分され、第２図に示すような波形のタイマー
リセット入力信号となり、タイマー回路１がリセット状
態を継続することなく、微分回路６の時定数で決まる一
定時間（Ｔ）経過後タイマー動作を開始することが可能
となるので、一定時間（τ）後にＣＰしリセット信号を
出力することができる。
微分回路入力端子５に加えられた場合、微分回路６によ
り信号が微分され、第２図に示すような波形のタイマー
リセット入力信号となり、タイマー回路１がリセット状
態を継続することなく、微分回路６の時定数で決まる一
定時間（Ｔ）経過後タイマー動作を開始することが可能
となるので、一定時間（τ）後にＣＰしリセット信号を
出力することができる。
なお、微分回路６としては第１図（ｂ）に示す回路でも
同じ作用を有する。
同じ作用を有する。
以上説明したように本発明は、タイマーリセット入力端
子の前段に微分回路を追加することにより、ＣＰＵから
のタイマリセットの信号レベルがタイマーリセット条件
に固定されるＣＰＵの暴走状態を検出することが可能に
なり、ＣＰＵリセット信号を出力できるため、暴走状態
のいかんによらずＣＰＵをリセットできる。
子の前段に微分回路を追加することにより、ＣＰＵから
のタイマリセットの信号レベルがタイマーリセット条件
に固定されるＣＰＵの暴走状態を検出することが可能に
なり、ＣＰＵリセット信号を出力できるため、暴走状態
のいかんによらずＣＰＵをリセットできる。
第１図（ａ）は本発明の一実施例を示すブロック図、第
１図（ｂ）は第１図（ａ）の微分回路の他の構成例を示
す回路図、第２図は第１図の実施例における各部信号波
形の説明図、第３図は従来例のブロック図、第４図及び
第５図は従来例における各部信号波形の説明図である。 １・・・タイマー回路、２・・・タイマーリセット入力
端子、３・・クロック入力端子、４・・・ＣＰＵリセッ
ト出力端子、５・・微分回路入力端子、６・・・微分回
路。
１図（ｂ）は第１図（ａ）の微分回路の他の構成例を示
す回路図、第２図は第１図の実施例における各部信号波
形の説明図、第３図は従来例のブロック図、第４図及び
第５図は従来例における各部信号波形の説明図である。 １・・・タイマー回路、２・・・タイマーリセット入力
端子、３・・クロック入力端子、４・・・ＣＰＵリセッ
ト出力端子、５・・微分回路入力端子、６・・・微分回
路。
Claims (1)
- 【特許請求の範囲】 １、ＣＰＵからのタイマーリセット信号が所定時間以上
消滅した場合にＣＰＵリセット信号を発生するＣＰＵ暴
走検出回路において、タイマーリセット信号入力部にコ
ンデンサと抵抗とから成る微分回路を備えていることを
特徴とするＣＰＵ暴走検出回路。 ２、前記微分回路が、前記タイマーリセット信号入力部
への負電圧の印加を防止するダイオードを含んでいるこ
とを特徴とする請求項１記載のＣＰＵ暴走検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2278071A JPH04152437A (ja) | 1990-10-17 | 1990-10-17 | Ｃｐｕ暴走検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2278071A JPH04152437A (ja) | 1990-10-17 | 1990-10-17 | Ｃｐｕ暴走検出回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04152437A true JPH04152437A (ja) | 1992-05-26 |
Family
ID=17592244
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2278071A Pending JPH04152437A (ja) | 1990-10-17 | 1990-10-17 | Ｃｐｕ暴走検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04152437A (ja) |
-
1990
- 1990-10-17 JP JP2278071A patent/JPH04152437A/ja active Pending
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