JPH04162811A - Power amplifier and its control method - Google Patents

Power amplifier and its control method

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Publication number
JPH04162811A
JPH04162811A JP2290260A JP29026090A JPH04162811A JP H04162811 A JPH04162811 A JP H04162811A JP 2290260 A JP2290260 A JP 2290260A JP 29026090 A JP29026090 A JP 29026090A JP H04162811 A JPH04162811 A JP H04162811A
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JP
Japan
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transistor
base
output
voltage
power amplifier
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Pending
Application number
JP2290260A
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Japanese (ja)
Inventor
Shinji Oda
伸二 小田
Akifumi Shimizu
昌文 清水
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Renesas Semiconductor Manufacturing Co Ltd
Kansai Nippon Electric Co Ltd
Original Assignee
Renesas Semiconductor Manufacturing Co Ltd
Kansai Nippon Electric Co Ltd
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Publication date
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Abstract

PURPOSE:To raise the output stably without malfunction by floating the base of a transistor (TR) being a component of an inverting circuit, and grounding the emitter via a resistor. CONSTITUTION:A resistor R3 is inserted between the emitter of a TR Q1 and GND. In such a case, since a filter voltage 7 is lower than a Vref6 just after application of power, a current I1 flows and currents I2, I3 flow much more than a steady-state value and the base of a TR Q2 rises more than that in the steady-state. Since a current I4 flows to the base of the TR Q1 in such a case, the TR Q1 acts like decreasing the base voltage of a TR 9. In such a case, since the voltage drop of the resistor R3 is in existence, the base of the TR Q9 is decided freely depending on the resistance of the resistor R3 and when the filter voltage 7 rises and a comparator 1 is switched, a time t1 when the base voltage of the TR Q2 drops is earlier than the rise in the base voltage of the TR Q9. Thus, the output rises stably without malfunction.

Description

【発明の詳細な説明】 庄  +71u11肚 この発明はパワーアンプおよびその制御方法に関シ、特
に電源投入後の出力電圧立ち上がりの安定化に、関する
DETAILED DESCRIPTION OF THE INVENTION This invention relates to a power amplifier and its control method, and particularly to stabilizing the rise of output voltage after power is turned on.

従】!」幻1 従来、この種のパワーアンプは、第4図に示すように、
コンパレータ(1)9反転回路■、差動アンプ■、出力
段(4)およびバイアス回路■で構成されており、出力
段(至)は8級プッシュプルで構成されており、パワー
トランジスタQ5 、QEiはNPNTrである。この
ような回路構成では、通常、電源投入後、出力電圧v0
は0.1V程度からvo。の中点まで上昇してその後、
中点電位を維持する。以下、この回路の動作を説明する
Follow】! ”Illusion 1 Conventionally, this type of power amplifier has the following characteristics, as shown in Figure 4.
It consists of a comparator (1) 9-inverting circuit ■, a differential amplifier ■, an output stage (4), and a bias circuit ■. is NPNTr. In such a circuit configuration, after the power is turned on, the output voltage v0
is from about 0.1V to vo. rises to the midpoint of and then
Maintain midpoint potential. The operation of this circuit will be explained below.

電源投入直後は、コンパレータ(1)のV□、■よりフ
ィルタ電圧■が低いため、電流11が流れており、その
結果、差動アンプ3にI2およびI3の電流値が定常時
より多く流れ、その結果トランジスタQ2のベース電位
は、第5図(a)のように定常時より上昇している。さ
らに、コンパレータ(1)に11の電流が流れていると
きは、反転回路■のトランジスタQ1が飽和しているの
で、バイアス回路■のトランジスタQ9のベース電位は
、第5図(b)の ようにほぼGND電位である。その
結果、出力段(4)のトランジスタQ4にはベース電流
が流れないため、トランジスタQ5のエミッタ電位(出
力電圧VO)は、第5図(C)のようにほぼGND電位
である。この場合、トランジスタQ6は、飽和状態にな
っている。
Immediately after the power is turned on, the filter voltage ■ is lower than the V□, ■ of the comparator (1), so the current 11 is flowing, and as a result, the current values of I2 and I3 are larger than in the steady state flowing through the differential amplifier 3. As a result, the base potential of the transistor Q2 is higher than the normal state as shown in FIG. 5(a). Furthermore, when a current of 11 is flowing through the comparator (1), the transistor Q1 of the inverting circuit (■) is saturated, so the base potential of the transistor Q9 of the bias circuit (■) is as shown in Figure 5 (b). It is approximately at GND potential. As a result, since no base current flows through the transistor Q4 of the output stage (4), the emitter potential (output voltage VO) of the transistor Q5 is approximately the GND potential as shown in FIG. 5(C). In this case, transistor Q6 is in a saturated state.

次に、フィルタ電圧■が上昇してコンパレータ(1)が
切換わると、まず、反転回路■のトランジスタQ1の飽
和が解除されるので、バイアス回路■のトランジスタQ
9のベース電位は、第5図(b)のように時刻t2で上
昇する。次に、電流I、が減少するため、差動アンプ■
の電流12,1.が減少して、トランジスタQ2のベー
ス電位が、第5図(a)のように時刻t1で低下する。
Next, when the filter voltage ■ rises and the comparator (1) switches, the saturation of the transistor Q1 of the inverting circuit ■ is released, so the transistor Q of the bias circuit ■
9 rises at time t2 as shown in FIG. 5(b). Next, since the current I decreases, the differential amplifier ■
Current 12,1. decreases, and the base potential of transistor Q2 drops at time t1 as shown in FIG. 5(a).

その結果、時刻t1でトランジスタQ4にベース電流が
流れて、トランジスタQ5が動作し、第5図(C)のよ
うに時刻t1で出力電圧vo (8)が立ち上がる。
As a result, the base current flows through the transistor Q4 at time t1, the transistor Q5 operates, and the output voltage vo (8) rises at time t1 as shown in FIG. 5(C).

日の   。of the day.

ところで、上記の従来のパワーアンプの制御方法では、
パワートランジスタQBが飽和状態から活性領域に移行
するとき、パワートランジスタQ5が急激に動作するの
で、瞬間的に大電流がパワートランジスタQ5.Q6に
流れるため、発振しやすい。
By the way, in the conventional power amplifier control method described above,
When power transistor QB transitions from the saturated state to the active region, power transistor Q5 operates rapidly, so that a large current momentarily flows through power transistor Q5. Since it flows to Q6, it is easy to oscillate.

従って、天絡あるいは地絡の保護回路を同一チップに内
蔵した場合は、上記の発振によってこれらの保護回路が
誤動作して、出力電圧V。が立ち上がらないという欠点
があった。
Therefore, if protection circuits for power supply faults or ground faults are built into the same chip, these protection circuits will malfunction due to the above oscillation, causing the output voltage to drop. The problem was that it did not stand up.

そこで、この発明は、パワートランジスタQ5゜QBの
切り換わり時に、両トランジスタQ5 、QGが同時に
動作状態にならないパワートランジスタおよびその制御
方法を提供することを目的とする。
SUMMARY OF THE INVENTION It is therefore an object of the present invention to provide a power transistor and a method for controlling the same, in which both transistors Q5 and QG do not go into operation at the same time when power transistors Q5 and QB are switched.

、の この発明のパワーアンプは、特許請求の範囲1の基準電
圧とフィルタ電圧とを比較するコンパレータと、このコ
ンパレータの出力に応じて動作する反転回路およびバイ
アス回路と、前記反転回路の出力に応じて動作する差動
アンプと、この差動アンプおよび前記バイアス回路の出
力に応じて動作する出力段とを具備するパワーアンプに
おいて、 前記反転回路を構成するトランジスタのベースをフロー
ティングにするとともに、エミッタを抵抗を介して接地
して構成されている。
A power amplifier according to the present invention includes a comparator for comparing the reference voltage and the filter voltage according to claim 1, an inverting circuit and a bias circuit that operate according to the output of the comparator, and an inverting circuit and a bias circuit that operate according to the output of the inverting circuit. In the power amplifier, the base of the transistor constituting the inverting circuit is made floating, and the emitter is made floating. It is configured by grounding through a resistor.

この発明のパワーアンプは、また、特許請求の範囲2の
基準電圧とフィルタ電圧とを比較するコンパレータと、
このコンパレータの出力に応じて動作する反転回路およ
びバイアス回路と、前記反転回路の出力に応じて動作す
る差動アンプと、この差動アンプおよび前記バイアス回
路の出力に応じて動作する出力段とを具備するパワーア
ンプにおいて、 前記バイアス回路に電源電圧分圧手段を設け、その分圧
点を、基準電圧に応じて動作するトランジスタと並列接
続されたトランジスタのベースおよび反転回路を構成す
るトランジスタのコレクタに接続するとともに、反転回
路を構成するトランジスタのベースに、コレクタΦベー
スを短絡したトランジスタのベースを接続して構成され
ている。
The power amplifier of the present invention also includes a comparator that compares the reference voltage and the filter voltage according to claim 2;
An inverting circuit and a bias circuit that operate according to the output of the comparator, a differential amplifier that operates according to the output of the inverting circuit, and an output stage that operates according to the output of the differential amplifier and the bias circuit. In the power amplifier, a power supply voltage dividing means is provided in the bias circuit, and the voltage dividing point thereof is connected to the base of a transistor connected in parallel with a transistor that operates according to a reference voltage and the collector of a transistor constituting an inverting circuit. In addition, the base of a transistor whose collector Φ base is short-circuited is connected to the base of a transistor constituting an inverting circuit.

また、この発明のパワーアンプめ制御方法は波形の上下
をNPNトランジスタで出力するプッシュプル方式のパ
ワーアンプにおいて、上下のパワートランジスタを電流
制限した状態で出力電圧を立ち上げた後、上下のパワー
トランジスタの電流制限を解除することによって構成さ
れている。
In addition, in the power amplifier control method of the present invention, in a push-pull type power amplifier that outputs the upper and lower waves of the waveform using NPN transistors, the output voltage is raised with the upper and lower power transistors being current-limited, and then the upper and lower power transistors are is configured by removing the current limit.

1反 上記の構成によると、波形の上下をNPNトランジスタ
で出力するプッシュプル方式のパワーアンプにおいて、
出力電圧が立ち上がるときに上下のパワートランジスタ
の電流を制限することによって、瞬間的な発振を防止で
きるため、天絡あるいは地絡の保護回路が同一チップに
内蔵されていても、誤動作することなく、出力が安定に
立ち上がる。
According to the above configuration, in a push-pull power amplifier that outputs the upper and lower waves of the waveform using NPN transistors,
By limiting the current of the upper and lower power transistors when the output voltage rises, instantaneous oscillations can be prevented, so even if a power fault or ground fault protection circuit is built into the same chip, it will not malfunction. Output rises stably.

尖五阻 − 以下、この発明について図面を参照して説明する。Tsungoen - The present invention will be explained below with reference to the drawings.

第1図は、この発明の一実施例のパワーアンプの等価回
路図である。第4図の従来例とはトランジスタQlのベ
ース−GND間の抵抗R1を削除した点と、トランジス
タQlのエミッターGND間に抵抗R3を挿入した点が
異なっており、その他の回路は従来例と同一であるので
、同一箇所には同一符号を付している。
FIG. 1 is an equivalent circuit diagram of a power amplifier according to an embodiment of the present invention. The difference from the conventional example shown in Fig. 4 is that the resistor R1 between the base of the transistor Ql and GND is removed, and the resistor R3 is inserted between the emitter of the transistor Ql and GND, and the other circuits are the same as the conventional example. Therefore, the same parts are given the same reference numerals.

次に上記のトランジスタQlを含むコンパレータ(1)
の動作について説明する。
Next, a comparator (1) including the above transistor Ql
The operation will be explained.

電源投入直後は、フィルタ電圧■がVrer(6)より
低いため、電流!、が流れており、12およびI3の電
流値が定常値より多く流れ、その結果トランジスタQ2
のベース電位は、第2図(a)のように定常時より上昇
している。このとき、トランジスタQlのベースには電
流I4が流れているため、トランジスタQ9のベース電
圧を下げるように動作する。この場合、トランジスタQ
lのエミッターGND間には抵抗R3が挿入されている
ので、抵抗R3の電位降下分がある。その結果、トラン
ジスタQ3のベース電位は抵抗値R3の値で自由に決め
ることができ、トランジスタQ9のベース電位を0.9
 V程度に設定した場合は、第2図(b)のようになる
Immediately after the power is turned on, the filter voltage ■ is lower than Vrer (6), so the current! , is flowing, and the current value of 12 and I3 is larger than the steady value, and as a result, the transistor Q2
The base potential of , as shown in FIG. 2(a), has increased from the steady state. At this time, since current I4 is flowing through the base of transistor Ql, it operates to lower the base voltage of transistor Q9. In this case, transistor Q
Since the resistor R3 is inserted between the emitter GND of 1, there is a potential drop due to the resistor R3. As a result, the base potential of the transistor Q3 can be freely determined by the value of the resistance value R3, and the base potential of the transistor Q9 can be set to 0.9
When set to about V, the result is as shown in FIG. 2(b).

この場合、トランジスタQlのべ−x −G N D 
間に抵抗が入っていないため、フィルタ電圧■が上昇し
てコンパレータ(1)が切換わるとき、トランジスタQ
9のベース電圧上昇よりもトランジスタQ2のベース電
圧が降下する時刻t□の方が早い。よって、トランジス
タQ9のベース電位が定常時より下がった状態、つまり
トランジスタQ8の電流値が定常値より少ない状態で、
トランジスタQ2のベースが定常値になるため、パワー
トランジスタQ5 、QBの電流を制限した状態で出力
電圧V。I23)が第2図(C)の時刻t1で、発振す
ることなく安定に立ち上がる。
In this case, the voltage of the transistor Ql is
Since there is no resistance between the
The time t□ at which the base voltage of the transistor Q2 drops is earlier than the rise in the base voltage of the transistor Q9. Therefore, when the base potential of transistor Q9 is lower than the steady state, that is, when the current value of transistor Q8 is lower than the steady state,
Since the base of transistor Q2 is at a steady value, the output voltage V remains constant while the currents of power transistors Q5 and QB are limited. I23) stably rises without oscillation at time t1 in FIG. 2(C).

出力電圧V。(8)が安定に立ち上がった後、トランジ
スタQlが完全にオフし、トランジスタQ3のベースが
時刻t3で定常値になるので、出力に接続された負荷を
充分に駆動できるようにする。
Output voltage V. After (8) stably rises, the transistor Ql is completely turned off and the base of the transistor Q3 reaches a steady value at time t3, so that the load connected to the output can be sufficiently driven.

災胤叢2 第3図は、この発明の第2実施例について説明するパワ
ーアンプの等価回路図である。この実施例は、前記第1
の実施例の反転回路■のトランジスタQ13のコレクタ
を、トランジスタQ15 、Qlで構成されるカレント
ミラーに接続し、バイアス回路■のトランジスタQll
のエミッタとQIOベースとの接続点に、トランジスタ
Q14のエミッタを接続し、そのコレクタは接地し、ベ
ースとvo。との間に抵抗R4+ベースとGNDとの間
には抵抗R1sを接続シ、かつベースをトランジスタQ
1コレクタと接続した点を除いては第1の実施例と同様
であるため、同一部分には同一参照符号を付してその説
明を省略する。
Disaster 2 FIG. 3 is an equivalent circuit diagram of a power amplifier illustrating a second embodiment of the present invention. In this embodiment, the first
The collector of the transistor Q13 of the inverting circuit (2) of the embodiment is connected to a current mirror composed of transistors Q15 and Q1, and the collector of the transistor Q13 of the bias circuit (2) is
The emitter of transistor Q14 is connected to the connection point between the emitter of QIO and the base of QIO, its collector is grounded, and the base and QIO are connected. A resistor R1s is connected between the resistor R4 + base and GND, and the base is connected to the transistor Q.
Since this embodiment is the same as the first embodiment except that it is connected to the first collector, the same reference numerals are given to the same parts and the explanation thereof will be omitted.

この実施例では、電源投入直後のフィルタ電位■がV−
r(eより低いときは、電流I4が流れるためトランジ
スタQ14のベース電位がトランジスタQllのベース
電位より下がると、トランジスタQ14が動作してトラ
ンジスタQ14のエミッタ電位が下がる。
In this embodiment, the filter potential ■ immediately after the power is turned on is V-
When it is lower than r(e, current I4 flows, so when the base potential of transistor Q14 falls below the base potential of transistor Qll, transistor Q14 operates and the emitter potential of transistor Q14 falls.

つまり、トランジスタQ9のベース電位が下がっており
、この状態でフィルタ電位■が上昇してコンパレータ(
1)が切換わると、まず、トランジスタQ2のベース電
位が定常値になって、出力電圧V。(8)が立ち上がる
。次に、電流I4が減少して、トランジスタQ14がカ
ットオフしてトランジスタQ3のベース電位を定常値に
する。この場合、電源投入直後のトランジスタQBのベ
ース電位は、抵抗R4+R5で任意に調整できるので、
パワートランジスタQ5. QBが発振しないような値
を選ぶことができる。
In other words, the base potential of the transistor Q9 is falling, and in this state, the filter potential ■ rises and the comparator (
When 1) is switched, first, the base potential of transistor Q2 becomes a steady value, and the output voltage V. (8) stands up. Next, current I4 decreases, transistor Q14 is cut off, and the base potential of transistor Q3 becomes a steady value. In this case, the base potential of transistor QB immediately after power is turned on can be adjusted arbitrarily using resistors R4+R5, so
Power transistor Q5. It is possible to select a value that does not cause QB to oscillate.

発瀝じB九1 以上説明したように、この発明は、出力電圧が立ち上が
るときに上下のパワートランジスタの電流を制限するこ
とによって、瞬間的な発振を防止するようにしたことに
より、天絡あるいは地絡の保護回路が同一チップに内蔵
されていても、誤動作することなく、出力が安定に立ち
上がるという効果がある。
Oscillation B91 As explained above, the present invention prevents instantaneous oscillation by limiting the current of the upper and lower power transistors when the output voltage rises, thereby reducing the Even if a ground fault protection circuit is built into the same chip, there is no malfunction and the output is stable.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はこの発明の第1の実施例によるパワーアンプの
等価回路図、第2図(a)〜(c)は第1図の動作タイ
ミングをあられした電圧波形図である。 第3図はこの発明の第2の実施例によるパワーアンプの
等価回路図である。 第4図は従来のパワーアンプの等価回路図であり、第5
図は第4図の動作タイミングをあられした電圧波形図で
ある。 1・・・・・・コンパレータ、 2・・・・・・反転回路、 3・・・・・・差動アンプ、 4・・・・・・出力段、 5・・・・・・バイアス回路、 8・・・・・・Vrafz 7・・・・・・フィルタ電圧、 8・・・・・・出力電圧y。。 w4.1図 勘2図  tl ↓ 1訂″1″I tl  一時間 ↓ 一時間 →乃藺 113  図 114図
FIG. 1 is an equivalent circuit diagram of a power amplifier according to a first embodiment of the present invention, and FIGS. 2(a) to 2(c) are voltage waveform diagrams showing the operation timing of FIG. 1. FIG. 3 is an equivalent circuit diagram of a power amplifier according to a second embodiment of the invention. Figure 4 is an equivalent circuit diagram of a conventional power amplifier.
The figure is a voltage waveform diagram showing the operation timing of FIG. 4. 1... Comparator, 2... Inverting circuit, 3... Differential amplifier, 4... Output stage, 5... Bias circuit, 8...Vrafz 7...Filter voltage, 8...Output voltage y. . w4.1 Illustrated Kankan 2 tl ↓ 1st edition "1"I tl 1 hour ↓ 1 hour → Noi 113 Figure 114

Claims (1)

【特許請求の範囲】 1、基準電圧とフィルタ電圧とを比較するコンパレータ
と、このコンパレータの出力に応じて動作する反転回路
およびバイアス回路と、前記反転回路の出力に応じて動
作する差動アンプと、この差動アンプおよび前記バイア
ス回路の出力に応じて動作する出力段とを具備するパワ
ーアンプにおいて、 前記反転回路を構成するトランジスタのベースをフロー
ティングにするとともに、エミッタを抵抗を介して接地
したことを特徴とするパワーアンプ。 2、基準電圧とフィルタ電圧とを比較するコンパレータ
と、このコンパレータの出力に応じて動作する反転回路
およびバイアス回路と、前記反転回路の出力に応じて動
作する差動アンプと、この差動アンプおよび前記バイア
ス回路の出力に応じて動作する出力段とを具備するパワ
ーアンプにおいて、 前記バイアス回路に電源電圧分圧手段を設け、その分圧
点を、基準電圧に応じて動作するトランジスタと並列接
続されたトランジスタのベースおよび反転回路を構成す
るトランジスタのコレクタに接続するとともに、反転回
路を構成するトランジスタのベースに、コレクタ・ベー
スを短絡したトランジスタのベースを接続したことを特
徴とするパワーアンプ。 3、波形の上下をNPNトランジスタで出力するプッシ
ュプル方式のパワーアンプにおいて、 上下のパワートランジスタを電流制限した状態で出力電
圧を立ち上げた後、上下のパワートランジスタの電流制
限を解除することを特徴とするパワーアンプの制御方法
[Claims] 1. A comparator that compares a reference voltage and a filter voltage, an inverting circuit and a bias circuit that operate according to the output of the comparator, and a differential amplifier that operates according to the output of the inverting circuit. In this power amplifier, which includes a differential amplifier and an output stage that operates according to the output of the bias circuit, the base of the transistor constituting the inverting circuit is floating, and the emitter is grounded via a resistor. A power amplifier featuring 2. A comparator that compares a reference voltage and a filter voltage, an inverting circuit and a bias circuit that operate according to the output of this comparator, a differential amplifier that operates according to the output of the inverting circuit, and this differential amplifier and In a power amplifier comprising an output stage that operates according to the output of the bias circuit, the bias circuit is provided with a power supply voltage dividing means, and the voltage dividing point thereof is connected in parallel with a transistor that operates according to a reference voltage. A power amplifier characterized in that the base of a transistor whose collector and base are short-circuited is connected to the base of a transistor that constitutes an inverting circuit and the collector of a transistor that constitutes an inverting circuit. 3. In a push-pull power amplifier that outputs the upper and lower waveforms using NPN transistors, the feature is that the output voltage is raised with the upper and lower power transistors current limited, and then the current limit of the upper and lower power transistors is released. How to control a power amplifier.
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