JPH0424143U - - Google Patents
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- Publication number
- JPH0424143U JPH0424143U JP6245590U JP6245590U JPH0424143U JP H0424143 U JPH0424143 U JP H0424143U JP 6245590 U JP6245590 U JP 6245590U JP 6245590 U JP6245590 U JP 6245590U JP H0424143 U JPH0424143 U JP H0424143U
- Authority
- JP
- Japan
- Prior art keywords
- minimum
- maximum value
- circuit
- auction
- value
- Prior art date
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- Pending
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- Measurement Of Current Or Voltage (AREA)
Description
第１図及び第２図はこの考案の最小値及び最大
値競売回路の構成図、第３図及び第４図は従来の
最小値及び最大値競売回路の構成図である。図に
おいて、１１，１２は演算増幅器、２１，２２は
ダイオード、６１，６２は表示器、７１は定電流
源、８１，８２はＰＮＰトランジスタ、８３，８
４はＮＰＮトランジスタを示す。なお、図中、同
一符号は同一、または相当部分を示す。
値競売回路の構成図、第３図及び第４図は従来の
最小値及び最大値競売回路の構成図である。図に
おいて、１１，１２は演算増幅器、２１，２２は
ダイオード、６１，６２は表示器、７１は定電流
源、８１，８２はＰＮＰトランジスタ、８３，８
４はＮＰＮトランジスタを示す。なお、図中、同
一符号は同一、または相当部分を示す。
Claims (1)
- 演算増幅器・ダイオード及びトランジスタとの
直列回路を複数個組合せて構成され各直列回路に
個別に与えられる複数の入力電圧の内の最小値も
しくは最大値を出力する競売回路において、最小
値もしくは最大値を出力している入力電圧をＬＥ
Ｄ等にて表示することを特徴とする最小値・最大
値競売回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6245590U JPH0424143U (ja) | 1990-06-13 | 1990-06-13 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6245590U JPH0424143U (ja) | 1990-06-13 | 1990-06-13 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0424143U true JPH0424143U (ja) | 1992-02-27 |
Family
ID=31591621
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6245590U Pending JPH0424143U (ja) | 1990-06-13 | 1990-06-13 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0424143U (ja) |
-
1990
- 1990-06-13 JP JP6245590U patent/JPH0424143U/ja active Pending