JPH04292034A - トークンリングコンセントレータ - Google Patents

トークンリングコンセントレータ

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JPH04292034A
JPH04292034A JP3353788A JP35378891A JPH04292034A JP H04292034 A JPH04292034 A JP H04292034A JP 3353788 A JP3353788 A JP 3353788A JP 35378891 A JP35378891 A JP 35378891A JP H04292034 A JPH04292034 A JP H04292034A
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JP
Japan
Prior art keywords
reset
token ring
port
coil
concentrator
Prior art date
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Pending
Application number
JP3353788A
Other languages
English (en)
Inventor
Bret A Matz
ブレット エー・マッツ
K C Babu
ケー・シー・バブ
Geeta George
ギータ ジョージ
Hemant K R Kumar
ヘマント クマー  ケー・アール.
Soma Rakshit
ソマ ラクシット
S Krishnakumar Rao
エス.クリシュナクマー ラオ
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TE Connectivity Corp
Original Assignee
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L12/00Data switching networks
    • H04L12/28Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
    • H04L12/42Loop networks

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  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Small-Scale Networks (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、トークンリングコンセ
ントレータに関し、特にトークンリングのアクセスプロ
トコルに従って動作するコンピュータ通信ネットワーク
で使用されるトークンリングコンセントレータに関する
【0002】
【従来の技術】トークンリングネットワークは、ネット
ワークに接続されたコンピュータ間の相互通信を行う標
準化されたネットワークであり、通常、閉リングを有す
るトランクと、リレースイッチ手段によりコンピュータ
をネットワークに挿入する多数の入/出力ポートを有す
るトークンリングコンセントレータとを含んでいる。標
準化されたトークンリングネットワークは、IEEE標
準802.5で規定され、各入/出力ポートはトランク
結合ユニットと称される。この標準によれば、コンピュ
ータのリングへの挿入は、コンピュータ自身により制御
される。ここで、コンピュータの挿入またはバイパスを
実行するメカニズムは、コンセントレータのそれぞれの
入/出力ポート内にある。各コンピュータは、中間イン
タフェースケーブル(MIC)を介してコンセントレー
タのそれぞれの入/出力ポートに接続され、コンピュー
タはファンタム回路技術を用い、MICを介して挿入/
バイパスメカニズムの制御を行う。ファンタム回路は、
MIC上のDC電圧を印加する。このDC電圧は、コン
ピュータ伝送シンボルの通路に対して透明であり、した
がって、“ファンタム”と称される。印加電圧は、コン
セントレータの入/出力ポート内で用いられ、リング内
のコンピュータの直列挿入を行わせるためのスイッチ動
作を遷移させる。ファンタム駆動の中断は、コンピュー
タをバイパスし、ループ(ラップ)状態にするようなス
イッチ動作を行わせる。このループは、コンピュータに
よりオフライン自己試験機能のために用いることができ
る。
【0003】IEEE標準802.5には、コンピュー
タをバイパス/挿入するスイッチング動作を行なわせる
リレー接点が示されている。通常、印加ファンタム電圧
、その結果生ずる電流がリレーを連続的に駆動するに充
分ではないので、ラッチリレーが使用されている。そし
て、コンデンサがエネルギー蓄積用に設けられ、適切な
時間にコンデンサをリレーコイルを通して放電させ、リ
レーをスイッチさせるのに必要なエネルギーバーストを
供給している。
【0004】
【発明が解決しようとする課題】上述の如きシステムで
は、通常のラッチリレーは、セットコイルとリセットコ
イルを有し、セットコイルの駆動によりコンピュータが
リング内に挿入され、リセットコイルの駆動によりリン
グからコンピュータがバイパスされる。コンセントレー
タの入/出力ポートに接続されているすべてのコンピュ
ータを同時にバイパスさせる一括リセットが、しばしば
要望され、すべてのリセットコイルの同時駆動が要望さ
れている。また、一括リセット装置と同様に、リセット
コイルが入/出力ポート内の挿入/バイパス制御メカニ
ズムによって使用されるとき、すべてのリセットコイル
を一括リセット装置に結合しつつ、互いにリセットコイ
ルを絶縁する或る種の手段が設けられなければならない
。更に、使用中にポートがリセットされると、当該ポー
トに接続されたコンピュータに好ましくない状態が生ず
る。
【0005】そこで、本発明の目的は、トークンリング
コンセントレータ内のすべてのリセットコイルの同時駆
動を可能とするトークンリングコンセントレータを提供
することにある。本発明の他の目的は、すべてのリセッ
トコイルを包括的リセット装置に結合しつつ互いにリセ
ットコイルを絶縁するようなトークンリングコンセント
レータを提供することにある。本発明の更に他の目的は
、包括的リセット機能の駆動が能動入/出力ポートに影
響を与えるのを防止するトークンリングコンセントレー
タを提供することにある。
【0006】
【課題を解決するための手段】前述の課題を解決するた
め、本発明によるトークンリングコンセントレータは、
接続されているコンピュータをトークンリングネットワ
ーク内に挿入または該トークンリングネットワークから
取り外す機能をもつスイッチ手段を有する複数のポート
と、前記スイッチ手段を選択的に制御する制御手段と、
前記ポートのうちを能動ポート以外のすべてのポートを
所定の状態に設定するため前記スイッチ手段をセットす
る一括リセット手段と、を備えて構成される。
【0007】
【作用】本発明では、コンセントレータは、複数のポー
トと、スイッチ手段と、制御手段と、一括リセット手段
とから成る。各ポートは、トークンリングアダプタをも
つそれぞれのコンピュータの入/出力ポートへの接続用
であり、各コンセントレータはコンピュータを選択的に
ネットワーク内に挿入し、または、それぞれのコンピュ
ータをネットワークから絶縁するスイッチ手段をもつ。 スイッチ手段は、セットコイルとリセットコイルをもつ
ラッチリレーと制御手段を有するとともに、セットコイ
ルの駆動により、それぞれのコンピュータをネットワー
ク内に挿入し、リセットコイルの駆動によりそれぞれの
コンピュータをネットワークから絶縁させるように構成
されている。制御手段は、セットコイルとリセットコイ
ルの選択的駆動を制御し、コンセントレータポートに接
続されたとき、それぞれのコンピュータにより供給され
るファンタム電圧に応答してセットコイルを駆動し、フ
ァンタム電圧の不存在に応答してリセットコイルを駆動
する。一括リセット手段は、すべてのリセットコイルを
選択的に駆動するすべてのコンセントレータに接続され
ており、スイッチと、電流パルスを発生するためのオペ
レータのスイッチの手動操作に応答する電流パルス発生
手段と、電流パルス発生手段をすべてのコンセントレー
タポートのリセットコイルに結合する手段と、コンセン
トレータポートのリセットコイル間を絶縁する手段とを
含んでいる。
【0008】本発明の一態様によれば、一括リセット手
段の結合手段は、電流パルス発生手段から延びる一対の
リードを含み、絶縁手段は、各コンセントレータポート
内に、第1のリードとそれぞれのリセットコイルの第1
端間に接続された第1のトランジスタと、第2のリード
とそれぞれのリセットコイルの第2端間に接続された第
2のトランジスタとを含んでいる。本発明の他の態様に
よれば、各コンセントレータポートは、更に、当該ポー
トにファンタム電圧の存在に応答して、当該ポートのリ
セットコイルをバイパスする電流パルスに通路を与える
リセット不能手段を含んでいる。
【0009】
【実施例】次に、本発明について図面を参照しながら説
明する。図1は、IEEE標準802.5に従う複数の
トランク結合ユニットを有するトークンリングコンセン
トレータ10を示す。コンセントレータ10は、複数の
トランク結合ユニットやポート14A,14B,…,1
4Nを通るループ状またはエンドレスの2つのワイヤ通
信チャンネル、またはリング12(トランクとも称され
る)を有する。これらポートは、中間インタフェースケ
ーブル18A,18B,…,18Nによってコンピュー
タ16A,16B,…,16Nのそれぞれの入/出力ポ
ートに接続されている。IEEE標準802.5に従っ
て、各コンピュータ16A,16B,…,16Nは、分
離された受信トランス及び送信トランスをもつトークン
リングアダプタを有する。各トランスは、DC的には互
いに絶縁され、AC的には結合された2つのコイルを有
し、一対の送信導体20Aと一対の受信導体22Aを有
する。これら導体には、ファンタム電圧が印加され、一
対の送信導体20Aとは+VボルトDC電圧が、一対の
受信導体22Aには0ボルトDC電圧が印加されている
【0010】コンセントレータ10の各ポート(14A
,14B,…,14N)14内には、スイッチ機構(2
4A,24B…)24が設けられている。このスイッチ
機構24は、それぞれのコンピュータ(16A,16B
,…,16N)16を選択的にトークンリングネットワ
ーク内に挿入し、またはトークンリングネットワークか
らそれぞれのコンピュータをバイパス(絶縁)するため
に利用される複数のリレーコンタクトを有する。スイッ
チ動作の制御は、各ポート14内のバイパス制御回路(
26A,26B…)26を介して行われる。バイパス制
御回路26は、コンタクトがスイッチ機構を構成するラ
ッチリレーを含み、それぞれのコンピュータ16によっ
て中間インタフェースケーブル(18A,18B,…,
18N)18上に印加されているファンタム電圧の存在
または不存在に応答してそれぞれのコンピュータ16を
挿入またはバイパスする。
【0011】各ポート14は、また負荷バランス回路2
7を有する。IEEE標準802.5に従って、リード
32(32A)、29(29A)とリード34(34A
)、31(31A)間に設けられた静負荷は、2.9K
オームから5.3Kオームの間の抵抗をもち、5%以内
で整合されている。リード32(32A)と34(34
A)間の負荷はバイパス制御回路26により生成され、
リード29(29A)と31(31A)間の負荷は負荷
バランス回路27により生成される。したがって、バイ
パス制御回路26により生成される負荷の非直線性が補
償される。
【0012】図2は、本発明の原理に従って構成された
バイパス制御回路26を示す。バイパス制御回路26は
、そのコンタクトがスイッチ機構24を構成するラッチ
リレーのコイルを含んでいる。このラッチリレーは、セ
ットコイル28とリセットコイル30を有する。セット
コイルが駆動されると、スイッチ機構24は、それぞれ
のコンピュータ16をトークンリングネットワーク内に
挿入するように機能する。リセットコイル30が駆動さ
れると、スイッチ機構24は、それぞれのコンピュータ
16をトークンリングネットワークから絶縁するように
機能する。バイパス制御回路26の端子32は、中間イ
ンタフェースケーブル18の送信対20(20A)に接
続され、それぞれのコンピュータ16により供給される
ファンタム正電圧を受信する。バイパス制御回路26の
端子34は、中間インタフェースケーブル18の受信対
22(22A)に接続され、それぞれのコンピュータ1
6により供給されるファンタム零ボルトを受信する。
【0013】それぞれのコンピュータ16の中間インタ
フェースケーブル18を介するポート14への接続によ
り、端子32と34を通ってファンタム電圧が最初に供
給されると、プログラマブル単接合トランジスタ38の
ゲートがアノード40よりも高電圧となり、トランジス
タ38は導通しない。このとき、ファンタム電圧に起因
した抵抗42とダイオード44を流れる電流は、コンデ
ンサ46を充電する。コンデンサ46がゲート36の電
圧とトランジスタ38のオフセット電圧の和に等しい電
圧まで充電されると、トランジスタ38は導通する。し
たがって、トランジスタ48が順方向バイアスされる。 トランジスタ48の導通によって、コンデンサ46をラ
ッチリレーのセットコイル28を通して放電させて、そ
れぞれのコンピュータ16をトークンリングネットワー
ク内に挿入させる。トランジスタ38は、コンデンサ5
0が充分に充電されると導通が停止し、コイル28を通
る電流の流れを終了させる。コンデンサ46は、その後
再充電される。ダイオード52は、セットコイル28内
の背景EMFに対する保護用に設けられている。
【0014】中間インタフェースケーブル18のポート
14への接続による端子32と34を通るファンタム電
圧が存在するときには常時、プログラマブル単接合トラ
ンジスタ56のゲート54はアノード58よりも高電圧
である。しかしながら、中間インタフェースケーブル1
8がポート14から切り離され、またはコンピュータ1
6がファンタム電圧を除くと、ゲート54の電圧はアノ
ード58の電圧より低下し、トランジスタ56を導通状
態とする。その結果、コンデンサ60は、トランジスタ
56を通して放電し、トランジスタ62を順方向バイア
スする。トランジスタ62の導通によりコンデンサ46
と50をラッチリレーのリセットコイル30を通して放
電させる。リセットコイル30を駆動すると、スイッチ
機構24によりポート14をトークンリングネットワー
クからバイパスさせ、絶縁させる。抵抗64は、リセッ
トコイル30を横切る電圧を制限するために設けられて
おり、ダイオード66は、リセットコイル30内の背景
EMFに対する保護を行う。
【0015】本発明の原理によれば、トランジスタ68
と79は、リセットコイル30を駆動する一括リセット
電流パルスに通路を与える。トランジスタ68と70は
、またコンセントレータ10のすべてのポート14間の
信号絶縁を与える機能をもつ。これは、すべてのポート
14のラッチリレーのリセットコイルが一括リセット機
能を実行するべく並列に接続されているからである。 一括リセット電流パルスを発生する回路が図3に示され
ている。この回路は、好ましくは、長寿命3Vリチウム
電池である電池72と、コンデンサ74と、スイッチ7
6を有する。スイッチ76は、瞬間接触型スイッチであ
り、アーマチュア78は、端子80と82を平常時接続
し、コンデンサ74をリセット端子84と86に接続す
る。リセット端子84と86は、コンセントレータ10
のすべてのポート14に接続される。通常、コンデンサ
74には、充電されていないので回路は動作せず、トラ
ンジスタ68と72はポート14間を絶縁している。し
かし、スイッチ76のアーマチュア78が破線位置に動
き、スイッチ端子80と88が接続されると、コンデン
サ74は電池72により充電される。操作者がアーマチ
ュア78を実線で示す元の位置に戻すと、充電されたコ
ンデンサ74は端子84と86を通って接続される。コ
ンデンサ74は、次にトランジスタ68と70を順方向
バイアスし、すべてのポート14のリセットコイル30
を通して放電する。したがって、すべてのポート14は
トークンリングネットワークから絶縁され、ファンタム
電圧が存在するときは引き続く挿入が可能となる。発光
ダイオード89は、コンデンサ74が一括リセットを保
証するに充分に充電されているときに視覚的表示を行う
【0016】発光ダイオード90と抵抗92は、それぞ
れのポート14の状態を示し、ファンタム電圧が端子3
2と34を通って存在するときに駆動される。バイパス
制御回路26の発光ダイオード90は、電圧変化として
の電圧を生じさせ、端子32と34間の実効抵抗の電圧
変化により非直線性を生じさせる(IEEE標準802
.5は3.5V〜7.0Vの範囲のファンタム電圧を許
容している)。その結果、負荷バランス27として抵抗
を用いることはIEEE標準802.5の要求に合致す
るものではない。何故ならば、その抵抗は電圧変化に従
って比例して変化しないからである。5%マッチング要
望に合致させるため、光アイソレータ94が端子29と
31を横切って設けられている。光アイソレータ94の
発光ダイオード96により、発光ダイオード90と同様
に同じ等価電圧降下が得られ、負荷バランス要求を満足
させる。
【0017】本発明によれば、光アイソレータ94は、
また能動ポートに対して一括リセット保護を与えるため
に利用されており、スイッチ76(図3)の突発動作に
より使用中のポートがリセットされることはない。こう
して、光アイソレータ94のフォトトランジスタ98は
、ファンタム電圧が存在するときはトランジスタ70を
回路短絡するため接続される。したがって、一括リセッ
ト電流パルスが端子84,86に供給されると、トラン
ジスタ70が導通するのを阻止する。トランジスタ98
は、導通すると、電流パルスの通路を与え、この通路は
リセットコイル30をバイパスさせる。
【0018】
【発明の効果】以上説明したように、本発明によれば、
トークンリングコンセントレータの入出力ポートに接続
されているすべてのコンピュータを同時にバイパスさせ
るリセットを一括リセットでき、また当該リセット用の
リセットコイルは互いに絶縁させることができ、リセッ
ト時に当該ポートに接続されているコンピュータへの影
響を除去することができる。
【図面の簡単な説明】
【図1】本発明によるトークンリングコンセントレータ
の一実施例を示し、複数のトランク結合ユニットを含む
トークンリングコンセントレータを有するトークンリン
グネットワークの構成ブロック図である。
【図2】本発明により構成されたバイパス制御回路の詳
細回路ブロック図である。
【図3】図2に示す回路に接続された一括リセット回路
の回路ブロック図である。
【符号の説明】

Claims (1)

    【特許請求の範囲】
  1. 接続されているコンピュータをトークンリングネットワ
    ーク内に挿入または該トークンリングネットワークから
    取り外す機能をもつスイッチ手段を有する複数のポート
    と、前記スイッチ手段を選択的に制御する制御手段と、
    前記ポートのうちを能動ポート以外のすべてのポートを
    所定の状態に設定するため前記スイッチ手段をセットす
    る一括リセット手段と、を備えて成ることを特徴とする
    トークンリングコンセントレータ。
JP3353788A 1990-12-18 1991-12-18 トークンリングコンセントレータ Pending JPH04292034A (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US07628886 US5132832B1 (en) 1990-12-18 1990-12-18 Token ring concentration with global reset capability
US07/628,886 1990-12-18

Publications (1)

Publication Number Publication Date
JPH04292034A true JPH04292034A (ja) 1992-10-16

Family

ID=24520727

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3353788A Pending JPH04292034A (ja) 1990-12-18 1991-12-18 トークンリングコンセントレータ

Country Status (6)

Country Link
US (1) US5132832B1 (ja)
EP (1) EP0491524A1 (ja)
JP (1) JPH04292034A (ja)
KR (1) KR920014000A (ja)
CA (1) CA2057776A1 (ja)
IL (1) IL100075A (ja)

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