JPH04295298A - 上下限制限回路 - Google Patents
上下限制限回路Info
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- JPH04295298A JPH04295298A JP3060675A JP6067591A JPH04295298A JP H04295298 A JPH04295298 A JP H04295298A JP 3060675 A JP3060675 A JP 3060675A JP 6067591 A JP6067591 A JP 6067591A JP H04295298 A JPH04295298 A JP H04295298A
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- Control Of Ac Motors In General (AREA)
- Tone Control, Compression And Expansion, Limiting Amplitude (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は、入力電圧に比例した出
力電圧が得られるとともに、出力電圧の上限値と下限値
とを設定できるようにした上下限制限回路に関するもの
である。
力電圧が得られるとともに、出力電圧の上限値と下限値
とを設定できるようにした上下限制限回路に関するもの
である。
【０００２】
【従来の技術】従来より、この種の上下限制限回路が、
インバータ回路の入力電圧を所定範囲に制限するなどの
目的で用いられている。たとえば、交流モータを駆動す
るインバータ回路では、外部から入力される電圧に応じ
て出力の周波数やデューティ比を変化させることにより
、交流モータの回転速度を変えるようにしたものがある
。いま、周囲環境の変化に対応したアナログの電圧出力
が得られるセンサの出力電圧に基づいて交流モータの回
転速度を制御するとすれば、センサの出力電圧と交流モ
ータの回転速度との対応関係を設定することが必要にな
る。そこで、センサの出力電圧を上下限制限回路を通し
てインバータ回路に入力することによって、インバータ
回路に入力する電圧の可変範囲を制限するとともに、セ
ンサの出力電圧に対するインバータ回路への入力電圧の
変化率を調節するのである。このように上下限制限回路
を用いれば、センサの出力電圧の上限値および下限値に
対応する交流モータの回転速度の上限値および下限値を
規制するとともに、センサの出力電圧に対する交流モー
タの回転速度の変化率を調節することができるのであっ
て、センサの出力に対応するように交流モータの回転速
度を制御できるのである。
インバータ回路の入力電圧を所定範囲に制限するなどの
目的で用いられている。たとえば、交流モータを駆動す
るインバータ回路では、外部から入力される電圧に応じ
て出力の周波数やデューティ比を変化させることにより
、交流モータの回転速度を変えるようにしたものがある
。いま、周囲環境の変化に対応したアナログの電圧出力
が得られるセンサの出力電圧に基づいて交流モータの回
転速度を制御するとすれば、センサの出力電圧と交流モ
ータの回転速度との対応関係を設定することが必要にな
る。そこで、センサの出力電圧を上下限制限回路を通し
てインバータ回路に入力することによって、インバータ
回路に入力する電圧の可変範囲を制限するとともに、セ
ンサの出力電圧に対するインバータ回路への入力電圧の
変化率を調節するのである。このように上下限制限回路
を用いれば、センサの出力電圧の上限値および下限値に
対応する交流モータの回転速度の上限値および下限値を
規制するとともに、センサの出力電圧に対する交流モー
タの回転速度の変化率を調節することができるのであっ
て、センサの出力に対応するように交流モータの回転速
度を制御できるのである。
【０００３】上下限制限回路としては、図２に示すよう
な構成のものがある。すなわち、入力電圧の増幅率を設
定する増幅率設定部１１と、出力電圧の下限値を設定す
る下限電圧設定部１２と、増幅率設定部１１の出力電圧
と下限電圧設定部１２の出力電圧とを加算した電圧を出
力する電圧加算部１３とを備えているのである。増幅率
設定部１１は、演算増幅器ＯＰ６ 、抵抗Ｒ５ ，Ｒ６
、可変抵抗ＶＲ３ よりなる反転増幅器であって、可
変抵抗ＶＲ３ によって増幅率αが設定されるように構
成されている。したがって、増幅率設定部１１への入力
電圧をＶｉｎとすれば、増幅率設定部１１の出力電圧は
−α・Ｖｉｎになる。下限電圧設定部１２は、演算増幅
器ＯＰ７ よりなるボルテージフォロワ、抵抗Ｒ７ 、
可変抵抗ＶＲ４ を備えている。可変抵抗ＶＲ４ は、
一端が接地電位、他端が接地電位よりも低い所定電位−
Ｖｃｃとなるように接続されており、可変抵抗ＶＲ４
を調節すると下限電圧設定部１２は、０〜−Ｖｃｃの範
囲の電圧を出力する。 電圧加算部１３は、演算増幅器ＯＰ８ 、抵抗Ｒ８ 〜
Ｒ１１よりなり、抵抗Ｒ８ 〜Ｒ１０は等しい値に設定
されている。被加算電圧は、抵抗Ｒ８ ，Ｒ９ を介し
て演算増幅器ＯＰ８ の反転入力端に入力されるのであ
って、電圧加算部１３からは、被加算電圧の総和の極性
を反転させた出力電圧Ｖｏｕｔが得られる。すなわち、
下限電圧設定部１２の出力電圧が−Ｖｉ（０≦Ｖｉ≦Ｖ
ｃｃ）であるとすれば、電圧加算部１３の出力電圧Ｖｏ
ｕｔは、α・Ｖｉｎ＋Ｖｉになる。ここに、増幅率設定
部１１および下限電圧設定部１２の出力は負極性である
が、電圧加算部１３は入出力の極性を反転させるから、
以下では増幅率設定部１１および下限電圧設定部１２の
出力を正極性として説明する。しかるに上記構成では、
増幅率αを０．５、下限電圧設定部１２の出力電圧Ｖｉ
を２〔Ｖ〕に設定し、入力電圧Ｖｉｎが０〜１０Ｖの範
囲で変化するものとすれば、出力電圧Ｖｏｕｔは、２〔
Ｖ〕≦Ｖｏｕｔ≦７〔Ｖ〕になる。要するに、出力電圧
Ｖｏｕｔは、下限電圧設定部１２の出力電圧Ｖｉが下限
値になり、入力電圧Ｖｉｎの変化範囲の最高電圧Ｖｍａ
ｘと増幅率αとの積に下限電圧設定部１２の出力電圧Ｖ
ｉを加算した電圧α・Ｖｍａｘ＋Ｖｉが上限値になるの
である。
な構成のものがある。すなわち、入力電圧の増幅率を設
定する増幅率設定部１１と、出力電圧の下限値を設定す
る下限電圧設定部１２と、増幅率設定部１１の出力電圧
と下限電圧設定部１２の出力電圧とを加算した電圧を出
力する電圧加算部１３とを備えているのである。増幅率
設定部１１は、演算増幅器ＯＰ６ 、抵抗Ｒ５ ，Ｒ６
、可変抵抗ＶＲ３ よりなる反転増幅器であって、可
変抵抗ＶＲ３ によって増幅率αが設定されるように構
成されている。したがって、増幅率設定部１１への入力
電圧をＶｉｎとすれば、増幅率設定部１１の出力電圧は
−α・Ｖｉｎになる。下限電圧設定部１２は、演算増幅
器ＯＰ７ よりなるボルテージフォロワ、抵抗Ｒ７ 、
可変抵抗ＶＲ４ を備えている。可変抵抗ＶＲ４ は、
一端が接地電位、他端が接地電位よりも低い所定電位−
Ｖｃｃとなるように接続されており、可変抵抗ＶＲ４
を調節すると下限電圧設定部１２は、０〜−Ｖｃｃの範
囲の電圧を出力する。 電圧加算部１３は、演算増幅器ＯＰ８ 、抵抗Ｒ８ 〜
Ｒ１１よりなり、抵抗Ｒ８ 〜Ｒ１０は等しい値に設定
されている。被加算電圧は、抵抗Ｒ８ ，Ｒ９ を介し
て演算増幅器ＯＰ８ の反転入力端に入力されるのであ
って、電圧加算部１３からは、被加算電圧の総和の極性
を反転させた出力電圧Ｖｏｕｔが得られる。すなわち、
下限電圧設定部１２の出力電圧が−Ｖｉ（０≦Ｖｉ≦Ｖ
ｃｃ）であるとすれば、電圧加算部１３の出力電圧Ｖｏ
ｕｔは、α・Ｖｉｎ＋Ｖｉになる。ここに、増幅率設定
部１１および下限電圧設定部１２の出力は負極性である
が、電圧加算部１３は入出力の極性を反転させるから、
以下では増幅率設定部１１および下限電圧設定部１２の
出力を正極性として説明する。しかるに上記構成では、
増幅率αを０．５、下限電圧設定部１２の出力電圧Ｖｉ
を２〔Ｖ〕に設定し、入力電圧Ｖｉｎが０〜１０Ｖの範
囲で変化するものとすれば、出力電圧Ｖｏｕｔは、２〔
Ｖ〕≦Ｖｏｕｔ≦７〔Ｖ〕になる。要するに、出力電圧
Ｖｏｕｔは、下限電圧設定部１２の出力電圧Ｖｉが下限
値になり、入力電圧Ｖｉｎの変化範囲の最高電圧Ｖｍａ
ｘと増幅率αとの積に下限電圧設定部１２の出力電圧Ｖ
ｉを加算した電圧α・Ｖｍａｘ＋Ｖｉが上限値になるの
である。
【０００４】
【発明が解決しようとする課題】上記構成では、出力電
圧Ｖｏｕｔの上限値に下限電圧設定部１２の出力電圧Ｖ
ｉが含まれているから、出力電圧Ｖｏｕｔの下限値を変
更すると上限値も変化することになる。すなわち、下限
値を変更したときには上限値の再調節が必要になるので
ある。その結果、下限値のみを独立して変更することが
できないという問題がある。
圧Ｖｏｕｔの上限値に下限電圧設定部１２の出力電圧Ｖ
ｉが含まれているから、出力電圧Ｖｏｕｔの下限値を変
更すると上限値も変化することになる。すなわち、下限
値を変更したときには上限値の再調節が必要になるので
ある。その結果、下限値のみを独立して変更することが
できないという問題がある。
【０００５】本発明は上記問題点の解決を目的とするも
のであり、上限値と下限値とをそれぞれ独立して変更で
きるようにした上下限制限回路を提供しようとするもの
である。
のであり、上限値と下限値とをそれぞれ独立して変更で
きるようにした上下限制限回路を提供しようとするもの
である。
【０００６】
【課題を解決するための手段】本発明では、上記目的を
達成するために、入力電圧に比例し入力電圧の変化範囲
の最高電圧が入力されたときに０になる出力電圧が得ら
れるとともに比例定数を設定する第１比例定数設定手段
を備えた第１電圧設定部と、入力電圧に比例し入力電圧
の変化範囲の最低電圧が入力されたときに０になる出力
電圧が得られるとともに比例定数を設定する第２比例定
数設定手段を備えた第２電圧設定部と、第１電圧設定部
および第２電圧設定部の出力電圧を加算した出力電圧が
得られる電圧加算部とを具備しているのである。
達成するために、入力電圧に比例し入力電圧の変化範囲
の最高電圧が入力されたときに０になる出力電圧が得ら
れるとともに比例定数を設定する第１比例定数設定手段
を備えた第１電圧設定部と、入力電圧に比例し入力電圧
の変化範囲の最低電圧が入力されたときに０になる出力
電圧が得られるとともに比例定数を設定する第２比例定
数設定手段を備えた第２電圧設定部と、第１電圧設定部
および第２電圧設定部の出力電圧を加算した出力電圧が
得られる電圧加算部とを具備しているのである。
【０００７】
【作用】上記構成によれば、第１電圧設定部は、入力電
圧の最高電圧が入力されたときに出力電圧を０にするか
ら、入力電圧の最高電圧に対する電圧加算部の出力電圧
は第２電圧設定部の出力電圧によって決定されることに
なる。また、逆に入力電圧の最低電圧が入力されたとき
には第２電圧設定部の出力電圧が０になるから、入力電
圧の最低電圧に対する電圧加算部の出力電圧は第１電圧
設定部の出力電圧によって決定されることになる。すな
わち、入力電圧の最低電圧および最高電圧に対する出力
電圧は、第１電圧設定部および第２電圧設定部によって
それぞれ独立して設定されるのであり、一方を調節して
も他方が変化することはないのである。
圧の最高電圧が入力されたときに出力電圧を０にするか
ら、入力電圧の最高電圧に対する電圧加算部の出力電圧
は第２電圧設定部の出力電圧によって決定されることに
なる。また、逆に入力電圧の最低電圧が入力されたとき
には第２電圧設定部の出力電圧が０になるから、入力電
圧の最低電圧に対する電圧加算部の出力電圧は第１電圧
設定部の出力電圧によって決定されることになる。すな
わち、入力電圧の最低電圧および最高電圧に対する出力
電圧は、第１電圧設定部および第２電圧設定部によって
それぞれ独立して設定されるのであり、一方を調節して
も他方が変化することはないのである。
【０００８】また、第１電圧設定部および第２電圧設定
部は、どちらも出力電圧が入力電圧に比例するから、第
１電圧設定部と第２電圧設定部との出力電圧を電圧加算
部で加算した結果の出力電圧も入力電圧に比例するので
ある。以上のことを数式を用いて説明すれば以下のよう
になる。すなわち、第１電圧設定部の出力電圧Ｖ１ と
第２電圧設定部の出力電圧Ｖ２ とは、入力電圧Ｖｉｎ
に対して次式のような関係になる。
部は、どちらも出力電圧が入力電圧に比例するから、第
１電圧設定部と第２電圧設定部との出力電圧を電圧加算
部で加算した結果の出力電圧も入力電圧に比例するので
ある。以上のことを数式を用いて説明すれば以下のよう
になる。すなわち、第１電圧設定部の出力電圧Ｖ１ と
第２電圧設定部の出力電圧Ｖ２ とは、入力電圧Ｖｉｎ
に対して次式のような関係になる。
【０００９】Ｖ１ ＝α１ ・Ｖｉｎ＋β１ Ｖ２ ＝
α２ ・Ｖｉｎ＋β２ ただし、α１ ，α２ は比例定数、β１ ，β２ は
オフセット値である。オフセット値β１ ，β２ は、
入力電圧Ｖｉｎの変化範囲の最高電圧をＸｍａｘ、最低
電圧をＸｍｉｎとするとき、次式が成立するように設定
する。
α２ ・Ｖｉｎ＋β２ ただし、α１ ，α２ は比例定数、β１ ，β２ は
オフセット値である。オフセット値β１ ，β２ は、
入力電圧Ｖｉｎの変化範囲の最高電圧をＸｍａｘ、最低
電圧をＸｍｉｎとするとき、次式が成立するように設定
する。
【００１０】Ｘｍａｘ＋（β１ ／α１ ）＝０Ｘｍｉ
ｎ＋（β２ ／α２ ）＝０ したがって、電圧加算部の出力電圧Ｖｏｕｔは、Ｖｏｕ
ｔ＝Ｖ１ ＋Ｖ２ ＝α１ ・Ｖｉｎ＋β１ ＋α２ ・Ｖｉｎ＋β２ ＝
（α１ ＋α２ ）Ｖｉｎ＋（β１ ＋β２ ）となり
、出力電圧Ｖｏｕｔは入力電圧Ｖｉｎに比例する。また
、入力電圧Ｖｉｎの変化範囲の最高電圧Ｘｍａｘおよび
最低電圧Ｘｍｉｎに対して、上述のようにオフセット値
β１ ，β２ を設定したことにより、次式の関係が成
立する。
ｎ＋（β２ ／α２ ）＝０ したがって、電圧加算部の出力電圧Ｖｏｕｔは、Ｖｏｕ
ｔ＝Ｖ１ ＋Ｖ２ ＝α１ ・Ｖｉｎ＋β１ ＋α２ ・Ｖｉｎ＋β２ ＝
（α１ ＋α２ ）Ｖｉｎ＋（β１ ＋β２ ）となり
、出力電圧Ｖｏｕｔは入力電圧Ｖｉｎに比例する。また
、入力電圧Ｖｉｎの変化範囲の最高電圧Ｘｍａｘおよび
最低電圧Ｘｍｉｎに対して、上述のようにオフセット値
β１ ，β２ を設定したことにより、次式の関係が成
立する。
【００１１】
（α１ ＋α２ ）Ｘｍａｘ＋（β１ ＋
β２ ）＝α２ ・Ｘｍａｘ＋β２ （α
１ ＋α２ ）Ｘｍｉｎ＋（β１ ＋β２ ）＝α１
・Ｘｍｉｎ＋β１ したがって、（α２ ・Ｘｍａｘ＋
β２ ）と（α１ ・Ｘｍｉｎ＋β１ ）との一方を出
力電圧Ｖｏｕｔの上限値とし、他方を下限値とすること
ができるのである。このとき、上限値および下限値に含
まれる比例定数α１ ，α２ 、オフセット値β１ ，
β２ は、それぞれ第１電圧設定部と第２電圧設定部と
の一方のみによって決定されるから、上限値と下限値と
を他方に影響を与えることなく独立して設定できるので
ある。ここに、どちらが上限値になるかは、比例定数α
１ ，α２ の設定に依存する。
β２ ）＝α２ ・Ｘｍａｘ＋β２ （α
１ ＋α２ ）Ｘｍｉｎ＋（β１ ＋β２ ）＝α１
・Ｘｍｉｎ＋β１ したがって、（α２ ・Ｘｍａｘ＋
β２ ）と（α１ ・Ｘｍｉｎ＋β１ ）との一方を出
力電圧Ｖｏｕｔの上限値とし、他方を下限値とすること
ができるのである。このとき、上限値および下限値に含
まれる比例定数α１ ，α２ 、オフセット値β１ ，
β２ は、それぞれ第１電圧設定部と第２電圧設定部と
の一方のみによって決定されるから、上限値と下限値と
を他方に影響を与えることなく独立して設定できるので
ある。ここに、どちらが上限値になるかは、比例定数α
１ ，α２ の設定に依存する。
【００１２】
【実施例】図１に示すように、基本的には、入力部４を
通して入力電圧が印加される第１電圧設定部１および第
２電圧設定部２と、第１電圧設定部１の出力電圧と第２
電圧設定部２との出力電圧とを加算した電圧を出力する
電圧加算部３とを備えている。
通して入力電圧が印加される第１電圧設定部１および第
２電圧設定部２と、第１電圧設定部１の出力電圧と第２
電圧設定部２との出力電圧とを加算した電圧を出力する
電圧加算部３とを備えている。
【００１３】入力部４は、演算増幅器ＯＰ１ よりなる
ボルテージフォロワＶＦ１ によって構成されている。 したがって、入力電圧を変化させずに出力する。第１電
圧設定部１は、演算増幅器ＯＰ２ 、抵抗Ｒ１ ，Ｒ２
（Ｒ１ ＝Ｒ２ ）、オフセット電源Ｅよりなるオフ
セット設定回路ＯＳと、オフセット設定回路ＯＳの出力
電圧を分圧する第１比例定数設定手段としての可変抵抗
ＶＲ１ と、演算増幅器ＯＰ３ よりなるボルテージフ
ォロワＶＦ２ とにより構成されている。オフセット設
定回路ＯＳでは、オフセット電源Ｅの２倍の電圧から入
力部４の出力電圧を引いた電圧を出力する。
ボルテージフォロワＶＦ１ によって構成されている。 したがって、入力電圧を変化させずに出力する。第１電
圧設定部１は、演算増幅器ＯＰ２ 、抵抗Ｒ１ ，Ｒ２
（Ｒ１ ＝Ｒ２ ）、オフセット電源Ｅよりなるオフ
セット設定回路ＯＳと、オフセット設定回路ＯＳの出力
電圧を分圧する第１比例定数設定手段としての可変抵抗
ＶＲ１ と、演算増幅器ＯＰ３ よりなるボルテージフ
ォロワＶＦ２ とにより構成されている。オフセット設
定回路ＯＳでは、オフセット電源Ｅの２倍の電圧から入
力部４の出力電圧を引いた電圧を出力する。
【００１４】第２電圧設定部２は、入力部４の出力電圧
を分圧する第２比例定数設定手段としての可変抵抗ＶＲ
２ と、演算増幅器ＯＰ４ よりなるボルテージフォロ
ワＶＦ３ とにより構成されており、入力電圧を可変抵
抗ＶＲ２ によって分圧した電圧を出力する。電圧加算
部３は、抵抗Ｒ３ ，Ｒ４ （Ｒ３ ＝Ｒ４ ）と、演
算増幅器ＯＰ５ よりなるボルテージフォロワＶＦ４
とにより構成され、抵抗Ｒ３ ，Ｒ４ を介して入力さ
れる第１電圧設定部１および第２電圧設定部２の出力電
圧を加算した電圧を出力する。
を分圧する第２比例定数設定手段としての可変抵抗ＶＲ
２ と、演算増幅器ＯＰ４ よりなるボルテージフォロ
ワＶＦ３ とにより構成されており、入力電圧を可変抵
抗ＶＲ２ によって分圧した電圧を出力する。電圧加算
部３は、抵抗Ｒ３ ，Ｒ４ （Ｒ３ ＝Ｒ４ ）と、演
算増幅器ＯＰ５ よりなるボルテージフォロワＶＦ４
とにより構成され、抵抗Ｒ３ ，Ｒ４ を介して入力さ
れる第１電圧設定部１および第２電圧設定部２の出力電
圧を加算した電圧を出力する。
【００１５】次に、上記回路の動作を説明する。入力電
圧をＶｉｎとし、オフセット電源Ｅの電圧をＶｅとする
と、オフセット設定回路ＯＳの出力電圧は２Ｖｅ−Ｖｉ
ｎになる。この電圧が可変抵抗ＶＲ１ によって分圧さ
れるから、可変抵抗ＶＲ１ による分圧比をα１ とす
れば（すなわち、α１ は第１電圧設定部１における比
例定数に相当する）、第１電圧設定部１の出力電圧Ｖ１
は、α１ ・（２Ｖｅ−Ｖｉｎ）になる。一方、可変
抵抗ＶＲ２ による分圧比をα２ とすれば（すなわち
、α２ は第２電圧設定部２における比例定数に相当す
る）、第２電圧設定部２の出力電圧Ｖ２ はα２ ・Ｖ
ｉｎになる。その結果、電圧加算部３の出力電圧Ｖｏｕ
ｔは、次式のようになる。
圧をＶｉｎとし、オフセット電源Ｅの電圧をＶｅとする
と、オフセット設定回路ＯＳの出力電圧は２Ｖｅ−Ｖｉ
ｎになる。この電圧が可変抵抗ＶＲ１ によって分圧さ
れるから、可変抵抗ＶＲ１ による分圧比をα１ とす
れば（すなわち、α１ は第１電圧設定部１における比
例定数に相当する）、第１電圧設定部１の出力電圧Ｖ１
は、α１ ・（２Ｖｅ−Ｖｉｎ）になる。一方、可変
抵抗ＶＲ２ による分圧比をα２ とすれば（すなわち
、α２ は第２電圧設定部２における比例定数に相当す
る）、第２電圧設定部２の出力電圧Ｖ２ はα２ ・Ｖ
ｉｎになる。その結果、電圧加算部３の出力電圧Ｖｏｕ
ｔは、次式のようになる。
【００１６】Ｖｏｕｔ＝α１ ・（２Ｖｅ−Ｖｉｎ）＋
α２ ・Ｖｉｎ ＝（α２ −α１ ）・Ｖｉｎ＋２α１ ・Ｖｅここで
、２α１ ・Ｖｅは定数であるから、電圧加算部３の出
力電圧Ｖｏｕｔは入力電圧Ｖｉｎに比例することになる
。ここにおいて、（α２ −α１ ）が正であれば入力
電圧Ｖｉｎの上昇に伴って電圧加算部３の出力電圧Ｖｏ
ｕｔが上昇し、（α２ −α１ ）が負であれば入力電
圧Ｖｉｎの上昇に伴って出力電圧Ｖｏｕｔが下降するこ
とになる。
α２ ・Ｖｉｎ ＝（α２ −α１ ）・Ｖｉｎ＋２α１ ・Ｖｅここで
、２α１ ・Ｖｅは定数であるから、電圧加算部３の出
力電圧Ｖｏｕｔは入力電圧Ｖｉｎに比例することになる
。ここにおいて、（α２ −α１ ）が正であれば入力
電圧Ｖｉｎの上昇に伴って電圧加算部３の出力電圧Ｖｏ
ｕｔが上昇し、（α２ −α１ ）が負であれば入力電
圧Ｖｉｎの上昇に伴って出力電圧Ｖｏｕｔが下降するこ
とになる。
【００１７】いま、入力電圧Ｖｉｎが０〔Ｖ〕であると
、（α２ −α１ ）・Ｖｉｎ＝０になるから、電圧加
算部３の出力電圧Ｖｏｕｔは２α１ ・Ｖｅになる。す
なわち、入力電圧Ｖｉｎの最低電圧が０〔Ｖ〕であると
き、（α２ −α１ ）が正に設定してあれば、電圧加
算部３の出力電圧Ｖｏｕｔの下限値は、第１電圧設定部
１の可変抵抗ＶＲ１ のみで設定されることになる。ま
た、（α２ −α１ ）が負に設定してあれば、出力電
圧Ｖｏｕｔの上限値を設定することになる。
、（α２ −α１ ）・Ｖｉｎ＝０になるから、電圧加
算部３の出力電圧Ｖｏｕｔは２α１ ・Ｖｅになる。す
なわち、入力電圧Ｖｉｎの最低電圧が０〔Ｖ〕であると
き、（α２ −α１ ）が正に設定してあれば、電圧加
算部３の出力電圧Ｖｏｕｔの下限値は、第１電圧設定部
１の可変抵抗ＶＲ１ のみで設定されることになる。ま
た、（α２ −α１ ）が負に設定してあれば、出力電
圧Ｖｏｕｔの上限値を設定することになる。
【００１８】一方、入力電圧Ｖｉｎの最高電圧Ｖｍａｘ
とオフセット電圧Ｖｅとの関係をＶｍａｘ＝２Ｖｅに設
定しておけば、入力電圧Ｖｉｎが最高電圧Ｖｍａｘにな
ったとき、２Ｖｅ−Ｖｉｎ＝０になる。したがって、（
α２ −α１ ）が正に設定してあれば、電圧加算部３
の出力電圧Ｖｏｕｔの上限値はα２ ・Ｖｍａｘになる
。すなわち、電圧加算部３の出力電圧Ｖｏｕｔの上限値
は、第２電圧設定部２の可変抵抗ＶＲ２ のみで設定さ
れることになる。逆に、（α２ −α１ ）が負に設定
してあれば、出力電圧Ｖｏｕｔの下限値を設定すること
になる。
とオフセット電圧Ｖｅとの関係をＶｍａｘ＝２Ｖｅに設
定しておけば、入力電圧Ｖｉｎが最高電圧Ｖｍａｘにな
ったとき、２Ｖｅ−Ｖｉｎ＝０になる。したがって、（
α２ −α１ ）が正に設定してあれば、電圧加算部３
の出力電圧Ｖｏｕｔの上限値はα２ ・Ｖｍａｘになる
。すなわち、電圧加算部３の出力電圧Ｖｏｕｔの上限値
は、第２電圧設定部２の可変抵抗ＶＲ２ のみで設定さ
れることになる。逆に、（α２ −α１ ）が負に設定
してあれば、出力電圧Ｖｏｕｔの下限値を設定すること
になる。
【００１９】以上のようにして、出力電圧Ｖｏｕｔの上
限値および下限値を、第１電圧設定部１の可変抵抗ＶＲ
１ と第２電圧設定部２の可変抵抗ＶＲ２ によってそ
れぞれ独立に設定することができるのであって、上限値
および下限値の一方を変更したときに他方に影響を及ぼ
さないようにすることができるのである。上記実施例で
は、入力電圧Ｖｉｎの下限値を０〔Ｖ〕としているが、
入力電圧Ｖｉｎの最低電圧が０〔Ｖ〕ではない場合には
、第２電圧設定部２にその電圧が入力されたときに第２
電圧設定部２の出力が０〔Ｖ〕になるようにオフセット
設定回路を設ければよい。また、従来構成では、入力電
圧の変化範囲の最低電圧に対して出力電圧の下限値が対
応するように構成されていたが、上記構成では、入力電
圧の最低電圧だけではなく最高電圧に対しても出力電圧
の下限値を対応させることができるのであって、使用用
途が広がるのである。
限値および下限値を、第１電圧設定部１の可変抵抗ＶＲ
１ と第２電圧設定部２の可変抵抗ＶＲ２ によってそ
れぞれ独立に設定することができるのであって、上限値
および下限値の一方を変更したときに他方に影響を及ぼ
さないようにすることができるのである。上記実施例で
は、入力電圧Ｖｉｎの下限値を０〔Ｖ〕としているが、
入力電圧Ｖｉｎの最低電圧が０〔Ｖ〕ではない場合には
、第２電圧設定部２にその電圧が入力されたときに第２
電圧設定部２の出力が０〔Ｖ〕になるようにオフセット
設定回路を設ければよい。また、従来構成では、入力電
圧の変化範囲の最低電圧に対して出力電圧の下限値が対
応するように構成されていたが、上記構成では、入力電
圧の最低電圧だけではなく最高電圧に対しても出力電圧
の下限値を対応させることができるのであって、使用用
途が広がるのである。
【００２０】
【発明の効果】本発明は上述のように、第１電圧設定部
は、入力電圧の最高電圧が入力されたときに出力電圧を
０にするから、入力電圧の最高電圧に対する電圧加算部
の出力電圧は第２電圧設定部の出力電圧によって決定さ
れることになる。また、逆に入力電圧の最低電圧が入力
されたときには第２電圧設定部の出力電圧が０になるか
ら、入力電圧の最低電圧に対する電圧加算部の出力電圧
は第１電圧設定部の出力電圧によって決定されることに
なる。その結果、入力電圧の最低電圧および最高電圧に
対する出力電圧は、第１電圧設定部および第２電圧設定
部によってそれぞれ独立して設定されるのであり、一方
を調節しても他方が変化することがないという利点を有
するのである。
は、入力電圧の最高電圧が入力されたときに出力電圧を
０にするから、入力電圧の最高電圧に対する電圧加算部
の出力電圧は第２電圧設定部の出力電圧によって決定さ
れることになる。また、逆に入力電圧の最低電圧が入力
されたときには第２電圧設定部の出力電圧が０になるか
ら、入力電圧の最低電圧に対する電圧加算部の出力電圧
は第１電圧設定部の出力電圧によって決定されることに
なる。その結果、入力電圧の最低電圧および最高電圧に
対する出力電圧は、第１電圧設定部および第２電圧設定
部によってそれぞれ独立して設定されるのであり、一方
を調節しても他方が変化することがないという利点を有
するのである。
【図１】実施例を示す回路図である。
【図２】従来例を示す回路図である。
１ 第１電圧設定部
２ 第２電圧設定部
３ 電圧加算部
ＶＲ１ 可変抵抗
ＶＲ２ 可変抵抗
Claims (1)
- 【請求項１】 入力電圧に比例し入力電圧の変化範囲
の最高電圧が入力されたときに０になる出力電圧が得ら
れるとともに比例定数を設定する第１比例定数設定手段
を備えた第１電圧設定部と、入力電圧に比例し入力電圧
の変化範囲の最低電圧が入力されたときに０になる出力
電圧が得られるとともに比例定数を設定する第２比例定
数設定手段を備えた第２電圧設定部と、第１電圧設定部
および第２電圧設定部の出力電圧を加算した出力電圧が
得られる電圧加算部とを具備して成ることを特徴とする
上下限制限回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3060675A JP2823374B2 (ja) | 1991-03-26 | 1991-03-26 | 上下限制限回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3060675A JP2823374B2 (ja) | 1991-03-26 | 1991-03-26 | 上下限制限回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04295298A true JPH04295298A (ja) | 1992-10-20 |
| JP2823374B2 JP2823374B2 (ja) | 1998-11-11 |
Family
ID=13149135
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3060675A Expired - Lifetime JP2823374B2 (ja) | 1991-03-26 | 1991-03-26 | 上下限制限回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2823374B2 (ja) |
Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4926686A (ja) * | 1972-07-05 | 1974-03-09 | ||
| JPS6166590A (ja) * | 1984-09-04 | 1986-04-05 | Matsushita Electric Ind Co Ltd | Ｖｖｖｆ操作電圧制限装置 |
| JPS6235218U (ja) * | 1985-08-22 | 1987-03-02 | ||
| JPH02104117A (ja) * | 1988-10-13 | 1990-04-17 | Mitsubishi Precision Co Ltd | リミッタ回路 |
| JPH02245901A (ja) * | 1989-03-20 | 1990-10-01 | Noboru Yamaguchi | 制御方法および制御装置 |
-
1991
- 1991-03-26 JP JP3060675A patent/JP2823374B2/ja not_active Expired - Lifetime
Patent Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4926686A (ja) * | 1972-07-05 | 1974-03-09 | ||
| JPS6166590A (ja) * | 1984-09-04 | 1986-04-05 | Matsushita Electric Ind Co Ltd | Ｖｖｖｆ操作電圧制限装置 |
| JPS6235218U (ja) * | 1985-08-22 | 1987-03-02 | ||
| JPH02104117A (ja) * | 1988-10-13 | 1990-04-17 | Mitsubishi Precision Co Ltd | リミッタ回路 |
| JPH02245901A (ja) * | 1989-03-20 | 1990-10-01 | Noboru Yamaguchi | 制御方法および制御装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2823374B2 (ja) | 1998-11-11 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19980818 |