JPH0430421A - 選択メタル成長法 - Google Patents

選択メタル成長法

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JPH0430421A
JPH0430421A JP13416490A JP13416490A JPH0430421A JP H0430421 A JPH0430421 A JP H0430421A JP 13416490 A JP13416490 A JP 13416490A JP 13416490 A JP13416490 A JP 13416490A JP H0430421 A JPH0430421 A JP H0430421A
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JP
Japan
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film
contact hole
side wall
selective
growth
Prior art date
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Pending
Application number
JP13416490A
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English (en)
Inventor
Junichi Sato
淳一 佐藤
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Sony Corp
Original Assignee
Sony Corp
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Publication date
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Publication of JPH0430421A publication Critical patent/JPH0430421A/ja
Pending legal-status Critical Current

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  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、集積回路の電極形成のためのコンタクトホー
ルや、多層配線におけるビヤホール内への選択的メタル
成長法に関する。
〔発明の概要] 本発明は、コンタクトホールやビヤホール内にメタルを
選択的に成長させるに際し、コンタクトホールの側壁に
は選択成長の種となるべき非晶質シリコン膜(以下a−
Si膜という)を形成し、コンタクトホールの底部には
窒化チタン膜(以下TiN膜という)等の耐熱性膜を形
成した後、メタルをコンタクトホール内に選択的に成長
させる選択メタル成長法である。コンタクトホールの側
壁にaSi膜を形成してメタルの選択成長の種とし、か
つ底部の耐熱性膜によって下地の材料との反応を防止す
ることができる。
〔従来の技術] 集積回路の電極形成のコンタクトホールや、多層配線の
ビヤホール内に、メタルを選択的に埋め込んで平坦化を
行う方法が用いられている。コンタクトホール内に選択
的にメタルを埋め込むときの材料として、通常SiH4
還元により、高速でメタルを成長できるタングステン(
以下−という)をコンタクトホール内に選択的に成長さ
せる技術、いわゆる選択W−CVD法が用いられる。す
なわち、最近の高密度集積回路のコンタクトホールの穴
の直径に対する深さ、すなわちアスペクト比がますます
大きくなって来つつあるが、選択W−CVD法はアスペ
クト比に関係なくコンタクトホールを埋め込むため有望
である。
しかし、デバイスに応用した場合、再現性よく、かつリ
ーク電流の少ないオーミックコンタクトを実現すること
が困難になってきている。一つには、下地のシリコンの
表面の拡散層あるいはコンタクト部とシリサイド化反応
を起こして信軌性を低下させるためである。この反応を
防止するために、例えば第2図に示すような耐熱性膜を
有するコンタクトホールの形成方法が提案されていた(
特開平2−16755号公報)。まず、シリコン基板1
の表面にSiO□のような絶縁膜2に、コンタクトホー
ル3を形成する。次に、コンタクトホールの底部4にチ
タンシリサイド膜6(以下Ti5iz膜という)を形成
し、さらにTiN膜7を形成し、その上にタングステン
膜8(以下−膜という)を形成する。
この−膜の上にポリシリコンを全面被着してコンタクト
ホール内のみポリシリコンを残すようにする。
また、第3図に示すような選択成長の種を有するコンタ
クトホールが提案されていた(特開昭62−14173
9号公報)。前述のコンタクトホール形成と同様にして
形成されたコンタクトホール3の側壁5にのみ、ポリシ
リコン膜9を形成し、さらに側壁に一膜8を形成する。
側壁にのみポリシリコン膜やり膜を残すには、異方性エ
ツチング法を用いる。この側壁の讐膜を選択成長の種と
して埋め込み用の−を選択的に成長させることができる
〔発明が解決しようとする課題〕
前述のコンタクトホールの底部に耐熱性膜としてTiN
膜を用いたとき、選択的に埋め込むべき−の選択成長性
が阻害されるおそれがあった。また、ポリシリコンのよ
うな選択成長の種をコンタクトホール内の全面に形成す
れば選択成長は改善されるが、耐熱性を満足することが
できない。
本発明の目的は、選択成長性と耐熱性の向上を同時に満
足するコンタクトホールへのメタルの成長を実現するこ
とにある。
〔課題を解決するための手段〕
前記課題を解決するために、コンタクトホールの側壁に
選択成長の種となるべき膜を形成し、コンタクトホール
の底部に耐熱性膜となるべき膜を形成した後、コンタク
トホール内へメタルを選択的に成長させて埋め込めば、
両者を同時に満足することができる。
〔作用〕
耐熱性膜は、メタルの選択成長を阻害するおそれが大き
いので、側壁にのみ選択成長の種を形成しておけばよい
。そのために、まずコンタクトホール内に選択成長の種
となるべき非晶質シリコン膜(以下a−5t膜という)
を形成し、しかる後、耐熱性膜としてのTiN膜を形成
すれば、側壁に被着したTiN膜は粗であるために、プ
ラズマエツチング法によってエツチングすれば除去され
て、側壁のみにa−Si膜が露出して、胸の選択成長の
種とすることができて、かつ耐熱性の向上をはかること
ができる。
〔実施例〕
本発明の実施例を第1図aないし第1図dを用いて説明
する。
まず、第1図aに示すように、シリコン基板11の表面
に、SiO□等の絶縁膜12を形成して所定寸法のコン
タクトホール13を開口する。しかる後、全面にコンタ
クト抵抗を下げるため、例えば燐(P)をドープしたa
−5i膜16を形成する。また、a−Si膜16の形成
には、高周波バイアス印加によって側壁15のa−3i
膜16を緻密化するために、高周波バイアス印加型EC
Rプラズマ装置を用いるのがよい。
条件として、ソースガスに5iHa/PH3を用い、減
圧下で高周波バイアスパワー300−を印加して、マイ
クロ波パワー800−1磁場の強さ875ガウスのEC
Rプラズマ装置によって形成する。
次に、第1図すに示すように、TtN膜17をa−Si
膜16の上に形成する。形成方法は、高周波バイアスを
印加しないECRプラズマ装置によって形成する。この
ときのソースガスにはTiCl4/NF13を用い、高
周波バイアスを印加しないこと以外は前述の条件と同様
である。
次に、第1図Cに示すように、同じ高周波バイアス印加
型ECRプラズマ装置を用いるか、他のプラズマ装置を
用いるかして、粗の部分のTiN、すなわち側壁のTi
N膜17aをプラズマエツチングによって除去する。ホ
ール底部14と、上面のTiN膜17は、緻密であるた
め、CF4のような弗素主体のプラズマエツチングでは
除去されない。工・ンチング時間は、側壁15の計Si
膜16が除去されない程度の時間内であればよい。
次に、第1図dに示すように、選択IL−CV D法に
よって、−18を形成する。このとき、コンタクトホー
ル底部14のTiN膜17の上にはWlBが成長しにく
いが、側壁15のa−Si膜16を成長の種としてWl
Bが成長するので、コンタクトホール13の中を埋め込
むことができる。この後に、上部のa−5i膜16やT
iN膜17を異方性エツチング法等によって除去して後
、スパッタリング法等によって上部配線を形成すること
ができる。
本発明の実施例においては、シリコン基板上のコンタク
トホールについて説明したが、シリコン以外の化合物半
導体基板上のコンタクトホールあるいはAIのような配
線上の接続のためのビヤホール等においても同様に適用
可能である。
また、コンタクトホール底部に、a−5i膜を残したま
まTiN膜を形成したが、第1図aの状態からa−Si
膜をエッチバックして、側壁のみに残し、底部にはTi
N膜が下地と接するようにすれば、選択−を形成後のア
ニール後に、残ったa−5iと選択−とがシリサイド反
応を起こしてジャンクションリークが増大するような現
象を解決できるので、より望ましい方法である。
〔発明の効果〕
本発明の実施例を用いて選択メタル成長を行えば、コン
タクトホール側壁に選択成長の種を有し、コンタクトホ
ール底部に耐熱性膜を有するので、メタルを埋め込むた
めの選択成長性と耐熱性同上を同時に実現することがで
きる。
【図面の簡単な説明】
第1図aないし第1図dは本発明の選択メタル成長の工
程図、第2図は従来の耐熱性膜を有するコンタクトホー
ルの断面図、第3図は従来の選択成長の種を有するコン
タクトホールの断面図である。 1.11 2.12 3.13 4.14 5.15・・ 16−−−−・−・・ ・−−−−−−シリコン基板 絶縁膜 ・−コンタクトホール ・・・−底部 −・側壁 TiSi2膜 ・−a−Si膜 7.17 TiN 膜 7a 側壁のTiN 膜 一膜 1日 ポリシリコン膜 13コンタクトホーンレ 14底部

Claims (1)

    【特許請求の範囲】
  1.  基板上の絶縁膜にコンタクトホールを開口し、該コン
    タクトホール内に選択的にメタルを成長させる方法にお
    いて、前記コンタクトホールの側壁に選択成長の種とな
    るべき非晶質シリコン膜を形成する工程と、前記コンタ
    クトホールの底部に耐熱性膜を形成する工程と、前記コ
    ンタクトホール内に選択的にメタルを成長させる工程と
    からなる選択メタル成長法。
JP13416490A 1990-05-25 1990-05-25 選択メタル成長法 Pending JPH0430421A (ja)

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