JPH04314182A - 画像処理装置 - Google Patents
画像処理装置Info
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- JPH04314182A JPH04314182A JP7963691A JP7963691A JPH04314182A JP H04314182 A JPH04314182 A JP H04314182A JP 7963691 A JP7963691 A JP 7963691A JP 7963691 A JP7963691 A JP 7963691A JP H04314182 A JPH04314182 A JP H04314182A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は画像処理装置に関し、特
に画像情報を入力し所定の処理を行なつて出力するメモ
リ制御技術に関するものである。
に画像情報を入力し所定の処理を行なつて出力するメモ
リ制御技術に関するものである。
【０００２】
【従来の技術】一般に、コンピユータと周辺機器装置と
の間にはバツフアメモリを設けており、このメモリによ
つてコンピユータと周辺機器の両者の処理速度の差や転
送速度の差を吸収している。周辺機器装置が画像データ
の入力機器及び出力機器では、画像の走査形式がラスタ
ー形式の場合がほとんどを占めている。
の間にはバツフアメモリを設けており、このメモリによ
つてコンピユータと周辺機器の両者の処理速度の差や転
送速度の差を吸収している。周辺機器装置が画像データ
の入力機器及び出力機器では、画像の走査形式がラスタ
ー形式の場合がほとんどを占めている。
【０００３】
【発明が解決しようとしている課題】しかしながら、上
記従来例では、スキヤナ及びプリンタの画像の走査形式
が、一般的なラスター形式ではなく、図２に示すような
形式（以後シヤトル形式と呼ぶ）である場合には、コン
ピユータ側のラスター形式とスキヤナ／プリンタ側のシ
ヤトル形式の間の走査方向の縦横変換と、重複データの
処理が必要となる。
記従来例では、スキヤナ及びプリンタの画像の走査形式
が、一般的なラスター形式ではなく、図２に示すような
形式（以後シヤトル形式と呼ぶ）である場合には、コン
ピユータ側のラスター形式とスキヤナ／プリンタ側のシ
ヤトル形式の間の走査方向の縦横変換と、重複データの
処理が必要となる。
【０００４】以下、シヤトル形式について、詳しく述べ
る。
る。
【０００５】図２において、２０１は原稿または用紙の
１ページを表している。２０２はセンサまたはプリンタ
のヘツドを表し、このヘツド２０１自体は２０４の矢印
で示すラスター方向に移動する。一方ヘツド２０２には
、ラスター方向２０４とは直角な方向にセンサの各画素
もしくはプリンタヘツドのノズルが並んでおり、データ
は２０３の矢印で示す縦方向で流れる。従つて、一回の
ヘツド２０１の移動で２０５で示すメモリのエリアＮｏ
．１の部分がスキヤンまたはプリントされる。このよう
なシヤトル形式では、コンピユータ側で通常扱うラスタ
ー形式のデータにするために、各エリアごとに縦横変換
が必要である。
１ページを表している。２０２はセンサまたはプリンタ
のヘツドを表し、このヘツド２０１自体は２０４の矢印
で示すラスター方向に移動する。一方ヘツド２０２には
、ラスター方向２０４とは直角な方向にセンサの各画素
もしくはプリンタヘツドのノズルが並んでおり、データ
は２０３の矢印で示す縦方向で流れる。従つて、一回の
ヘツド２０１の移動で２０５で示すメモリのエリアＮｏ
．１の部分がスキヤンまたはプリントされる。このよう
なシヤトル形式では、コンピユータ側で通常扱うラスタ
ー形式のデータにするために、各エリアごとに縦横変換
が必要である。
【０００６】さらに、ヘツド２０２のように１ページを
エリアに分けたために、画像処理において、前後のエリ
アの数ラスターラインを必要とする場合が生じる。例え
ば、スムージング処理などで、注目画素の周辺を参照す
る場合に、エリアの上または下の部分では、前または後
のエリアのデータを参照しなくてはならない。このこと
を考慮し、シヤトル形式ではスキヤナからのデータは、
矢印２０３の縦方向に余分に付加され、プリンタへのデ
ータも、プリンタヘツドそのものには重複分のノズルは
ないが、プリンタへ送るデータとしては内部の処理のた
めに矢印２０３の方向に余分にデータを付加しなければ
ならない。従つて、２０６に示されるように、各走査ご
とにデータの重複が生じ、縦横変換もこの大きさの単位
で行なう必要がある。
エリアに分けたために、画像処理において、前後のエリ
アの数ラスターラインを必要とする場合が生じる。例え
ば、スムージング処理などで、注目画素の周辺を参照す
る場合に、エリアの上または下の部分では、前または後
のエリアのデータを参照しなくてはならない。このこと
を考慮し、シヤトル形式ではスキヤナからのデータは、
矢印２０３の縦方向に余分に付加され、プリンタへのデ
ータも、プリンタヘツドそのものには重複分のノズルは
ないが、プリンタへ送るデータとしては内部の処理のた
めに矢印２０３の方向に余分にデータを付加しなければ
ならない。従つて、２０６に示されるように、各走査ご
とにデータの重複が生じ、縦横変換もこの大きさの単位
で行なう必要がある。
【０００７】本発明は、上述した従来例の欠点に鑑みて
なされたものであり、その目的とするところは、シヤト
ル形式のＩ／Ｆを持ち、１回のシヤトルスキヤンの間は
ヘツドを止められない。つまり、データを連続して受け
とる、もしくは供給しなければならないようなスキヤナ
／プリンタ装置と、ホストとなるコンピユータとを接続
するさいに、システム全体のスループツトを向上できる
画像処理装置を提供する点にある。
なされたものであり、その目的とするところは、シヤト
ル形式のＩ／Ｆを持ち、１回のシヤトルスキヤンの間は
ヘツドを止められない。つまり、データを連続して受け
とる、もしくは供給しなければならないようなスキヤナ
／プリンタ装置と、ホストとなるコンピユータとを接続
するさいに、システム全体のスループツトを向上できる
画像処理装置を提供する点にある。
【０００８】
【課題を解決するための手段】上述した課題を解決し、
目的を達成するため、本発明に係る画像処理装置は、デ
ータを記憶する第１の記憶手段と、データを記憶する第
２の記憶手段と、前記第１の記憶手段と前記第２の記憶
手段の内の一方の記憶をラスター形式でデータアクセス
する第１のアクセス手段と、前記第１のアクセス手段と
同時に前記第１のアクセス手段でデータアクセスした記
憶手段とは異なる他方の記憶手段をシヤトル形式でデー
タアクセスする第２のアクセス手段と、前記第１のアク
セス手段と前記第２のアクセス手段でそれぞれデータア
クセスする記憶手段を前記第１の記憶手段と前記第２の
記憶手段間で切り換える切り換え手段とを備えることを
特徴とする。
目的を達成するため、本発明に係る画像処理装置は、デ
ータを記憶する第１の記憶手段と、データを記憶する第
２の記憶手段と、前記第１の記憶手段と前記第２の記憶
手段の内の一方の記憶をラスター形式でデータアクセス
する第１のアクセス手段と、前記第１のアクセス手段と
同時に前記第１のアクセス手段でデータアクセスした記
憶手段とは異なる他方の記憶手段をシヤトル形式でデー
タアクセスする第２のアクセス手段と、前記第１のアク
セス手段と前記第２のアクセス手段でそれぞれデータア
クセスする記憶手段を前記第１の記憶手段と前記第２の
記憶手段間で切り換える切り換え手段とを備えることを
特徴とする。
【０００９】
【作用】かかる構成によれば、第１の記憶手段と第２の
記憶手段はそれぞれデータを記憶し、第１のアクセス手
段は第１の記憶手段と第２の記憶手段の内の一方の記憶
手段をラスター形式でデータアクセスし、第２のアクセ
ス手段は第１のアクセス手段と同時に第１のアクセス手
段でデータアクセスした記憶手段とは異なる他方の記憶
手段をシヤトル形式でデータアクセスし、切り換え手段
は第１のアクセス手段と第２のアクセス手段でそれぞれ
データアクセスする記憶手段を第１の記憶手段と第２の
記憶手段間で切り換える。
記憶手段はそれぞれデータを記憶し、第１のアクセス手
段は第１の記憶手段と第２の記憶手段の内の一方の記憶
手段をラスター形式でデータアクセスし、第２のアクセ
ス手段は第１のアクセス手段と同時に第１のアクセス手
段でデータアクセスした記憶手段とは異なる他方の記憶
手段をシヤトル形式でデータアクセスし、切り換え手段
は第１のアクセス手段と第２のアクセス手段でそれぞれ
データアクセスする記憶手段を第１の記憶手段と第２の
記憶手段間で切り換える。
【００１０】
【実施例】以下に添付図面を参照して、本発明の好適な
実施例を詳細に説明する。
実施例を詳細に説明する。
【００１１】図１は本発明に係る画像処理装置の一実施
例を示すブロツク図である。同図において、１は本実施
例の画像処理装置を示し、１０９，１１０は本装置１と
接続されたホストコンピユータ、スキヤナ／プリンタ装
置をそれぞれ示している。本装置１において、１１１は
データバス、１１２はアドレスバス、１０６は本装置全
体の制御を行うＣＰＵをそれぞれ示している。１００Ａ
はバツフアメモリで、１０１のメインブロツクと１０２
のサブブロツクとを有している。１００Ｂもまたバツフ
アメモリで、１０３のメインメモリと１０４のサブメモ
リとを有している。１０５はデータバス１１１及びアド
レスバス１１２のためのセレクタであり、ＣＰＵ１０６
の指示によつて２組のバツフアメモリ１００Ａ（１０１
と１０２），１００Ｂ（１０３と１０４）それぞれのブ
ロツク（全部で４つ）へのバスをＣＰＵ側またはビデオ
側に切替える。ＣＰＵ側は、ラスター形式のホストコン
ピユータ１０９側であり、ビデオ側はシヤトル形式のス
キヤナ／プリンタ装置１１０側である。また１０７はホ
ストコンピユータ１０９との通信を行う外部Ｉ／Ｆ（イ
ンターフェース）、１０８はスキヤナ／プリンタ装置１
１０との通信を行うビデオＩ／Ｆをそれぞれ示している
。１２１はＲＯＭで、ＣＰＵ１０６が動作するためのプ
ログラムである図６のフローチヤートに従うプログラム
等を格納している。１２２はＲＡＭで、ＲＯＭ１２１の
プログラムのワークエリアとして機能する。
例を示すブロツク図である。同図において、１は本実施
例の画像処理装置を示し、１０９，１１０は本装置１と
接続されたホストコンピユータ、スキヤナ／プリンタ装
置をそれぞれ示している。本装置１において、１１１は
データバス、１１２はアドレスバス、１０６は本装置全
体の制御を行うＣＰＵをそれぞれ示している。１００Ａ
はバツフアメモリで、１０１のメインブロツクと１０２
のサブブロツクとを有している。１００Ｂもまたバツフ
アメモリで、１０３のメインメモリと１０４のサブメモ
リとを有している。１０５はデータバス１１１及びアド
レスバス１１２のためのセレクタであり、ＣＰＵ１０６
の指示によつて２組のバツフアメモリ１００Ａ（１０１
と１０２），１００Ｂ（１０３と１０４）それぞれのブ
ロツク（全部で４つ）へのバスをＣＰＵ側またはビデオ
側に切替える。ＣＰＵ側は、ラスター形式のホストコン
ピユータ１０９側であり、ビデオ側はシヤトル形式のス
キヤナ／プリンタ装置１１０側である。また１０７はホ
ストコンピユータ１０９との通信を行う外部Ｉ／Ｆ（イ
ンターフェース）、１０８はスキヤナ／プリンタ装置１
１０との通信を行うビデオＩ／Ｆをそれぞれ示している
。１２１はＲＯＭで、ＣＰＵ１０６が動作するためのプ
ログラムである図６のフローチヤートに従うプログラム
等を格納している。１２２はＲＡＭで、ＲＯＭ１２１の
プログラムのワークエリアとして機能する。
【００１２】以上の構成にかかる動作を説明する。
【００１３】図６は本実施例の画像処理動作を説明する
フローチヤートである。
フローチヤートである。
【００１４】まず、スキヤン時において、ＣＰＵ１０６
は、ビデオＩ／Ｆ１０８がバツフアメモリ１００Ｂのメ
インブロツク１０３とサブブロツク１０４とをアクセス
できように設定し（ステツプＳ１）、ＣＰＵ１０６自身
がバツフアメモリ１００Ａのメインブロツク１０１とサ
ブブロツク１０２とをアクセスできるように設定する（
ステツプＳ２）。次に、本装置１に対してスキヤナ／プ
リンタ装置１１０のスキヤナ部より画像データがシヤト
ル形式で送られる。ビデオＩ／Ｆ１０８は、アドレスを
発生させ、送られた画像データをメモリブロツク１０３
及びサブブロツク１０４にシヤトル形式で書き込む（ス
テツプＳ３）。これと同時に、この動作の前の動作で既
にビデオＩ／Ｆ１０８によつてデータの書き込まれてい
るメインブロツク１０１からＣＰＵ１０６がデータをラ
スター形式で読み出し、外部Ｉ／Ｆ１０７へ転送する。 この外部Ｉ／Ｆ１０７は例えばＳＣＳＩなどであつて、
ホストコンピユータ１０９へ画像が転送される（ステツ
プＳ４）。このときサブブロツク１０２のデータは捨て
られている。
は、ビデオＩ／Ｆ１０８がバツフアメモリ１００Ｂのメ
インブロツク１０３とサブブロツク１０４とをアクセス
できように設定し（ステツプＳ１）、ＣＰＵ１０６自身
がバツフアメモリ１００Ａのメインブロツク１０１とサ
ブブロツク１０２とをアクセスできるように設定する（
ステツプＳ２）。次に、本装置１に対してスキヤナ／プ
リンタ装置１１０のスキヤナ部より画像データがシヤト
ル形式で送られる。ビデオＩ／Ｆ１０８は、アドレスを
発生させ、送られた画像データをメモリブロツク１０３
及びサブブロツク１０４にシヤトル形式で書き込む（ス
テツプＳ３）。これと同時に、この動作の前の動作で既
にビデオＩ／Ｆ１０８によつてデータの書き込まれてい
るメインブロツク１０１からＣＰＵ１０６がデータをラ
スター形式で読み出し、外部Ｉ／Ｆ１０７へ転送する。 この外部Ｉ／Ｆ１０７は例えばＳＣＳＩなどであつて、
ホストコンピユータ１０９へ画像が転送される（ステツ
プＳ４）。このときサブブロツク１０２のデータは捨て
られている。
【００１５】次に、セレクタ１０５において、先ほどと
は反対に、ＣＰＵ１０６は、ビデオＩ／Ｆ１０８がメイ
ンメモリ１０１とサブメモリ１０２とをアクセスできる
ように設定し（ステツプＳ５）、ＣＰＵ自身がメインメ
モリ１０３とサブメモリ１０４をアクセスできるように
設定する（ステツプＳ６）。前の動作で既に書き込まれ
たメインブロツク１０３からＣＰＵ１０６はデータをラ
スター形式で読み出し、外部Ｉ／Ｆ１０７を介してホス
トコンピユータ１０９にデータを送る（ステツプＳ７）
。これと同時にバツフアメモリ１００Ａにはスキヤナ／
プリンタ装置１１０のスキヤナ部よりのデータがビデオ
Ｉ／Ｆ１０８によつてシヤトル形式で書き込まれる（ス
テツプＳ８）。これらの動作を繰り返す（ステツプＳ９
）。
は反対に、ＣＰＵ１０６は、ビデオＩ／Ｆ１０８がメイ
ンメモリ１０１とサブメモリ１０２とをアクセスできる
ように設定し（ステツプＳ５）、ＣＰＵ自身がメインメ
モリ１０３とサブメモリ１０４をアクセスできるように
設定する（ステツプＳ６）。前の動作で既に書き込まれ
たメインブロツク１０３からＣＰＵ１０６はデータをラ
スター形式で読み出し、外部Ｉ／Ｆ１０７を介してホス
トコンピユータ１０９にデータを送る（ステツプＳ７）
。これと同時にバツフアメモリ１００Ａにはスキヤナ／
プリンタ装置１１０のスキヤナ部よりのデータがビデオ
Ｉ／Ｆ１０８によつてシヤトル形式で書き込まれる（ス
テツプＳ８）。これらの動作を繰り返す（ステツプＳ９
）。
【００１６】またプリント時の動作は、上述のスキヤン
時と類似した動作であるため、説明を省略するが、重複
データの処理の分だけ若干複雑な動作をする。
時と類似した動作であるため、説明を省略するが、重複
データの処理の分だけ若干複雑な動作をする。
【００１７】図３は本実施例によるプリント時のバツフ
アメモリへのアクセスの４つの状態を示した図であり、
詳細は後述するが、図中の４つの状態（１），（２），
（３），（４）を繰り返すことでダブルバツフアリング
による動作が可能となる。
アメモリへのアクセスの４つの状態を示した図であり、
詳細は後述するが、図中の４つの状態（１），（２），
（３），（４）を繰り返すことでダブルバツフアリング
による動作が可能となる。
【００１８】図４は本実施例のバツフアメモリの構成を
示す図である。
示す図である。
【００１９】メインブロツク１０１と１０３はそれぞれ
図２で示したメモリ２０５の大きさになつている。また
サブブロツク１０２，１０４は、重複データのためのメ
モリ部分であり、図２の２０６で示されるように、メイ
ンブロツクと合わせて重複データを含んだエリアを構成
する。
図２で示したメモリ２０５の大きさになつている。また
サブブロツク１０２，１０４は、重複データのためのメ
モリ部分であり、図２の２０６で示されるように、メイ
ンブロツクと合わせて重複データを含んだエリアを構成
する。
【００２０】バツフアメモリ１００Ａにおいて、メイン
ブロツク１０１は、図４に示されるように、Ａ−Ｍ１と
Ａ−Ｍ２とのエリアに分けられる。このＡ−Ｍ１はサブ
ブロツク１０２、すなわちＡ−Ｓと同じ大きさである。 これはバツフアメモリ１００Ｂにつていも同様である。
ブロツク１０１は、図４に示されるように、Ａ−Ｍ１と
Ａ−Ｍ２とのエリアに分けられる。このＡ−Ｍ１はサブ
ブロツク１０２、すなわちＡ−Ｓと同じ大きさである。 これはバツフアメモリ１００Ｂにつていも同様である。
【００２１】ここで図３を使つて動作を説明する。
（１）の状態では、Ａ−Ｓ（サブブロツク１０２）の内
容をＢ−Ｍ１（メインブロツク１０３）へ複写する。次
の（２）の状態では、上述の（１）で複写されたつづき
、すなわち、Ｂ−Ｍ２（メインメモリ１０３）にＣＰＵ
１０６からのデータをラスター形式で書き込む。つづい
て、Ｂ−Ｓ（サブブロツク１０４）にもラスター形式で
書き込む。これらと同時進行でバツフアメモリ１００Ａ
の内容をビデオＩ／Ｆ１０８がシヤトル形式で読み出す
。
容をＢ−Ｍ１（メインブロツク１０３）へ複写する。次
の（２）の状態では、上述の（１）で複写されたつづき
、すなわち、Ｂ−Ｍ２（メインメモリ１０３）にＣＰＵ
１０６からのデータをラスター形式で書き込む。つづい
て、Ｂ−Ｓ（サブブロツク１０４）にもラスター形式で
書き込む。これらと同時進行でバツフアメモリ１００Ａ
の内容をビデオＩ／Ｆ１０８がシヤトル形式で読み出す
。
【００２２】続く（３）の状態では、Ｂ−Ｓ（サブブロ
ツク１０４）のデータをＡ−Ｍ１（メインメモリ１０１
）に複写する。次に、（４）の状態では、Ａ−Ｍ１（メ
インメモリ１０１）のつづきＡ−Ｍ２（メインメモリ１
０１）へＣＰＵ１０６からラスター形式のデータが書き
込まれ、Ａ−Ｓ（サブメモリ１０２）にもそのつづきが
書き込まれる。これと同時進行でバツフアメモリ１００
ＢのデータはビデオＩ／Ｆ１０８によつてシヤトル形式
で読み出される。そして（１）の状態に戻り、以下これ
らの４つの状態を順に繰り返す。これらの４つの状態の
それぞれは、図１のＣＰＵ１０６がセレクタ１０５を設
定することで行なわれる。状態（１）ではサブブロツク
１０２とメインブロツク１０３に対して、ＣＰＵ１０６
からのデータバス、アドレスバスが接続される。状態（
２）では、バツフアメモリ１００Ａはメイン、サブの両
ブロツクともビデオＩ／Ｆ１０８側に、バツフアメモリ
１００Ｂのメイン、サブの両ブロツクはＣＰＵ１０６側
に接続される。状態（３）では、メインブロツク１０１
とサブブロツク１０４がＣＰＵ１０６側に接続される。 状態（４）では、バツフアメモリ１００ＡはＣＰＵ１０
６側に、バツフアメモリ１００ＢはビデオＩ／Ｆ１０８
側に接続される。
ツク１０４）のデータをＡ−Ｍ１（メインメモリ１０１
）に複写する。次に、（４）の状態では、Ａ−Ｍ１（メ
インメモリ１０１）のつづきＡ−Ｍ２（メインメモリ１
０１）へＣＰＵ１０６からラスター形式のデータが書き
込まれ、Ａ−Ｓ（サブメモリ１０２）にもそのつづきが
書き込まれる。これと同時進行でバツフアメモリ１００
ＢのデータはビデオＩ／Ｆ１０８によつてシヤトル形式
で読み出される。そして（１）の状態に戻り、以下これ
らの４つの状態を順に繰り返す。これらの４つの状態の
それぞれは、図１のＣＰＵ１０６がセレクタ１０５を設
定することで行なわれる。状態（１）ではサブブロツク
１０２とメインブロツク１０３に対して、ＣＰＵ１０６
からのデータバス、アドレスバスが接続される。状態（
２）では、バツフアメモリ１００Ａはメイン、サブの両
ブロツクともビデオＩ／Ｆ１０８側に、バツフアメモリ
１００Ｂのメイン、サブの両ブロツクはＣＰＵ１０６側
に接続される。状態（３）では、メインブロツク１０１
とサブブロツク１０４がＣＰＵ１０６側に接続される。 状態（４）では、バツフアメモリ１００ＡはＣＰＵ１０
６側に、バツフアメモリ１００ＢはビデオＩ／Ｆ１０８
側に接続される。
【００２３】図５は本実施例によるバツフアメモリの構
成を示す外観斜視図である。
成を示す外観斜視図である。
【００２４】バツフアメモリの構成は、アドレスの与え
方のみで縦横変換を行なうために、１画素はＲ，Ｇ，Ｂ
またはＣ，Ｍ，Ｙ，Ｋの各色８ビツト、すなわち３２ビ
ツトで構成される。そして、例えば、図４のブロツク１
０１と１０２に示すように、ラスター方向に４０９６画
素、縦方向は１２８画素と１６画素のように構成する。 このときの４０９６は４００ｄｐｉでＡ４サイズの短い
方向の画素数を越えて、切りの良い値であり、１２８は
プリンタヘツドのノズルの数であり、１６は画像処理の
ための重複データに相当する。このバツフアメモリをＤ
ＲＡＭで具体的に構成するには、図５に示すように、４
ビツトタイプの１ＭのＤＲＡＭ（２５６Ｋビツト×４ビ
ツト）を１６個でメインブロツクを構成し、４ビツトタ
イプの２５６ＫのＤＲＡＭ（６４Ｋビツト×４ビツト）
を８個でサブブロツクを構成するようにする。
方のみで縦横変換を行なうために、１画素はＲ，Ｇ，Ｂ
またはＣ，Ｍ，Ｙ，Ｋの各色８ビツト、すなわち３２ビ
ツトで構成される。そして、例えば、図４のブロツク１
０１と１０２に示すように、ラスター方向に４０９６画
素、縦方向は１２８画素と１６画素のように構成する。 このときの４０９６は４００ｄｐｉでＡ４サイズの短い
方向の画素数を越えて、切りの良い値であり、１２８は
プリンタヘツドのノズルの数であり、１６は画像処理の
ための重複データに相当する。このバツフアメモリをＤ
ＲＡＭで具体的に構成するには、図５に示すように、４
ビツトタイプの１ＭのＤＲＡＭ（２５６Ｋビツト×４ビ
ツト）を１６個でメインブロツクを構成し、４ビツトタ
イプの２５６ＫのＤＲＡＭ（６４Ｋビツト×４ビツト）
を８個でサブブロツクを構成するようにする。
【００２５】以上説明したように、本実施例によれば、
ラスター形式とシヤトル形式の縦横変換と、重複データ
の処理を、バブルバツフアリングで行うことができ、ホ
ストコンピユータからは特殊な形式を意識せずにスキヤ
ナ／プリンタを使用できる。さて、上述した実施例では
、カラー画像の場合を示したが、白黒画像でも同様であ
り、この場合には１画素は３２ビツトではなく８ビツト
で構成される。
ラスター形式とシヤトル形式の縦横変換と、重複データ
の処理を、バブルバツフアリングで行うことができ、ホ
ストコンピユータからは特殊な形式を意識せずにスキヤ
ナ／プリンタを使用できる。さて、上述した実施例では
、カラー画像の場合を示したが、白黒画像でも同様であ
り、この場合には１画素は３２ビツトではなく８ビツト
で構成される。
【００２６】また、４０９６×（１２８＋１６）という
バツフアメモリの大きさは１２８ノズルのヘツドとＡ４
で４００ｄｐｉといつたスペツクによるもので、当然シ
ステムの解像度や用紙サイズや、ヘツドのノズルの数に
よつて、異なった大きさのメモリ構成を得る。
バツフアメモリの大きさは１２８ノズルのヘツドとＡ４
で４００ｄｐｉといつたスペツクによるもので、当然シ
ステムの解像度や用紙サイズや、ヘツドのノズルの数に
よつて、異なった大きさのメモリ構成を得る。
【００２７】尚、本発明は、複数の機器から構成される
システムに適用しても、１つの機器から成る装置に適用
しても良い。また、本発明はシステム或は装置にプログ
ラムを供給することによつて達成される場合にも適用で
きることは言うまでもない。
システムに適用しても、１つの機器から成る装置に適用
しても良い。また、本発明はシステム或は装置にプログ
ラムを供給することによつて達成される場合にも適用で
きることは言うまでもない。
【００２８】
【発明の効果】以上説明したように、本発明によれば、
ラスター形式とシヤトル形式の縦横変換と、重複データ
の処理を、バブルバツフアリングで行うことができ、ホ
ストコンピユータからは特殊な形式を意識せずにスキヤ
ナ／プリンタを使用できる。
ラスター形式とシヤトル形式の縦横変換と、重複データ
の処理を、バブルバツフアリングで行うことができ、ホ
ストコンピユータからは特殊な形式を意識せずにスキヤ
ナ／プリンタを使用できる。
【図１】本発明に係る画像処理装置の一実施例を示すブ
ロツク図である。
ロツク図である。
【図２】一般的なシヤトル形式を説明する図である。
【図３】本実施例によるプリント時のバツフアメモリへ
のアクセスの４つの状態を示した図である。
のアクセスの４つの状態を示した図である。
【図４】本実施例のバツフアメモリの構成を示す図であ
る。
る。
【図５】本実施例によるバツフアメモリの構成を示す外
観斜視図である。
観斜視図である。
【図６】本実施例の画像処理動作を説明するフローチヤ
ートである。
ートである。
１０１，１０３ メインブロツク
１０２，１０４ サブブロツク
１０５ セレクタ
１０６ ＣＰＵ
１０７ 外部Ｉ／Ｆ
１０８ ビデオＩ／Ｆ
１０９ ホストコンピユータ
１１０ スキヤナ／プリンタ
１１１ データバス
１１２ アドレスバス
１２１ ＲＯＭ
１２２ ＲＡＭ
Claims (1)
- 【請求項１】データを記憶する第１の記憶手段と、デー
タを記憶する第２の記憶手段と、前記第１の記憶手段と
前記第２の記憶手段の内の一方の記憶をラスター形式で
データアクセスする第１のアクセス手段と、前記第１の
アクセス手段と同時に前記第１のアクセス手段でデータ
アクセスした記憶手段とは異なる他方の記憶手段をシヤ
トル形式でデータアクセスする第２のアクセス手段と、
前記第１のアクセス手段と前記第２のアクセス手段でそ
れぞれデータアクセスする記憶手段を前記第１の記憶手
段と前記第２の記憶手段間で切り換える切り換え手段と
を備えることを特徴とする画像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7963691A JPH04314182A (ja) | 1991-04-12 | 1991-04-12 | 画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7963691A JPH04314182A (ja) | 1991-04-12 | 1991-04-12 | 画像処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04314182A true JPH04314182A (ja) | 1992-11-05 |
Family
ID=13695582
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7963691A Withdrawn JPH04314182A (ja) | 1991-04-12 | 1991-04-12 | 画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04314182A (ja) |
-
1991
- 1991-04-12 JP JP7963691A patent/JPH04314182A/ja not_active Withdrawn
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19980711 |