JPH04315281A - ホット−プラグ回路 - Google Patents

ホット−プラグ回路

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JPH04315281A
JPH04315281A JP3337904A JP33790491A JPH04315281A JP H04315281 A JPH04315281 A JP H04315281A JP 3337904 A JP3337904 A JP 3337904A JP 33790491 A JP33790491 A JP 33790491A JP H04315281 A JPH04315281 A JP H04315281A
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card
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Pierre Austruy
ピエール・オーストリ
Jean-Paul Conjeaud
ジャン・ポール・コンジォー
Patrick Massi
パトリック・マシー
Christian Jacquart
クリスティアン・ジャカール
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    • H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
    • H02H9/00—Emergency protective circuit arrangements for limiting excess current or voltage without disconnection
    • H02H9/001—Emergency protective circuit arrangements for limiting excess current or voltage without disconnection limiting speed of change of electric quantities, e.g. soft switching on or off
    • H02H9/004—Emergency protective circuit arrangements for limiting excess current or voltage without disconnection limiting speed of change of electric quantities, e.g. soft switching on or off in connection with live-insertion of plug-in units
    • Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
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  • Coupling Device And Connection With Printed Circuit (AREA)
  • Power Sources (AREA)
  • Mounting Of Printed Circuit Boards And The Like (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明はカードのボードへの相互
接続に関し、更に詳しくは、カードがこれらのカードの
内の１つ上に、もしくはボード上に配置された共通電源
からパワー供給されるときに、ボードへのカード挿入が
ホット−プラグ・モードで達成されることを保証する回
路に関する。
【０００２】
【従来の技術】カードのボードに対する挿抜は、カード
自身に固有の電源が提供されておらずに共通電源からパ
ワー供給される際には問題を引き起こす。なぜなら、カ
ードが挿入されると、既存のカード上に配置された回路
動作に傷害を及ぼすサージ電流が発生するからである。
【０００３】従来、異なるピン長を有するコネクタを使
用することにより、カードが挿入される際に、カード上
に配列された回路によって要求される異なる電圧レベル
の印加に関する正しいシーケンスを提供する方法が知ら
れている。
【０００４】こうした機構は米国特許第３９９３９３５
号及び　ＩＢＭ　Ｔｅｃｈｎｉｃａｌ　Ｄｉｓｃｌｏｓ
ｕｒｅＢｕｌｌｅｔｉｎ　Ｖｏｌｕｍｅ　３１、Ｎ゜６
−Ｎｏｖｅｍｂｅｒ　６、１９８８　ｐａｇｅ　１２５
で述べられている。
【０００５】図１はカードが挿入される際に発生するサ
ージ電流問題を解決する従来方法を示す。
【０００６】図１はマスタ・カードと称されるカード１
を示す。なぜなら、これはカード１に挿入可能なカード
３などに対して、例えばボードとコネクタで構成される
接続機構を通じて電圧を供給する電源装置２を含むから
である。電源２は接続機構４の端子５に第１の電圧を、
２つの端子６−１及び６−２に第２の電圧を供給する。 ここで第１の電圧をグランド電圧、また第２の電圧を正
の供給電圧＋Ｖと仮定する。
【０００７】単純化のために供給電圧＋Ｖだけが図１に
示されているが、カード上に配置される回路の動作に依
存して、いくつかの異なる供給電圧が要求される場合も
ある。
【０００８】カード３はオス側コネクタ７により接続機
構４に接続される。同コネクタはグランド・ピン８と２
つの電圧ピン９−１及び９−２を含み、これらは端子５
、６−１及び６−２にそれぞれ挿入される。コネクタ７
が接続機構４に挿入されると、グランド電圧及びＶ電圧
がピン８、ピン９−２及びライン１０、１１を通じて与
えられ、カード３上の回路をバイアスする。デカップリ
ング・キャパシタＣｄはライン１０と１１の間に配置さ
れ、カード３上の回路にグランドとＶ電圧を提供する。
【０００９】カードが挿入される際に発生するデカップ
リング・キャパシタＣｄのチャージによるサージ電流Ｉ
により引き起こされる問題の解決のために、抵抗値ｒの
抵抗Ｒがサージ電流Ｉを許容値に制限する。
【００１０】抵抗値ｒは電圧Ｖ及び許容されるサージ電
流値とに依存する。キャパシタＣｄのチャージ時定数τ
は、コネクタ仕様に依存する電圧Ｖのロングピン９−１
への印加と電圧Ｖのショートピン９−２への印加の間の
時間差と比較して小さくなければならない。キャパシタ
Ｃｄのキャパシタンスが小さいときは、上述の制限に合
致する抵抗値ｒを見いだすことができる。しかし、キャ
パシタンスＣｄが大きいときは問題が生ずる。
【００１１】
【発明が解決しようとする課題】本発明の目的はカード
のボードへの或いはボードからの挿抜を、ボードに既に
挿入されているカードの動作に悪影響を及ぼすことなく
効率的に達成する回路を提供することである。
【００１２】本発明の別の目的は、カードを組み込んだ
システムの同時メンテナンスを実現する回路を提供する
ことである。
【００１３】
【課題を解決するための手段】本発明によるホット−プ
ラグ回路は、電源供給装置により第１の供給ライン上に
第１の供給電圧（グランド）を、また第２の供給ライン
上に第２の供給電圧（＋Ｖ）を供給される第１のカード
上に配置される第１の回路手段の相互接続時に発生する
サージ電流を制限するものであり、第２のカード上の第
２の回路手段は第３及び第４の供給ラインを通じて電源
供給装置によりパワー供給される。その際、カードが相
互接続機構を通じて相互接続されるときに、前記サージ
電流は第２のカード上の第３及び第４の供給ライン間に
配置されるキャパシタンスＣｄなるデカップリング・キ
ャパシタのチャージに起因する。
【００１４】この回路は第１及び第２の供給ラインに接
続される制御ランプ（ｒａｍｐ）生成手段を含む点に特
徴があり、これは第１及び第３の供給ライン間の相互接
続が接続機構を通じて完了した際に活動化され、第４の
供給ライン上に第１及び第２の供給ライン上の電圧に由
来する第１のランプ電圧Ｖｂの生成を開始する。このラ
ンプ電圧は調整可能スロープａ＝ｄＶｂ／ｄｔを有し、
ここでサージ電流ｉはａ．Ｃｄとなり、スロープ値ａを
調整することにより目標値に制限される。
【００１５】本発明の実施例では、相互接続機構は第１
の供給ラインに接続される第１及び第２の供給ピンを有
する第１のコネクタを含み、第１のピンは第２のピンよ
りも長く、また第１のピンはカードが完全に相互接続さ
れる以前に第３の供給ラインに接続可能であり、第１の
電圧を第２の回路手段に供給する。第２のカードは第１
及び第２のカードの相互接続が完了したときに第２の供
給ピンに接続可能な存在指示ラインを含み、この存在指
示ライン上に第１の供給電圧に由来する第１の制御信号
を生成する。この制御信号は制御ランプ生成制御手段に
供給され、第１のランプ電圧の生成を開始する。
【００１６】更に、第１のコネクタの第１及び第２の供
給ピンは同コネクタの第１の終端に配置され、同コネク
タの第２の終端には第３の供給ピンを含む。相互接続機
構は第２のカード上に位置する第２のコネクタを含み、
この第２のコネクタは第１及び第２のカードが相互接続
機構を介して相互接続されるときに、第１、第２及び第
３のピンにそれぞれ接続可能な第４、第５及び第６のピ
ンとを含み、第２のカード上の第５と第６のピン間にあ
る存在指示ラインが接続される。第３及び第６のピンが
接続されるときに、第１の制御信号がこの存在指示ライ
ンから制御ランプ生成手段に供給され、カードが傾いて
挿入されて第１及び第２の回路手段の動作を乱すことを
回避する。
【００１７】
【実施例】本発明は異なるカード上に配置された回路ア
センブリが動作して信号及びデータを交換できるような
相互接続に関する。更に詳しくは、本発明は電源装置以
降マスタ・カードと称するカードの１つに登載されると
きに、相互接続がホット−プラグ・モードで達成され、
マスタ・カード上に回路アセンブリが登載されている場
合には供給電圧及び電流をこの回路アセンブリに供給し
、また接続機構を介してマスタ・カードに挿抜される以
降スレーブと称されるカード上に登載される回路アセン
ブリに供給する回路に関する。
【００１８】接続機構はコネクタ、電源装置から供給電
圧を提供するためのパワー・ライン、及びデータ或いは
信号の転送ラインからなる。
【００１９】本発明によるホット−プラグ回路は各カー
ドに関係し、本発明の特定の実施例によりマスタ・カー
ド或いはスレーブ・カードの一方に配置され、デカップ
リング・キャパシタの値に係わらずに、スレーブ・カー
ドの挿抜がマスタ・カード及び既に挿入されているスレ
ーブ・カード上の回路アセンブリの動作を乱すことを回
避する。
【００２０】図１は従来技術の項で述べたように、従来
技術による問題解決方法を示し、図２は本発明によるホ
ット−プラグ回路の第１の実施例を示す。図１及び図２
で同一の参照番号が同一の要素を表すために使用されて
いる。
【００２１】マスタ・カード１はエッジ・コネクタ１４
を介してボード１２に挿入される。エッジ・コネクタ１
４はマスタ・カード上のオス部１４−Ｍ、及びボード１
２上のメス部１４−Ｆとからなる。電源装置２はマスタ
・カード１上に配置されている。
【００２２】３−１及び３−２等のスレーブ・カードは
ボードのもう一方側のコネクタ２０及び２２を介してボ
ード１２に挿入される。これらのコネクタはボード１２
上のメス部２０−Ｆ及び２２−Ｆとカード上のオス部２
０−Ｍ及び２２−Ｍとからなる。
【００２３】明らかにカード及びボードに関するコネク
タのオス部とメス部の配置は互いに対向する。
【００２４】スレーブ・カード３−１及び３−２上の回
路アセンブリ２４及び２６は、例えばロジック回路アセ
ンブリ等の何れのタイプでもよく、マスタ・カード１上
の電源装置２からパワー供給される。図２に示されるよ
うに、ロジック回路アセンブリ３０はマスタ・カード１
上にも配置されてパワー装置２によりパワー供給され、
カードがコネクタ２０及び２２により挿入されると、本
発明の応用例に依存してデータ或いは何れかのタイプの
信号を運搬するバス３２を介してロジック回路アセンブ
リ２４及び２６と相互接続される。明瞭化のために、回
路アセンブリ２４、２６及び３０は電源回路２からライ
ン３４上に電圧Ｖのみを、またライン３６上にグランド
電圧を供給されるものとする。
【００２５】コネクタ１４のオス部は、コネクタ２０及
び２２のオス部２０−Ｍ及び２２−Ｍの対応するピンと
関連して、２セットのピンが備えられている。
【００２６】コネクタ１４のオス部の第１のセットのピ
ンはサフィックスＰ（ＰはＰｉｎを意味する）を伴う偶
数番号４０から４８により参照され、第２のセットのピ
ンは同様にサフィックスＰを伴う奇数番号４１から４９
により参照される。
【００２７】コネクタ１４のメス部はサフィックスＴを
伴う同一番号で参照される対応する端子で構成される。 ここでＴは端子（Ｔｅｒｍｉｎａｌ）を表す。
【００２８】コネクタ２０のメス部２０−Ｆの端子は５
０−Ｔから５８−Ｔの偶数参照番号を有し、端子５０−
Ｔから５８−Ｔは端子４０−Ｔから４８−Ｔにそれぞれ
接続される。
【００２９】コネクタ２２のメス部２２−Ｆの端子は５
１−Ｔから５９−Ｔの奇数参照番号を有し、端子５１−
Ｔから５９−Ｔは端子４１−Ｔから４９−Ｔにそれぞれ
接続される。
【００３０】オス部２２−Ｍは奇数番号ピン５１−Ｐか
ら５９−Ｐ及び偶数番号ピン５０−Ｐから５８−Ｐとに
より構成され、これらはそれぞれ対応する端子５１−Ｔ
から５９−Ｔ及び５０−Ｔから５８−Ｔに挿入される。
【００３１】電源装置２からのグランド・ライン３６は
第１のセットのピン４０−Ｐ及び４８−Ｐ、及び第２の
セットの４１−Ｐ及び４９−Ｐに接続される。Ｖ電圧ラ
イン３４は抵抗６０及びライン３５を介してピン４６−
Ｐに接続され、抵抗６１及びライン３７を介してピン４
７−Ｐに接続される。データ・ライン３２は対応するピ
ン４２−Ｐ及び４３−Ｐに接続される。本発明ではピン
４４−Ｐ及び４５−Ｐはホット−プラグ回路６２及び６
３の出力ライン６４及び６５にそれぞれ接続される。ス
レーブ・カード１枚につきホット−プラグ回路が１つ存
在する。
【００３２】本発明の実施例では、コネクタ２０及び２
２のピン５６−Ｐ、５８−Ｐ及び５７−Ｐ、５９−Ｐは
、ピン５０−Ｐ、５２−Ｐ、５４−Ｐ及びピン５１−Ｐ
、５３−Ｐ、５５−Ｐよりもそれぞれ短い。
【００３３】３−１及び３−２等の各スレーブ・カード
上において、ピン５８−Ｐ及び５６−Ｐ、５１−Ｐ及び
５７−Ｐはコネクタ部２０−Ｍ及び２２−Ｍの反対側の
終端にそれぞれ位置し、スレーブ・カードが傾いて挿入
されることにより正常な動作が乱されることを回避する
。
【００３４】ピン５８−Ｐはピン５６−Ｐに、またピン
５７−Ｐは５９−Ｐにそれぞれワイヤ７０及び７１を介
して接続される。
【００３５】カード３−１上のロジック回路２４はピン
５０−Ｐに接続されるグランド・ライン７４、及びピン
５４−Ｐに接続される電圧ライン７６間に配置されるデ
カップリング・キャパシタＣｄを含む。
【００３６】カード３−２上のロジック回路２６はピン
５１−Ｐに接続されるグランド・ライン７５、及びピン
５５−Ｐに接続される電圧ライン７７間に配置されるデ
カップリング・キャパシタＣｄを含む。
【００３７】例えば、カード３−２がボードに挿入され
ると、最初にライン３６及び７４間で接触が起こるが、
ロジック回路２６は後に図３を参照して説明するように
、ライン７６上に電圧が供給されていないために動作す
ることはできない。
【００３８】コネクタ部２０−Ｍが異なるピン長により
２０−Ｆ部に完全に挿入されると、電圧Ｖがホット−プ
ラグ回路６４によりライン７６上に所定の制限電流によ
って形成される。
【００３９】ホット−プラグ回路６２及び６３は同一で
ある。これらは電界効果トランジスタＦＥＴ、パワー制
御回路及び制御ロジック装置からなる。ホット−プラグ
回路６２は図３に詳細に示されており、これを参照しな
がら後に述べることにする。
【００４０】マスタ・カード１がボード１２に挿入され
ると、電圧Ｖが抵抗６０を介してノード８０に供給され
、ハイレベルの第１の制御電圧が制御ロジック８２の入
力に供給される。
【００４１】制御ロジックはスイッチング素子８３を含
み、これはノード８０がハイレベル電圧の時に閉じてグ
ランド電圧をノード８５に提供し、一方ノード８０がグ
ランド電位の場合はオープンとなる。
【００４２】こうしてカード３−２の挿入が完了しない
うちは、スイッチは閉じられた状態となる。
【００４３】パワー制御ロジック８４は演算増幅機８６
を含み、この非反転入力８８は制御ロジック８２の出力
８５に抵抗値Ｒ１の保護抵抗９０を介して接続され、一
方ライン３４には抵抗値Ｒ２の抵抗９２を介して接続さ
れる。
【００４４】抵抗９０及び９２間の共通ノード９４は演
算増幅器８６の入力ライン８８と、キャパシタンスＣの
キャパシタ９６の第１の端子に接続され、このキャパシ
タ９６の第２の端子はグランド・ライン３６に接続され
る。
【００４５】演算増幅器８６の反転入力はノード９８で
ライン６４に接続される。
【００４６】演算増幅器８６の出力１００はＦＥＴトラ
ンジスタ１０２のゲートに接続され、このドレイン端子
はノード１０４でライン３４に接続され、またソース端
子はノード９８に接続される。
【００４７】本発明の実施例では、ＦＥＴトランジスタ
１０２はＮチャンネル素子であり、抵抗１０６を介して
バイアスされ、この抵抗は第１の端子がノード１００に
、また第２の端子が＋Ｖよりも高いバイアス電位Ｖｇに
接続される。
【００４８】図３に示される回路は以下のように動作す
る。
【００４９】例えば３−２等のカードがボード１２に挿
入されると、カード１上のライン６４が最初にカード３
２上のライン７６に接続される。
【００５０】ノード８５は、ライン３５及び７０間の接
続がショート・ピン５８−Ｐ及び５６−Ｐのために達成
されていないために接地される。
【００５１】抵抗９０の抵抗値Ｒ１は低く、ノード９４
はグランド・レベルとなり、従ってトランジスタ１０２
はＯＦＦとなる。
【００５２】ライン３５及び７０間の接続が達成される
と、グランド電位がノード８０に供給され、スイッチン
グ素子８３がオープンとなる。こうしてキャパシタ９６
のチャージが時定数Ｒ２．Ｃで開始され、ランプ電圧Ｖ
ａがノード９４に生成される。
【００５３】ｄＶａ／ｄｔ＝ａ ここでａは定数Ｒ２．Ｃである。
【００５４】演算増幅器８６及びＦＥＴトランジスタ１
０２はフォロア（ｆｏｌｌｏｗｅｒ）構成を成し、ノー
ド９８に電圧Ｖａに追従するランプ電圧Ｖｂを生成する
。
【００５５】ｄＶｂ／ｄｔ＝ａ＝Ｒ２．Ｃ
【００５６】
その結果、デカップリング・キャパシタ７２は電流ｉに
よりチャージされる。
【００５７】 ｉ＝Ｃｄ．（ｄＶｂ／ｄｔ）＝Ｃｄ．Ｒ２．Ｃ
【００５
８】この電流はＲ２及びＣを選択することにより、挿入
時間を考慮することなしに容易に制限できる。
【００５９】図４は本発明によるホット−プラグ回路の
第２の実施例を表し、スレーブ・カード３−１及び３−
２に対して実施されている。図２と同一の参照番号が類
似の構成要素に対して示されている。
【００６０】例えば、３−２のカードがボードに挿入さ
れると、ライン３６からのグランド電圧が最初にカード
３−２上のロジック回路にコネクタ２０のロング・ピン
４０−Ｐ及び５０−Ｐを通じて供給される。
【００６１】また、ライン３４からの電圧Ｖは抵抗６０
、ライン３５及びピン４６−Ｐ´及び５６−Ｐ´を介し
てノード８０に供給される。これらのピンはピン４６−
Ｐ及び５６−Ｐと類似ではあるがより長く、図３で示し
たようにノード８０が最初にハイレベルとなり制御ロジ
ック回路８２内のスイッチ８３を閉じるようにする。
【００６２】次に、コネクタ２０の全てのピンが完全に
挿入されると、ノード８０がショート・ピン４８−Ｐ及
び５８−Ｐを介してグランド電位に接続され、電圧Ｖが
ホット−プラグ回路６２内のＦＥＴトランジスタ１０２
のドレインに与えられる。この回路は既に図３を参照し
て説明したように動作する。
【００６３】この実施例においては、制御ロジック回路
８２はライン７５上の電圧がカード挿入と同時に生成さ
れるために任意選択である。
【００６４】これはパワー制御回路のキャパシタ９６を
ショート・グランド・ピン５８−Ｐに接続し、ライン７
０、抵抗６０、ライン３５及びピン４６−Ｐ´及び５６
−Ｐ´及び制御ロジックを抑止することにより達成され
る。
【００６５】
【発明の効果】以上説明したように、本発明によれば、
カードがカードの１つもしくはボード上に配置される電
源からパワー供給されるときに、カードがボードに挿入
される際に発生するデカップリング・キャパシタのチャ
ージによるサージ電流を抑制するホット−プラグ回路を
提供することができる。
【図面の簡単な説明】
【図１】カードが挿入される際に発生するサージ電流問
題を解決する従来方法を示す図である。
【図２】本発明によるホット−プラグ回路の第１の実施
例を示す図である。
【図３】ホット−プラグ回路の詳細を示す図である。
【図４】本発明によるホット−プラグ回路の第２の実施
例を示す図である。

Claims (7)

    【特許請求の範囲】
  1. 【請求項１】第１のカード（１）上に配置されて電源装
    置（２）によりパワー供給される第１の回路手段（３０
    ）の相互接続時に生成されるサージ電流を制限するホッ
    ト−プラグ回路（６２）であって、前記電源装置は第１
    の供給ライン上（３６）に第１の供給電圧（グランド）
    を、第２の供給ライン上（３４）に第２の供給電圧（＋
    Ｖ）を供給し、第２のカード上の第２の回路手段（２４
    ）は第３の供給ライン（７４）及び第４の供給ライン（
    ７６）を介して前記電源装置（２）からパワー供給され
    、前記サージ電流は前記カードが相互接続機構（１４、
    １２、２２）を介して相互接続されるときに、前記第２
    のカード上の第３及び第４の供給ライン間に配置される
    キャパシタンスＣｄなるデカップリング・キャパシタの
    チャージに起因し、前記第１及び第２の供給ライン及び
    （８２、８４、１０２）に接続される制御ランプ（ｒａ
    ｍｐ）生成手段は、前記第１及び前記第３の供給ライン
    間の接続が前記接続機構を介して完了したときに活動化
    され、前記第４の供給ライン上に前記第１及び第２の供
    給ライン上の電圧に由来する第１のランプ電圧Ｖｂの生
    成を開始し、前記ランプ電圧は調整可能なスロープａ＝
    ｄＶｂ／ｄｔを有し、前記サージ電流ｉはａ．Ｃｄに等
    しく、スロープ値ａを調整することにより目標値に制限
    されることを特徴とするホット−プラグ回路。
  2. 【請求項２】前記相互接続機構は前記第１の供給ライン
    に接続される第１及び第２の供給ピン（４０−Ｐ、４８
    −Ｐ）を有する第１のコネクタ（１４）を含み、前記第
    １のピンは前記第２のピンよりも長く、前記第１のピン
    は最初に前記第１の電圧を前記第２の回路手段に供給す
    るために前記第３の供給ラインに接続可能であり、前記
    第２のカードは前記第１及び第２のカードの相互接続が
    完了したときに前記第２の供給ピンに接続可能な存在指
    示ライン（７０）を含み、前記存在指示ライン（７０）
    上に前記第１の供給電圧に由来する第１の制御信号を生
    成し、該信号は前記制御ランプ生成制御手段に与えられ
    て第１のランプ電圧の生成を開始することを特徴とする
    請求項１記載のホット−プラグ回路。
  3. 【請求項３】前記第１のコネクタの前記第１及び第２の
    供給ピンは該コネクタの第１の終端に位置し、該コネク
    タは第２の終端に第３の供給ピンを含み、前記相互接続
    機構は前記第２のカード上に位置する第２のコネクタ（
    ２０）を含み、前記第２のコネクタは前記第１及び第２
    のカードが前記相互接続機構を介して相互接続されると
    きに前記第１、第２及び第３のピンにそれぞれ接続可能
    な第４、第５及び第６のピンを含み、前記存在指示ライ
    ンは前記第２のカード上の前記第５及び第６のピン間に
    あって接続され、前記第３及び前記第６のピンが接続さ
    れるときに前記第１の制御信号が前記存在指示ラインか
    ら前記制御ランプ生成手段に提供され、前記制御信号は
    前記カードが傾いて挿入されたことにより前記第１及び
    第２の回路手段の動作を乱すことを回避することを特徴
    とする請求項２記載のホット−プラグ回路。
  4. 【請求項４】前記制御ランプ生成手段が第１及び第２の
    ステータスを有するランプ生成制御回路（８２）を含み
    、該回路は前記第１及び第２のカードが完全に相互接続
    されるときに前記第１の制御信号に応答し、或いは前記
    第１及び第２のカードが完全に相互接続されていないと
    きには前記第２の供給電圧に由来する第２の制御信号に
    応答して、前記第１及び第２のステータスにセットされ
    、該ステータスはそれぞれ前記第１のランプ電圧の生成
    を開始するか、或いは前記ランプ電圧が生成されること
    を回避することを特徴とする請求項２及び請求項３記載
    のホット−プラグ回路。
  5. 【請求項５】前記制御ランプ生成手段が前記ランプ生成
    制御回路の前記第１及び第２のステータスに応答するラ
    ンプ生成回路（８２、１０２）を含み、前記第２の供給
    ラインに接続されて前記カードが前記相互接続機構を介
    して完全に相互接続されたときに前記第４の供給ライン
    上に前記第１のランプ電圧を生成することを特徴とする
    請求項４記載のホット−プラグ回路。
  6. 【請求項６】前記ランプ生成回路が第１及び第２の端子
    を有する抵抗値Ｒ２の抵抗（９２）及び第１及び第２の
    端子を有するキャパシタンスＣのキャパシタ（９６）を
    含むチャージ回路を含み、前記抵抗及び前記キャパシタ
    の前記第１の端子はそれぞれ前記第１及び第２の供給ラ
    インに接続され、前記抵抗及び前記キャパシタの前記第
    ２の端子は共通ノードに接続され、前記共通ノードは前
    記ランプ制御回路が前記第２或いは第１のステータスか
    に依存してそれぞれ前記第１の供給電圧に接続されるか
    否かが決定され、前記ランプ生成制御回路が前記第１の
    ステータスの時にスロープａ＝Ｒ．Ｃなる第２のランプ
    電圧Ｖａが前記共通ノードに生成され、前記抵抗及びキ
    ャパシタの前記共通ノードに接続され、出力（９８）に
    前記第２のランプ電圧を生成する電圧フォロア手段（８
    ６、１０２）を含むことを特徴とする請求項５記載のホ
    ット−プラグ回路。
  7. 【請求項７】前記電圧フォロア手段は、第１の入力が前
    記共通ノードに接続され、第２の入力が前記第４の供給
    ラインに接続される演算増幅器（８６）と、第１の電極
    （ドレイン）が前記抵抗の前記第１の端子に接続され、
    第２の電極（ソース）が前記第４の供給電圧ラインに接
    続され、制御電極（ゲート）が前記演算増幅器からの前
    記出力信号に応答する電界効果トランジスタを含み、前
    記カードが完全に相互接続されると前記第１のランプ電
    圧が前記電界効果トランジスタの前記第２の電極に生成
    されることを特徴とする請求項６記載のホット−プラグ
    回路。
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