JPH0431848U - - Google Patents

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JPH0431848U
JPH0431848U JP1990074083U JP7408390U JPH0431848U JP H0431848 U JPH0431848 U JP H0431848U JP 1990074083 U JP1990074083 U JP 1990074083U JP 7408390 U JP7408390 U JP 7408390U JP H0431848 U JPH0431848 U JP H0431848U
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JP
Japan
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detection circuit
signal
input
boards
facilitates
Prior art date
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JP1990074083U
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Pending legal-status Critical Current

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Landscapes

  • Detection And Prevention Of Errors In Transmission (AREA)
  • Time-Division Multiplex Systems (AREA)
  • Maintenance And Management Of Digital Transmission (AREA)

Description

【図面の簡単な説明】
第１図はこの考案の一実施例による障害検出回
路を示すブロツク図、第２図はこの考案の一実施
例による障害検出回路に入力される入力信号のフ
レームフオーマツト、第３図は従来の障害検出回
路を示すブロツク図である。 図において、１は入力信号、２は入力フレーム
パルス、３は入力クロツク、４はフレーム位相検
出回路、５はフレーム位相信号、６はラツチ回路
、７はチエツク信号、８は交番信号検出回路、９
は障害検出信号、１０は誤り検出回路である。な
お、図中、同一符号は同一、又は相当部分を示す
。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数の基板により構成され、フレームパルスと
    それに同期した信号を伝送する装置において、障
    害のある基板の検出を容易にしたことを特徴とす
    る障害検出回路。
JP1990074083U 1990-07-10 1990-07-10 Pending JPH0431848U (ja)

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JPH0431848U true JPH0431848U (ja) 1992-03-16

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