JPH043276Y2 - - Google Patents

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JPH043276Y2
JPH043276Y2 JP10154686U JP10154686U JPH043276Y2 JP H043276 Y2 JPH043276 Y2 JP H043276Y2 JP 10154686 U JP10154686 U JP 10154686U JP 10154686 U JP10154686 U JP 10154686U JP H043276 Y2 JPH043276 Y2 JP H043276Y2
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circuit
voltage
power supply
clock
switch
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Description

【考案の詳細な説明】 [産業上の利用分野] 本考案はクロツクパルスをカウントして時刻を
表示する電子時計であつて、該時計の時刻修正用
スイツチ等の操作スイツチが時計本体と分離した
操作部に設けられる時計に関するものである。
[Detailed Description of the Invention] [Industrial Application Field] The present invention is an electronic watch that displays the time by counting clock pulses, and the operation switch such as the time adjustment switch of the watch is operated separately from the main body of the watch. This relates to a clock installed in the department.

[従来の技術] 従来、時計の表示時刻修正用スイツチ等は時計
本体に取り付けられることが一般的であるも、今
日、時計掲示板、自動車用時計等、用途の多用化
により時計の表示時刻及び修正モードの切換等操
作スイツチを時計本体と位置的に分離して設ける
ことが要求される場合が生じている。
[Prior Art] In the past, switches for adjusting the display time of a clock were generally attached to the watch body, but today, due to the diversification of uses such as clock bulletin boards and automobile clocks, it is difficult to adjust the display time and adjustment of the clock. There are cases in which it is required to provide an operating switch such as a mode changeover position separated from the main body of the watch.

この様に操作スイツチを操作部に設けて時計本
体と分離する場合、従来は単にスイツチのコード
を延長して時計本体から引き出していた(例えば
実開昭60−127590号)。
Conventionally, when an operating switch is provided in the operating section and separated from the watch body, the switch cord was simply extended and pulled out from the watch body (for example, Utility Model Application No. 127590/1983).

[考案が解決しようとする問題点] 前述の様に各スイツチのコードを時計本体から
引き出すことは、スイツチの個数が増加すると引
き出し線の本数が多くなり、操作部と時計本体と
の配線が困難になる場合があつた。
[Problems that the invention aims to solve] As mentioned above, when the cords of each switch are pulled out from the watch body, as the number of switches increases, the number of lead-out wires increases, making it difficult to wire the operating section and the watch body. There were times when this happened.

[問題を解決するための手段] 本考案は、時計回路に安定した電圧を供給する
電源回路からの電源線に、操作部からの信号線を
接続し、操作部のスイツチが操作されて操作信号
が発生した場合に、電源線の電圧が変動する様に
操作部に電圧変動回路を組み込み、時計部に電源
の電圧変動を検出する変動検出回路と、この検出
信号を操作信号に変換するデコーダー回路とを設
けることとする。
[Means for solving the problem] The present invention connects the signal line from the operation unit to the power line from the power supply circuit that supplies stable voltage to the clock circuit, and when the switch on the operation unit is operated, the operation signal is transmitted. A voltage fluctuation circuit is built into the operation section so that the voltage of the power supply line fluctuates when a power supply line voltage occurs, and a fluctuation detection circuit that detects voltage fluctuations in the power supply is built into the clock section, and a decoder circuit that converts this detection signal into an operation signal. We will provide the following.

[作用] 本考案はスイツチを操作した場合の信号を電源
線を介し、以て電源電圧の変動として時計本体に
送る故、電源回路を時計本体から分離して操作部
に設ける場合は時計本体からの引き出し線を、1
本の複線である電源線のみとすることができ、
又、電源回路が時計本体に設けられていても電源
回路と時計回路との間の電源線を操作部に引き出
すのみで、多くの操作スイツチを設けることがで
き、操作部と時計本体との間の配線数を増加させ
ることがない。
[Function] This invention sends the signal when the switch is operated to the watch body via the power line as fluctuations in the power supply voltage, so if the power circuit is separated from the watch body and installed in the operation section, it is necessary to The leader line of 1
It can only be a power line that is a double line,
Furthermore, even if the power supply circuit is installed in the watch body, many operation switches can be installed by simply pulling out the power line between the power supply circuit and the watch circuit to the operation unit, and the connection between the operation unit and the watch body can be There is no need to increase the number of wiring lines.

[実施例] 本考案の実施例として、時計回路における表示
時刻の時修正、分修正、秒リセツトを行ない得る
回路例を第1図に示す。
[Embodiment] As an embodiment of the present invention, an example of a circuit that can adjust the hours, minutes, and reset the displayed time in a timepiece circuit is shown in FIG.

該実施例は、時計部12を電源部14と時計本
体34とで構成し、電源部14は時計回路66を
安定して作動させる定電圧回路16を含むもので
ある。
In this embodiment, the timepiece section 12 is composed of a power supply section 14 and a timepiece body 34, and the power supply section 14 includes a constant voltage circuit 16 that stably operates a timepiece circuit 66.

該定電圧回路16を経て電源部14から引き出
された電源線を操作部18に引き、該操作部18
には時修正スイツチ32、分修正スイツチ24、
秒修正スイツチ26が設けられており、電源線の
一方には第1抵抗器20を介した後、前記時修正
スイツチ22、分修正スイツチ24、秒修正スイ
ツチ26を平行とする様に各スイツチの一端が接
続され、この時修正スイツチ22、分修正スイツ
チ24、秒修正スイツチ26の各スイツチの他の
一端は夫々第1ツエナーダイオード28、第2ツ
エナーダイオード30、第3ツエナーダイオード
32を介して電源線の他の一本に接続されてい
る。
A power line drawn out from the power supply section 14 via the constant voltage circuit 16 is connected to the operation section 18.
hour correction switch 32, minute correction switch 24,
A second correction switch 26 is provided, and after passing through a first resistor 20 on one side of the power supply line, each switch is connected so that the hour correction switch 22, minute correction switch 24, and second correction switch 26 are parallel to each other. At this time, the other ends of each of the correction switch 22, the minute correction switch 24, and the second correction switch 26 are connected to the power supply via the first Zener diode 28, the second Zener diode 30, and the third Zener diode 32, respectively. connected to another one of the wires.

この第1ツエナーダイオード28、第2ツエナ
ーダイオード30、第3ツエナーダイオード32
は夫々時計回路66の安定作動電圧範囲におい
て、異なる降伏電圧を有するツエナーダイオード
を用いることが好ましい。
The first Zener diode 28, the second Zener diode 30, and the third Zener diode 32
It is preferable to use Zener diodes having different breakdown voltages within the stable operating voltage range of the clock circuit 66, respectively.

上記第1抵抗器20を介した電源線の一方、及
び第1ツエナーダイオード28、第2ツエナーダ
イオード30、第3ツエナーダイオード32が接
続された電源線の他方を時計本体34へ導き、ロ
ーパスフイルター64を介して時計回路66へ接
続すると共に該電源線は変動検出回路36にも接
続する。
One of the power wires via the first resistor 20 and the other power wire to which the first Zener diode 28 , the second Zener diode 30 , and the third Zener diode 32 are connected are led to the watch body 34 and passed through the low-pass filter 64 . The power supply line is connected to the clock circuit 66 via the power line, and the power supply line is also connected to the fluctuation detection circuit 36.

該変動検出回路36は抵抗器とツエナーダイオ
ードによる基準電圧発生回路と、前記操作部18
のスイツチの個数に対応した3個のコンパレータ
とで構成され、前記電源線の両線間に第2抵抗器
38と第4ツエナーダイオード40とを直列とし
て挿入することにより基準電圧発生回路を構成す
ると共に、第4ツエナーダイオード40の電圧を
分圧する様に第3抵抗器42、第4抵抗器44、
第5抵抗器46を直列に接続する。そして、この
第4ツエナーダイオード40の電圧を基準電圧と
する様に第1コンパレータ50の一入力端子を接
続し、第3抵抗器42と第4抵抗器44との間の
電圧を基準電圧とする様に第2コンパレータ52
の一入力端子を接続し、第4抵抗器44と第5抵
抗器46との間を基準電圧とする様に第3コンパ
レータ54の一入力端子を接続する。又、変動検
出回路36の第2抵抗器38に接続される以前の
電源線を分圧抵抗器48に接続し、以て、操作信
号分を含む電源電圧を該分圧抵抗器48により電
圧降下させ、前記第1コンパレータ50、第2コ
ンパレータ52、第3コンパレータ54の他の各
入力端子に接続する。
The fluctuation detection circuit 36 includes a reference voltage generation circuit including a resistor and a Zener diode, and the operation section 18.
A reference voltage generation circuit is constructed by inserting a second resistor 38 and a fourth Zener diode 40 in series between both of the power supply lines. At the same time, a third resistor 42, a fourth resistor 44, and so on divide the voltage of the fourth Zener diode 40.
A fifth resistor 46 is connected in series. Then, one input terminal of the first comparator 50 is connected so that the voltage of the fourth Zener diode 40 is used as a reference voltage, and the voltage between the third resistor 42 and the fourth resistor 44 is used as the reference voltage. Similarly, the second comparator 52
One input terminal of the third comparator 54 is connected so as to set a reference voltage between the fourth resistor 44 and the fifth resistor 46. In addition, the power supply line before being connected to the second resistor 38 of the fluctuation detection circuit 36 is connected to the voltage dividing resistor 48, so that the power supply voltage including the operation signal is reduced by the voltage dividing resistor 48. and is connected to the other input terminals of the first comparator 50, the second comparator 52, and the third comparator 54.

そして、上記第1コンパレータ50、第2コン
パレータ52、第3コンパレータ54の各出力端
子をデコーダー回路56に導く。該デコーダー回
路56は前記各コンパレータ出力に応じて時計回
路66の制御信号を発生させるものであり、第3
コンパレータ54の出力端子を時計回路66の秒
修正入力端子に直結させると共に、第3コンパレ
ータ54の出力端子を第1アンド回路58の否定
入力端子及び第3アンド回路62の否定入力端子
に接続している。又、第2コンパレータ52の出
力端子を第3アンド回路62の他の入力端子に接
続し、該第3アンド回路62の出力端子は時計回
路66の分修正入力端子に接続すると共に第2ア
ンド回路60の否定入力端子に接続し、第1コン
パレータ50の出力端子を第1アンド回路58の
他の入力端子へ、第1アンド回路58の出力端子
を第2アンド回路60の他の入力端子へ、第2ア
ンド回路60の出力端子を時計回路66の時修正
入力端子に接続する。
Then, each output terminal of the first comparator 50, second comparator 52, and third comparator 54 is led to a decoder circuit 56. The decoder circuit 56 generates a control signal for the clock circuit 66 in accordance with the outputs of the respective comparators, and a third
The output terminal of the comparator 54 is directly connected to the second correction input terminal of the clock circuit 66, and the output terminal of the third comparator 54 is connected to the negative input terminal of the first AND circuit 58 and the negative input terminal of the third AND circuit 62. There is. Further, the output terminal of the second comparator 52 is connected to the other input terminal of the third AND circuit 62, and the output terminal of the third AND circuit 62 is connected to the minute correction input terminal of the clock circuit 66, and the output terminal of the third AND circuit 62 is connected to the minute correction input terminal of the clock circuit 66. 60, the output terminal of the first comparator 50 to the other input terminal of the first AND circuit 58, the output terminal of the first AND circuit 58 to the other input terminal of the second AND circuit 60, The output terminal of the second AND circuit 60 is connected to the time correction input terminal of the clock circuit 66.

上述の様に構成した回路の動作を以下に説明す
る。
The operation of the circuit configured as described above will be explained below.

先ず電源部14から電源を介して一定電圧V0
の電力が時計回路66に供給され、時計回路66
が作動して時刻を表示する。そして、時修正スイ
ツチ22を接続すると操作部18の第1抵抗器2
0及び第1ツエナーダイオード28により操作部
18と時計本体34とを接続する電源線の電圧
V0は第2図に示す様にV1に電圧降下し、分修正
スイツチ24を接続すると第1抵抗器20と第2
ツエナーダイオード30によりV2に電圧降下し、
秒修正スイツチ26を接続するとV3に電圧降下
することになる。尚、このV1,V2,V3の各電圧
は時計回路66を安定動作させ得る許容範囲内で
の電圧変動とされることが望ましいが、本実施例
では時計回路66の動作電圧よりも高くし、ロー
パスフイルター64により適正な動作電圧に電圧
降下させている。
First, a constant voltage V 0 is applied from the power supply section 14 via the power supply.
power is supplied to the clock circuit 66, and the clock circuit 66
operates and displays the time. Then, when the hour adjustment switch 22 is connected, the first resistor 2 of the operating section 18
0 and the voltage of the power supply line connecting the operating section 18 and the watch body 34 through the first Zener diode 28.
As shown in FIG .
The voltage drops to V 2 by Zener diode 30,
When the second correction switch 26 is connected, the voltage will drop to V3 . It is desirable that the voltages V 1 , V 2 , and V 3 fluctuate within an allowable range that allows the clock circuit 66 to operate stably. The voltage is lowered to an appropriate operating voltage by a low-pass filter 64.

又、変動検出回路36における基準電圧を発生
させる第4ツエナーダイオード40の基準電圧
は、分圧抵抗器48により変動電圧V1を電圧降
下させた電位よりも高い電位V1′とされ、第3抵
抗器42と第4抵抗器44との間の基準電圧
V2′は、変動電圧V2を分圧抵抗器48により電圧
降下させた電位よりも高く、且つ、変動電圧V1
を分圧抵抗器48により電圧降下させた電位より
も低く設定され、第4抵抗器44と第5抵抗器4
6との間の基準電圧V3′は、変動電圧V3を分圧抵
抗器48により電圧降下させた電位よりも高く、
且つ、変動電圧V2を電圧降下させた電位よりも
低く設定されている。この様な電位の設定は、第
4ツエナーダイオード40の電位と分圧抵抗器4
8の分圧比及び第3抵抗器42乃至第5抵抗器4
6の抵抗値比とにより容易に設定し得るものであ
る。
Further, the reference voltage of the fourth Zener diode 40 that generates the reference voltage in the fluctuation detection circuit 36 is set to a potential V 1 ' higher than the potential obtained by dropping the fluctuation voltage V 1 by the voltage dividing resistor 48, and the third Reference voltage between resistor 42 and fourth resistor 44
V 2 ' is higher than the potential obtained by reducing the voltage of the variable voltage V 2 by the voltage dividing resistor 48, and is higher than the potential of the variable voltage V 1
is set lower than the voltage drop potential by the voltage dividing resistor 48, and the fourth resistor 44 and the fifth resistor 4
The reference voltage V 3 ′ between V 3 and V 6 is higher than the potential obtained by reducing the voltage V 3 by the voltage dividing resistor 48,
In addition, it is set lower than the potential obtained by dropping the variable voltage V2 . Setting such a potential is performed by adjusting the potential of the fourth Zener diode 40 and the voltage dividing resistor 4.
Voltage division ratio of 8 and third resistor 42 to fifth resistor 4
This can be easily set with a resistance value ratio of 6.

上述の様に第4ツエナーダイオード40及び第
3抵抗器42乃至第5抵抗器46により基準電圧
を設定することにより、第1コンパレータ50の
出力信号A1には操作部18の時修正スイツチ2
2、分修正スイツチ24、秒修正スイツチ26の
いずれかのスイツチが接続されたときにHレベル
信号を発生させ、第2コンパレータ52の出力信
号A2には分修正スイツチ24又は秒修正スイツ
チ26が接続されたときにHレベル信号を発生さ
せ、第3コンパレータ54の出力信号A3には秒
修正スイツチ26が接続されたときにHレベル信
号を発生させることができる。
As described above, by setting the reference voltage using the fourth Zener diode 40 and the third resistor 42 to the fifth resistor 46, the output signal A1 of the first comparator 50 is controlled by the time correction switch 2 of the operating section 18.
2. When either the minute correction switch 24 or the second correction switch 26 is connected, an H level signal is generated, and the output signal A2 of the second comparator 52 is connected to the minute correction switch 24 or the second correction switch 26. When connected, an H level signal can be generated, and when the second correction switch 26 is connected to the output signal A3 of the third comparator 54, an H level signal can be generated.

この変動検出回路36の出力信号A1,A2,A3
をデコーダー回路56に導くと、該デコーダー回
路56において第3コンパレータ54の出力をデ
コーダー回路56のA6出力信号としている故、
該A6信号は秒修正スイツチ26が接続されたと
きのみHレベル信号を発生させ、該Hレベル信号
を時計回路66の秒修正入力端子に送ることにな
る。又、第2コンパレータ52の出力信号A2
前述の様に分修正スイツチ24又は秒修正スイツ
チ26が接続されたときにHレベル信号を発生さ
せるも、該第2コンパレータ52の出力端子はデ
コーダー回路56の第3アンド回路62を介して
時計回路66の分修正入力端子に接続されてお
り、該第3アンド回路62は第2コンパレータ5
2の出力信号を入力信号とすると共に第3コンパ
レータ54の出力信号を否定入力としている故、
該第3アンド回路62の出力信号であるA5信号
は分修正スイツチ24が接続されたときにのみH
レベル信号を発生させ、時計回路66の分修正入
力端子に修正信号を送ることになる。そして、第
1コンパレータ50の出力端子は変動検出回路3
6の第1アンド回路58、第2アンド回路60を
介して時計回路66の時修正入力端子に接続され
ており、第1コンパレータ50の出力信号A1
時修正スイツチ22、分修正スイツチ24、秒修
正スイツチ26のいずれかが接続されたときにH
レベル信号を発するも、第3コンパレータ54の
出力端子が第1アンド回路58の否定入力端子に
接続されている故、秒修正スイツチ26が接続さ
れた場合には第1アンド回路58の出力はLレベ
ルが維持されることとなり、又、分修正スイツチ
24が接続された場合にも第3アンド回路62の
出力端子が第2アンド回路60の否定入力端子に
接続されている故、第2アンド回路60の出力は
Lレベルが維持されることとなる。従つて、時修
正スイツチ22が接続されたときにのみ第1コン
パレータ50の出力信号は第1アンド回路58及
び第2アンド回路60を通り、A4出力信号にH
レベル信号を発生させて時計回路66の時修正入
力端子に時修正信号を送ることができる。
Output signals A 1 , A 2 , A 3 of this fluctuation detection circuit 36
is led to the decoder circuit 56, since in the decoder circuit 56 the output of the third comparator 54 is used as the A6 output signal of the decoder circuit 56,
The A6 signal generates an H level signal only when the second correction switch 26 is connected, and sends the H level signal to the second correction input terminal of the clock circuit 66. Further, as described above, the output signal A2 of the second comparator 52 generates an H level signal when the minute correction switch 24 or the second correction switch 26 is connected, but the output terminal of the second comparator 52 is connected to the decoder circuit. 56 is connected to the minute correction input terminal of the clock circuit 66 via the third AND circuit 62 of the second comparator 56.
Since the output signal of the second comparator 54 is used as an input signal and the output signal of the third comparator 54 is used as a negative input,
The A5 signal, which is the output signal of the third AND circuit 62, goes high only when the minute correction switch 24 is connected.
A level signal is generated and a correction signal is sent to the minute correction input terminal of the clock circuit 66. The output terminal of the first comparator 50 is connected to the fluctuation detection circuit 3.
The output signal A1 of the first comparator 50 is connected to the hour correction input terminal of the clock circuit 66 through the first AND circuit 58 and the second AND circuit 60 of 6, and the output signal A1 of the first comparator 50 is connected to the hour correction switch 22, the minute correction switch 24, When any of the second correction switches 26 is connected
Although a level signal is generated, since the output terminal of the third comparator 54 is connected to the negative input terminal of the first AND circuit 58, when the second correction switch 26 is connected, the output of the first AND circuit 58 is L. Since the output terminal of the third AND circuit 62 is connected to the negative input terminal of the second AND circuit 60 even when the minute correction switch 24 is connected, the second AND circuit The output of 60 will be maintained at the L level. Therefore, only when the time correction switch 22 is connected, the output signal of the first comparator 50 passes through the first AND circuit 58 and the second AND circuit 60, and the A4 output signal becomes H.
It is possible to generate a level signal and send the time correction signal to the time correction input terminal of the clock circuit 66.

この様に本考案においては、時修正スイツチ2
2、分修正スイツチ24、秒修正スイツチ26等
の操作スイツチの断続による信号によつて電源電
圧を変動させ、該電源電圧の変動を検出し、デコ
ーダー回路56によつて信号を識別するものであ
る故、操作部18と時計本体34との信号線を省
略し、電源線のみで接続することができる。
In this way, in the present invention, the time adjustment switch 2
2. The power supply voltage is varied by signals generated by the intermittent operation of operation switches such as the minute correction switch 24 and the second correction switch 26, and the fluctuations in the power supply voltage are detected and the signals are identified by the decoder circuit 56. Therefore, the signal line between the operating section 18 and the watch body 34 can be omitted, and the connection can be made using only the power line.

尚、時計回路66と直列に設けたローパスフイ
ルター64は操作部18のスイツチ操作による電
源電圧の変動が時計回路66に伝達されることを
極力防止するものであるも、変動幅が時計回路6
6の許容範囲に設定されていれば必ずしも必要と
されるものではない。もつとも、第1図に示す実
施例においては、該ローパスフイルター64にツ
エナーダイオードを用い、電源電圧を時計回路6
6の作動電圧よりも高くし、電源電圧の変動幅を
広くすることにより多くの操作スイツチを設ける
ことを可能とし、且つ、安定した時計回路66の
作動電圧を得る様にしている。
Although the low-pass filter 64 provided in series with the clock circuit 66 prevents as much as possible the variation in power supply voltage caused by the switch operation of the operating section 18 from being transmitted to the clock circuit 66, the range of variation is
It is not necessarily required if it is set within the permissible range of 6. However, in the embodiment shown in FIG. 1, a Zener diode is used for the low-pass filter 64, and the power supply voltage is
By making the operating voltage higher than that of clock circuit 66 and widening the fluctuation range of the power supply voltage, it is possible to provide many operating switches, and a stable operating voltage of clock circuit 66 can be obtained.

又、時計回路66の入力として変動検出回路3
6で生じさせる基準電圧を用い、電圧変動の無い
時計回路66への入力を得ることも可能である。
Also, as an input to the clock circuit 66, the fluctuation detection circuit 3
It is also possible to obtain an input to the clock circuit 66 without voltage fluctuations by using the reference voltage generated in 6.

そして、第3図に示す様に、電源部14を操作
部18と一体とすれば操作部18と時計本体34
との間の配線は1本の電源線で足りることにな
る。
As shown in FIG. 3, if the power supply section 14 is integrated with the operation section 18, the operation section 18 and the watch body 34
One power line is sufficient for wiring between the two.

[考案の効果] 本考案は操作部のスイツチを断続した場合に、
該スイツチの断続に基く断続信号を電源電圧の変
動として時計本体に送ることができる故、操作部
と時計本体との間の配線数を増加させることなく
操作部に各種のスイツチを設けることができ、操
作部と時計本体とを分離した電子時計において、
操作部と時計本体との配線数を少なくし、以て配
線を容易とすることができる。
[Effects of the invention] This invention has the effect of
Since the intermittent signal based on the on/off of the switch can be sent to the watch body as a fluctuation in the power supply voltage, various switches can be installed in the operation section without increasing the number of wires between the operation section and the watch body. , in an electronic watch in which the operating section and the watch body are separated,
The number of wires between the operating section and the watch body can be reduced, thereby making the wiring easier.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本考案の一実施例を示す回路図、第2
図は第1図の回路における修正スイツチを操作し
た場合のタイムチヤート図、第3図は本考案の一
実施例を示す外観図である。 12……時計部、14……電源部、16……操
作部、34……時計本体、36……変動検出回
路、54……デコーダー回路、66……時計回
路。
Figure 1 is a circuit diagram showing one embodiment of the present invention;
This figure is a time chart when the correction switch in the circuit of FIG. 1 is operated, and FIG. 3 is an external view showing one embodiment of the present invention. 12...Clock section, 14...Power supply section, 16...Operation section, 34...Clock body, 36...Fluctuation detection circuit, 54...Decoder circuit, 66...Clock circuit.

Claims (1)

【実用新案登録請求の範囲】 時計部と、 該時計部とは分離して構成され、且つ、複数の
スイツチを有して前記時計部の表示を制御する操
作部とから成り、 前記時計部は、時刻を計時して表示する時計回
路を含む時計本体と、 該時計回路に電源線を介して電力を供給する電
源部とで構成される 電子時計において、 前記操作部からの信号線が、前記電源部からの
電源線に接続され、 該操作部は、各スイツチが押圧される毎に電源
線の電圧を異なつたレベルに変動させる電圧変動
回路を含み、 前記電源線の電圧レベルの変動を検出する変動
検出回路と、 前記変動検出回路の出力を前記時計回路の制御
信号に変換するデコーダー回路と、 の両回路を時計本体に設けたことを特徴とする電
子時計。
[Claims for Utility Model Registration] The clock section is composed of a clock section, and an operation section that is configured separately from the clock section and has a plurality of switches to control the display of the clock section; , an electronic watch consisting of a watch body including a watch circuit that measures and displays time, and a power supply unit that supplies power to the watch circuit via a power line, wherein the signal line from the operating unit is connected to the The operation section is connected to a power line from a power supply unit, and the operating unit includes a voltage fluctuation circuit that varies the voltage of the power line to a different level each time each switch is pressed, and detects fluctuations in the voltage level of the power line. An electronic timepiece characterized in that a timepiece main body is provided with both a fluctuation detection circuit for detecting fluctuations, and a decoder circuit for converting an output of the fluctuation detection circuit into a control signal for the timepiece circuit.
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