JPH0432812Y2 - - Google Patents

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JPH0432812Y2
JPH0432812Y2 JP8156886U JP8156886U JPH0432812Y2 JP H0432812 Y2 JPH0432812 Y2 JP H0432812Y2 JP 8156886 U JP8156886 U JP 8156886U JP 8156886 U JP8156886 U JP 8156886U JP H0432812 Y2 JPH0432812 Y2 JP H0432812Y2
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voltage
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Description

【考案の詳細な説明】 技術分野 本考案は互いに離れた位置に設置されて互いに
異なる接地系を有する装置間の信号を中継するア
ースアイソレーシヨンアンプに関するものであ
る。
[Detailed Description of the Invention] Technical Field The present invention relates to an earth isolation amplifier that relays signals between devices installed at separate locations and having different grounding systems.

背景技術 例えば車載オーデイオ装置のように、一方がダ
ツシユパネルに設置され他方がこのダツシユパネ
ルから離れたトランクルーム等に設置されたオー
デイオ信号処理装置同士の信号中継を信号へのア
ースノイズの混入を抑制しつつなすべく第9図に
示される如きアースアイソレーシヨンアンプが使
用される。
BACKGROUND ART Signal relay between audio signal processing devices, such as an in-vehicle audio device, where one is installed in a dash panel and the other is installed in a trunk room or the like away from the dash panel, is performed while suppressing the mixing of ground noise into the signal. For this reason, an earth isolation amplifier as shown in FIG. 9 is used.

第9図において、抵抗R1及びR2によつて構成
される抵抗分圧回路の一端Aに電流制限抵抗R3
を介してバイアス電源Vccから電圧Vccが印加さ
れ、該抵抗分圧回路の他端は入力信号供給源(図
示せず)の接地系と共通の接地点Bに接続され
る。また、抵抗分圧回路に対して並列にバイパス
コンデンサC1が接続されA点とB点とは交流電
位が等しくなされる。上記抵抗分圧回路の分圧電
圧はPNP形トランジスタQ1のベースに印加され
る。このベースには結合コンデンサC2を経て入
力信号が供給される。トランジスタQ1のエミツ
タはエミツタ抵抗R4に接続され、抵抗R4の他端
Cは上記抵抗R1とR3との接続点Aに接続される。
トランジスタQ1のコレクタには、結合コンデン
サC3及びコレクタ抵抗R5の各一端が接続され、
コンデンサC3の他端は信号伝送線路2の中心導
体2aに接続される。このようにしてアイソレー
シヨンアンプ1が構成される。コレクタ抵抗R5
の他端は信号伝送線路2のシールド導体2b接続
される。中心導体2aの他端3aは、出力側回路
(図示せず)の入力端に接続され、シールド導体
2bの他端3bは上記出力側回路の接地点Dに接
続される。ここで、接地点Dと接地点Bとの間の
電位差により生ずるアース間ノイズはノイズ源ひ
nとして表示されている。
In FIG. 9, a current limiting resistor R 3 is connected to one end A of the resistor voltage divider circuit composed of resistors R 1 and R 2 .
A voltage Vcc is applied from a bias power supply Vcc through the resistor voltage divider circuit, and the other end of the resistor voltage divider circuit is connected to a ground point B that is common to the ground system of an input signal supply source (not shown). Further, a bypass capacitor C1 is connected in parallel to the resistor voltage divider circuit, so that the AC potentials at points A and B are made equal. The divided voltage of the resistor voltage divider circuit is applied to the base of the PNP transistor Q1 . This base is supplied with the input signal via a coupling capacitor C2 . The emitter of the transistor Q1 is connected to the emitter resistor R4 , and the other end C of the resistor R4 is connected to the connection point A between the resistors R1 and R3 .
The collector of the transistor Q1 is connected to one end of a coupling capacitor C3 and a collector resistor R5 ,
The other end of the capacitor C 3 is connected to the center conductor 2 a of the signal transmission line 2 . In this way, the isolation amplifier 1 is constructed. Collector resistance R 5
The other end is connected to the shield conductor 2b of the signal transmission line 2. The other end 3a of the center conductor 2a is connected to an input end of an output circuit (not shown), and the other end 3b of the shield conductor 2b is connected to a ground point D of the output circuit. Here, inter-ground noise caused by the potential difference between the ground point D and the ground point B is indicated as a noise source h.

次に、この回路の動作について説明する。ま
ず、入力信号に対してアイソレーシヨンアンプ1
は周知のPNP形トランジスタによるエミツタ接
地増幅回路として動作し、入力信号の電位をひi
エミツタ抵抗R4の値をR4とすると、エミツタ電
流ieは、ie≒ひi/R4となる。またコレクタ抵抗
R5の値をR5とし、出力側回路3を高入カインピ
ーダンスにすればエミツタ電流ieはほぼコレクタ
抵抗R5を流れるから、コレクタ抵抗R5に印加さ
れる電圧ひcは、ひc≒ie・R5となる。故に、か
かる増幅回路の利得はR5/R4として表わされる。
また、トランジスタQ1は交流等価的に電流源と
して作用しそのインピーダンスは非常に大きいの
で、ノイズ源ひnによるノイズ電流inはコレクタ
抵抗R5にほとんど流れず、ノイズ源ひnによる
出力信号へのノイズ混入は無視し得る。従つて、
かかる回路によつて接地系の相違によるノイズひ
nの信号への混入(以下混信と称する)は抑制さ
れ(以下ノイズ抑制作用と称する)互いに離れた
位置になる設置間の信号中継における混信を防止
することが可能である。
Next, the operation of this circuit will be explained. First, the isolation amplifier 1
operates as a common emitter amplifier circuit using a well-known PNP type transistor, and the potential of the input signal is
When the value of the emitter resistance R 4 is R 4 , the emitter current ie becomes ie≈hii/R 4 . Also the collector resistance
If the value of R5 is set to R5 and the output side circuit 3 is made to have a high input impedance, the emitter current ie will almost flow through the collector resistor R5 , so the voltage Hc applied to the collector resistor R5 will be Hc≒ It becomes ie・R 5 . Therefore, the gain of such an amplifier circuit is expressed as R 5 /R 4 .
In addition, since the transistor Q1 acts equivalently as an AC current source and its impedance is very large, the noise current in from the noise source hin hardly flows to the collector resistor R5 , and the noise current in from the noise source hin flows to the output signal from the noise source hin. Noise contamination can be ignored. Therefore,
This circuit suppresses noise from entering the signal due to differences in grounding systems (hereinafter referred to as interference) (hereinafter referred to as noise suppression effect) and prevents interference in signal relays between installations located far apart from each other. It is possible to do so.

しかしながら、ノイズひnの周波数が高くなる
と、トランジスタQ1のベース・コレクタ間容量
によりベース・コレクタ間のインピーダンスが上
記周波数の増加と共に低下し、ノイズ抑制作用が
損われ抵抗R2及びR5を経由してノイズル−プ電
流inが発生する。また、トランジスタの出力アド
ミタンスが十分に小さくない場合にはノイズ抑制
作用が十分でなく比較的に低い周波数からノイズ
ル−プ電流inが発生し、アースノイズひnが出力
信号中に進入して混信を生じ、出力信号のS/N
が低下する不具合がある。
However, as the frequency of the noise hin increases, the impedance between the base and collector decreases as the frequency increases due to the base-collector capacitance of the transistor Q1 , and the noise suppression effect is impaired and the noise is passed through the resistors R2 and R5 . As a result, a noise loop current in is generated. In addition, if the output admittance of the transistor is not small enough, the noise suppression effect will not be sufficient and a noise loop current will be generated from a relatively low frequency, and ground noise will enter the output signal and cause interference. S/N of output signal
There is a problem where the value decreases.

考案の概要 よつて、本考案の目的とするところは広帯域に
亘つてノイズ抑制作用が発揮され得るアースアイ
ソレーシヨンアンプを提供することである。
Summary of the invention Therefore, an object of the invention is to provide an earth isolation amplifier that can exhibit a noise suppressing effect over a wide band.

上記目的を達成する為に本考案のアースアイソ
レーションアンプにおいては、少なくともエミツ
タ接地形トランジスタ増幅回路による2段増幅回
路を含みその前段増幅回路が第1接地系に、後段
増幅回路が第2接地系に接続されかつ前段増幅回
路のコレクタ出力が後段増幅回路のベース入力と
なるトランジスタ多段増幅回路と、上記第1及び
第2接地系間に接続され交流分圧回路とを有し、
その分圧出力が前段増幅回路のコレクタ回路及び
後段増幅回路のエミツタ回路に供給される構成と
している。
In order to achieve the above object, the earth isolation amplifier of the present invention includes at least a two-stage amplifier circuit using an emitter-grounded transistor amplifier circuit, the front-stage amplifier circuit is connected to the first grounding system, and the rear-stage amplifier circuit is connected to the second grounding system. a transistor multi-stage amplifier circuit connected to the circuit and whose collector output of the front-stage amplifier circuit serves as a base input of the rear-stage amplifier circuit, and an AC voltage divider circuit connected between the first and second ground systems,
The divided voltage output is supplied to the collector circuit of the front-stage amplifier circuit and the emitter circuit of the rear-stage amplifier circuit.

実施例 以下、本考案の実施例について第1図を参照し
つつ説明する。第1図において、アイソレーシヨ
ンアンプ1は前段増幅回路であるエミツタ接地形
トランジスタ増幅回路10、後段増幅回路である
エミツタ接地形トランジスタ増幅回路20及び抵
抗分圧回路30によつて構成されている。増幅回
路10は、その一端Aに抵抗R3を介してバイア
ス電圧Vccが印加され、他端が接地点Bに接続さ
れる抵抗R11とR12とからなるベースバイアス回
路と、このベースバイアス回路によりベース所定
電圧が印加されるNPN形トランジスタQ10と、こ
のトランジスタQ10のエミツタと接地点Bとの間
に接続される抵抗R13及び一端がトランジスタ
Q10のコレクタに接続される抵抗R14とにより形
成される。トランジスタQ10のベースには結合コ
ンデンサC10を介して入力信号が供給される。抵
抗R14の他端Cとベースバイアス回路の一端Aと
の間には抵抗R31が接続され、一端Aはバイパス
コンデンサC11により接地点Bに交流的に接地さ
れる。
Embodiment Hereinafter, an embodiment of the present invention will be described with reference to FIG. In FIG. 1, an isolation amplifier 1 includes a grounded emitter transistor amplifier circuit 10 as a front stage amplifier circuit, a grounded emitter transistor amplifier circuit 20 as a rear stage amplifier circuit, and a resistive voltage divider circuit 30. The amplifier circuit 10 includes a base bias circuit consisting of resistors R 11 and R 12 to which a bias voltage Vcc is applied to one end A via a resistor R 3 and the other end connected to a ground point B, and this base bias circuit. An NPN transistor Q 10 to which a predetermined voltage is applied to the base, a resistor R 13 connected between the emitter of this transistor Q 10 and the ground point B, and one end connected to the transistor Q 10
It is formed by a resistor R14 connected to the collector of Q10 . The input signal is supplied to the base of transistor Q10 via a coupling capacitor C10 . A resistor R 31 is connected between the other end C of the resistor R 14 and one end A of the base bias circuit, and the one end A is AC grounded to the ground point B by a bypass capacitor C 11 .

トランジスタQ10のコレクタ出力は増幅回路2
0のPNP形トランジスタ20のベースに供給さ
れる。トランジスタ20のエミツタのエミツタは
抵抗R21を介して抵抗R14の他端Cに接続されコ
レクタは抵抗R22を介して接地点Dに接続され
る。抵抗R22の両端に印加される電圧は出力信号
として結合コンデンサC20を介して出力端3aに
供給される。
The collector output of transistor Q10 is amplifier circuit 2
0 to the base of a PNP transistor 20. The emitter of the transistor 20 is connected to the other end C of the resistor R14 via a resistor R21 , and the collector is connected to the ground point D via a resistor R22 . The voltage applied across the resistor R 22 is supplied as an output signal to the output terminal 3a via the coupling capacitor C 20 .

抵抗R14の他端Cと接地点Dとの間にはバイパ
スコンデンサC21(直流阻止コンデンサ)を介して
抵抗R32が接続される。抵抗R31及びR32は抵抗分
圧回路30を形成する。また、抵抗分圧回路30
はコンデンサC11及びC21と共に交流分圧回路を形
成する。この抵抗R31及びR32の値は抵抗R14及び
R21の値に比して十分に小なる値に設定される。
抵抗分圧回路30の両端にはコンデンサC11及び
C21を介してノイズ電圧ひnが印加され、分圧さ
れたノイズ成分がトランジスタQ10のコレクタ回
路R14及びトランジスタQ20のエミツタ回路R21
印加される。
A resistor R 32 is connected between the other end C of the resistor R 14 and the ground point D via a bypass capacitor C 21 (DC blocking capacitor). Resistors R 31 and R 32 form a resistive voltage divider circuit 30 . In addition, the resistor voltage divider circuit 30
forms an AC voltage divider circuit with capacitors C 11 and C 21 . The values of these resistors R 31 and R 32 are the same as those of resistors R 14 and
It is set to a value sufficiently smaller than the value of R21 .
Capacitor C11 and
A noise voltage hin is applied through C21 , and the divided noise component is applied to the collector circuit R14 of the transistor Q10 and the emitter circuit R21 of the transistor Q20 .

次に回路の動作について説明する。増幅回路1
0及び20はエミツタ接地形増幅回路であるの
で、抵抗R13,R14,R21及びR22の値をそれぞれ
R13,R14,R21及びR22とすると、入力信号は増
幅回路10によりR14/R13倍され、さらに増幅
回路20によりR21/R22倍されて抵抗R22の両端
に出力信号として導出される。ところで、トラン
ジスタQ10及びQ20はコレクタベース間容量Cob及
び出力アドミタンスhoeを有し完全な電流源とは
なり得ず、アース間のノイズひnが信号系へ侵入
する。これを抑制するため抵抗分圧回路30が設
けられている。以下第2図を参照しつつ本考案に
おけるノイズ抑制作用について説明する。
Next, the operation of the circuit will be explained. Amplifier circuit 1
Since 0 and 20 are emitter grounded amplifier circuits, the values of resistors R 13 , R 14 , R 21 and R 22 are respectively
Assuming R 13 , R 14 , R 21 and R 22 , the input signal is multiplied by R 14 /R 13 by the amplifier circuit 10, further multiplied by R 21 /R 22 by the amplifier circuit 20, and the output signal is sent to both ends of the resistor R 22 . It is derived as By the way, the transistors Q 10 and Q 20 have a collector-base capacitance Cob and an output admittance hoe, and cannot serve as perfect current sources, and noise between the ground and the ground intrudes into the signal system. A resistive voltage divider circuit 30 is provided to suppress this. The noise suppression effect of the present invention will be explained below with reference to FIG.

第2図の回路は、第1図に示された回路の交流
等価回路であり、ノイズ電圧ひnは抵抗分圧回路
30により、接続点A,C間に印加されるノイズ
電圧ノイズ電圧tひn及び接続点C,D間に印加
されるノイズ電圧(1−t)ひnに分けられる。
ここで、tは分圧比であり、R17/(R17+R18
として表わされる。抵抗R30は抵抗R17とR18とが
並列接続された合成抵抗を示す。前段増幅回路1
0は従来のアイソレーシヨンアンプと同様の構成
であり、そのノイズひn成分に対する伝達関数は
A+jωBの形で表わされる。ここで、A,Bは実
数、ωはノイズnの周波数、jは虚数単位を示
す。よつて、ノイズ電圧tひnにより抵抗R14
印加されるノイズ電圧はtひn(A+jωB)とな
る。また、後段増幅回路20のノイズひn成分に
対する伝達関数はC+jωDと表わされる。ここで
C及びDは実数である。よつて、ノイズ電圧(1
−t)ひnにより抵抗R22に印加されるノイズ電
圧は(1−t)ひn(C+jωD)となる。なお、
上記A,B,C及びDは0もしくは0よりも大な
る値である。さらに、後段増幅回路20は、抵抗
R14の両端に印加されるノイズ電圧を増幅し、抵
抗R22の両端に出力する。後段増幅回路20の増
幅率を1とし、出力される位相を考慮して重ねの
理を適用すると、抵抗R16の両端に印加されるノ
イズ出力電圧ひoは、 ひo=(1−t)ひn(C+jωD)−tひn(A+
jωB)(dB)として表わされる。かかるノイズ電
圧ひnと出力電圧ひoとの関係を示す伝達関数を
hとして複素平面に表わすと、第3図のベクトル
図の如くなる。図中、h1=A+jωB,h2=C+
jωD、(1−t)<1である。ここで、伝達関数h
=(1−t)(C+jωD)−t(A+jωB)におい
て、tの値がt=D/(D+B)に設定される
と、ho=(B・C−D・A)/(D+B)となり
虚数部が相殺されて周波数依存性が解消され、実
数部の値も減少する。従つて、ノイズ抑制がなさ
れる。一方、tを変数として伝達関数hのとり得
る値|h|は、|h|≦|h1|もしくは|h|≦
|h2|であるから、少なくとも本考案のアイソレ
ーシヨンアンプのノイズ抑制作用は、分圧比tの
設定が適切でない場合でも2段増幅回路を構成す
る増幅回路のうちいずれかノイズ抑制作用の劣る
方よりも劣ることはなく回路の信頼性において好
ましい。さらに、伝達関数hの実数部と虚数部と
の比を調整しA/B=C/Dとすれば、伝達関数
hの値をほぼ0とすることが可能であり、ノイズ
電圧ひn成分は除去される。
The circuit shown in FIG. 2 is an AC equivalent circuit of the circuit shown in FIG. n and the noise voltage (1-t) applied between the connection points C and D.
Here, t is the partial pressure ratio, R 17 / (R 17 + R 18 )
It is expressed as Resistor R 30 represents a composite resistance in which resistors R 17 and R 18 are connected in parallel. Front stage amplifier circuit 1
0 has the same configuration as a conventional isolation amplifier, and its transfer function for the noise component is expressed in the form A+jωB. Here, A and B are real numbers, ω is the frequency of noise n, and j is an imaginary unit. Therefore, the noise voltage applied to the resistor R14 due to the noise voltage thin becomes thin(A+jωB). Further, the transfer function for the noise component of the rear-stage amplifier circuit 20 is expressed as C+jωD. Here C and D are real numbers. Therefore, the noise voltage (1
The noise voltage applied to the resistor R 22 by -t)hin becomes (1-t)hn(C+jωD). In addition,
The above A, B, C and D are 0 or a value larger than 0. Furthermore, the rear stage amplifier circuit 20 includes a resistor
The noise voltage applied across R14 is amplified and output across resistor R22 . Assuming that the amplification factor of the second-stage amplifier circuit 20 is 1 and applying the superposition principle in consideration of the output phase, the noise output voltage H o applied across the resistor R 16 is H o = (1 - t) hin(C+jωD)−thin(A+
jωB) (dB). If the transfer function indicating the relationship between the noise voltage h and the output voltage h is expressed on a complex plane as h, it will look like the vector diagram in FIG. 3. In the figure, h 1 =A+jωB, h 2 =C+
jωD, (1-t)<1. Here, the transfer function h
=(1-t)(C+jωD)-t(A+jωB), if the value of t is set to t=D/(D+B), then ho=(B・C−D・A)/(D+B) and becomes an imaginary number The parts cancel each other out, frequency dependence is eliminated, and the value of the real part also decreases. Therefore, noise suppression is achieved. On the other hand, the possible value |h| of the transfer function h with t as a variable is |h|≦|h 1 | or |h|≦
|h 2 | Therefore, at least the noise suppression effect of the isolation amplifier of the present invention is such that even if the setting of the voltage division ratio t is not appropriate, one of the amplifier circuits constituting the two-stage amplifier circuit has a worse noise suppression effect. It is preferable in terms of circuit reliability and is not inferior to the latter. Furthermore, by adjusting the ratio between the real part and the imaginary part of the transfer function h so that A/B=C/D, it is possible to make the value of the transfer function h almost 0, and the noise voltage h component is removed.

後段増幅回路20の増幅度がαであるときは、 上記伝達関数はh(α)は、 h(α)=(1−t)(Cα+jωDα)−αt(A+
jωB)となる。ただし、Cα+jωDαは後段増幅回
路20のノイズひn成分に対する伝達関数であ
る。かかる場合にも虚数成分を0とするtが存在
する。よつて、分圧回路30分の圧比を適切に設
定することにより高周波数域におけるノイズ抑制
作用の低下を抑制することが可能である。
When the amplification degree of the second-stage amplifier circuit 20 is α, the above transfer function h(α) is h(α)=(1-t)(Cα+jωDα)-αt(A+
jωB). However, Cα+jωDα is a transfer function for the noise component of the rear stage amplifier circuit 20. Even in such a case, there is a t whose imaginary component is 0. Therefore, by appropriately setting the pressure ratio of the voltage dividing circuit 30, it is possible to suppress a decrease in the noise suppression effect in the high frequency range.

第10図は、従来のアイソレーシヨンアンプの
周波数特性Aと本考案によるアイソレーシヨンア
ンプの周波数特性Bとを示しており、縦軸はノイ
ズ電圧ひnとして0〔dBV〕を印加したときの出
力端へのもれを、横軸はノイズ電圧ひnの周波数
〔KHz〕を表わす。この図からも明らかであるよ
うに、ナーデイオ周波数の広い帯域に亘つて出力
端へのアースノイズの侵入が著しく抑制され特に
高周波数域におけるノイズ抑制作用の改善が著し
い。
Figure 10 shows the frequency characteristic A of the conventional isolation amplifier and the frequency characteristic B of the isolation amplifier according to the present invention, where the vertical axis shows the frequency characteristic when 0 [dBV] is applied as the noise voltage. The horizontal axis represents the frequency [KHz] of the noise voltage hin, which represents the leakage to the output terminal. As is clear from this figure, the intrusion of ground noise into the output end is significantly suppressed over a wide range of radio frequencies, and the noise suppression effect is particularly improved in the high frequency range.

本考案の他の実施例を第4図から第8図に示
す。各図に示された回路において第1図に示され
た回路と対応する部分には同一符号を付してお
り、かかる部分の説明は省略する。
Other embodiments of the invention are shown in FIGS. 4 to 8. In the circuit shown in each figure, the parts corresponding to the circuit shown in FIG. 1 are denoted by the same reference numerals, and the explanation of these parts will be omitted.

第4図の回路おいては、トランジスタQ10
PNP形トランジスタ、トランジスタQ20にNPN
形トランジスタを用いている。抵抗R40は接地系
を分離するデカツプリング抵抗である。
In the circuit of Figure 4, the transistor Q10
PNP type transistor, NPN in transistor Q 20
It uses a type transistor. Resistor R 40 is a decoupled spring resistor that isolates the ground system.

第5図の回路においては、トランジスタQ10
びQ20にPNP形トランジスタを用いている。コン
デンサC22は分圧回路(抵抗R31及びR32)の分圧
出力(交流分)をトランジスタQ20のエミツタ回
路に供給する。
In the circuit of FIG. 5, PNP type transistors are used for transistors Q10 and Q20 . Capacitor C 22 supplies the divided voltage output (AC component) of the voltage dividing circuit (resistors R 31 and R 32 ) to the emitter circuit of transistor Q 20 .

第6図の回路においては、トランジスタQ10
びQ20としてFETを用いている。抵抗R41はトラ
ンジスタQ20のゲートバイアス抵抗である。コン
デンサC12は結合コンデンサである。
In the circuit of FIG. 6, FETs are used as transistors Q10 and Q20 . Resistor R 41 is the gate bias resistance of transistor Q 20 . Capacitor C12 is a coupling capacitor.

第7図の回路は、第1図の回路において分圧回
路の抵抗R31とバイパスコンデンサC11の位置を変
更した例であり、交流回路として両者は等しいも
のである。
The circuit of FIG. 7 is an example in which the positions of the resistor R 31 of the voltage dividing circuit and the bypass capacitor C 11 of the voltage dividing circuit are changed in the circuit of FIG. 1, and both are equivalent as an AC circuit.

第8図の回路は、第1図の回路のトランジスタ
Q10をFETとし、抵抗R31とコンデンサC11の位置
を逆にして接続した例である。
The circuit in Figure 8 is a transistor of the circuit in Figure 1.
This is an example in which Q 10 is a FET and the resistor R 31 and capacitor C 11 are connected with their positions reversed.

各回路の交流等価回路は第1図に示された回路
の交流等価回路と同等であり、同様のノイズ抑制
作用が得られる。
The AC equivalent circuit of each circuit is equivalent to the AC equivalent circuit of the circuit shown in FIG. 1, and the same noise suppressing effect can be obtained.

なお、抵抗分圧回路30を可変抵抗もしくは可
変抵抗を含む構成とすることが可能であり、かか
る場合には回路素子の値のバラツキによる回路毎
の特性の相違を調整することが可能である。ま
た、交流成分を分圧する交流分圧回路は抵抗分圧
回路に限らず、インピーダンス回路により構成さ
れ得る。
Note that the resistive voltage divider circuit 30 can be configured to be a variable resistor or include a variable resistor, and in such a case, it is possible to adjust differences in characteristics of each circuit due to variations in the values of circuit elements. Further, the AC voltage divider circuit that divides the voltage of the AC component is not limited to a resistive voltage divider circuit, but may be configured by an impedance circuit.

考案の効果 以上説明したように本考案のアースアイソレー
シヨンにおいては、前段が第1接地系に、その後
段が第2接地系に接続されるエミツタ接地系多段
増幅回路と、アース間ノイズ電圧が印加される交
流分圧回路とを備え、この分圧回路の分圧出力を
前段増幅回路のコレクタ回路及び後段増幅回路の
エミツタ回路に適切な値で供給してアース間ノイ
ズに対する両回路の合成伝達関数の周波数依存性
及び利得を減ずる構成としている故、オーデイオ
周波数の低域から高域に亘つてアースノイズ成分
の出力信号への混入が抑制されて好ましい。
Effects of the invention As explained above, the earth isolation of the invention uses a grounded emitter multistage amplifier circuit in which the first stage is connected to the first grounding system and the subsequent stage is connected to the second grounding system, and the ground-to-ground noise voltage. The divided voltage output of this voltage dividing circuit is supplied at an appropriate value to the collector circuit of the front-stage amplifier circuit and the emitter circuit of the rear-stage amplifier circuit, so that the combined transmission of both circuits to the ground-to-ground noise is achieved. Since the configuration is such that the frequency dependence and gain of the function are reduced, it is preferable that ground noise components are suppressed from being mixed into the output signal from low to high audio frequencies.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は、本考案の実施例を示す回路図、第2
図は、第1図に示された回路の交流等価回路を示
回路図、第3図は、第2図に示された回路の動作
を説明するためのベクトル図、第4図〜第8図
は、本考案の他の実施例を示す回路図、第9図
は、従来回路例を示す回路図、第10図は、従来
回路及び本考案回路の周波数特性を示す特性曲線
図である。 10……前段増幅回路、20……後段増幅回
路、30……分圧回路。
FIG. 1 is a circuit diagram showing an embodiment of the present invention, and FIG.
The figure is a circuit diagram showing an AC equivalent circuit of the circuit shown in Fig. 1, Fig. 3 is a vector diagram for explaining the operation of the circuit shown in Fig. 2, and Figs. 4 to 8 9 is a circuit diagram showing another embodiment of the present invention, FIG. 9 is a circuit diagram showing an example of a conventional circuit, and FIG. 10 is a characteristic curve diagram showing frequency characteristics of the conventional circuit and the circuit of the present invention. 10... front stage amplifier circuit, 20... rear stage amplifier circuit, 30... voltage dividing circuit.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] 第1接地系を有するエミツタ接地形の第1トラ
ンジスタ増幅回路と、前記第1トランジスタ増幅
回路のコレクタ出力をベース入力としかつ第2接
地系を有するエミツタ接地形の第2トランジスタ
増幅回路とを含むアースアイソレーシヨンアンプ
であつて、前記第1接地系と前記第2接地系との
間に接続されて交流分のみを圧する交流分圧回路
を有し、前記交流分圧回路の分圧出力が前記第1
トランジスタ増幅回路のコレクタ回路及び前記第
2トランジスタ増幅回路のエミツタ回路に供給さ
れることを特徴とするアースアイソレーシヨンア
ンプ。
a first transistor amplifier circuit with an emitter-grounded configuration having a first grounding system; and a second transistor amplifier circuit with an emitter-grounded configuration that uses the collector output of the first transistor amplifier circuit as a base input and has a second grounding system. The isolation amplifier includes an AC voltage divider circuit that is connected between the first grounding system and the second grounding system and outputs only an AC component, and the divided voltage output of the AC voltage divider circuit is connected to the AC voltage divider circuit. 1st
An earth isolation amplifier characterized in that the earth isolation amplifier is supplied to a collector circuit of a transistor amplifier circuit and an emitter circuit of the second transistor amplifier circuit.
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