JPH04340751A - 樹脂封止型半導体装置 - Google Patents
樹脂封止型半導体装置Info
- Publication number
- JPH04340751A JPH04340751A JP3112092A JP11209291A JPH04340751A JP H04340751 A JPH04340751 A JP H04340751A JP 3112092 A JP3112092 A JP 3112092A JP 11209291 A JP11209291 A JP 11209291A JP H04340751 A JPH04340751 A JP H04340751A
- Authority
- JP
- Japan
- Prior art keywords
- semiconductor chip
- chip
- lead frame
- resin
- package
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/851—Dispositions of multiple connectors or interconnections
- H10W72/874—On different surfaces
- H10W72/884—Die-attach connectors and bond wires
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/731—Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors
- H10W90/736—Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors between a chip and a stacked lead frame, conducting package substrate or heat sink
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/751—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
- H10W90/756—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink
Landscapes
- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【0001】
【産業上の利用分野】本発明は樹脂封止型半導体装置に
関する。
関する。
【0002】
【従来の技術】従来の樹脂封止型半導体装置は、リード
フレームのアイランド部の上面に半導体チップをダイボ
ンディングし、ボンディングワイヤにより、半導体チッ
プと外部端子との電気的接続を行ない、その後、樹脂封
止を行なうというものであった。この封止用樹脂は、リ
ードフレームを境としてパッケージの上下がほぼ対称と
なるように同一の厚さに形成されるのが一般的であった
。
フレームのアイランド部の上面に半導体チップをダイボ
ンディングし、ボンディングワイヤにより、半導体チッ
プと外部端子との電気的接続を行ない、その後、樹脂封
止を行なうというものであった。この封止用樹脂は、リ
ードフレームを境としてパッケージの上下がほぼ対称と
なるように同一の厚さに形成されるのが一般的であった
。
【0003】
【発明が解決しようとする課題】上述した従来の樹脂封
止型半導体装置は、リードフレームの片面にのみ半導体
チップをダイボンディングにより搭載するため、リード
フレームを境としてパッケージの上下が同一の厚さに形
成する場合は上下の樹脂量が異なるので、樹脂封止後の
温度低下による封止用樹脂の熱収縮の差によりパッケー
ジが上面あるいは下面に反るという欠点があった。
止型半導体装置は、リードフレームの片面にのみ半導体
チップをダイボンディングにより搭載するため、リード
フレームを境としてパッケージの上下が同一の厚さに形
成する場合は上下の樹脂量が異なるので、樹脂封止後の
温度低下による封止用樹脂の熱収縮の差によりパッケー
ジが上面あるいは下面に反るという欠点があった。
【0004】
【課題を解決するための手段】本発明の樹脂封止型半導
体装置は、上面に半導体チップを搭載するリードフレー
ムのアイランド部の下面に搭載する前記半導体チップと
同一の材料を用い同一の寸法に形成した疑似半導体チッ
プを備えて構成されている。
体装置は、上面に半導体チップを搭載するリードフレー
ムのアイランド部の下面に搭載する前記半導体チップと
同一の材料を用い同一の寸法に形成した疑似半導体チッ
プを備えて構成されている。
【0005】
【実施例】次に、本発明の実施例について図面を参照し
て説明する。
て説明する。
【0006】図1は本発明の樹脂封止型半導体装置の一
実施例を示す断面図である。
実施例を示す断面図である。
【0007】本実施例の樹脂封止型半導体装置は、図1
に示すように、リードフレームのアイランド部3の上面
に半導体チップ2を接着剤7によりダイボンディングを
して搭載し、ボンディングワイヤ4により外部端子5と
電気的接続を行ない、アイランド部3の下面に疑似半導
体チップ1を半導体チップ2と同様なダイボンディング
により搭載し、封止用の樹脂6で樹脂封止を行なうもの
である。
に示すように、リードフレームのアイランド部3の上面
に半導体チップ2を接着剤7によりダイボンディングを
して搭載し、ボンディングワイヤ4により外部端子5と
電気的接続を行ない、アイランド部3の下面に疑似半導
体チップ1を半導体チップ2と同様なダイボンディング
により搭載し、封止用の樹脂6で樹脂封止を行なうもの
である。
【0008】疑似半導体チップ1は、半導体チップ2と
同一の材料、たとえば、シリコン単結晶を用いて同一の
寸法に形成したものである。これはたとえば、半導体チ
ップ2を形成するウエーハと同一のウエーハを用い半導
体チップ2と同一の寸法に切断したものである。あるい
は、半導体チップ2のチップ検査による不良品を用いて
もよい。
同一の材料、たとえば、シリコン単結晶を用いて同一の
寸法に形成したものである。これはたとえば、半導体チ
ップ2を形成するウエーハと同一のウエーハを用い半導
体チップ2と同一の寸法に切断したものである。あるい
は、半導体チップ2のチップ検査による不良品を用いて
もよい。
【0009】
【発明の効果】以上説明したように、本発明の樹脂封止
型半導体装置は、上面に半導体チップを搭載するリード
フレームのアイランド部の下面に、半導体チップと同一
の材料を用い同一の寸法に形成した疑似半導体チップを
搭載するので、リードフレームを境としてパッケージの
上下が同一の厚さに形成する場合に上下の樹脂量は等し
くなるので、樹脂封止後の温度低下による封止用樹脂の
熱収縮の差によるパッケージの反りを防止することがで
きるという効果を有している。
型半導体装置は、上面に半導体チップを搭載するリード
フレームのアイランド部の下面に、半導体チップと同一
の材料を用い同一の寸法に形成した疑似半導体チップを
搭載するので、リードフレームを境としてパッケージの
上下が同一の厚さに形成する場合に上下の樹脂量は等し
くなるので、樹脂封止後の温度低下による封止用樹脂の
熱収縮の差によるパッケージの反りを防止することがで
きるという効果を有している。
【図1】本発明の樹脂封止型半導体装置の一実施例を示
す断面図である。
す断面図である。
1 疑似半導体チップ
2 半導体チップ
3 アイランド部
4 ボンディングワイヤ
5 外部端子
6 樹脂
7 接着剤
Claims (1)
- 【請求項1】 上面に半導体チップを搭載するリード
フレームのアイランド部の下面に搭載する前記半導体チ
ップと同一の材料を用い同一の寸法に形成した疑似半導
体チップを備えることを特徴とする樹脂封止型半導体装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3112092A JPH04340751A (ja) | 1991-05-17 | 1991-05-17 | 樹脂封止型半導体装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3112092A JPH04340751A (ja) | 1991-05-17 | 1991-05-17 | 樹脂封止型半導体装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04340751A true JPH04340751A (ja) | 1992-11-27 |
Family
ID=14577912
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3112092A Pending JPH04340751A (ja) | 1991-05-17 | 1991-05-17 | 樹脂封止型半導体装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04340751A (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06295970A (ja) * | 1993-04-08 | 1994-10-21 | Seiko Epson Corp | 半導体装置及び半導体装置製造方法 |
| KR20010066463A (ko) * | 1999-12-31 | 2001-07-11 | 박종섭 | 적층 패키지 및 그 제조 방법 |
| JP2008172115A (ja) * | 2007-01-15 | 2008-07-24 | Rohm Co Ltd | 半導体装置 |
| US7622333B2 (en) | 2006-08-04 | 2009-11-24 | Stats Chippac Ltd. | Integrated circuit package system for package stacking and manufacturing method thereof |
| US7645638B2 (en) | 2006-08-04 | 2010-01-12 | Stats Chippac Ltd. | Stackable multi-chip package system with support structure |
| US7683467B2 (en) | 2006-12-07 | 2010-03-23 | Stats Chippac Ltd. | Integrated circuit package system employing structural support |
-
1991
- 1991-05-17 JP JP3112092A patent/JPH04340751A/ja active Pending
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06295970A (ja) * | 1993-04-08 | 1994-10-21 | Seiko Epson Corp | 半導体装置及び半導体装置製造方法 |
| KR20010066463A (ko) * | 1999-12-31 | 2001-07-11 | 박종섭 | 적층 패키지 및 그 제조 방법 |
| US7622333B2 (en) | 2006-08-04 | 2009-11-24 | Stats Chippac Ltd. | Integrated circuit package system for package stacking and manufacturing method thereof |
| US7645638B2 (en) | 2006-08-04 | 2010-01-12 | Stats Chippac Ltd. | Stackable multi-chip package system with support structure |
| US7915738B2 (en) | 2006-08-04 | 2011-03-29 | Stats Chippac Ltd. | Stackable multi-chip package system with support structure |
| US8067272B2 (en) | 2006-08-04 | 2011-11-29 | Stats Chippac Ltd. | Integrated circuit package system for package stacking and manufacturing method thereof |
| US7683467B2 (en) | 2006-12-07 | 2010-03-23 | Stats Chippac Ltd. | Integrated circuit package system employing structural support |
| JP2008172115A (ja) * | 2007-01-15 | 2008-07-24 | Rohm Co Ltd | 半導体装置 |
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