JPH04359187A - 計算機時計システム - Google Patents
計算機時計システムInfo
- Publication number
- JPH04359187A JPH04359187A JP3133130A JP13313091A JPH04359187A JP H04359187 A JPH04359187 A JP H04359187A JP 3133130 A JP3133130 A JP 3133130A JP 13313091 A JP13313091 A JP 13313091A JP H04359187 A JPH04359187 A JP H04359187A
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- JP
- Japan
- Prior art keywords
- time
- clock
- computer
- common clock
- common
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
［発明の目的］
【０００１】
【産業上の利用分野】本発明は、複合系計算機システム
における計算機の時刻を合わせる計算機時計システムに
関する。
における計算機の時刻を合わせる計算機時計システムに
関する。
【０００２】
【従来の技術】一般に、複合系計算機システムでは、各
々の計算機が内部時計を備え、各々の計算機は自計算機
の内部時計の時刻を正として動作している。この場合、
各々の計算機の内部時計の時刻を合わせるために複数の
計算機から読み出し可能な共通時計が設置され、操作員
の要求により共通時計の時刻を各々の計算機の内部時計
に設定する。
々の計算機が内部時計を備え、各々の計算機は自計算機
の内部時計の時刻を正として動作している。この場合、
各々の計算機の内部時計の時刻を合わせるために複数の
計算機から読み出し可能な共通時計が設置され、操作員
の要求により共通時計の時刻を各々の計算機の内部時計
に設定する。
【０００３】図３に、従来の複合系計算機システムにお
ける計算機時計システムを示す。
ける計算機時計システムを示す。
【０００４】この計算機時計システムは、計算機１（１
）および計算機１（２）に共通時計２が接続されている
。各計算機１は、計算機内部時計３および計算機内部時
計時刻設定部４とを備えている。
）および計算機１（２）に共通時計２が接続されている
。各計算機１は、計算機内部時計３および計算機内部時
計時刻設定部４とを備えている。
【０００５】計算機１（１）について、操作員が時刻修
正指令を入力すると、計算機内部時計時刻設定部４では
、共通時計２より時刻を読み出し、計算機内部時計３に
時刻を設定する。さらに、同様に計算機１（２）につい
て、操作員の時刻修正指令の入力により計算機内部時計
時刻設定部４が共通時計２より計算機内部時計３に時刻
を設定する。このように複合系計算機システムでは同様
の処理を各計算機に実施して全ての計算機の内部時計の
時刻を共通時計の時刻に一致させる。
正指令を入力すると、計算機内部時計時刻設定部４では
、共通時計２より時刻を読み出し、計算機内部時計３に
時刻を設定する。さらに、同様に計算機１（２）につい
て、操作員の時刻修正指令の入力により計算機内部時計
時刻設定部４が共通時計２より計算機内部時計３に時刻
を設定する。このように複合系計算機システムでは同様
の処理を各計算機に実施して全ての計算機の内部時計の
時刻を共通時計の時刻に一致させる。
【０００６】
【発明が解決しようとする課題】しかしながら、上記し
た従来のシステムでは、操作員が気付いたときに手動に
より時刻修正指令を入力するために計算機１（１）と計
算機１（２）の計算機内部時計３の時刻ずれが生じてい
る場合がある。
た従来のシステムでは、操作員が気付いたときに手動に
より時刻修正指令を入力するために計算機１（１）と計
算機１（２）の計算機内部時計３の時刻ずれが生じてい
る場合がある。
【０００７】各計算機１の計算機内部時計３に時刻ずれ
が生じると、プラントデータ等の値が刻々と変化する処
理では、各計算機１の出力における時刻とプラントデー
タの関係がずれ、データの統一性が取れず、さらにデー
タの信頼性の低下を招くという問題がある。
が生じると、プラントデータ等の値が刻々と変化する処
理では、各計算機１の出力における時刻とプラントデー
タの関係がずれ、データの統一性が取れず、さらにデー
タの信頼性の低下を招くという問題がある。
【０００８】この場合、共通時計２の時刻を計算機内部
時計３に定期的に自動で設定して、上記した時刻ずれを
なくすことは可能である。ところが、共通時計２の時刻
が狂っていれば、全ての計算機の時刻が狂うため実施で
きなかった。
時計３に定期的に自動で設定して、上記した時刻ずれを
なくすことは可能である。ところが、共通時計２の時刻
が狂っていれば、全ての計算機の時刻が狂うため実施で
きなかった。
【０００９】そこで、本発明は、共通時計の健全性を確
認しながら計算機内部時計に共通時計の時刻を定期的に
自動設定する計算機時計システムを提供することを目的
とする。 ［発明の構成］
認しながら計算機内部時計に共通時計の時刻を定期的に
自動設定する計算機時計システムを提供することを目的
とする。 ［発明の構成］
【００１０】
【課題を解決するための手段】本発明は、複数の計算機
と、これら複数の計算機の各々の計算機内部時計を同じ
時刻に合わせるための共通時計と、前記各々の計算機に
は時刻修正指令により前記共通時計の時刻を読み出し、
かつ、前記計算機内部時計に前記共通時計の時刻を設定
するための計算機内部時計時刻設定部を有する計算機時
計システムにおいて、前記共通時計の時刻と前記各計算
機内部時計との時刻を定期的に読み出しこの両時刻の時
刻差を演算する前記各々の計算機に設けられた時刻比較
部と、これらの時刻比較部により演算された前記各時刻
差を記憶する記憶装置と、この記憶装置に記憶された前
記各時刻差と予め前記記憶装置に記憶された規定値とを
定期的に読み出して順次比較し、前記時刻差のいずれか
が前記規定値以内のとき前記計算機内部時計時刻設定部
に時刻修正指令を出力する前記各々の計算機に設けられ
た共通時計健全性確認部とを設けるようにしたものであ
る。
と、これら複数の計算機の各々の計算機内部時計を同じ
時刻に合わせるための共通時計と、前記各々の計算機に
は時刻修正指令により前記共通時計の時刻を読み出し、
かつ、前記計算機内部時計に前記共通時計の時刻を設定
するための計算機内部時計時刻設定部を有する計算機時
計システムにおいて、前記共通時計の時刻と前記各計算
機内部時計との時刻を定期的に読み出しこの両時刻の時
刻差を演算する前記各々の計算機に設けられた時刻比較
部と、これらの時刻比較部により演算された前記各時刻
差を記憶する記憶装置と、この記憶装置に記憶された前
記各時刻差と予め前記記憶装置に記憶された規定値とを
定期的に読み出して順次比較し、前記時刻差のいずれか
が前記規定値以内のとき前記計算機内部時計時刻設定部
に時刻修正指令を出力する前記各々の計算機に設けられ
た共通時計健全性確認部とを設けるようにしたものであ
る。
【００１１】
【作用】上記構成により、共通時計健全性確認部は、共
通時計の時刻と計算機内部時計との各時刻差のいずれか
が予め記憶装置に記憶された規定値以内のとき共通時計
の時刻は正常と判定する。計算機内部時計時刻設定部は
、時刻修正指令により共通時計の時刻を読み出し、この
時刻を計算機内部時計に設定する。これにより、複数の
計算機システムの各計算機内部時計が共通時計の時刻に
合わせられ、全ての計算機内部時計の時刻を一致させる
ことができる。
通時計の時刻と計算機内部時計との各時刻差のいずれか
が予め記憶装置に記憶された規定値以内のとき共通時計
の時刻は正常と判定する。計算機内部時計時刻設定部は
、時刻修正指令により共通時計の時刻を読み出し、この
時刻を計算機内部時計に設定する。これにより、複数の
計算機システムの各計算機内部時計が共通時計の時刻に
合わせられ、全ての計算機内部時計の時刻を一致させる
ことができる。
【００１２】
【実施例】以下、本発明の実施例を図面を参照して説明
する。
する。
【００１３】図１は、本発明の一実施例を示す計算機時
計システムのブロック構成図である。図中、図３と同一
符号は同一または相当部分を示す。図３と異なる点は、
記憶装置５を備えて計算機１（１）と計算機１（２）に
接続する一方、各計算機１に時刻比較部６および共通時
計健全性確認部７を備えた点である。
計システムのブロック構成図である。図中、図３と同一
符号は同一または相当部分を示す。図３と異なる点は、
記憶装置５を備えて計算機１（１）と計算機１（２）に
接続する一方、各計算機１に時刻比較部６および共通時
計健全性確認部７を備えた点である。
【００１４】記憶装置５は、共通時計２と計算機内部時
計３の時刻差および所定の規定値を書き込む。
計３の時刻差および所定の規定値を書き込む。
【００１５】時刻比較部６は、共通時計２の時刻と計算
機内部時計３の時刻との時刻差を演算して、その時刻差
を記憶装置５へ書き込む。
機内部時計３の時刻との時刻差を演算して、その時刻差
を記憶装置５へ書き込む。
【００１６】共通時計健全性確認部７は、記憶装置５に
書き込まれた時刻差が規定値以内であるか否か判定し、
規定値以内であれば共通時計２は正常であるとして、計
算機内部時計時刻設定部４時刻修正指令を出力する。
書き込まれた時刻差が規定値以内であるか否か判定し、
規定値以内であれば共通時計２は正常であるとして、計
算機内部時計時刻設定部４時刻修正指令を出力する。
【００１７】次に、図２に示す処理手順に沿って作用を
説明する。
説明する。
【００１８】最初に、計算機１（１）について処理がさ
れるとする。まず、時刻比較部６が共通時計２の時刻を
読み込む（１０１）。続いて、時刻比較部６が計算機内
部時計３の時刻を読み込む（１０２）。さらに、時刻比
較部６は上記時刻比較部６が読み込んだ共通時計２の時
刻と計算機内部時計３の時刻との差を演算してその時刻
差をε１として記憶装置５の共有メモリに書き込む（１
０３）。
れるとする。まず、時刻比較部６が共通時計２の時刻を
読み込む（１０１）。続いて、時刻比較部６が計算機内
部時計３の時刻を読み込む（１０２）。さらに、時刻比
較部６は上記時刻比較部６が読み込んだ共通時計２の時
刻と計算機内部時計３の時刻との差を演算してその時刻
差をε１として記憶装置５の共有メモリに書き込む（１
０３）。
【００１９】共通時計健全性確認部７では、時刻比較部
６が演算して記憶装置５に書き込んだ時刻差ε１を読み
出し、時刻差ε１が規定値ε以内か否か判定する（１０
４）。
６が演算して記憶装置５に書き込んだ時刻差ε１を読み
出し、時刻差ε１が規定値ε以内か否か判定する（１０
４）。
【００２０】即ち、次の条件式（１）が成立するか否か
判定する。
判定する。
【００２１】
【数１】
ε１＜（｜α１｜＋｜α２｜）×Ｔ＝ε……（１）
【０
０２２】ここで、α１：共通時計２の精度α２：計算機
内部時計３の精度 Ｔ：時刻合わせの周期
０２２】ここで、α１：共通時計２の精度α２：計算機
内部時計３の精度 Ｔ：時刻合わせの周期
【００２３】上記の条件式（１）の条件が成立する場合
、共通時計２は正常として共通時計健全性確認部７が計
算機内部時計時刻設定部４へ時刻修正指令を出力する。 計算機内部時計時刻設定部４では、時刻修正指令により
共通時計２から時刻を読み出し、これを計算機内部時計
３に設定する（１０５）（１０６）。
、共通時計２は正常として共通時計健全性確認部７が計
算機内部時計時刻設定部４へ時刻修正指令を出力する。 計算機内部時計時刻設定部４では、時刻修正指令により
共通時計２から時刻を読み出し、これを計算機内部時計
３に設定する（１０５）（１０６）。
【００２４】一方、上記の条件式（１）の条件が成立し
ない場合、共通時計２または計算機１（１）の計算機内
部時計３の時刻が異常として次の処理がされる。
ない場合、共通時計２または計算機１（１）の計算機内
部時計３の時刻が異常として次の処理がされる。
【００２５】まず、次の計算機１（２）について上記計
算機１（１）と同様に処理された共通時計２の時刻と計
算機１（２）の計算機内部時計３の時刻との差、つまり
、記憶装置５に書き込まれた時刻差ε２の読み出しを計
算機１（１）の共通時計健全性確認部７がする（１０７
）。次に、計算機１（１）の共通時計健全性確認部７は
、次の条件式（２）の条件が成立するか否かを判定をす
る（１０８）。
算機１（１）と同様に処理された共通時計２の時刻と計
算機１（２）の計算機内部時計３の時刻との差、つまり
、記憶装置５に書き込まれた時刻差ε２の読み出しを計
算機１（１）の共通時計健全性確認部７がする（１０７
）。次に、計算機１（１）の共通時計健全性確認部７は
、次の条件式（２）の条件が成立するか否かを判定をす
る（１０８）。
【００２６】
【数２】ε２＜ε……（２）
【００２７】この判定で上記式（２）の条件が成立する
場合、計算機１（１）の共通時計健全性確認部７は計算
機内部時計時刻設定部４へ時刻修正指令を出力する。こ
れにより、計算機内部時計時刻設定部４が共通時計２の
時刻を読み出す（１０５）。そして、計算機１（１）の
計算機内部時計３に共通時計２の時刻を設定する（１０
６）。
場合、計算機１（１）の共通時計健全性確認部７は計算
機内部時計時刻設定部４へ時刻修正指令を出力する。こ
れにより、計算機内部時計時刻設定部４が共通時計２の
時刻を読み出す（１０５）。そして、計算機１（１）の
計算機内部時計３に共通時計２の時刻を設定する（１０
６）。
【００２８】計算機１（２）についても同様の処理によ
り計算機内部時計時刻設定部４が共通時計２の時刻を読
み出す。そして、計算機１（２）の計算機内部時計３に
共通時計２の時刻を設定する。以上の処理は、一定の周
期で繰り返し実施される。また、上記の条件式（２）の
条件が成立しない場合、共通時計２が異常として時刻の
設定をしない。このような場合、例えば、警報を出力す
る。
り計算機内部時計時刻設定部４が共通時計２の時刻を読
み出す。そして、計算機１（２）の計算機内部時計３に
共通時計２の時刻を設定する。以上の処理は、一定の周
期で繰り返し実施される。また、上記の条件式（２）の
条件が成立しない場合、共通時計２が異常として時刻の
設定をしない。このような場合、例えば、警報を出力す
る。
【００２９】なお、共通時計２の健全性を判定するため
の上記規定値εは、予め演算され記憶装置５の共有メモ
リに書き込まれている。
の上記規定値εは、予め演算され記憶装置５の共有メモ
リに書き込まれている。
【００３０】このように、操作員の操作を必要としない
で共通時計の健全性を確認しながら計算機内部時計の時
刻を共通時計に合わせて２台の計算機時計システムの時
刻を一致させることができる。
で共通時計の健全性を確認しながら計算機内部時計の時
刻を共通時計に合わせて２台の計算機時計システムの時
刻を一致させることができる。
【００３１】なお、上記した実施例では、２台の構成の
計算機時計システムについて説明したが、計算機の台数
が増加しても時刻差を比較する計算機の台数を増加して
いずれかが正常であれば共通時計は正常であるとして時
刻合わせを実施して複合系計算機システムの各計算機の
時刻を一致させることができる。
計算機時計システムについて説明したが、計算機の台数
が増加しても時刻差を比較する計算機の台数を増加して
いずれかが正常であれば共通時計は正常であるとして時
刻合わせを実施して複合系計算機システムの各計算機の
時刻を一致させることができる。
【００３２】
【発明の効果】以上説明したように本実施例によれば、
共通時計の健全性を確認しながら計算機内部時計の時刻
を共通時計に合わせることができる。従って、複合系計
算機システムにおける各計算機の時刻のずれが正確に修
正される。
共通時計の健全性を確認しながら計算機内部時計の時刻
を共通時計に合わせることができる。従って、複合系計
算機システムにおける各計算機の時刻のずれが正確に修
正される。
【図１】本発明の一実施例を示す計算機時計システムの
ブロック構成図である。
ブロック構成図である。
【図２】同装置の処理手順を示すフローチャートである
。
。
【図３】従来例を示す計算機時計システムのブロック構
成図である。
成図である。
１（１），１（２） 計算機
２ 共通時計
３ 計算機内部時計
４ 計算機内部時計時刻設定部
５ 記憶装置
６ 時刻比較部
７ 共通時計健全性確認部
Claims (1)
- 【請求項１】 複数の計算機と、これら複数の計算機
の各々の計算機内部時計を同じ時刻に合わせるための共
通時計と、前記各々の計算機には時刻修正指令により前
記共通時計の時刻を読み出し、かつ、前記計算機内部時
計に前記共通時計の時刻を設定するための計算機内部時
計時刻設定部を有する計算機時計システムにおいて、前
記共通時計の時刻と前記各計算機内部時計との時刻を定
期的に読み出しこの両時刻の時刻差を演算する前記各々
の計算機に設けられた時刻比較部と、これらの時刻比較
部により演算された前記各時刻差を記憶する記憶装置と
、この記憶装置に記憶された前記各時刻差と予め前記記
憶装置に記憶された規定値とを定期的に読み出して順次
比較し、前記時刻差のいずれかが前記規定値以内のとき
前記計算機内部時計時刻設定部に時刻修正指令を出力す
る前記各々の計算機に設けられた共通時計健全性確認部
とからなることを特徴とする計算機時計システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3133130A JPH04359187A (ja) | 1991-06-05 | 1991-06-05 | 計算機時計システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3133130A JPH04359187A (ja) | 1991-06-05 | 1991-06-05 | 計算機時計システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04359187A true JPH04359187A (ja) | 1992-12-11 |
Family
ID=15097485
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3133130A Pending JPH04359187A (ja) | 1991-06-05 | 1991-06-05 | 計算機時計システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04359187A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012234275A (ja) * | 2011-04-28 | 2012-11-29 | Nec System Technologies Ltd | リアルタイムクロック補正回路及びリアルタイムクロック補正方法 |
-
1991
- 1991-06-05 JP JP3133130A patent/JPH04359187A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012234275A (ja) * | 2011-04-28 | 2012-11-29 | Nec System Technologies Ltd | リアルタイムクロック補正回路及びリアルタイムクロック補正方法 |
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