JPH0436318U - - Google Patents

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JPH0436318U
JPH0436318U JP7901490U JP7901490U JPH0436318U JP H0436318 U JPH0436318 U JP H0436318U JP 7901490 U JP7901490 U JP 7901490U JP 7901490 U JP7901490 U JP 7901490U JP H0436318 U JPH0436318 U JP H0436318U
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JP7901490U
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  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Description

【図面の簡単な説明】
第１図は本考案の周波数掃引発信器の構成ブロ
ツク図、第２図は第１図において示した周期設定
部及び周波数設定部を抽出して示した構成ブロツ
ク図、第３図は本考案の周波数掃引発生器の動作
を説明するためのタイミングチヤートである。 １……第１のデジタル加算器、２……正弦波デ
ータメモリ、３……ＤＡ変換器、４……ＬＰＦ、
５……周期設定部、６……周波数設定部、６１…
…第２のデジタル加算器、６２……第３のデジタ
ル加算器。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 入力された周波数設定データとフイドバツ
    クされた出力データとを基本クロツクごとに加算
    する第１のデジタル加算器と、 この第１のデジタル加算器の出力データをアド
    レスとして、基本クロツクの入力ごとに振幅デー
    タが読み出される正弦波データメモリと、 この正弦波データメモリから出力される前記振
    幅データのデジタル信号をアナログ信号に変換す
    るＤＡ変換器と、 このＤＡ変換器の出力信号の高調波を除去する
    ためのＬＰＦと、 前記第１のデジタル加算器から出力される最上
    位ビツトをクロツクとして、設定された周期をカ
    ウントする周期設定部と、 この周期設定部が設定された周期をカウントし
    て発生するタイミングクロツクによつて、周期ご
    とに前記周波数設定データに一定の位相を加算し
    て前記第１のデジタル加算器に出力する周波数設
    定部とを備え、 前記第１のデジタル加算器の周波数設定データ
    を前記周期設定部で設定された周期ごとに、前記
    周波数設定部で可変とすることによつて、周波数
    を任意に掃引できるようにしたことを特徴とする
    周波数掃引発信器。 (2) 前記周波数設定部は、 ＭＳＢによつて生成したタイミングクロツクご
    とに、入力されたステツプ周波数設定データとフ
    イドバツクされた出力データを加算してステツプ
    周波数データとして出力する第２のデジタル加算
    器と、 前記タイミングクロツク信号ごとに、スタート
    周波数データと前記第２のデジタル加算器からの
    ステツプ周波数データとを加算して前記第１のデ
    ジタル加算器に周波数設定データとして出力する
    第３のデジタル加算器、 とによつて構成されたことを特徴とする請求項(1
    )の周波数掃引発信器。
JP7901490U 1990-07-25 1990-07-25 Pending JPH0436318U (ja)

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JP (1) JPH0436318U (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007157626A (ja) * 2005-12-08 2007-06-21 High Energy Accelerator Research Organization 高周波制御装置
JP2011146400A (ja) * 2011-03-22 2011-07-28 High Energy Accelerator Research Organization 高周波制御装置

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007157626A (ja) * 2005-12-08 2007-06-21 High Energy Accelerator Research Organization 高周波制御装置
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