JPH04373041A - マイクロコンピュータ - Google Patents
マイクロコンピュータInfo
- Publication number
- JPH04373041A JPH04373041A JP3177494A JP17749491A JPH04373041A JP H04373041 A JPH04373041 A JP H04373041A JP 3177494 A JP3177494 A JP 3177494A JP 17749491 A JP17749491 A JP 17749491A JP H04373041 A JPH04373041 A JP H04373041A
- Authority
- JP
- Japan
- Prior art keywords
- code
- microcomputer
- bit
- address bus
- output
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
- Y02D10/00—Energy efficient computing, e.g. low power processors, power management or thermal management
Landscapes
- Executing Machine-Instructions (AREA)
- Microcomputers (AREA)
- Memory System (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】この発明は、周辺装置とアドレス
バスで接続されるマイクロコンピュータに関し、特に数
表示の連続する２つのコード間におけるビット位置のビ
ット信号が異なるようなアドレスバス出力コードに変換
してアドレスバスに出力するマイクロコンピュータに関
するものである。
バスで接続されるマイクロコンピュータに関し、特に数
表示の連続する２つのコード間におけるビット位置のビ
ット信号が異なるようなアドレスバス出力コードに変換
してアドレスバスに出力するマイクロコンピュータに関
するものである。
【０００２】
【従来の技術】図４は、従来のマイクロコンピュータと
周辺装置との接続と、マイクロコンピュータ内の一部構
成を示すブロック図である。図４において、１はマイク
ロコンピュータ、２は周辺装置、３はマイクロコンピュ
ータ１と周辺装置２とを接続するアドレスバス、４はデ
ータバス、５はコントロールバス、６は２進カウンタで
ある。
周辺装置との接続と、マイクロコンピュータ内の一部構
成を示すブロック図である。図４において、１はマイク
ロコンピュータ、２は周辺装置、３はマイクロコンピュ
ータ１と周辺装置２とを接続するアドレスバス、４はデ
ータバス、５はコントロールバス、６は２進カウンタで
ある。
【０００３】従来のマイクロコンピュータでは、２進カ
ウンタ６の内容を基に、アドレスバス３の制御を行って
いる。図５は、従来のマイクロコンピュータのＢ０〜Ｂ
３の４ビットのアドレスバス出力コードで、０から１づ
つ増加する数値を各ビットの電圧レベルで示したもので
ある。アドレスバス３を制御するアドレスバス出力コー
ドはＢ０〜Ｂ３の信号の“Ｈ”レベルを“１”、“Ｌ”
レベルを“０”とすると、１０進数０〜９の数表示の連
続するコードが
ウンタ６の内容を基に、アドレスバス３の制御を行って
いる。図５は、従来のマイクロコンピュータのＢ０〜Ｂ
３の４ビットのアドレスバス出力コードで、０から１づ
つ増加する数値を各ビットの電圧レベルで示したもので
ある。アドレスバス３を制御するアドレスバス出力コー
ドはＢ０〜Ｂ３の信号の“Ｈ”レベルを“１”、“Ｌ”
レベルを“０”とすると、１０進数０〜９の数表示の連
続するコードが
〔００００〕〜〔１００１）の２進コー
ドで示される。そして、この２進コードがアドレスバス
３に出力されていた。
ドで示される。そして、この２進コードがアドレスバス
３に出力されていた。
【０００４】
【発明が解決しようとする課題】従来のマイクロコンピ
ュータのアドレスバス出力コードは、上記のようなコー
ドであるため、連続したアドレスを順にアクセスする等
のときに、あるタイミングでは多くのビットが同時に変
化する。この結果、多量の電流が流れ、電源に対してノ
イズが発生するという問題があった。
ュータのアドレスバス出力コードは、上記のようなコー
ドであるため、連続したアドレスを順にアクセスする等
のときに、あるタイミングでは多くのビットが同時に変
化する。この結果、多量の電流が流れ、電源に対してノ
イズが発生するという問題があった。
【０００５】この発明は上記のような問題点を解消する
ためになされたもので、連続したアドレスを順にアクセ
スする等のきのノイズを減らし、消費電力が小さいマイ
クロコンピュータを提供することにある。
ためになされたもので、連続したアドレスを順にアクセ
スする等のきのノイズを減らし、消費電力が小さいマイ
クロコンピュータを提供することにある。
【０００６】
【課題を解決するための手段】この発明に係るマイクロ
コンピュータは、図１および図３で示すように、数表示
Ｔの連続する２つのコード間におけるビット位置のビッ
ト信号が異なるようにコード変換するコード変換手段（
コード変換器７）をマイクロコンピュータ内に設けた。
コンピュータは、図１および図３で示すように、数表示
Ｔの連続する２つのコード間におけるビット位置のビッ
ト信号が異なるようにコード変換するコード変換手段（
コード変換器７）をマイクロコンピュータ内に設けた。
【０００７】
【作用】上記コード変換手段をマイクロコンピュータ内
に設けたため、このマイクロコンピュータからアドレス
バスに出力されるコードは、数表示Ｔの連続する２つの
コード間におけるビット位置のビット信号が異なるコー
ドである。したがって、上記のようなコードを出力する
アドレスバスでは、連続するアドレスをアクセスしてい
る限り、同時に複数のビットが変化すことがないので、
ノイズが減少し、また、各ビットの変化点も少なくなる
ので、全体としての消費電力が減少する。
に設けたため、このマイクロコンピュータからアドレス
バスに出力されるコードは、数表示Ｔの連続する２つの
コード間におけるビット位置のビット信号が異なるコー
ドである。したがって、上記のようなコードを出力する
アドレスバスでは、連続するアドレスをアクセスしてい
る限り、同時に複数のビットが変化すことがないので、
ノイズが減少し、また、各ビットの変化点も少なくなる
ので、全体としての消費電力が減少する。
【０００８】
【実施例】図１はこの発明の一実施例のマイクロコンピ
ュータと、周辺装置とのマイコンシステムにおける接続
を示すブロック図である。図１において、１はマイクロ
コンピュータ、２は周辺装置、３はアドレスバス、４は
データバス、５はコントロルバス、６は２進カウンタ、
７はコード変換手段としてのコード変換器である。この
コード変換器７以外の部分（ブロック）については、従
来のものと機能が同じであるため、詳細な説明は省略す
る。
ュータと、周辺装置とのマイコンシステムにおける接続
を示すブロック図である。図１において、１はマイクロ
コンピュータ、２は周辺装置、３はアドレスバス、４は
データバス、５はコントロルバス、６は２進カウンタ、
７はコード変換手段としてのコード変換器である。この
コード変換器７以外の部分（ブロック）については、従
来のものと機能が同じであるため、詳細な説明は省略す
る。
【０００９】コード変換器７は、マイクロコンピュータ
１内に２進カウンタ６と接続して設けられ、２進カウン
タ６からの数表示を示す複数ビットから成る連続して増
減する２進コードを、数表示Ｔの連続する２つのコード
間におけるビット位置のビット信号が異なるコードに変
換して、アドレスバス３に出力する。図２は図１のマイ
クロコンピュータに内蔵されたコード変換器の回路の一
例を示してい。このコード変換器７は交番２進コード（
グレーコード）にコードを変換する変換器であり、図２
において、Ｂ０〜Ｂｎは入力端子、７−１〜７−ｎはエ
クスクルーシブ・オア素子、Ａ０〜Ａｎは出力端子であ
る。
１内に２進カウンタ６と接続して設けられ、２進カウン
タ６からの数表示を示す複数ビットから成る連続して増
減する２進コードを、数表示Ｔの連続する２つのコード
間におけるビット位置のビット信号が異なるコードに変
換して、アドレスバス３に出力する。図２は図１のマイ
クロコンピュータに内蔵されたコード変換器の回路の一
例を示してい。このコード変換器７は交番２進コード（
グレーコード）にコードを変換する変換器であり、図２
において、Ｂ０〜Ｂｎは入力端子、７−１〜７−ｎはエ
クスクルーシブ・オア素子、Ａ０〜Ａｎは出力端子であ
る。
【００１０】エクスクルーシブ・オア素子７−１〜７−
ｎは、それぞれの入力の一端が隣のエクスクルーシブ・
オア素子の入力端子Ｂ１〜Ｂｎに接続されている。図３
は図２のコード変換器から出力されるアドレスバス出力
コードを示すタイミング図の一例である。このタイミン
グ図は、図２の変換器の出力がＡ０〜Ａ３の４ビットの
場合の例であり、連続した数表示Ｔの数値をアドレスバ
スの各ビットの電圧レベルで示している。そして、Ａ０
〜Ａ３の“Ｈ”信号を“１”、“Ｌ”信号を“０”に対
応させた場合の、４ビットのコード〔Ａ０Ａ１Ａ２Ａ３
〕の信号と、この信号に対応する１０進数の数値（数表
示Ｔ）で示している。
ｎは、それぞれの入力の一端が隣のエクスクルーシブ・
オア素子の入力端子Ｂ１〜Ｂｎに接続されている。図３
は図２のコード変換器から出力されるアドレスバス出力
コードを示すタイミング図の一例である。このタイミン
グ図は、図２の変換器の出力がＡ０〜Ａ３の４ビットの
場合の例であり、連続した数表示Ｔの数値をアドレスバ
スの各ビットの電圧レベルで示している。そして、Ａ０
〜Ａ３の“Ｈ”信号を“１”、“Ｌ”信号を“０”に対
応させた場合の、４ビットのコード〔Ａ０Ａ１Ａ２Ａ３
〕の信号と、この信号に対応する１０進数の数値（数表
示Ｔ）で示している。
【００１１】次に、この実施例の動作について図１〜図
３を参照して説明する。コード変換器７を４ビット（入
力端子：Ｂ０〜Ｂ３，出力端子：Ａ０〜Ａ３）の変換器
として説明すると、連続するアドレスをアクセスする場
合、２進カウンタ６から出力された数表示Ｔの連続する
２進コードの数値０
３を参照して説明する。コード変換器７を４ビット（入
力端子：Ｂ０〜Ｂ３，出力端子：Ａ０〜Ａ３）の変換器
として説明すると、連続するアドレスをアクセスする場
合、２進カウンタ６から出力された数表示Ｔの連続する
２進コードの数値０
〔００００〕〜９〔１００１〕はコ
ード変換器７の入力端子Ｂ０〜Ｂ３に入力される。次に
、コード変換器７は、入力された入力端子Ｂ０〜Ｂ３の
４ビットの２進コードの数値０
ード変換器７の入力端子Ｂ０〜Ｂ３に入力される。次に
、コード変換器７は、入力された入力端子Ｂ０〜Ｂ３の
４ビットの２進コードの数値０
〔００００〕〜９〔１０
０１〕をエクスクルーシブ・オア素子７−１〜７−３で
、０
０１〕をエクスクルーシブ・オア素子７−１〜７−３で
、０
〔００００〕〜９〔１０１１〕のグレイコードの数
値に変換して、アドレスバス３に出力する。
値に変換して、アドレスバス３に出力する。
【００１２】このとき、例えば２進コードの連続した数
表示Ｔとしての数値７〔１１１０〕から８〔０００１〕
への変化の場合では、７から８への数値のビット変化が
４ビットにもなるため、アドレスバス３の複数ビットが
同時変化のときに、電源に対してノイズが発生するおそ
れがある。ところが、コード変換器７でグレーコードに
変換すると、数値７〔００１０〕から８〔００１１〕へ
のビット変化がＡ４の１ビットの変化だけとなり、複数
ビットの同時変化による電源へのノイズ発生を少なくす
ることが可能となる。また、各ビットの変化点も少ない
ので、全体としての消費電力も減少する。もちろん、上
記の説明では７から８への数値の変化の例で説明したが
、グレーコードを使用する場合は、連続する数であれば
どの数値の変化でも１ビットの変化であり、上記と同様
の効果が得られる。なお、この実施例では、コード変換
器をグレーコードに変換する変換器として説明したが、
連続する数値のビット変化が少なく、かつ、ビット同時
変化による電源への影響が少なければ、グレーコードに
限定されるものではなく、他のコードでもよい。
表示Ｔとしての数値７〔１１１０〕から８〔０００１〕
への変化の場合では、７から８への数値のビット変化が
４ビットにもなるため、アドレスバス３の複数ビットが
同時変化のときに、電源に対してノイズが発生するおそ
れがある。ところが、コード変換器７でグレーコードに
変換すると、数値７〔００１０〕から８〔００１１〕へ
のビット変化がＡ４の１ビットの変化だけとなり、複数
ビットの同時変化による電源へのノイズ発生を少なくす
ることが可能となる。また、各ビットの変化点も少ない
ので、全体としての消費電力も減少する。もちろん、上
記の説明では７から８への数値の変化の例で説明したが
、グレーコードを使用する場合は、連続する数であれば
どの数値の変化でも１ビットの変化であり、上記と同様
の効果が得られる。なお、この実施例では、コード変換
器をグレーコードに変換する変換器として説明したが、
連続する数値のビット変化が少なく、かつ、ビット同時
変化による電源への影響が少なければ、グレーコードに
限定されるものではなく、他のコードでもよい。
【００１３】
【発明の効果】以上のように、この発明によれば、数表
示の連続する２つのコード間におけるビット位置のビッ
ト信号が異なるようにコード変換するコード変換手段を
マイクロコンピュータ内のアドレス出力部に設けたため
、ノイズを減らし、消費電力が小さいシステムを構成で
きる効果がある。
示の連続する２つのコード間におけるビット位置のビッ
ト信号が異なるようにコード変換するコード変換手段を
マイクロコンピュータ内のアドレス出力部に設けたため
、ノイズを減らし、消費電力が小さいシステムを構成で
きる効果がある。
【図１】この発明の一実施例のマイクロコンピュータと
周辺装置とのマイコンシステムにおける接続を示すブロ
ック図である。
周辺装置とのマイコンシステムにおける接続を示すブロ
ック図である。
【図２】図１のマイクロコンピュータに内蔵されたコー
ド変換器の回路の一例を示す図である。
ド変換器の回路の一例を示す図である。
【図３】図２のコード変換器から出力されるアドレスバ
ス出力コードを示すタイミング図である。
ス出力コードを示すタイミング図である。
【図４】従来の技術の一例を示すマイコンシステムの構
成を示すブロック図である。
成を示すブロック図である。
【図５】図４のマイコンシステムによるアドレスバス出
力コードを示すタイミング図である。
力コードを示すタイミング図である。
１ マイクロコンピュータ
２ 周辺装置
３ アドレスバス
４ データバス
５ コントロールバス
６ ２進カウンタ
７ コード変換器
Claims (1)
- 【請求項１】 数表示を示す複数ビットから成るコー
ドを、上記数表示が連続して増減するように出力するア
ドレス出力手段を備えたマイクロコンピュータにおいて
、数表示の連続する２つのコード間におけるビット位置
のビット信号が異なるようにコード変換するコード変換
手段を介して上記アドレス出力手段の出力を外部に供給
するようにしたことを特徴とするマイクロコンピュータ
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3177494A JPH04373041A (ja) | 1991-06-21 | 1991-06-21 | マイクロコンピュータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3177494A JPH04373041A (ja) | 1991-06-21 | 1991-06-21 | マイクロコンピュータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04373041A true JPH04373041A (ja) | 1992-12-25 |
Family
ID=16031888
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3177494A Pending JPH04373041A (ja) | 1991-06-21 | 1991-06-21 | マイクロコンピュータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04373041A (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62180612A (ja) * | 1986-02-04 | 1987-08-07 | Toshiba Corp | 半導体集積回路装置 |
| JPS63150747A (ja) * | 1986-12-16 | 1988-06-23 | Toshiba Corp | バツフアメモリアドレス生成回路 |
| JPS63167496A (ja) * | 1986-12-29 | 1988-07-11 | Hitachi Ltd | 半導体メモリ装置 |
-
1991
- 1991-06-21 JP JP3177494A patent/JPH04373041A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62180612A (ja) * | 1986-02-04 | 1987-08-07 | Toshiba Corp | 半導体集積回路装置 |
| JPS63150747A (ja) * | 1986-12-16 | 1988-06-23 | Toshiba Corp | バツフアメモリアドレス生成回路 |
| JPS63167496A (ja) * | 1986-12-29 | 1988-07-11 | Hitachi Ltd | 半導体メモリ装置 |
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