JPH0444046U - - Google Patents

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JPH0444046U
JPH0444046U JP1990086002U JP8600290U JPH0444046U JP H0444046 U JPH0444046 U JP H0444046U JP 1990086002 U JP1990086002 U JP 1990086002U JP 8600290 U JP8600290 U JP 8600290U JP H0444046 U JPH0444046 U JP H0444046U
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reset signal
reset
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cpu
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【図面の簡単な説明】
第１図は本考案に係る異常検出回路の一実施例
を示す回路構成図、第２図は第１図の回路の動作
を示すタイムチヤートである。 １……下位機器、１１……ＣＰＵ、１２……Ｗ
ＤＴ回路、１３……シリアル通信用ＩＣ、１４…
…インバータ、１５……ワンシヨツト回路、１６
……パワーオンリセツト回路、１７……ＮＯＲゲ
ート、１８……ＲＯＭ、１９……ＲＡＭ、２……
上位機器。

Claims (1)

  1. 【実用新案登録請求の範囲】 下位機器の異常を検出して復帰させる異常検出
    回路において、 下位機器を制御するＣＰＵと、 このＣＰＵからのリセツト信号でクリアされ、
    入力クロツクによりタイムアツプしたときに上位
    機器にステータス信号を通知するＷ
    ＤＴ回路と、 シリアルデータをパラレル信号に変換するシリ
    アル通信用ＩＣと、 前記ＷＤＴ回路から出力される信
    号がアクテイブのときのみ動作し、上位機器から
    データが送られたときをトリガとし、外部リセツ
    ト信号を出力するワンシヨツト回路と、 電源がオンになつたときにリセツト信号を出力
    するパワーオンリセツト回路と、 前記ワンシヨツト回路からの外部リセツト信号
    と前記パワーオンリセツト回路からのパワーオン
    リセツト信号を入力として、前記ＣＰＵにリセツ
    ト信号を出力する回路とを具備し、 上位機器は前記ＷＤＴ回路からの
    信号がアクテイブになつたときに異常を検出した
    のちダミーコードを送出し、下位機器はこのダミ
    ーコードの入力をトリガとして前記ＣＰＵをリセ
    ツトすることを特徴とする異常検出回路。
JP1990086002U 1990-08-15 1990-08-15 Pending JPH0444046U (ja)

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