JPH0447775B2 - - Google Patents
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- JPH0447775B2 JPH0447775B2 JP58195617A JP19561783A JPH0447775B2 JP H0447775 B2 JPH0447775 B2 JP H0447775B2 JP 58195617 A JP58195617 A JP 58195617A JP 19561783 A JP19561783 A JP 19561783A JP H0447775 B2 JPH0447775 B2 JP H0447775B2
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- G03B—APPARATUS OR ARRANGEMENTS FOR TAKING PHOTOGRAPHS OR FOR PROJECTING OR VIEWING THEM; APPARATUS OR ARRANGEMENTS EMPLOYING ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ACCESSORIES THEREFOR
- G03B7/00—Control of exposure by setting shutters, diaphragms or filters, separately or conjointly
- G03B7/08—Control effected solely on the basis of the response, to the intensity of the light received by the camera, of a built-in light-sensitive device
- G03B7/081—Analogue circuits
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-
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- Photometry And Measurement Of Optical Pulse Characteristics (AREA)
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Description
【発明の詳細な説明】
（技術分野）
本発明は撮像装置等に用いられる測光回路、特
に受光素子からの光電流をキヤパシタによつて積
分する測光回路に関するものである。DETAILED DESCRIPTION OF THE INVENTION (Technical Field) The present invention relates to a photometric circuit used in an imaging device or the like, and particularly to a photometric circuit that integrates a photocurrent from a light receiving element using a capacitor.
（従来技術）
従来この種の装置は銀塩フイルムや撮像デバイ
スに対する露光以前にキヤパシタの両端をスイツ
チング素子をONさせる事によつて短絡してお
き、受光面への露光に伴つてこのスイツチング素
子をOFFし、光電流によりキヤパシタの充電を
開始して充電電圧が全露光量に比例する事を利用
して受光面への露光量を測定している。ところ
が、通常このスイツチング素子としては半導体素
子が使われ、そのON電圧はゼロにできず、流す
電流等によつてそのオフセツトが変わつてしま
う。またキヤパシタの電圧を増巾する為に増幅器
を用い、それがオフセツト電圧を有する場合、ス
イツチング素子のON状態でのオフセツト電圧と
ともに無視できない程度の測光誤差を発生させる
という問題があつた。これに対し従来ではスイツ
チング素子や増巾器のオフセツトと減少させる為
に高価で複雑な構成の素子や増巾器を用いてき
た。(Prior art) Conventionally, this type of apparatus short-circuits both ends of the capacitor by turning on a switching element before exposing a silver halide film or an imaging device, and when the light-receiving surface is exposed, this switching element is turned on. The capacitor is turned off and the photocurrent starts charging the capacitor, and the amount of exposure to the light-receiving surface is measured using the fact that the charging voltage is proportional to the total amount of exposure. However, a semiconductor element is normally used as this switching element, and its ON voltage cannot be made zero, and its offset changes depending on the current flowing. Furthermore, when an amplifier is used to amplify the voltage of the capacitor and it has an offset voltage, there is a problem in that a non-negligible photometry error is generated along with the offset voltage when the switching element is in the ON state. In contrast, in the past, in order to reduce the offset of switching elements and amplifiers, expensive and complicated elements and amplifiers have been used.
（目 的）
本発明は従来回路のかかる欠点にかんがみてな
されたものであり、スイツチング素子や増幅器の
オフセツト電圧の大小や変動に拘らず、常にこれ
を較正できる測光回路を提供する事を目的とす
る。(Purpose) The present invention has been made in view of the drawbacks of conventional circuits, and an object of the present invention is to provide a photometry circuit that can always calibrate offset voltages of switching elements and amplifiers, regardless of their magnitude or fluctuation. do.
（実施例） 以下実施例に基づき本発明を説明する。(Example) The present invention will be explained below based on Examples.
第１図は閃光発光装置の制御に適用した本発明
測光回路の例を示すものである。図中１はSPC等
の受光素子であり、増巾手段としての演算増幅器
４の２つの入力の間に接続される。２はキヤパシ
タであり演算増幅器４の反転入力および出力の間
に接続される。３はトランジスタ等のスイツチン
グ素子でありキヤパシタ３と並列に接続されると
ともにその制御端子はコントロール回路８に接続
される。５は演算手段としてのコンパレータであ
り、その非反転入力は演算増幅器４の出力に、そ
の反転入力はＤ／Ａコンバータ７の出力に、その
出力はアナログスイツチ６の端子６ｂに接続され
るとともにコントロール回路８に接続される。ア
ナログスイツチ６はその制御端子６ａがハイレベ
ルの時端子６ｂ−６ｃ間が導通し、制御端子６ａ
がローレベルの時端子６ｂ−６ｃ間が非導通にな
るものであつて端子６ａはコントロール回路８に
接続され、６ｃは閃光発光装置１２の光量制御回
路１０に接続される。光量制御回路１０にはアナ
ログスイツチ６を通して正のパルスが入力された
時閃光発光装置が発光中であればこれをただちに
止める作用がある。７は設定手段としてのＤ／Ａ
コンバータのコントロール回路８からのデイジタ
ル入力をアナログ値に変えてその出力を基準値と
してコンパレータ５の反転入力端子に入力させて
いる。８はコントロール回路であり、レリーズス
イツチ９からの入力をもとにスイツチング素子
３、アナログスイツチ６、Ｄ／Ａコンバータ７、
閃光発光装置１２のシンクロ回路１１を第２図の
如く制御する。尚、シンクロ回路１１はコントロ
ール回路８からのコントロール信号に応じて閃光
発光装置内の閃光管等を発光させる回路である。
又、第１図において１〜８は閃光発光装置外にあ
るが、このうちの一部又は全部が閃光発光装置内
にあつてもよい。又、ここで言う閃光発光装置は
キセノン管等を発光させる為の公知のもので良
い。 FIG. 1 shows an example of the photometric circuit of the present invention applied to the control of a flashlight emitting device. In the figure, reference numeral 1 denotes a light receiving element such as an SPC, which is connected between two inputs of an operational amplifier 4 as an amplifying means. A capacitor 2 is connected between the inverting input and the output of the operational amplifier 4. Reference numeral 3 denotes a switching element such as a transistor, which is connected in parallel with the capacitor 3 and whose control terminal is connected to the control circuit 8. 5 is a comparator as a calculation means, its non-inverting input is connected to the output of the operational amplifier 4, its inverting input is connected to the output of the D/A converter 7, and its output is connected to the terminal 6b of the analog switch 6, and the control Connected to circuit 8. When the control terminal 6a of the analog switch 6 is at a high level, conduction occurs between the terminals 6b and 6c, and the control terminal 6a
When is at a low level, the terminals 6b and 6c become non-conductive; the terminal 6a is connected to the control circuit 8, and the terminal 6c is connected to the light amount control circuit 10 of the flash light emitting device 12. The light quantity control circuit 10 has the function of immediately stopping the flash light emitting device if it is in the process of emitting light when a positive pulse is input through the analog switch 6. 7 is D/A as a setting means
The digital input from the control circuit 8 of the converter is converted into an analog value, and the output is inputted to the inverting input terminal of the comparator 5 as a reference value. 8 is a control circuit which, based on the input from the release switch 9, switches the switching element 3, analog switch 6, D/A converter 7,
The synchro circuit 11 of the flash light emitting device 12 is controlled as shown in FIG. The synchro circuit 11 is a circuit that causes a flash tube or the like in a flash light emitting device to emit light in response to a control signal from the control circuit 8.
Further, in FIG. 1, numerals 1 to 8 are outside the flashlight emitting device, but some or all of them may be located inside the flashlight emitting device. Further, the flashlight emitting device referred to herein may be a known device for emitting light from a xenon tube or the like.
本発明の一実施例は上述の構成からなるもので
あり、以下に第２図も参照しながらその作用を説
明する。まずレリーズがなされる時刻T1以前、
第２図ｂに示す如くスイツチング素子３の制御電
圧がハイレベルでありスイツチング素子３はオン
となつている。また第２図ｃに示す如くアナログ
スイツチ６の制御端子６ａがローレベルにあり、
アナログスイツチ６の６ｂ−６ｃ間は非導通であ
る。この結果、演算増幅器４の出力には演算増幅
器４のオフセツト電圧およびスイツチング素子３
のオン電圧に依存する電圧が発生している。尚、
この間コンパレータ５の出力電圧が光量制御回路
１０に入力することはない。この状態でコントロ
ール回路８、Ｄ／Ａコンバータ７、コンパレータ
５は次の如く働く。すなわち、コンパレータ５の
出力がハイレベルであればコントロール回路８は
Ｄ／Ａコンバータ７の入力を１ビツト大きくし、
もしもコンパレータ５の出力がローレベルであれ
ばコントロール回路８はＤ／Ａコンバータ７の入
力を１ビツト小さくする。このようにすると最終
的にＤ／Ａコンバータ７の出力電圧は１ビツト以
下の誤差の精度で演算増幅器４の出力電圧に等し
くなる。Ｄ／Ａコンバータ７の分解能を十分小さ
くとつておけばこの値は演算増幅器４の出力と等
しいとみなしてよい。 One embodiment of the present invention has the above-described configuration, and its operation will be explained below with reference to FIG. 2 as well. First, before time T1 when the release is made,
As shown in FIG. 2b, the control voltage of the switching element 3 is at a high level, and the switching element 3 is turned on. Further, as shown in FIG. 2c, the control terminal 6a of the analog switch 6 is at low level,
There is no conduction between 6b and 6c of analog switch 6. As a result, the output of the operational amplifier 4 contains the offset voltage of the operational amplifier 4 and the switching element 3.
A voltage is generated that depends on the on-voltage of the still,
During this time, the output voltage of the comparator 5 is not input to the light amount control circuit 10. In this state, the control circuit 8, D/A converter 7, and comparator 5 operate as follows. That is, if the output of the comparator 5 is at a high level, the control circuit 8 increases the input of the D/A converter 7 by 1 bit,
If the output of the comparator 5 is at a low level, the control circuit 8 reduces the input to the D/A converter 7 by one bit. In this way, the output voltage of the D/A converter 7 finally becomes equal to the output voltage of the operational amplifier 4 with an error accuracy of 1 bit or less. If the resolution of the D/A converter 7 is set to a sufficiently small value, this value can be considered to be equal to the output of the operational amplifier 4.
時刻T1において、レリーズスイツチ９がONさ
れるとコントロール回路８は第２図ｂ，ｃ，ｄに
示した如くスイツチング素子３の制御端子をロー
レベルにし、スイツチング素子３をOFFにする
とともにアナログスイツチ６の制御端子６ａをハ
イにして端子６ｂ−６ｃ間を導通させる。同時に
Ｄ／Ａコンバータ７への入力を直前の値に一定の
ビツト数ΔV（所定の測光量を規定する値）だけ
上のせしてコンパレータ５の反転入力電位をΔV
だけ高くする。（第２図ｈ）さらに第２図ｄに示
す如くシンクロ回路１１に短かい正のパルスを送
り、閃光発光装置１２を発光させる（第２図ｇ）
閃光発光装置からの閃光が被写体に照射され、こ
の被写体からの反射光が受光素子１によつて光電
変換され受光強度に比例する電流が流れ、この電
流でキヤパシタ２を充電する。そして充電電圧が
ΔVを越えると（時刻T2）コンパレータ５の出力
がローレベルからハイレベルになり、光量制御回
路１０に正のパルスが入力してその結果閃光発光
は停止する。尚、この閃光発光時即ち、（T2−
T1）は例えばμsec〜数百msecである。 At time T1, when the release switch 9 is turned ON, the control circuit 8 sets the control terminal of the switching element 3 to a low level as shown in FIG. The control terminal 6a of the control terminal 6a is set high to establish conduction between the terminals 6b and 6c. At the same time, the input to the D/A converter 7 is increased by a certain number of bits ΔV (a value that defines a predetermined photometric amount) from the previous value, and the inverted input potential of the comparator 5 is increased by ΔV.
only higher. (Figure 2h) Furthermore, as shown in Figure 2d, a short positive pulse is sent to the synchro circuit 11 to cause the flash light emitting device 12 to emit light (Figure 2g)
A subject is irradiated with flash light from a flashlight emitting device, and reflected light from the subject is photoelectrically converted by a light receiving element 1, a current proportional to the intensity of the received light flows, and a capacitor 2 is charged with this current. When the charging voltage exceeds ΔV (time T2), the output of the comparator 5 changes from low level to high level, a positive pulse is input to the light amount control circuit 10, and as a result, the flash light emission stops. In addition, at the time of this flash emission, that is, (T 2 −
T 1 ) is, for example, μsec to several hundred msec.
以上説明した如く本発明装置を用いれば測光作
動状態に入る前にスイツチング素子のオン電圧、
増幅時のオフセツト電圧に依存する項を検出して
しまつているため、これらが存在しても誤差にな
る事はなく、精度の高い測光ができる。 As explained above, when using the device of the present invention, the on-voltage of the switching element,
Since terms that depend on the offset voltage during amplification have been detected, even if they exist, there will be no error, and highly accurate photometry can be performed.
第３図は第２図中コントロール回路８をさらに
詳しく説明するための図であり、第４図のタイミ
ング図も参照しながらその作用について説明す
る。 FIG. 3 is a diagram for explaining the control circuit 8 in FIG. 2 in more detail, and its operation will be explained with reference to the timing diagram of FIG. 4 as well.
８−１，８−１′，８−２はワンシヨツト回路、
８−３はアツプダウンカウンタ、８−４はクロツ
ク発生回路、８−５はラツチ回路、８−６はOR
回路、８−７はインバータであり、図のように接
続されている。 8-1, 8-1', 8-2 are one-shot circuits,
8-3 is an up-down counter, 8-4 is a clock generation circuit, 8-5 is a latch circuit, and 8-6 is an OR circuit.
The circuit 8-7 is an inverter and is connected as shown in the figure.
従つて第４図示の如く、時刻T′1においてレリ
ーズ信号に同期してワンシヨツト回路８−１が動
作しパルス巾ΔTのパルスが出力される。このパ
ルスがハイレベルの間はORゲート出力はハイレ
ベルとなるからカウンタ８−３はカウントアツプ
状態となり、クロツク発生器８−４の出力をカウ
ントしていきΔVに相当するカウントアツプを行
なう。ワンシヨツト回路８−１′，８−２は共に
ワンシヨツト回路８−１の立下り（時刻T″1）に
同期して夫々パルスを出力し、回路８−２の出力
によりシンクロ回路１１が動作し発光を開始す
る。又、アナログスイツチ６をONすると共に、
スイツチング素子３がOFFする。このように構
成された本実施例ではデジタル的にスイツチング
素子のON電圧や増巾器のオフセツトを記憶して
いるので極めて正確な基準値補正が可能となる
が、このようなものの他にアナログ的にこの誤差
分を記憶しても良い。第５図はそのような構成の
一例を示す図である。 Therefore, as shown in FIG. 4, the one shot circuit 8-1 operates in synchronization with the release signal at time T'1 and outputs a pulse having a pulse width ΔT. While this pulse is at a high level, the OR gate output is at a high level, so the counter 8-3 enters a count-up state and counts the output of the clock generator 8-4, performing a count-up corresponding to .DELTA.V. The one-shot circuits 8-1' and 8-2 each output a pulse in synchronization with the falling edge of the one-shot circuit 8-1 (time T''1 ), and the output of the circuit 8-2 operates the synchro circuit 11 to emit light. .Also, turn on analog switch 6 and
Switching element 3 turns OFF. In this embodiment configured as described above, the ON voltage of the switching element and the offset of the amplifier are digitally memorized, so extremely accurate reference value correction is possible. This error may be stored in the memory. FIG. 5 is a diagram showing an example of such a configuration.
図中第１〜第４図区同じ符番のものは同じ要素
を示す。１３はコントロール回路、１４は設定手
段としてのサンプルホールド回路で、１５はΔV
を発生する電源である。 In the figures, the same reference numerals in the first to fourth sections indicate the same elements. 13 is a control circuit, 14 is a sample hold circuit as a setting means, and 15 is a ΔV
It is a power source that generates
このように構成すれば回路構成は極めて簡単化
される。レリーズスイツチ９の出力が得られるま
ではコントロール回路１３の出力１３ａはハイレ
ベルであり、素子３はONしているのでキヤパシ
タ２の電荷は放電されている。 With this configuration, the circuit configuration can be extremely simplified. Until the output of the release switch 9 is obtained, the output 13a of the control circuit 13 is at a high level, and since the element 3 is turned on, the charge in the capacitor 2 is discharged.
又、１３ａのレベルがハイレベルの間サンプル
ホールド回路１４は増巾器４の誤差成分出力をサ
ンプルホールドしている。 Further, while the level of the signal 13a is at a high level, the sample and hold circuit 14 samples and holds the error component output of the amplifier 4.
レリーズスイツチ９をONするとコントロール
回路１３の出力１３ａはローレベルとなり、素子
３OFFしキヤパシタに充電が開始されると共に
サンプルホールド回路はレリーズ直前の値をホー
ルドする。従つてコンパレータ５の反転入力には
サンプルホールドされた誤差電圧とΔVとが加算
されて入力される。 When the release switch 9 is turned on, the output 13a of the control circuit 13 becomes low level, the element 3 is turned off, charging of the capacitor is started, and the sample and hold circuit holds the value immediately before the release. Therefore, the sampled and held error voltage and ΔV are added and input to the inverting input of the comparator 5.
従つてスイツチング素子３のON電圧や増巾器
４のオフセツト分が重畳された基準電圧とキヤパ
シタの充電電圧とが比較されこれに基づき閃光発
光装置の発光停止（調光）タイミングが制御され
る。 Therefore, the reference voltage on which the ON voltage of the switching element 3 and the offset of the amplifier 4 are superimposed is compared with the charging voltage of the capacitor, and based on this, the timing of stopping light emission (light control) of the flash light emitting device is controlled.
尚、以上の実施例では測光回路として閃光発光
による反射光を測光する為の回路の例を挙げたが
本発明はこれに限るものではなく、銀塩フイルム
カメラ等においてシヤツター開閉と共に測光を開
始するような測光回路としても利用できる事は言
う迄もない。尚、以上の説明では演算手段として
コンパレータ５の例を挙げたが、本発明はこのよ
うな判別動作を行なうものに限らず、各種パラメ
ータと共に測光値を演算処理するものすべてに適
用可能である。 Incidentally, in the above embodiment, an example of a circuit for measuring reflected light from flash light emission was given as a photometric circuit, but the present invention is not limited to this, and photometry starts when the shutter is opened or closed in a silver halide film camera or the like. Needless to say, it can also be used as a photometric circuit. In the above description, the comparator 5 is used as an example of the calculation means, but the present invention is not limited to those that perform such a discrimination operation, but can be applied to any device that processes photometric values along with various parameters.
（効 果）
以上説明した如く本発明によれば測光動作以前
のスイツチング素子のON電圧や増巾器のオフセ
ツト等を検出し、記憶しておくようにすると共
に、測光情報に対し、この記憶データを演算する
ようにしているので精度の高い測光が可能とな
る。(Effects) As explained above, according to the present invention, the ON voltage of the switching element, the offset of the amplifier, etc. before the photometry operation are detected and stored, and this stored data is applied to the photometry information. Since the calculation is performed, highly accurate photometry is possible.
第１図は本発明の第１実施例図、第２図はその
タイミングチヤート、第３図はコントロール回路
の詳細な例を示す図、第４図はコントロール回路
内のタイミングを示す図、第５図は本発明の第２
実施例図である。
１…SPC等の受光素子、２…キヤパシタ、３…
トランジスタ等のスイツチング素子、４…増巾手
段としての演算増幅器、５…演算手段としてのコ
ンパレータ、６…アナログスイツチ、７…設定手
段としてのＤ／Ａコンバータ、８…コントロール
回路、９…レリーズスイツチ、１０…光量制御回
路、１１…シンクロ回路、１２…閃光発光装置、
１４…設定手段としてのサンプルホールド回路。
FIG. 1 is a diagram showing a first embodiment of the present invention, FIG. 2 is a timing chart thereof, FIG. 3 is a diagram showing a detailed example of a control circuit, FIG. 4 is a diagram showing timing in the control circuit, and FIG. The figure shows the second aspect of the present invention.
It is an example figure. 1... Light receiving element such as SPC, 2... Capacitor, 3...
Switching elements such as transistors, 4... operational amplifier as amplifying means, 5... comparator as calculating means, 6... analog switch, 7... D/A converter as setting means, 8... control circuit, 9... release switch, 10... Light amount control circuit, 11... Synchro circuit, 12... Flash light emitting device,
14...Sample and hold circuit as setting means.
Claims (1)
受光手段、 該受光手段からの電気信号を充電する為のキヤ
パシタ、 該キヤパシタの電気信号を放電する為のスイツ
チング手段、 前記キヤパシタの電気信号を増幅する増幅手
段、 該増幅手段の出力を基準値と演算する演算手
段、 前記スイツチング手段により前記キヤパシタの
電気信号を放電している間に得られる前記増幅手
段の出力値を保持すると共に、該出力値に所定の
測光量を規定する値を付加して前記基準値を設定
する設定手段、を有する測光回路。[Scope of Claims] 1. A light receiving means for receiving light from a subject and converting it into an electric signal, a capacitor for charging the electric signal from the light receiving means, a switching means for discharging the electric signal of the capacitor, and the above. amplification means for amplifying the electrical signal of the capacitor; arithmetic means for calculating the output of the amplification means with a reference value; and holding an output value of the amplification means obtained while the electrical signal of the capacitor is being discharged by the switching means. and setting means for setting the reference value by adding a value defining a predetermined photometric amount to the output value.
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58195617A JPS6088329A (en) | 1983-10-19 | 1983-10-19 | Photometry circuit |
| US06/894,384 US4711546A (en) | 1983-10-19 | 1986-08-07 | Photometric circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58195617A JPS6088329A (en) | 1983-10-19 | 1983-10-19 | Photometry circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6088329A JPS6088329A (en) | 1985-05-18 |
| JPH0447775B2 true JPH0447775B2 (en) | 1992-08-04 |
Family
ID=16344143
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58195617A Granted JPS6088329A (en) | 1983-10-19 | 1983-10-19 | Photometry circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6088329A (en) |
-
1983
- 1983-10-19 JP JP58195617A patent/JPS6088329A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6088329A (en) | 1985-05-18 |
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