JPH0449067A - Printing apparatus - Google Patents

Printing apparatus

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JPH0449067A
JPH0449067A JP15869490A JP15869490A JPH0449067A JP H0449067 A JPH0449067 A JP H0449067A JP 15869490 A JP15869490 A JP 15869490A JP 15869490 A JP15869490 A JP 15869490A JP H0449067 A JPH0449067 A JP H0449067A
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JP
Japan
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data
output
circuit
color component
color
Prior art date
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Pending
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JP15869490A
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Japanese (ja)
Inventor
Yoshibumi Okamoto
義文 岡本
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Canon Inc
Original Assignee
Canon Inc
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Publication date
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Abstract

PURPOSE:To free the central processing unit of an apparatus from inking processing by a method wherein the presence of an output dot to a noticeable black component is judged when a recording color component is black and all of the data of all of the chromatic color components read by a reading means are ones showing the presence of the output dot and a signal showing this state is outputted to a recording means. CONSTITUTION:The image based on the data inputted to a CPU 100 from a data input part 103 is successively developed on the bit map memory corresponding to the color code contained in said data. When the image corresponding to one page is developed, the CPU 100 only outputs a video signal at every color component to a data output part 105 without executing inking processing to carry out the same printing as that carried out when inking processing is actually executed.

Description

【発明の詳細な説明】[Detailed description of the invention] 【産業上の利用分野】[Industrial application field]

本発明は印刷装置、詳しくは各色成分毎の画像を重畳印
刷することで記録媒体にカラー可視画像を印刷する印刷
装置に関するものである。
The present invention relates to a printing device, and more particularly, to a printing device that prints a color visible image on a recording medium by superimposing images of each color component.

【従来の技術】[Conventional technology]

通常、この種の装置は、Y(イエロー)1M(マゼンダ
)、C(シアン)、K(ブラック)の4色分のビットイ
メージメモリを有している。ホストコンピュータ等から
送られてきた文字情報(文字パターン)を、同様にして
送られてきたカラーコードに基づき、対応するビットマ
ツプメモリに展開する。こうして、各色成分の組み合せ
によって、多色記録を可能にしている。 ところで、この装置においては、Y、M、Cの各包金て
のビットマツプメモリに出力ドツト(オン状態のドツト
)が存在する場合、Y、M、Cの各ビットマツプメモリ
のドツトをオフにし、そして、Kのビットマツプメモリ
の対応するドツトをオンにする、所謂墨入れ処理を行な
っている。
Typically, this type of device has bit image memories for four colors: Y (yellow), 1M (magenta), C (cyan), and K (black). Character information (character pattern) sent from a host computer or the like is expanded into a corresponding bitmap memory based on the color code sent in the same way. In this way, multicolor recording is possible by combining each color component. By the way, in this device, if output dots (dots in the ON state) exist in the Y, M, and C bit map memories, the dots in the Y, M, and C bit map memories are turned off. , and performs a so-called inking process in which the corresponding dots in the bit map memory of K are turned on.

【発明が解決しようとしている課題】[Problem to be solved by the invention]

しかしながら、1ページ分墨入れ処理を行なうと、装置
全体の処理速度が低下してしまうとし1つごとは避けら
れない、特に、より高解像度の画像が望まれ、より大き
な容量のビットマツプメモリが必要になっている今日で
はなおさらである。 本発明はかかる従来技術に鑑みなされたものであり、装
置の中央処理装置を墨入れ処理から開放させ、処理速度
を向上させることが可能な印刷装置を提供しようとする
ものである。
However, inking one page at a time reduces the processing speed of the entire device, so it is unavoidable to ink one page at a time. Even more so today, when it is so necessary. The present invention has been made in view of such prior art, and it is an object of the present invention to provide a printing device that can free the central processing unit of the device from inking processing and improve processing speed.

【課題を解決するための手段】 この課題を解決する本発明の印刷装置は以下に示す構成
を備える。すなわち、 各色成分毎の画像を記録媒体に重畳印刷することでカラ
ー可視画像を印刷する印刷装置において、有彩色成分毎
及び黒色のイメージ画像を展開する複数のメモリと、該
メモリの各々から同時にデータを読み出す読み出し手段
と、色成分のデータに基づく可視画像を記録媒体に重畳
記録する記録手段と、該記録手段による記録色成分が有
彩色の1つであって、前記読み出し手段で読み出された
全有彩色成分のデータが全て出力ドット有りを示すデー
タであるとき、当該注目の有彩色成分に対して出力ドツ
トデータなしとして前記記録手段に出力する第1の出力
手段と、前記記録手段による記録色成分が黒色であって
、前記読み出し手段で読み出された全有彩色成分のデー
タが全て出力ドツトありを示すデータであるとき、当該
注目の黒色成分に対して出力ドツト有りとして前記記録
手段に出力する第2の出力手段とを備える。
[Means for Solving the Problems] A printing apparatus of the present invention that solves this problem has the configuration shown below. In other words, in a printing device that prints visible color images by superimposing images of each color component on a recording medium, a plurality of memories are used to develop images for each chromatic color component and black, and data is simultaneously output from each of the memories. a reading means for reading out a visible image based on color component data, a recording means for superimposing and recording a visible image based on color component data on a recording medium, and a color component recorded by the recording means is one of chromatic colors, and the color component read by the reading means a first output means for outputting the chromatic component of interest to the recording means as having no output dot data when all the data of all the chromatic color components are data indicating the presence of output dots; and recording by the recording means. When the color component is black and all the data of all chromatic color components read out by the reading means are data indicating that output dots are present, the black component of interest is recorded as having output dots in the recording means. and second output means for outputting the output.

【作用】[Effect]

かかる本発明の構成において、メモリの各々から各色成
分のデータを同時に読み出す。そして、記録手段が記録
しようとしている色が有彩色の1つであって、読み出さ
れた有彩色のデータ全てのドツト情報が全て出力ドット
有りを示すデータであるときには、注目している有彩色
成分に対して出力ドツトデータなしとして記録手段に出
力する。そして、記録手段による記録対象が黒色になっ
たときであって、読み出し手段で読み出された有彩色の
データ全てのドツト情報が全て出力ドット有りを示すデ
ータであるときには、注目の黒色成分に対して出力ドッ
ト有りとして記録手段に出力する。
In this configuration of the present invention, data for each color component is read out simultaneously from each memory. If the color that the recording means is trying to record is one of the chromatic colors, and the dot information of all the read chromatic color data is data indicating that there are output dots, then the chromatic color of interest The component is outputted to the recording means as having no output dot data. When the target to be recorded by the recording means is black, and when all the dot information of the chromatic color data read out by the reading means is data indicating the presence of output dots, the black component of interest is The output dots are outputted to the recording means as output dots.

【実施例】【Example】

以下、添付図面に従って本発明に係る実施例を詳細に説
明する。 第2図は実施例の印刷装置の概略構成を示す図である。 図中、100は装置全体の制御を行なうCPU(中央演
算処理装置)である。102は主メモリであり、cpu
iooの制御プログラムや文字フォントパターン等を記
録しているROM (リードオンリメモリ)Iotaと
ワークエリアとして使用するRAM (ランダムアクセ
スメモリ)101bから構成されている。102はY、
M、C,にの各色成分のビットマツプメモリを有するR
AMであり、103はホストコンピュータからのデータ
を入力するデータ入力部である。104はRAM102
に展開された各色成分のデータを所定の手順で読み出し
、ビデオ信号に変換して出力するビデオインタフェース
、105はビデオインタフェース104より出力された
ビデオ信号に基づいて記録紙に可視画像を印刷するデー
タ出力部である。尚、実施例におけるデータ出力部はレ
ーザビームプリンタを採用した場合を説明する。 上述した構成において、実施例のCPU100はデータ
入力部103より入力した情報に基づくイメージを、そ
の情報中に含まれるカラーコードに対応したビットマツ
プメモリに順次展開していく、そして、1ペ一ジ分のイ
メージが展開されたときに、CPU100は墨入れ処理
をせず、各色成分毎のビデオ信号をデータ出力部105
に出力するだけで、実際に墨入れ処理したのと同様の印
刷を可能にする。 第1図は実施例のRAM102及びビデオインタフェー
ス104の具体的構成と示している。 図示の如く、RAM102は、4色分のビットマツプメ
モリ102a (Y)、102b (M)。 102c (C)、102d (K)から構成されてい
る。これらビットマツプメモリ102a〜102dには
、先に説明したように、各色成分毎の出力イメージ情報
が展開される。各矢印は信号または情報の流れを示し、
それら矢印の途中にある数値はその情報が何ビットで構
成されているかを示している。 尚、図示において、1はCPU100のアドレスバスで
あり、その下位の2ビツト“AO″A1”を除いたバス
が各ビットマツプメモリ102aA−102dに供給さ
れている。4はビットマツプメモリ102a、102b
、102c、102dからのデータ10a、10b、1
0c、10dを読み出し、選択するセレクタであり、C
PU100からのアドレス1の下位アドレス2ビツト“
AO”、“A1”により4本の出力線のうちの1本が選
択されるようになっている。3は墨入れ処理を行なうビ
ット処理ユニットであり、ビットマツプメモリ102a
、102b、102c、102dからのデータ10a、
fob、10c、10dを入力し、且つビデオ変換する
色に対応するデータをアドレス1の下位2ビツト“AO
”“A1”により選択してビット処理を行ない、その出
力6をビデオ信号変換器5に出力する。このビデオ信号
変換器5は、ビット処理ユニット3よりの出力6をビデ
オ信号7に変換し8力する。ビデオインタフェース10
4は上述したビット処理ユニット3.セレクタ4.ビデ
オ信号変換器5より構成されている。 第3図は実施例におけるビット処理ユニット3の内部回
路構成例を示す図である(但し、1ビット単位の処理部
分を示している)。 以下、この回路の動作を説明するが、既に各ビットマツ
プメモリ102a〜102dには各々の色・に対応した
イメージデータが展開されているものとする。また、各
ビットマツプメモリへデータの展開す場合には1つのビ
ットマツプメモリだけをアクティブする回路があって、
その回路を利用して各々のメモリにデータを展開するも
のとする。但し、データバス2が32ビツトある場合に
はこの限りではない。 第3図においては、1ビット単位における処理を示して
いる。 ビットマツプメモリ102a、102b、102c、1
02dにそれぞれY、M、C,にのイメージデータが展
開されたものとする。また、図示におけるセレクタ20
では、アドレスバス1の下位2ビツト[A+、Ag3が
[0,Ojのときビットマツプメモリ102aよりのデ
ータ10a(Y成分データ)が選択されるようになって
いる。 同様に、[0,l]のときデータ10b(M成分データ
)、[1,Ojのときデータ10c(C成分データ)、
そして[1,11のときデータi。 d(K成分データ)が選択される。 セレクタ20の出力はAND回路23.25に供給され
、ビットマツプメモリ102〜102dへの読み出しア
ドレス(アドレスバス1に出力される)の下位ビット[
A+、A0]が[0,Oj[0,17[1,Oj [1
,1]のとき出力される。また、ビットマツプメモリ1
02a=102c (102dは除く)からの出力デー
タ10a。 10b、10cはNAND回路21に入力され、その出
力はAND回路26、インバータ27に入力される。ま
た、アドレス1の下位2ビツト[A 、A l+ 1は
NAND回路22に入力され、その出力はAND回路2
3及びインバータ24に入力される。インバータ24の
出力はAND回路25に入力される。インバータ27の
出力はAND回路28に入力され、その出力はOR回路
30に入力される。又AND回路26の出力はOR回路
29に入力される。 上述した回路構成において、イメージデータな各ビット
マツプメモリ102a〜102dに展開し、色単位つま
りビットマツプメモリ102a。 102b、102c、102dの順でビデオ変換する場
合、CPU100はビットマツプメモリ102aをアク
セスする為にアドレスバス1の下位2ビツトの[A、、
AO]を[0,O]にする。ビットマツプメモリ102
a〜102dは同時にアクセスする為、各々からデータ
10a〜10dとなって出力される。いま、アドレスバ
ス1の回2ビット(A + 、 A oコは[0,0]
であるため、NAND回路22の出力はHIGH(=1
)レベルになる。故に、AND回路23は開き、AND
回路25は閉じる。セレクタ20はビットマツプメモリ
102aからの出力データ10aを選択し、それを出力
している。ここで、AND回路23は開いているため、
そのAND回路23からは出力データloaが出力され
ることになる。 こここで、隅入れを行う必要がない場合を考える。つま
り、Y、M、Cによる出力ドツトが重複しない、換言す
ればデータ10a、10b、10’Cのうち少なくとも
1つがLOWレベル(二〇)のときである、この場合、
NAND回路21の出力がHIGHとなるので、AND
回路26は開き、AND回路28は逆に閉じることにな
る。このとき、AND回路25も閉じている為、OR回
路30の出力はLOWレベルでる。また、AND回路2
3は開いている為、ビットマツプメモリ102aのデー
タ10aがOR回路29の出力6となりビデオ信号に変
換される・ 墨入れ処理を行なう時、つまりビットマツプメモリ10
2,102b、102cそれぞれからのデータ10a、
10b、10c全てがHIGHレベルの場合を考える。 NADN回路21の出力はLOWとなり、AND回路2
6の出力は閉じ、又この時AND回路25も閉じている
為、OR回路29の出力6はLOWレベルとなる。つま
り、ビットマツプメモリ102の出力データ10a(Y
成分)がたとえHIGHレベルであった場合でも、他の
色成分M、Cの関係により、LOWレベルとなり印字さ
れない、これはビットマツプメモリ102b、102c
の出力10b、10cにも同様の事がいえる。 次にビットマツプメモリ102dからの出力データ10
d(K=黒成分データ)のビデオ信号変換の動作を考え
る。 この場合、CPU100はアドレスバス1の下位2ビツ
ト[A、、AOIを[1,1]にしてRAM102をア
クセスする。従って、NAND回路22の出力はLOW
となり、AND回路23は閉じ、AND回路25は開く
ことになる。セレクタ20はデータ10dを選択して出
力している。 ここで前述のようにY、M、Cの各成分の出力ドツトが
同一位置に重複せず、墨入れの必要のない場合から考え
る。 この場合、NAND回路21の出力はHIGHとなるの
でAND回路28は閉じる。又この時AND回路23が
閉じている事により、AND回路26の出力はLOWレ
ベルである。OR回路30は開いている為、OR回路2
9からはAND回路25の出力、すなわち、データ10
dが出力されることになる。 次に、墨入れの必要のある場合を考える。 この場合、AND回路21はLOWレベルとなるのでA
ND回路26は閉じる。又ここでAND回路28の出力
はHIGHレベルとなるため、OR回路30.29の出
力はHIGHとなる。つまり、ビットマツプメモリ10
2dからのデータlOdの内容にかかわらず出力6はH
IGHになり、K(ブラック)が印字される。 以上説明したように本実施例によれば、各色成分のイメ
ージデータが各々のビットマツプメモリに展開されてい
る場合、CPU100はデータ出力部105で要求して
いる色成分データを読み出し出力するだけで、隅入れ処
理を行ったのと同じ作用効果を得ることが可能となる。 尚、上述した実施例では、CPU100がRAMの読み
取り動作を行ない、ビデオ変換すると説明したが、DM
AによりRAMを読み取ってもかまわない、又4色それ
ぞれビデオ変換して順次出力すると述べているが、4色
同時にビデオ変換する事も可能である。つまり、セレク
タ20によるデータの選択が必要なくなるかわりに、ビ
デオ変換器が各色に対して必要となる。
Embodiments of the present invention will be described in detail below with reference to the accompanying drawings. FIG. 2 is a diagram showing a schematic configuration of a printing apparatus according to an embodiment. In the figure, 100 is a CPU (central processing unit) that controls the entire device. 102 is the main memory, and the CPU
It consists of a ROM (read only memory) Iota that records ioo control programs, character font patterns, etc., and a RAM (random access memory) 101b that is used as a work area. 102 is Y,
R having bitmap memory for each color component of M, C,
AM, and 103 is a data input unit for inputting data from the host computer. 104 is RAM102
A video interface reads the data of each color component developed in a predetermined procedure, converts it into a video signal and outputs it, and 105 is a data output that prints a visible image on recording paper based on the video signal output from the video interface 104. Department. Incidentally, a case will be described in which a laser beam printer is employed as the data output section in the embodiment. In the above-described configuration, the CPU 100 of the embodiment sequentially develops an image based on information input from the data input unit 103 into a bitmap memory corresponding to a color code included in the information, and one page at a time. When the image for each color component is developed, the CPU 100 does not perform the inking process and sends the video signal for each color component to the data output unit 105.
By simply outputting to , it is possible to print in the same way as when actually inking is performed. FIG. 1 shows the specific configuration of the RAM 102 and video interface 104 of the embodiment. As shown in the figure, the RAM 102 includes bitmap memories 102a (Y) and 102b (M) for four colors. It is composed of 102c (C) and 102d (K). As described above, output image information for each color component is developed in these bitmap memories 102a to 102d. Each arrow indicates a signal or information flow,
The numbers in the middle of these arrows indicate how many bits the information consists of. In the figure, 1 is the address bus of the CPU 100, and the bus excluding the lower 2 bits "AO"A1" is supplied to each bitmap memory 102aA-102d. 4 is the address bus of the bitmap memories 102a, 102b.
, 102c, 102d data 10a, 10b, 1
This is a selector that reads and selects 0c and 10d, and C
Lower address 2 bits of address 1 from PU100
One of the four output lines is selected by "AO" and "A1". 3 is a bit processing unit that performs inking processing, and the bitmap memory 102a
, 102b, 102c, 102d data 10a,
input fob, 10c, and 10d, and input the data corresponding to the color to be converted into the video to the lower 2 bits of address 1 “AO”.
"A1" selects and performs bit processing, and outputs the output 6 to the video signal converter 5. This video signal converter 5 converts the output 6 from the bit processing unit 3 into a video signal 7, Video interface 10
4 is the above-mentioned bit processing unit 3. Selector 4. It is composed of a video signal converter 5. FIG. 3 is a diagram showing an example of the internal circuit configuration of the bit processing unit 3 in the embodiment (however, the processing portion in units of 1 bit is shown). The operation of this circuit will be described below, assuming that image data corresponding to each color has already been developed in each bitmap memory 102a to 102d. Also, when expanding data to each bitmap memory, there is a circuit that activates only one bitmap memory.
It is assumed that the circuit is used to develop data in each memory. However, this does not apply if the data bus 2 has 32 bits. FIG. 3 shows processing in units of 1 bit. Bitmap memories 102a, 102b, 102c, 1
It is assumed that image data of Y, M, and C are respectively developed in 02d. In addition, the selector 20 in the illustration
In this case, when the lower two bits [A+ and Ag3 of address bus 1 are [0 and Oj], data 10a (Y component data) from bitmap memory 102a is selected. Similarly, data 10b (M component data) when [0, l], data 10c (C component data) when [1, Oj],
And when [1, 11, data i. d (K component data) is selected. The output of the selector 20 is supplied to an AND circuit 23.25, and the lower bit [
A+, A0] becomes [0, Oj [0, 17 [1, Oj [1
, 1]. Also, bitmap memory 1
02a=102c (excluding 102d) Output data 10a. 10b and 10c are input to a NAND circuit 21, and the output thereof is input to an AND circuit 26 and an inverter 27. Furthermore, the lower two bits of address 1 [A, A l+1 are input to the NAND circuit 22, and the output thereof is input to the AND circuit 2.
3 and the inverter 24. The output of the inverter 24 is input to an AND circuit 25. The output of the inverter 27 is input to an AND circuit 28, and the output thereof is input to an OR circuit 30. Further, the output of the AND circuit 26 is input to an OR circuit 29. In the circuit configuration described above, image data is developed in each bitmap memory 102a to 102d, and the image data is developed in each color unit, that is, the bitmap memory 102a. When video conversion is performed in the order of 102b, 102c, and 102d, the CPU 100 uses the lower two bits [A, . . .
AO] to [0, O]. Bitmap memory 102
Since data a to 102d are accessed simultaneously, each data is output as data 10a to 10d. Now, the 2nd bit of address bus 1 (A + , A o is [0, 0]
Therefore, the output of the NAND circuit 22 is HIGH (=1
) level. Therefore, the AND circuit 23 is opened and the AND circuit 23 is opened.
Circuit 25 is closed. The selector 20 selects the output data 10a from the bitmap memory 102a and outputs it. Here, since the AND circuit 23 is open,
The AND circuit 23 outputs output data loa. Here, let us consider a case where there is no need to perform cornering. In other words, when the output dots of Y, M, and C do not overlap, in other words, at least one of the data 10a, 10b, and 10'C is at a LOW level (20), in this case,
Since the output of the NAND circuit 21 becomes HIGH, the AND
The circuit 26 will be open and the AND circuit 28 will be closed. At this time, since the AND circuit 25 is also closed, the output of the OR circuit 30 is at a LOW level. Also, AND circuit 2
Since bitmap memory 102a is open, data 10a of bitmap memory 102a becomes output 6 of OR circuit 29 and is converted into a video signal. When performing inking processing, that is, bitmap memory 10
Data 10a from each of 2, 102b and 102c,
Consider the case where both 10b and 10c are at HIGH level. The output of the NADN circuit 21 becomes LOW, and the output of the AND circuit 2
Since the output 6 of the OR circuit 29 is closed and the AND circuit 25 is also closed at this time, the output 6 of the OR circuit 29 becomes LOW level. In other words, the output data 10a (Y
Even if the color component (component) is at a HIGH level, it will be at a LOW level due to the relationship between the other color components M and C and will not be printed.
The same can be said of the outputs 10b and 10c. Next, output data 10 from the bitmap memory 102d
Consider the operation of video signal conversion of d (K=black component data). In this case, the CPU 100 accesses the RAM 102 by setting the lower two bits [A, AOI] of the address bus 1 to [1, 1]. Therefore, the output of the NAND circuit 22 is LOW.
Therefore, the AND circuit 23 is closed and the AND circuit 25 is opened. The selector 20 selects and outputs the data 10d. Let us now consider the case where the output dots of the Y, M, and C components do not overlap at the same position and there is no need for inking, as described above. In this case, the output of the NAND circuit 21 becomes HIGH, so the AND circuit 28 is closed. Also, since the AND circuit 23 is closed at this time, the output of the AND circuit 26 is at a LOW level. Since OR circuit 30 is open, OR circuit 2
9 is the output of the AND circuit 25, that is, data 10.
d will be output. Next, consider a case where inking is required. In this case, the AND circuit 21 becomes LOW level, so A
ND circuit 26 is closed. Also, since the output of the AND circuit 28 is at a HIGH level, the output of the OR circuit 30.29 is at a HIGH level. In other words, bitmap memory 10
Output 6 is H regardless of the content of data lOd from 2d.
It becomes IGH and K (black) is printed. As explained above, according to this embodiment, when the image data of each color component is developed in each bitmap memory, the CPU 100 only needs to read and output the requested color component data from the data output unit 105. , it is possible to obtain the same effects as those obtained by performing cornering processing. In the above-mentioned embodiment, it was explained that the CPU 100 performs the reading operation of the RAM and converts the video, but the DM
Although it is stated that it is possible to read the RAM using A, and that the four colors are video converted and output sequentially, it is also possible to video convert the four colors at the same time. In other words, data selection by the selector 20 is no longer necessary, but a video converter is required for each color.

【発明の効果】【Effect of the invention】

以上説明したように本発明によれば、CPU等の中央処
理装置を墨入れ処理から開放させ、処理速度を向上させ
ることが可能になる。
As described above, according to the present invention, it is possible to free a central processing unit such as a CPU from inking processing and improve processing speed.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は実施例におけるRAMとビデオインクフェース
との回路構成を示す図、 第2図は実施例の印刷装置のブロック構成図、第3図は
第1図におけるビット処理ユニットの回路構成を示す図
である。 図中、1・・・アドレスバス、2・・・データバス、3
・・・ビット理ユニット、4・・・セレクタ、lOO・
・・CPU、101・・・主メモリ、102・・・RA
M。 102a〜102d・・・ビットマツプメモリ、103
・・・データ入力部、104・・・ビデオインタフェー
ス、105・・・データ出力部である。
FIG. 1 is a diagram showing the circuit configuration of the RAM and video ink face in the embodiment, FIG. 2 is a block diagram of the printing device of the embodiment, and FIG. 3 is a diagram showing the circuit configuration of the bit processing unit in FIG. 1. It is a diagram. In the figure, 1...address bus, 2...data bus, 3
...Bit processing unit, 4...Selector, lOO・
...CPU, 101...Main memory, 102...RA
M. 102a to 102d...Bitmap memory, 103
. . . data input section, 104 . . . video interface, 105 . . . data output section.

Claims (1)

【特許請求の範囲】 各色成分毎の画像を記録媒体に重畳印刷することでカラ
ー可視画像を印刷する印刷装置において、 有彩色成分毎及び黒色のイメージ画像を展開する複数の
メモリと、 該メモリの各々から同時にデータを読み出す読み出し手
段と、 色成分のデータに基づく可視画像を記録媒体に重畳記録
する記録手段と、 該記録手段による記録色成分が有彩色の1つであつて、
前記読み出し手段で読み出された全有彩色成分のデータ
が全て出力ドット有りを示すデータであるとき、当該注
目の有彩色成分に対して出力ドットデータなしとして前
記記録手段に出力する第1の出力手段と、 前記記録手段による記録色成分が黒色であつて、前記読
み出し手段で読み出された全有彩色成分のデータが全て
出力ドットありを示すデータであるとき、当該注目の黒
色成分に対して出力ドット有りとして前記記録手段に出
力する第2の出力手段とを備えることを特徴とする印刷
装置。
[Scope of Claims] A printing device that prints visible color images by superimposing images of each color component on a recording medium, comprising: a plurality of memories for developing images of each chromatic color component and black images; a reading means for simultaneously reading data from each; a recording means for superimposing and recording a visible image based on color component data on a recording medium; and a color component recorded by the recording means is one of chromatic colors,
When all the data of all chromatic color components read out by the readout means are data indicating that output dots are present, a first output is outputted to the recording means as no output dot data for the chromatic color component of interest. means, when the color component recorded by the recording means is black and all the data of all chromatic color components read by the reading means are data indicating that there are output dots, for the black component of interest; A printing apparatus comprising: a second output means for outputting to the recording means as an output dot.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2002083376A1 (en) * 2001-04-17 2002-10-24 Yong Kwon Park Suction hair-clipper

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* Cited by examiner, † Cited by third party
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