JPH0451005B2 - - Google Patents
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- JPH0451005B2 JPH0451005B2 JP60014753A JP1475385A JPH0451005B2 JP H0451005 B2 JPH0451005 B2 JP H0451005B2 JP 60014753 A JP60014753 A JP 60014753A JP 1475385 A JP1475385 A JP 1475385A JP H0451005 B2 JPH0451005 B2 JP H0451005B2
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- JP
- Japan
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- color
- pixel
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- rows
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Description
【発明の詳細な説明】
（産業上の利用分野）
本発明はスイツチング素子により各画素を独立
に駆動するカラー液晶マトリクスパネルにおける
カラー画素の構成に関するものである。
に駆動するカラー液晶マトリクスパネルにおける
カラー画素の構成に関するものである。
（従来技術とその問題点）
グラフイツクやキヤラクターあるいはテレビ動
画の表示を行う大表示容量の溝型平面表示装置の
開発がさかんである。そのような溝型表示装置の
中で、最近有望視されているものにカラー液晶マ
トリクスパネルがあり、その大表示容量、カラー
化は、各カラー画素にスイツチング素子を積層し
て、各カラー画素を独立に駆動する方式で実現さ
れている。スイツチング素子としては多結晶シリ
コンやアモルフアスシリコンなどの薄膜トランジ
スタが用いられる。
画の表示を行う大表示容量の溝型平面表示装置の
開発がさかんである。そのような溝型表示装置の
中で、最近有望視されているものにカラー液晶マ
トリクスパネルがあり、その大表示容量、カラー
化は、各カラー画素にスイツチング素子を積層し
て、各カラー画素を独立に駆動する方式で実現さ
れている。スイツチング素子としては多結晶シリ
コンやアモルフアスシリコンなどの薄膜トランジ
スタが用いられる。
第６図はこのように従来のスイツチング素子積
層方式のカラー液晶マトリクスパネルの薄膜トラ
ンジスタ基板の一部を模式的に示したものであ
る。１が走査線、２が信号線、３がスイツチング
素子としての薄膜トランジスタ、４が透明画素電
極である。
層方式のカラー液晶マトリクスパネルの薄膜トラ
ンジスタ基板の一部を模式的に示したものであ
る。１が走査線、２が信号線、３がスイツチング
素子としての薄膜トランジスタ、４が透明画素電
極である。
この薄膜トランジスタ基板に平行に全体をおお
うように、第７図に示すようなカラーフイルター
基板があり、Ｒ（赤色）、Ｇ（緑色）、Ｂ（青色）の
各カラーフイルタ５は薄膜トランジスタ基板の各
透明画素電極４と正確に位置合せして配列されて
いる。なおこの図では示されていないが、カラー
フイルタ基板全体をおおうように共通透明電極６
が形成されている。
うように、第７図に示すようなカラーフイルター
基板があり、Ｒ（赤色）、Ｇ（緑色）、Ｂ（青色）の
各カラーフイルタ５は薄膜トランジスタ基板の各
透明画素電極４と正確に位置合せして配列されて
いる。なおこの図では示されていないが、カラー
フイルタ基板全体をおおうように共通透明電極６
が形成されている。
このような薄膜トランジスタ基板とカラーフイ
ルタ基板との間のスキマに液晶をみたして、電極
間の電位差により、各画素電極４の液晶を駆動す
る。第８図に一個のカラー画素の等価回路を示
す。同図において同一番号は第６図および第７図
と同一物を示す。６が共通透明電極、７が液晶層
である。各画素電極４に信号電圧を発生させて液
晶をオンオフするのは薄膜トランジスタのスイツ
チングによる。
ルタ基板との間のスキマに液晶をみたして、電極
間の電位差により、各画素電極４の液晶を駆動す
る。第８図に一個のカラー画素の等価回路を示
す。同図において同一番号は第６図および第７図
と同一物を示す。６が共通透明電極、７が液晶層
である。各画素電極４に信号電圧を発生させて液
晶をオンオフするのは薄膜トランジスタのスイツ
チングによる。
通常薄膜トランジスタのスイツチング速度はあ
まり速くないので、液晶マトリクスパネルは線順
次走査で駆動される。第６図で説明すると、１の
走査線にゲート電圧が印加されて、一行分の薄膜
トランジスタが全てオン状態になつたときに、そ
れぞれの信号線２に画像信号電圧が印加され、こ
れらの画像信号電圧にしたがつてそれぞれの液晶
セルがオンオフする。一行分の画像信号印加が終
ると次の走査線が同様に駆動される。液晶は抵抗
が非常に大きいので、印加された画像信号は１フ
レーム時間ほとんど減衰することなく各液晶セル
に蓄積されその結果ほとんどスタテツク駆動に近
い鮮明な画像表示が得られる。
まり速くないので、液晶マトリクスパネルは線順
次走査で駆動される。第６図で説明すると、１の
走査線にゲート電圧が印加されて、一行分の薄膜
トランジスタが全てオン状態になつたときに、そ
れぞれの信号線２に画像信号電圧が印加され、こ
れらの画像信号電圧にしたがつてそれぞれの液晶
セルがオンオフする。一行分の画像信号印加が終
ると次の走査線が同様に駆動される。液晶は抵抗
が非常に大きいので、印加された画像信号は１フ
レーム時間ほとんど減衰することなく各液晶セル
に蓄積されその結果ほとんどスタテツク駆動に近
い鮮明な画像表示が得られる。
このように従来の液晶マトリクスパネルでは一
行毎の線順次走査駆動なので、Ｒ−Ｇ−Ｂ三色カ
ラー画素を１個のフルカラー画素とするカラー液
晶マトリクスパネルにおいては、Ｒ−Ｇ−Ｂ三色
カラー画素は第７図の斜線部に示すような一行並
列配置となる。（日経エレクトロニクス、1984，
９，10号、p215）。一行毎にカラー画素が一画素
づつづれているのは色の混ざりをよくして画質を
向上させるためのものである。
行毎の線順次走査駆動なので、Ｒ−Ｇ−Ｂ三色カ
ラー画素を１個のフルカラー画素とするカラー液
晶マトリクスパネルにおいては、Ｒ−Ｇ−Ｂ三色
カラー画素は第７図の斜線部に示すような一行並
列配置となる。（日経エレクトロニクス、1984，
９，10号、p215）。一行毎にカラー画素が一画素
づつづれているのは色の混ざりをよくして画質を
向上させるためのものである。
しかしながらこのようなＲ−Ｇ−Ｂ三色カラー
画素の一行並列配置を用いたカラー液晶マトリク
スパネルにおける問題点は、色モアレパターンの
発生と、分解能の向上が困難な点である。すなわ
ち同色のカラー画素が行毎に連続するため斜め方
向の色モアレパターンが発生する。また、同一行
内では同色カラー画素は二画素分離れているため
分解能が悪い。
画素の一行並列配置を用いたカラー液晶マトリク
スパネルにおける問題点は、色モアレパターンの
発生と、分解能の向上が困難な点である。すなわ
ち同色のカラー画素が行毎に連続するため斜め方
向の色モアレパターンが発生する。また、同一行
内では同色カラー画素は二画素分離れているため
分解能が悪い。
（発明の目的）
本発明の目的は、上記欠点を除去して、色モア
レパターンの発生がなくかつ分解能がよい高画品
質のスイツチング素子積層方式カラー液晶マトリ
クスパターンを提供することにある。
レパターンの発生がなくかつ分解能がよい高画品
質のスイツチング素子積層方式カラー液晶マトリ
クスパターンを提供することにある。
（発明の構成）
本発明によれば、スイツチング素子により独立
に駆動されるＲ−Ｇ−Ｂ三色カラー画素が行列状
に配置されたカラー液晶マトリクスパネルにおい
て、前記行列状に配置されたＲ−Ｇ−Ｂ三色カラ
ー画素は二行三角形に構成され、該二行三角形は
立正三角形および倒立三角形からなり、該二行内
では該正立三角形および倒立三角形が交互に配列
されており、該二行内の各画素を駆動するスイツ
チング素子は該二行内の同一の走査線に接続され
ていることを特徴とするカラー液晶マトリクスパ
ネルが得られる。
に駆動されるＲ−Ｇ−Ｂ三色カラー画素が行列状
に配置されたカラー液晶マトリクスパネルにおい
て、前記行列状に配置されたＲ−Ｇ−Ｂ三色カラ
ー画素は二行三角形に構成され、該二行三角形は
立正三角形および倒立三角形からなり、該二行内
では該正立三角形および倒立三角形が交互に配列
されており、該二行内の各画素を駆動するスイツ
チング素子は該二行内の同一の走査線に接続され
ていることを特徴とするカラー液晶マトリクスパ
ネルが得られる。
従来は一行毎に線順次走査して各画素を駆動し
ていたのに対して、本発明では二行同時に各画素
を駆動しようとするところにその特徴がある。
ていたのに対して、本発明では二行同時に各画素
を駆動しようとするところにその特徴がある。
このように二行同時に駆動するため、Ｒ−Ｇ−
Ｂ三色カラー画素の配列を三角形に構成すること
ができる。Ｒ−Ｇ−Ｂ三角形画素配列にすると、
同色のカラー画素は次の行では1.5画素分ずれる
ため色モアレパターンの発生が防げる。また同一
行内では同色カラー画素は1.5画素分しか離れて
いないため分解能が向上する。
Ｂ三色カラー画素の配列を三角形に構成すること
ができる。Ｒ−Ｇ−Ｂ三角形画素配列にすると、
同色のカラー画素は次の行では1.5画素分ずれる
ため色モアレパターンの発生が防げる。また同一
行内では同色カラー画素は1.5画素分しか離れて
いないため分解能が向上する。
以上のように二行同時に駆動するためには、信
号線は各画素のまん中を通るように配線されなけ
ればならない。このように信号線を配線すると、
信号線は複雑に折れ曲がることなくまつすぐにな
り、断線などによる画素欠陥の発生がおさえられ
る。ただし各画素は信号線で二分割された形とな
り、それにしたがつて各画素のスイツチング素子
を二分割するか、あるいはスイツチング素子を二
分割しないで分割された画素を配線でつなぐか二
通りの方式がある。もちろんスイツチング素子を
二分割した場合にも、二分割された画素を配線で
つなぐことが本発明の特徴である。こうすること
によりスイツチング素子欠陥による画素欠陥を減
らすことができる。
号線は各画素のまん中を通るように配線されなけ
ればならない。このように信号線を配線すると、
信号線は複雑に折れ曲がることなくまつすぐにな
り、断線などによる画素欠陥の発生がおさえられ
る。ただし各画素は信号線で二分割された形とな
り、それにしたがつて各画素のスイツチング素子
を二分割するか、あるいはスイツチング素子を二
分割しないで分割された画素を配線でつなぐか二
通りの方式がある。もちろんスイツチング素子を
二分割した場合にも、二分割された画素を配線で
つなぐことが本発明の特徴である。こうすること
によりスイツチング素子欠陥による画素欠陥を減
らすことができる。
以下図面を用いて実施例を詳細に説明する。
実施例 １
第１図は本願第１の発明の一実施例を説明する
ための薄膜トランジスタ基板の一部を模式的に示
したものである。１が走査線、２ａ，２ｂ，２ｃ
が信号線、３ａ，３a′，３ｂ，３b′，３ｃ，３
c′がスイツチング用薄膜トランジスタ、４ａ，４
a′，４ｂ，４b′，４ｃ，４c′が透明画素電極であ
る。第６図の従来例と比べて一本の走査線の上下
に作られた薄膜トランジスタが該走査線に接続さ
れており、また一本の信号線の左右に対称的に分
割して作られた薄膜トランジスタが該信号線に接
続され、該分割された二個の薄膜トランジスタ
は、おなじく信号線により分割された二個の透明
画素電極に接続されていることがわかる。該分割
された二個の透明画素電極により一画素が構成さ
れている。
ための薄膜トランジスタ基板の一部を模式的に示
したものである。１が走査線、２ａ，２ｂ，２ｃ
が信号線、３ａ，３a′，３ｂ，３b′，３ｃ，３
c′がスイツチング用薄膜トランジスタ、４ａ，４
a′，４ｂ，４b′，４ｃ，４c′が透明画素電極であ
る。第６図の従来例と比べて一本の走査線の上下
に作られた薄膜トランジスタが該走査線に接続さ
れており、また一本の信号線の左右に対称的に分
割して作られた薄膜トランジスタが該信号線に接
続され、該分割された二個の薄膜トランジスタ
は、おなじく信号線により分割された二個の透明
画素電極に接続されていることがわかる。該分割
された二個の透明画素電極により一画素が構成さ
れている。
この薄膜トランジスタ基板に平行に全体をおお
うように第２図に示すようなカラーフイルタ基板
がある。Ｒ（赤色）、Ｇ（緑色）、Ｂ（青色）の各カ
ラーフイルタ５ａ，５ｂ，５ｃは薄膜トランジス
タ基板の各々の二分割された透明画素電極と正確
に位置合せして三角形に配列されており、１個の
カラーフイルタが２個の分割透明画素電極をカバ
ーする。斜線部で示すようなＲ−Ｇ−Ｂカラーフ
イルタ三角形配列で、１個のフルカラー画素を構
成し、正立三角形配列と倒立三角形配列とが交互
に並べられて一走査線分の行画面を構成し、数百
本以上の行画面でカラー液晶マトリクスの全画面
が構成される。
うように第２図に示すようなカラーフイルタ基板
がある。Ｒ（赤色）、Ｇ（緑色）、Ｂ（青色）の各カ
ラーフイルタ５ａ，５ｂ，５ｃは薄膜トランジス
タ基板の各々の二分割された透明画素電極と正確
に位置合せして三角形に配列されており、１個の
カラーフイルタが２個の分割透明画素電極をカバ
ーする。斜線部で示すようなＲ−Ｇ−Ｂカラーフ
イルタ三角形配列で、１個のフルカラー画素を構
成し、正立三角形配列と倒立三角形配列とが交互
に並べられて一走査線分の行画面を構成し、数百
本以上の行画面でカラー液晶マトリクスの全画面
が構成される。
第３図は本実施例における１個のカラー画素の
等価回路を示す。同図において同一番号は第１図
および第２図と同一物を示す。６が共通透明電
極、７が液晶層である。分割された透明画素電極
は画素電極接続配線８により相互に接続されてい
る。このため分割された薄膜トランジスタの片方
が万一動作不良になつたとしても、他方の薄膜ト
ランジスタにより二分割画素が両方とも駆動さ
れ、画素欠陥を補償することができる。
等価回路を示す。同図において同一番号は第１図
および第２図と同一物を示す。６が共通透明電
極、７が液晶層である。分割された透明画素電極
は画素電極接続配線８により相互に接続されてい
る。このため分割された薄膜トランジスタの片方
が万一動作不良になつたとしても、他方の薄膜ト
ランジスタにより二分割画素が両方とも駆動さ
れ、画素欠陥を補償することができる。
本実施例においては、１つのカラーフイルタの
ピツチサイズを縦100μｍ横120μｍとした。１つ
のカラーフイルタには80μｍ×100μｍの大きさの
二つの二分割画素電極が対応する。３色を混合さ
せた１個のフルカラー画素としては、第１図に示
すように、100μｍ×120μｍ×３個の３角対で
36000μm2の面積となる。このとき隣接する同色
のカラーフイルタ間のピツチは180μｍとなる。
これに対して同一表示面積36000μm2を有する従
来の１個のフルカラー画素は、第７図に示すよう
に、並列に３個並ぶため、隣接する同色のカラー
フイルタ間のピツチを360μｍと横長にするか、
又は表示面積を同一にして１個のフルカラー画素
の縦横比を１に近い値とするために、１つのカラ
フイルタのピツチサイズを190μｍ×63μｍと極め
て縦長にする必要があり、分解能の向上が困難だ
つたり、混色が不十分だつたりした。
ピツチサイズを縦100μｍ横120μｍとした。１つ
のカラーフイルタには80μｍ×100μｍの大きさの
二つの二分割画素電極が対応する。３色を混合さ
せた１個のフルカラー画素としては、第１図に示
すように、100μｍ×120μｍ×３個の３角対で
36000μm2の面積となる。このとき隣接する同色
のカラーフイルタ間のピツチは180μｍとなる。
これに対して同一表示面積36000μm2を有する従
来の１個のフルカラー画素は、第７図に示すよう
に、並列に３個並ぶため、隣接する同色のカラー
フイルタ間のピツチを360μｍと横長にするか、
又は表示面積を同一にして１個のフルカラー画素
の縦横比を１に近い値とするために、１つのカラ
フイルタのピツチサイズを190μｍ×63μｍと極め
て縦長にする必要があり、分解能の向上が困難だ
つたり、混色が不十分だつたりした。
このように同一表示面積の１個のフルカラー画
素を用いて、従来例と比較してみても、本実施例
の方が１個のカラーフイルタが細長くならず、し
たがつて薄膜トランジスタ基板およびカラーフイ
ルタ基板も作成しやすい。
素を用いて、従来例と比較してみても、本実施例
の方が１個のカラーフイルタが細長くならず、し
たがつて薄膜トランジスタ基板およびカラーフイ
ルタ基板も作成しやすい。
実施例 ２
第４図は本願第２の発明の他の実施例を説明す
るための薄膜トランジスタ基板の一部を模式的に
示したものである。１が走査線、２ａ，２ｂ，２
ｃが信号線、３ａ，３ｂ，３ｃがスイツチング用
薄膜トランジスタ、４ａ，４a′，４ｂ，４b′，４
ｃ，４c′が透明画素電極である。実施例１と同
様、一本の走査線の上下に作られた薄膜トランジ
スタが該走査線に接続されている。また一本の信
号線により透明画素電極は左右に二分割され、該
分割された二個の透明画素電極により一画素が構
成される。実施例１と異なる点は薄膜トランジス
タを二分割していないことである。分割透明画素
電極の片側にのみ薄膜トランジスタを形成するこ
とが本実施例２の特徴である。このため薄膜トラ
ンジスタの数が実施例１と比べて1/2ですみ、製
造が容易になり、薄膜トランジスタの欠陥数が減
り画素欠陥が減少する。
るための薄膜トランジスタ基板の一部を模式的に
示したものである。１が走査線、２ａ，２ｂ，２
ｃが信号線、３ａ，３ｂ，３ｃがスイツチング用
薄膜トランジスタ、４ａ，４a′，４ｂ，４b′，４
ｃ，４c′が透明画素電極である。実施例１と同
様、一本の走査線の上下に作られた薄膜トランジ
スタが該走査線に接続されている。また一本の信
号線により透明画素電極は左右に二分割され、該
分割された二個の透明画素電極により一画素が構
成される。実施例１と異なる点は薄膜トランジス
タを二分割していないことである。分割透明画素
電極の片側にのみ薄膜トランジスタを形成するこ
とが本実施例２の特徴である。このため薄膜トラ
ンジスタの数が実施例１と比べて1/2ですみ、製
造が容易になり、薄膜トランジスタの欠陥数が減
り画素欠陥が減少する。
本実施例２の場合に用いるカラーフイルタ基板
は、図２の実施例１の場合と全く同じである。Ｒ
−Ｇ−Ｂカラーフイルタ三角配列で高画品質が実
現される。
は、図２の実施例１の場合と全く同じである。Ｒ
−Ｇ−Ｂカラーフイルタ三角配列で高画品質が実
現される。
第５図は本実施例２における１個のカラー画素
の等価回路を示す。薄膜トランジスタは１個で、
分割された透明画素電極は、画素電極接続配線８
により相互に接続されている。この画素電極接続
配線は通常金属配線を用いるが透明電極そのもの
を用いてもよい。この場合製造工程がより簡略化
される。
の等価回路を示す。薄膜トランジスタは１個で、
分割された透明画素電極は、画素電極接続配線８
により相互に接続されている。この画素電極接続
配線は通常金属配線を用いるが透明電極そのもの
を用いてもよい。この場合製造工程がより簡略化
される。
（発明の効果）
以上詳細に説明したとおり、本発明によるカラ
ー液晶マトリクスパネルにおいては、１個のフル
カラー画素を構成するＲ−Ｇ−B3色のカラー画
素の配置構成を二行三角形配列としたため、分解
能がよく混色性にすぐれた表示パネルが得られ
る。また二行三角形配列とするために、１個の画
素に対する透明画素電極を走査線で２分割した
が、この二分割透明画素電極を相互配線で接続す
ることで、スイツチング素子の欠陥に起因する画
素欠陥を大幅に減らすことができる。
ー液晶マトリクスパネルにおいては、１個のフル
カラー画素を構成するＲ−Ｇ−B3色のカラー画
素の配置構成を二行三角形配列としたため、分解
能がよく混色性にすぐれた表示パネルが得られ
る。また二行三角形配列とするために、１個の画
素に対する透明画素電極を走査線で２分割した
が、この二分割透明画素電極を相互配線で接続す
ることで、スイツチング素子の欠陥に起因する画
素欠陥を大幅に減らすことができる。
以上実施例ではスイツチング素子として薄膜ト
ランジスタを用いたが、薄膜ダイオードMIMな
ど他の非線形スイツチング素子を用いても同様の
効果が得られることは明らかである。
ランジスタを用いたが、薄膜ダイオードMIMな
ど他の非線形スイツチング素子を用いても同様の
効果が得られることは明らかである。
第１図は本発明の一実施例を説明するための、
薄膜トランジスタ基板の平面構造を示す模式図、
第２図はＲ−Ｇ−Ｂ−３色カラフイルターの配置
を示すカラーフイルタ基板の平面フイルター配置
図、第３図は１個のカラー画素の等価回路図、第
４図は本発明の他の実施例を説明するための、薄
膜トランジスタ基板の平面構造を示す模式図、第
５図は１個のカラー画素の等価回路図である。第
６図は従来例における薄膜トランジスタ基板の平
面構造を表わした模式図、第７図はカラーフイル
タ基板の平面フイルター配置図、第８図は１個の
カラー画素の等価回路図である。 １……走査線、２，２ａ，２ｂ，２，ｃ……信
号線、３，３ａ，３a′，３ｂ，３b′，３ｃ，３
c′……薄膜トランジスタ、４，４ａ，４a′，４
ｂ，４b′，４ｃ，４c′……透明画素電極、５，５
ａ，５ｂ，５ｃ……カラーフイルタ、６……共通
透明電極、７……液晶層、８……画素電極接続配
線。
薄膜トランジスタ基板の平面構造を示す模式図、
第２図はＲ−Ｇ−Ｂ−３色カラフイルターの配置
を示すカラーフイルタ基板の平面フイルター配置
図、第３図は１個のカラー画素の等価回路図、第
４図は本発明の他の実施例を説明するための、薄
膜トランジスタ基板の平面構造を示す模式図、第
５図は１個のカラー画素の等価回路図である。第
６図は従来例における薄膜トランジスタ基板の平
面構造を表わした模式図、第７図はカラーフイル
タ基板の平面フイルター配置図、第８図は１個の
カラー画素の等価回路図である。 １……走査線、２，２ａ，２ｂ，２，ｃ……信
号線、３，３ａ，３a′，３ｂ，３b′，３ｃ，３
c′……薄膜トランジスタ、４，４ａ，４a′，４
ｂ，４b′，４ｃ，４c′……透明画素電極、５，５
ａ，５ｂ，５ｃ……カラーフイルタ、６……共通
透明電極、７……液晶層、８……画素電極接続配
線。
Claims (1)
- 【特許請求の範囲】 １ マトリクス状に配線された走査線および信号
線に接続されているスイツチング素子により独立
に駆動されるＲ−Ｇ−Ｂ三色カラー画素が行列状
に配置されたカラー液晶マトリクスパネルにおい
て、前記行列状に配置されたＲ−Ｇ−Ｂ三色カラ
ー画素は二行三角形に構成され、該二行三角形は
正立三角形および倒立三角形からなり、該二行内
では該正立三角形および倒立三角形が交互に配列
されており、該二行内の各画素を駆動するスイツ
チング素子は該二行内の同一の走査線に接続さ
れ、Ｒ−Ｇ−Ｂ三色の各カラー画素と各カラー画
素を駆動するスイツチング素子は信号線によつて
二分割され、該二分割された２個のスイツチング
素子は該二分割されたカラー画素のそれぞれの分
割画素および該二分割した信号線に接続され、前
記二分割されたカラー画素は配線によつて相互に
接続されていることを特徴とするカラー液晶マト
リクスパネル。 ２ マトリクス状に配線された走査線および信号
線に接続されているスイツチング素子により独立
に駆動されるＲ−Ｇ−Ｂ三色カラー画素が行列状
に配置されたカラー液晶マトリクスパネルにおい
て、前記行列状に配置されたＲ−Ｇ−Ｂ三色カラ
ー画素は二行三角形に構成され、該二行三角形は
正立三角形および倒立三角形からなり、該二行内
では該正立三角形および倒立三角形が交互に配列
されており、該二行内の各画素を駆動するスイツ
チング素子は該二行内の同一の走査線に接続さ
れ、Ｒ−Ｇ−Ｂ三色の各カラー画素は信号線によ
つて二分割され、該二分割されたカラー画素を駆
動するスイツチング素子は１個で、該二分割され
たカラー画素の片方の分割画素および該二分割し
た信号線に接続され、前記二分割されたカラー画
素は配線によつて相互に接続されていることを特
徴とするカラー液晶マトリクスパネル。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60014753A JPS61173290A (ja) | 1985-01-29 | 1985-01-29 | カラ−液晶マトリクスパネル |
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Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60014753A JPS61173290A (ja) | 1985-01-29 | 1985-01-29 | カラ−液晶マトリクスパネル |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61173290A JPS61173290A (ja) | 1986-08-04 |
| JPH0451005B2 true JPH0451005B2 (ja) | 1992-08-17 |
Family
ID=11869858
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60014753A Granted JPS61173290A (ja) | 1985-01-25 | 1985-01-29 | カラ−液晶マトリクスパネル |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61173290A (ja) |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| US5715025A (en) * | 1993-02-22 | 1998-02-03 | Goldstar Co., Ltd. | Active matrix for liquid crystal displays in which a data bus consists of two data subbuses and each data subbus is separated from an adjacent data bus by one display electrode |
| JP2007093851A (ja) * | 2005-09-28 | 2007-04-12 | Sanyo Epson Imaging Devices Corp | 電気光学装置および電子機器 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
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-
1985
- 1985-01-29 JP JP60014753A patent/JPS61173290A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61173290A (ja) | 1986-08-04 |
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