JPH046096U - - Google Patents
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- Publication number
- JPH046096U JPH046096U JP4609390U JP4609390U JPH046096U JP H046096 U JPH046096 U JP H046096U JP 4609390 U JP4609390 U JP 4609390U JP 4609390 U JP4609390 U JP 4609390U JP H046096 U JPH046096 U JP H046096U
- Authority
- JP
- Japan
- Prior art keywords
- pulse
- circuit
- oscillation
- blanking
- synchronization
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000010355 oscillation Effects 0.000 claims 12
- 238000010586 diagram Methods 0.000 description 10
Landscapes
- Details Of Television Scanning (AREA)
Description
第１図は本考案のブランキング回路の一実施例
を示すブロツクダイアグラム、第２図は第１図の
ブロツクダイアグラムに即した回路実施例を示す
回路図、第３図は本考案の第２の実施例を示すブ
ロツクダイアグラム、第４図は本考案の第３の実
施例を示すブロツクダイアグラム、第５図は第１
図実施例の位相判別回路における波形図、第６図
は第２図における波形図、第７図は第３図の実施
例の位相判別回路における波形図、第８図は第４
図のカウンタにおける波形図、第９図は本考案の
他の実施例を示す回路図、第１０図は本考案の他
の実施例を示す回路図である。 １５……パルス幅修正回路、１６……位相判別
回路、２１……第１パルス発生回路、２２……第
２パルス発生回路、３２……カウンタ、３４……
メモリ。
を示すブロツクダイアグラム、第２図は第１図の
ブロツクダイアグラムに即した回路実施例を示す
回路図、第３図は本考案の第２の実施例を示すブ
ロツクダイアグラム、第４図は本考案の第３の実
施例を示すブロツクダイアグラム、第５図は第１
図実施例の位相判別回路における波形図、第６図
は第２図における波形図、第７図は第３図の実施
例の位相判別回路における波形図、第８図は第４
図のカウンタにおける波形図、第９図は本考案の
他の実施例を示す回路図、第１０図は本考案の他
の実施例を示す回路図である。 １５……パルス幅修正回路、１６……位相判別
回路、２１……第１パルス発生回路、２２……第
２パルス発生回路、３２……カウンタ、３４……
メモリ。
Claims (1)
- 【実用新案登録請求の範囲】 (1) 発振回路を有し、入力された同期パルスを
用い、発振回路より発振パルスを発生し、且つそ
のパルスにより、偏向回路またはドライブ回路を
制御している表示装置のブランキング回路におい
て、 前記発振パルスを前記同期パルスのパルス幅に
対して狭い幅に変換するパルス幅修正回路を設け
るとともに、前記同期パルスと前記パルス幅修正
回路からのパルスとの位相を判別する位相判別回
路を設けたことを特徴とするブランキング回路。 (2) 発振回路を有し、入力された同期パルスを
用い、発振回路より発振パルスを発生し、且つそ
のパルスにより、偏向回路またはドライブ回路を
制御している表示装置のブランキング回路におい
て、 前記同期パルスをトリガしてパルスを発生する
第１のパルス発生回路と、 前記発振パルスをトリガしてパルスを発生する
第２のパルス発生回路とを設けるとともに、前記
第１、第２の発生回路より発生されたパルスの位
相を判別する位相判別回路を設けたことを特徴と
するブランキング回路。 (3) 発振回路を有し、入力された同期パルスを
用い、発振回路より発振パルスを発生し、且つそ
のパルスにより、偏向回路またはドライブ回路を
制御している表示装置のブランキング回路におい
て、 前記同期パルスのエツジから、前記発振パルス
のエツジまでの間のパルスをカウントするカウン
タと、前記カウンタによりカウントした数値デー
タを記憶するメモリとを設け、 前記メモリの数値データと、次に入力された数
値データとを比較することを特徴とするブランキ
ング回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4609390U JPH046096U (ja) | 1990-04-27 | 1990-04-27 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4609390U JPH046096U (ja) | 1990-04-27 | 1990-04-27 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH046096U true JPH046096U (ja) | 1992-01-21 |
Family
ID=31560868
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4609390U Pending JPH046096U (ja) | 1990-04-27 | 1990-04-27 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH046096U (ja) |
-
1990
- 1990-04-27 JP JP4609390U patent/JPH046096U/ja active Pending
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