JPH0466659U - - Google Patents
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- Publication number
- JPH0466659U JPH0466659U JP10586890U JP10586890U JPH0466659U JP H0466659 U JPH0466659 U JP H0466659U JP 10586890 U JP10586890 U JP 10586890U JP 10586890 U JP10586890 U JP 10586890U JP H0466659 U JPH0466659 U JP H0466659U
- Authority
- JP
- Japan
- Prior art keywords
- processing unit
- central processing
- dual port
- port memory
- main
- Prior art date
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- Pending
Links
- 230000009977 dual effect Effects 0.000 claims description 5
- 230000006870 function Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Microcomputers (AREA)
Description
第１図は本考案の一実施例を示すブロツク図で
ある。 １……メイン部、２……デユアルポートメモリ
、１１，１４……読取り状態信号、１２，１３…
…読取り要求信号、２０……メインＣＰＵ。
ある。 １……メイン部、２……デユアルポートメモリ
、１１，１４……読取り状態信号、１２，１３…
…読取り要求信号、２０……メインＣＰＵ。
Claims (1)
- 【実用新案登録請求の範囲】 １ １チツプ中央処理装主中央処置装置とのイタ
ーフエイスとしデユアルポートメモリを設けたこ
とを特徴とする１チツプ中央処理装置。 ２ メイン部と主中央処理装置とのイターフエイ
スとしてのデユアルポートメモリとを備え、前記
主中央処理装置および１チツプ中央処理装置の前
記メイン部の両方から非同期のアクセスが可能で
あつて、同一番地に対して両方向から書込みとな
つたときおよび一方が書込みとなり他方が読出し
となつたときにデータが不定となるのを防止する
ための調停機能を前記デユアルポートメモリに設
けたことを特徴とする１チツプ中央処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10586890U JPH0466659U (ja) | 1990-10-08 | 1990-10-08 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10586890U JPH0466659U (ja) | 1990-10-08 | 1990-10-08 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0466659U true JPH0466659U (ja) | 1992-06-12 |
Family
ID=31851734
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10586890U Pending JPH0466659U (ja) | 1990-10-08 | 1990-10-08 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0466659U (ja) |
-
1990
- 1990-10-08 JP JP10586890U patent/JPH0466659U/ja active Pending