JPH0467755U - - Google Patents
Info
- Publication number
- JPH0467755U JPH0467755U JP11007890U JP11007890U JPH0467755U JP H0467755 U JPH0467755 U JP H0467755U JP 11007890 U JP11007890 U JP 11007890U JP 11007890 U JP11007890 U JP 11007890U JP H0467755 U JPH0467755 U JP H0467755U
- Authority
- JP
- Japan
- Prior art keywords
- data bus
- function
- internal data
- control
- control system
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Hardware Redundancy (AREA)
- Multi Processors (AREA)
Description
第１図は本考案の一実施例を示す構成図、第２
図は第１図の動作フローチヤート、第３図は従来
例を示す構成図、第４図は従来の動作フローチヤ
ートである。 １０，１１，１２……ハードウエアボーダ、２
０……内部データバス、３０，３１，３２……制
御用コンピユータ、４０……外部データバス。
図は第１図の動作フローチヤート、第３図は従来
例を示す構成図、第４図は従来の動作フローチヤ
ートである。 １０，１１，１２……ハードウエアボーダ、２
０……内部データバス、３０，３１，３２……制
御用コンピユータ、４０……外部データバス。
Claims (1)
- 【実用新案登録請求の範囲】 共通の外部データバスにそれぞれ独立して接続
された複数台の制御用コンピユータからなる多重
化制御システムにおいて、 共通の内部データバスと前記各制御用コンピユ
ータとの間に内部データバスの同期をとる機能と
ボーデイング終了時に制御用コンピユータに割り
込みをかける機能を有するハードウエアボーダが
それぞれ具備されていることを特徴とする多重化
制御システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11007890U JPH0467755U (ja) | 1990-10-20 | 1990-10-20 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11007890U JPH0467755U (ja) | 1990-10-20 | 1990-10-20 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0467755U true JPH0467755U (ja) | 1992-06-16 |
Family
ID=31857360
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11007890U Pending JPH0467755U (ja) | 1990-10-20 | 1990-10-20 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0467755U (ja) |
-
1990
- 1990-10-20 JP JP11007890U patent/JPH0467755U/ja active Pending
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