JPH0472784U - - Google Patents
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- Publication number
- JPH0472784U JPH0472784U JP11630290U JP11630290U JPH0472784U JP H0472784 U JPH0472784 U JP H0472784U JP 11630290 U JP11630290 U JP 11630290U JP 11630290 U JP11630290 U JP 11630290U JP H0472784 U JPH0472784 U JP H0472784U
- Authority
- JP
- Japan
- Prior art keywords
- head switching
- drum
- event
- divider
- signal output
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 4
- 238000003708 edge detection Methods 0.000 description 1
- 238000004804 winding Methods 0.000 description 1
Description
第１図は本考案の第一の実施例を示すヘツド・
スイツチング・パルス作成回路のブロツク構成図
、第２図は第１図における各種信号のタイミング
図、第３図は本考案の第二の実施例を示すヘツド
・スイツチング・パルス作成回路のブロツク構成
図、第４図は第３図における各種信号のタイミン
グ図、第５図ａ，ｂはそれぞれ従来の一例を説明
するためのＶＨＳ方式のテープ巻付け状態および
ＶＨＳ−Ｃ方式のテープ巻付け状態を示すテープ
とドラムの関係図、第６図は第５図ａ，ｂにおけ
るＶＨＳ方式及びＶＨＳ−Ｃ方式でのドラムＰＧ
信号、ドラムＦＧ信号およびＨＳＷ信号のタイミ
ング図、第７図は従来の一例を示すヘツド・スイ
ツチング・パルス作成回路のブロツク構成図、第
８図および第９図はそれぞれ第７図におけるＶＨ
Ｓ方式およびＶＨＳ−Ｃ方式でのヘツドスイツチ
ング信号の作成タイミング図である。
１２，３０……パルス入力ポート、１３……シ
ユミツト回路、１４……エツジ検出回路、１５…
…カウンタ、１６……イベント・デバイダ・コン
トロール・レジスタ、１７……イベント・カウン
タ（ＥＣ）、１８，１９……ＲＳフリツプフロツ
プ、２０〜２３……イベント・カウンタ・コンペ
ア・レジスタ（ＥＣＣ）、２５……ヘツド・スイ
ツチング信号（ＨＳＷ）出力、２６……ＥＣＣ０
一致信号マスク用制御回路、３２……出力切換え
セレクタ。
FIG. 1 shows a head and a first embodiment of the present invention.
2 is a timing diagram of various signals in FIG. 1; FIG. 3 is a block diagram of a head switching pulse generating circuit showing a second embodiment of the present invention; 4 is a timing diagram of various signals in FIG. 3, and FIGS. 5a and 5b are tape winding states of a VHS system and a VHS-C system, respectively, to explain a conventional example. Figure 6 shows the drum PG in the VHS system and VHS-C system in Figures 5a and b.
Fig. 7 is a block diagram of a head switching pulse generation circuit showing a conventional example; Figs. 8 and 9 are VH in Fig. 7, respectively.
FIG. 4 is a timing chart for creating head switching signals in the S system and the VHS-C system. 12, 30... Pulse input port, 13... Schmitt circuit, 14... Edge detection circuit, 15...
...Counter, 16...Event divider control register, 17...Event counter (EC), 18, 19...RS flip-flop, 20-23...Event counter compare register (ECC), 25... ...Head switching signal (HSW) output, 26...ECC0
Coincidence signal mask control circuit, 32...Output switching selector.
Claims (1)
するにあたり、ドラム・モータより出力されるド
ラムＰＧ信号を分周するためのイベント・デバイ
ダと、前記ドラム・モータより出力されるドラム
ＦＧ信号の入力毎にカウント・アツプするイベン
ト・カウンタと、出力パルスの立上りおよび立下
りタイミングを設定するための複数のイベント・
カウンタ・コンペア・レジスタと、前記複数のイ
ベントカウンタ・コンペア・レジスタからの信号
によりセツトおよびリセツトされるＲ−Ｓフリツ
プフロツプとを有し、ＶＨＳ方式及びＶＨＳ−Ｃ
方式のどちらでもソフトウエアの介在なしにヘツ
ド・スイツチング・パルスを作成することを特徴
とするヘツド・スイツチング・パルス作成回路。 In creating the VTR head switching pulse, an event divider is used to divide the frequency of the drum PG signal output from the drum motor, and a count/divider is used for each input of the drum FG signal output from the drum motor. Multiple event counters for setting the rise and fall timing of output pulses.
It has a counter compare register and an R-S flip-flop that is set and reset by signals from the plurality of event counter compare registers,
A head switching pulse generation circuit is characterized in that it generates head switching pulses without the intervention of software in either method.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11630290U JPH0472784U (en) | 1990-11-06 | 1990-11-06 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11630290U JPH0472784U (en) | 1990-11-06 | 1990-11-06 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0472784U true JPH0472784U (en) | 1992-06-26 |
Family
ID=31864117
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11630290U Pending JPH0472784U (en) | 1990-11-06 | 1990-11-06 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0472784U (en) |
-
1990
- 1990-11-06 JP JP11630290U patent/JPH0472784U/ja active Pending
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