JPH0480807A - constant current circuit - Google Patents
constant current circuitInfo
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- JPH0480807A JPH0480807A JP2195355A JP19535590A JPH0480807A JP H0480807 A JPH0480807 A JP H0480807A JP 2195355 A JP2195355 A JP 2195355A JP 19535590 A JP19535590 A JP 19535590A JP H0480807 A JPH0480807 A JP H0480807A
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Abstract
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、電圧源の電圧が変化しても常に一定の電流を
得ることが可能な定電流回路に関するものである。DETAILED DESCRIPTION OF THE INVENTION Field of Industrial Application The present invention relates to a constant current circuit that can always obtain a constant current even if the voltage of a voltage source changes.
従来の技術
一般的に定電流を得ようとする場合は、第3図に示す構
成で得ることか多い。BACKGROUND OF THE INVENTION Generally, when it is desired to obtain a constant current, the configuration shown in FIG. 3 is often used.
第3図の回路は、等価的電流源1と、エミッタか接地さ
れ共通ベースを有するNPN型トランジスタ23からな
るカレントミラー回路8と、エミッタが電圧源端子7に
接続されたPNP型トランジスタ45からなるカレント
ミラー回路9とし、且つ等価的電流源1をカレントミラ
ー回路8の入力側トランジスタ2のコレクタ、ベース共
通接続点に接続し、出力側トランジスタ3のコレクタを
、カレントミラー回路9の入力側トランジスタ4のコレ
クタ、ベース共通接続点に接続し、出力側トランジスタ
5のコレクタ側を出力端子6とした構成である。The circuit of FIG. 3 consists of an equivalent current source 1, a current mirror circuit 8 consisting of an NPN transistor 23 whose emitter is grounded and which has a common base, and a PNP transistor 45 whose emitter is connected to the voltage source terminal 7. The equivalent current source 1 is connected to the collector and base common connection point of the input transistor 2 of the current mirror circuit 9, and the collector of the output transistor 3 is connected to the input transistor 4 of the current mirror circuit 9. The collector and base of the transistor 5 are connected to a common connection point, and the collector side of the output transistor 5 is used as an output terminal 6.
等測的電流源の電流値をI、カレントミラー回路8のミ
ラー係数を1とすれば、トランジスタ3のコレクタ電流
Tc3は次式のようになる。If the current value of the isometric current source is I and the mirror coefficient of the current mirror circuit 8 is 1, then the collector current Tc3 of the transistor 3 is expressed by the following equation.
I c+= (1+VCB/ VA) ・l ・
・・−・(IIVc8 トランジスタ3のヘース、コレ
クタ間電圧
VA :トランジスタ3のアーり電圧
また、電圧源端子7の電圧値を■。Cとすれば、(1)
式は次式のようになる。I c+= (1+VCB/VA) ・l ・
... - (IIVc8 Heath-to-collector voltage VA of transistor 3: Earth voltage of transistor 3 Also, if the voltage value of voltage source terminal 7 is ■.C, then (1)
The formula is as follows.
I C3= (1+(VCCVBE3 VIIE4)
/ V、A) 1・・・・・・(2)
Vcc3・トランジスタ3のエミッタ、へ−ス間電圧
■BE4トランジスタ4のエミッタ、ベース間電圧
ここで、カレントミラー回路9のミラー係数を1、出力
端子6へ流れ出す電流を10とすれば、o−Ic3
、’、 I o” (1+(Vcc V[1E3V8
E4)/ VA) 1・・・・・・(3)
となる。通常VBE3= VBE4” 0.7 V、V
A” 30 Vとすると、(3)式は、
I o= (1+(Vcc 1.4 V)/ 30
V) J・・・・・・(4)
したがって、電圧源電圧Vccか変化してしまうと、出
力端子電流Ioが第4図に示すように変化してしまう。I C3= (1+(VCCVBE3 VIIE4)
/ V, A) 1... (2) Vcc3 - Voltage between emitter and base of transistor 3 ■BE4 Voltage between emitter and base of transistor 4 Here, the mirror coefficient of current mirror circuit 9 is 1, If the current flowing to the output terminal 6 is 10, o-Ic3 ,', I o'' (1+(Vcc V[1E3V8
E4)/VA) 1...(3) Normal VBE3= VBE4” 0.7 V, V
A” 30 V, formula (3) is I o= (1+(Vcc 1.4 V)/30
V) J (4) Therefore, if the voltage source voltage Vcc changes, the output terminal current Io will change as shown in FIG.
発明か解決しようとする課題
以上で述へたように、従来回路においては、電源電圧の
変化に従って得ようしている電流か変化してしまうとい
う課題を有していた。Problems to be Solved by the Invention As mentioned above, the conventional circuit has a problem in that the current to be obtained changes as the power supply voltage changes.
本発明は、上記課題を解決するものであり、トランジス
タのアーり効果を補償し、電源電圧か変化しても、常に
一定の電流を得ることができる定電流回路を提供するこ
とを目的とするものである。The present invention solves the above problems, and aims to provide a constant current circuit that can compensate for the earth effect of transistors and always obtain a constant current even if the power supply voltage changes. It is something.
課題を解決するための手段
上記課題を解決するために、本発明は、等測的電流源が
、エミッタが接地された入力側NPN型トランジスタの
コレクタ、ベース共通接続点に接続され、出力側トラン
ジスタを複数個有する第1のカレントミラー回路と、前
記第1のカレントミラー回路の出力側の第1トランジス
タのコレクタが、エミッタが電圧源に接続された入力側
PNP型トランジスタのコレクタ、ベース共通接続点に
接続され、出力側トランジスタを複数個有する第2のカ
レントミラー回路と、前記第1のカレントミラー回路の
出力側の第2のトランジスタのコレクタが、前記第2の
カレントミラー回路の出力側の第1トランジスタのコレ
クタに接続され、かつエミッタが接地された入力側NP
N型トランジスタのコレクタ、ベース共通接続点に接続
され、出力側トランジスタのコレクタが、前記第1のカ
レントミラー回路のベースに接続された第3のカレント
ミラー回路を有するものである。Means for Solving the Problems In order to solve the above problems, the present invention provides an isometry current source connected to a common connection point between the collector and base of an input NPN transistor whose emitter is grounded, and a collector of a first transistor on the output side of the first current mirror circuit is a common connection point between the collector and base of an input side PNP transistor whose emitter is connected to a voltage source. a second current mirror circuit having a plurality of output side transistors, and a collector of a second transistor on the output side of the first current mirror circuit connected to the second current mirror circuit having a plurality of output side transistors; Input side NP connected to the collector of one transistor and whose emitter is grounded
The third current mirror circuit is connected to a common connection point between the collector and base of the N-type transistor, and the collector of the output transistor is connected to the base of the first current mirror circuit.
作用
本発明は上記のように、電流帰還を用いた簡単な構成に
より、トランジスタのアーリ効果を補償し、電源電圧が
変化しても常に一定の電流を得ることが可能となる。As described above, the present invention compensates for the Early effect of the transistor by using a simple configuration using current feedback, making it possible to always obtain a constant current even when the power supply voltage changes.
実施例
以下本発明の一実施例を、図面を参照しながら説明する
。第1図は本発明の一実施例であり、従来例の第3図と
同一の構成には同一の符号を付しており、1は等測的電
流源、6は出力端子、7は電源電圧端子、8.9はカレ
ントミラー回路である。等測的電流源1は、エミッタが
接地されたカレントミラー回路8の入力側NPN型トラ
ンジスタ2のコレクタ、ベース共通接続点に接続され、
出力側N P N型トランジスタ3.10のコレクタは
それぞれ、エミッタが電源電圧7に接続されたカレント
ミラー回路9の入力側PNP型トランジスタ4のコレク
タ、ベース共通接続点、出力側PNP型トランジスタ5
のコレクタにそれぞれ接続され、さらにトランジスタ5
のコレクタは、エミッタが接地されたカレントミラー回
路14の入力側NPN型トランジスタ12のコレクタ、
ベース共通接続点に接続され、出力側NPN型トランジ
スタ13のコレクタはカレントミラー回路8の共通ベー
スに接続されており、カレントミラー回路9の出力側P
NP型トランジスタ11のコレクタは、出力端子6とす
るものである。EXAMPLE An example of the present invention will be described below with reference to the drawings. FIG. 1 shows an embodiment of the present invention, and the same components as in the conventional example shown in FIG. Voltage terminal 8.9 is a current mirror circuit. The isometry current source 1 is connected to a common connection point between the collector and base of the input side NPN transistor 2 of the current mirror circuit 8 whose emitter is grounded,
The collectors of the output side N P N-type transistors 3 and 10 are the collector and base common connection point of the input side PNP type transistor 4 of the current mirror circuit 9 whose emitter is connected to the power supply voltage 7, and the output side PNP type transistor 5
are connected to the collectors of transistors 5 and 5.
The collector of the input side NPN type transistor 12 of the current mirror circuit 14 whose emitter is grounded,
The collector of the output side NPN type transistor 13 is connected to the common base of the current mirror circuit 8, and the output side P of the current mirror circuit 9 is connected to the base common connection point.
The collector of the NP type transistor 11 is used as the output terminal 6.
上記構成において、従来例と同様に等価的電流源の電流
値を■、カレントミラー回路8.9.14のミラー係数
を1とすれば、トランジスタ3のコレクタ電流IC3は
次式のようになる。In the above configuration, if the current value of the equivalent current source is 2 and the mirror coefficient of the current mirror circuit 8.9.14 is 1, as in the conventional example, then the collector current IC3 of the transistor 3 is expressed by the following equation.
I c3= (1+ Vca/ Vわ・I・・・・・・
(1)ただし、VCB、VAは従来例と同しである。I c3= (1+ Vca/ Vwa・I...
(1) However, VCB and VA are the same as in the conventional example.
ここで、カレントミラー回路9のトランジスタ5のコレ
クタから流れ出す電流IC5は
I cs ’= I C3−−f21
また、カレントミラー回路8のトランジスタ10に流れ
込む電流はIであるので、(2)式からIを差し引いた
電流Ipsがカレントミラー回路14の入力側トランジ
スタに流れ込むことになる。ここでIFBは1
1FB=IC51
= (VC8/ VA) ・ I
−−13)(3)式の電流IFIIは、等価的電流源I
に帰還されるので、カレントミラー回路8の入力側トラ
ンジスタに流れ込む電流l。2は次式のようになる。Here, the current IC5 flowing out from the collector of the transistor 5 of the current mirror circuit 9 is I cs '= I C3--f21 Also, the current flowing into the transistor 10 of the current mirror circuit 8 is I, so from equation (2), I The current Ips obtained by subtracting the current Ips flows into the input transistor of the current mirror circuit 14. Here, IFB is 1 1FB=IC51 = (VC8/VA) ・I
--13) The current IFII in equation (3) is the equivalent current source I
Since the current l flows into the input transistor of the current mirror circuit 8. 2 is as shown in the following equation.
IC2=I IFB
−(I Vca/ VA) ・I −−(4よ
って、トランジスタ3のコレクタに流れる電流IC3は
、次式のようになる。IC2=I IFB - (I Vca/VA) · I - (4 Therefore, the current IC3 flowing to the collector of the transistor 3 is expressed by the following equation.
I C3−(1+ Vca/ VA) ・I cニー
(1−(VCB/V、t)2)・1 −・・15ここ
で(V ca/ Vわ:!=oとすると(5)式はIC
3=I ・・・・・・(6とな
り上式の電流が、出力端子6に流れ出すことになる。I C3-(1+ Vca/ VA) ・I c knee(1-(VCB/V, t)2)・1-...15Here, if (V ca/Vwa:!=o), equation (5) is IC
3=I (6), and the current in the above equation will flow to the output terminal 6.
よって第2図に示すように、トランジスタのアーリ効果
を補償し、電源電圧が変化しても常に一定の電流を得る
ことが可能である。Therefore, as shown in FIG. 2, it is possible to compensate for the Early effect of the transistor and always obtain a constant current even if the power supply voltage changes.
発明の詳細
な説明したように、本発明によれば、電流帰還を用いた
簡単な構成により、トランジスタのアーリ効果を補償し
、また、温度依存性7 トランジスタの特性にバラツキ
があったり、あるいは、電源電圧が変化しても、常に一
定の電流を得ることが可能となる。As described in detail, according to the present invention, the Early effect of the transistor can be compensated for by a simple configuration using current feedback, and the Early effect of the transistor can be compensated for by using a simple configuration using current feedback. Even if the power supply voltage changes, it is possible to always obtain a constant current.
第1図は本発明の一実施例の定電流回路図、第2図は本
発明による出力電流−電源電圧の関係特性図、第3図は
従来の定電流回路図、第4図は従来の出力電流−電源電
圧の関係特性図である。
1・・・・・・等°価的電流源、2,3,10,12.
13・・・・・・NPNトランジスタ、4,5.11・
・・・・・PNPトランジスタ、6・・・・・・出力端
子、7・・・・・・電源端子、8,9.14・=−・・
カレントミラー回路。
代理人の氏名 弁理士 粟野重孝 はか12第
図
第2図
Q、’ji、21)し)トミラーFig. 1 is a constant current circuit diagram of an embodiment of the present invention, Fig. 2 is a characteristic diagram of the relationship between output current and power supply voltage according to the present invention, Fig. 3 is a conventional constant current circuit diagram, and Fig. 4 is a conventional constant current circuit diagram. FIG. 3 is a characteristic diagram showing the relationship between output current and power supply voltage. 1... Equivalent current source, 2, 3, 10, 12.
13...NPN transistor, 4,5.11.
... PNP transistor, 6 ... Output terminal, 7 ... Power supply terminal, 8, 9.14 ... = - ...
current mirror circuit. Name of agent: Patent attorney Shigetaka Awano Haka12 Figure 2 Q, 'ji, 21) Shi) Tomira
Claims (1)
ッタ接地NP、N型トランジスタ対の入力側トランジス
タのコレクタ、ベース共通接続点に接続し、前記トラン
ジスタ対のうちの出力側トランジスタを複数個有し、前
記第1のカレントミラー構成の出力側の複数のトランジ
スタの各コレクタに、互いのエミッタを共通接続して電
圧源に接続したPNP型トランジスタ対でなる第2のカ
レントミラー構成の各コレクタを接続し、前記第1、第
2のカレントミラー構成のうちの一方のトランジスタの
コレクタ電路に、エミッタ共通接地NPN型トランジス
タ対でなる第3のカレントミラー構成の一方のトランジ
スタのコレクタ、ベース共通接続点を接続し、その他方
のトランジスタのコレクタを、前記第1のカレントミラ
ー構成の共通ベースに接続したことを特徴とする定電流
回路。An equivalent current source is connected to the common emitter ground NP of the first current mirror configuration, the collectors and bases of the input side transistors of the N-type transistor pair, and a plurality of output side transistors of the transistor pair are connected. and each collector of a second current mirror configuration consisting of a pair of PNP type transistors whose emitters are connected in common and connected to a voltage source is attached to each collector of the plurality of transistors on the output side of the first current mirror configuration. A common connection point between the collector and base of one transistor of a third current mirror configuration consisting of a pair of common-emitter NPN transistors is connected to the collector circuit of one of the transistors of the first and second current mirror configurations. , and the collector of the other transistor is connected to the common base of the first current mirror configuration.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2195355A JPH0480807A (en) | 1990-07-23 | 1990-07-23 | constant current circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2195355A JPH0480807A (en) | 1990-07-23 | 1990-07-23 | constant current circuit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0480807A true JPH0480807A (en) | 1992-03-13 |
Family
ID=16339795
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2195355A Pending JPH0480807A (en) | 1990-07-23 | 1990-07-23 | constant current circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0480807A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006238165A (en) * | 2005-02-25 | 2006-09-07 | Fujitsu Ltd | Early effect cancel circuit, differential amplifier, linear regulator, and early effect cancel method |
-
1990
- 1990-07-23 JP JP2195355A patent/JPH0480807A/en active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006238165A (en) * | 2005-02-25 | 2006-09-07 | Fujitsu Ltd | Early effect cancel circuit, differential amplifier, linear regulator, and early effect cancel method |
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