JPH048129U - - Google Patents

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JPH048129U
JPH048129U JP4626290U JP4626290U JPH048129U JP H048129 U JPH048129 U JP H048129U JP 4626290 U JP4626290 U JP 4626290U JP 4626290 U JP4626290 U JP 4626290U JP H048129 U JPH048129 U JP H048129U
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voltage
detection circuit
turned
voltage detection
power supply
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JP4626290U
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Description

【図面の簡単な説明】
第1図及び第2図は夫々本考案の一実施例の回
路図及びその動作タイミングチヤート、第3図及
び第4図は夫々従来の一例の回路図及びその動作
タイミングチヤートである。 1……システム電源、2,3……電圧検出回路
、4,13……アンドゲート、6……電源投入タ
イミング回路、7……CPU、8……電源端子、
11……リセツト端子、14……レギユレータ、
r1〜Tr3……トランジスタ、R,R
…抵抗、D……ダイオード。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) システム電源電圧がCPU動作保証範囲の
    上限電圧を越えた場合にのみオンとなる第1の電
    圧検出回路と、該システムの電源電圧が該CPU
    動作保証範囲の下限電圧未満になつた場合にのみ
    オフとなる第2の電圧検出回路と、該第1の電圧
    検出回路の出力端子に制御端子を接続されて上記
    システム電源電圧が上記上限電圧を越えた場合に
    のみオンとなる第1のスイツチング素子と、シス
    テム電源と該第1のスイツチング素子との間に接
    続された抵抗と、該第1のスイツチング素子と該
    抵抗との間に制御端子を接続され、上記第1の電
    圧検出回路のオフ及び上記第2の電圧検出回路の
    オンによりオン、上記第1及び第2の電圧検出回
    路のオンによりオフ、上記第1及び第2の電圧検
    出回路のオフによりオフとなるように該制御端子
    を制御されてCPUに上記システム電源電圧を印
    加する第2のスイツチング素子と、上記システム
    電源電圧が上記下限電圧未満になつた場合にCP
    Uにリセツトをかける回路とを有するコンピユー
    タの電圧監視回路において、 前記第2の電圧検出回路の出力端子と、前記抵
    抗と前記第1のスイツチング素子との接続点との
    間に、前記システム電源電圧が前記上限電圧を越
    えたときに前記第2の電圧検出回路の出力電流が
    前記第1のスイツチング素子を介してアースされ
    ないように阻止する電流阻止回路を接続し、 前記リセツトをかける回路として、前記第2の
    電圧検出回路の出力端子と上記電流阻止回路との
    接続点と、前記CPUのリセツト端子との間に信
    号経路を設けてなるコンピユータの電圧監視回路
    。 (2) システム電源電圧がCPU動作保証範囲の
    上限電圧を越えた場合にのみオンとなる第1の電
    圧検出回路と、該システムの電源電圧が該CPU
    動作保証範囲の下限電圧未満になつた場合にのみ
    オフとなる第2の電圧検出回路と、該第1の電圧
    検出回路の出力端子に制御端子を接続されて上記
    システム電源電圧が上記上限電圧を越えた場合に
    のみオンとなる第1のスイツチング素子と、シス
    テム電源と該第1のスイツチング素子との間に接
    続された第1の抵抗と、該第1のスイツチング素
    子と該第1の抵抗との間に制御端子を接続され、
    上記第1の電圧検出回路のオフ及び上記第2の電
    圧検出回路のオンによりオン、上記第1及び第2
    の電圧検出回路のオンによりオフ、上記第1及び
    第2の電圧検出回路のオフによりオフとなるよう
    に該制御端子を制御されてCPUに上記システム
    電源電圧を印加する第2のスイツチング素子と、
    上記システム電源電圧が上記下限電圧未満になつ
    た場合にCPUにリセツトをかける回路とを有す
    るコンピユータの電圧監視回路において、 前記第2の電圧検出回路の出力端子と、前記第
    1の抵抗と前記第1のスイツチング素子との接続
    点との間に、前記システム電源電圧が前記上限電
    圧を越えたときに前記第2の電圧検出回路の出力
    電流が前記第1のスイツチング素子を介してアー
    スされないように阻止する電流阻止回路を接続し
    、 前記リセツトをかける回路として、前記第2の
    電圧検出回路の出力端子と上記電流阻止回路との
    接続点と、前記CPUのリセツト端子との間に信
    号経路を設け、更に、前記第1の電圧検出回路の
    出力端子と前記第1のスイツチング素子との間に
    第2の抵抗を接続し、 前記システム電源と前記CPUの電源端子との
    間で前記第2のスイツチング素子と並列に、前記
    第1の電圧検出回路の出力によつてオン、オフ制
    御されるレギユレータを接続してなるコンピユー
    タの電圧監視回路。
JP4626290U 1990-04-27 1990-04-27 コンピュータの電圧監視回路 Expired - Lifetime JP2522689Y2 (ja)

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Publication Number Publication Date
JPH048129U true JPH048129U (ja) 1992-01-24
JP2522689Y2 JP2522689Y2 (ja) 1997-01-16

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ID=31561189

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4871750A (ja) * 1971-12-29 1973-09-28
JP2012003565A (ja) * 2010-06-18 2012-01-05 Hitachi Ltd 電気機器、および電気機器の診断方法

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS4871750A (ja) * 1971-12-29 1973-09-28
JP2012003565A (ja) * 2010-06-18 2012-01-05 Hitachi Ltd 電気機器、および電気機器の診断方法

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