JPH0482200B2 - - Google Patents
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- JPH0482200B2 JPH0482200B2 JP30592486A JP30592486A JPH0482200B2 JP H0482200 B2 JPH0482200 B2 JP H0482200B2 JP 30592486 A JP30592486 A JP 30592486A JP 30592486 A JP30592486 A JP 30592486A JP H0482200 B2 JPH0482200 B2 JP H0482200B2
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- package
- logic circuit
- switching
- packages
- wiring board
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- Expired - Lifetime
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Landscapes
- Mounting Of Printed Circuit Boards And The Like (AREA)
- Hand Tools For Fitting Together And Separating, Or Other Hand Tools (AREA)
- Details Of Connecting Devices For Male And Female Coupling (AREA)
Description
【発明の詳細な説明】 産業上の利用分野 本発明は、活線挿抜方式に関する。[Detailed description of the invention] Industrial applications The present invention relates to a hot-swap system.
従来の技術
従来の活線挿抜方式を第4図に示す。第4図
は、複数の電子回路パツケージを搭載するユニツ
ト41と、パツケージ間の信号を伝達するための
バツクワイヤリングボード42と、複数の電子回
路パツケージ43,44,45と、ガイドレール
46と、パツケージ引き抜き孔47と、引き抜き
挿入工具48,49から構成される活線挿抜方式
である。挿抜パツケージ44の引き穴に引き抜き
工具48を挿入し、電源パツケージ43のスイツ
チは“ON”の状態で引き抜く。挿入の際も同様
に電源は“ON”の状態で、挿入工具49をユニ
ツト41の前部にかけて挿入する。Prior Art A conventional hot-swap system is shown in Fig. 4. FIG. 4 shows a unit 41 on which a plurality of electronic circuit packages are mounted, a back wiring board 42 for transmitting signals between the packages, a plurality of electronic circuit packages 43, 44, 45, a guide rail 46, and a back wiring board 42 for transmitting signals between the packages. This is a live insertion/extraction method consisting of a extraction hole 47 and extraction/insertion tools 48 and 49. The extraction tool 48 is inserted into the draw hole of the insertion/extraction package 44, and the power supply package 43 is pulled out with the switch in the "ON" state. When inserting the unit 41, the power is similarly turned on and the insertion tool 49 is inserted over the front of the unit 41.
発明が解決しようとする問題点
しかしながら、従来の活線挿抜方式は電源が
“ON”状態のまま挿抜を行うために、バツクワ
イヤリングボード上のデータバスにノイズが発生
し、中央処理(CPU)パツケージ45が、誤動
作をする可能性が大きいという欠点があつた。Problems to be Solved by the Invention However, in the conventional hot-swapping method, since the power is inserted and removed while the power is in the "ON" state, noise is generated on the data bus on the backwiring board, and the central processing (CPU) package is 45 had the disadvantage that there was a high possibility of malfunction.
本発明は従来の上記実情に鑑みてなされたもの
であり、従つて本発明の目的は、従来の技術に内
在する上記欠点を解消することを可能とした新規
な活線挿抜方式を提供することにある。 The present invention has been made in view of the above-mentioned conventional circumstances, and therefore, an object of the present invention is to provide a novel hot-swap system that makes it possible to eliminate the above-mentioned drawbacks inherent in the conventional technology. It is in.
問題点を解決するための手段
上記目的を達成する為に、本発明に係る活線挿
抜方式は、複数の電子回路パツケージと、該複数
の電子回路パツケージを搭載するパツケージ搭載
ユニツトと、前記パツケージ間の信号を伝達する
ためのバツクワイヤリングボードと、前記パツケ
ージに設けられ活線挿抜を実現するための論理回
路と、前記パツケージのうち挿抜対象パツケージ
に形成されたスイツチング機能を有するパツケー
ジ引きぬき用スイツチングホールと、前記ユニツ
トに形成されたスイツチング機能を有するスイツ
チングガイドレールと、前記ホール及びガイドレ
ールに係合される導電性の引き抜き挿入工具とを
具備して構成される。Means for Solving the Problems In order to achieve the above object, the hot insertion/removal method according to the present invention includes a plurality of electronic circuit packages, a package mounting unit on which the plurality of electronic circuit packages are mounted, and a connection between the packages. a back wiring board for transmitting a signal; a logic circuit provided in the package for realizing hot insertion/extraction; and a switching function for removing the package having a switching function formed in the package to be inserted/extracted from among the packages. The unit includes a hole, a switching guide rail having a switching function formed in the unit, and an electrically conductive extraction/insertion tool that is engaged with the hole and the guide rail.
実施例
次に本発明をその好ましい一実施例について図
面を用いて具得的に説明する。Embodiment Next, a preferred embodiment of the present invention will be concretely explained using the drawings.
第1図は本発明の一実施例を示す概略斜視図で
ある。 FIG. 1 is a schematic perspective view showing an embodiment of the present invention.
第1図を参照するに、参照番号10は複数の電
子回路パツケージを搭載するユニツト、11はパ
ツケージ間の信号を伝達するためのバツクワイヤ
リングボード、12は挿抜の対象パツケージ、1
3は中央処理(CPU)パツケージ、14,15
は活線挿抜を実現するためにパツケージ12,1
3にそれぞれ設けられた論理回路、、16は
スイツチング機能を有するスイツチングホール、
17はスイツチング機能を有するスイツチングガ
イドレール、18,19は伝導性の引き抜き・挿
入工具をそれぞれ示す。 Referring to FIG. 1, reference numeral 10 is a unit mounting a plurality of electronic circuit packages, 11 is a back wiring board for transmitting signals between the packages, 12 is a package to be inserted and removed, and 1
3 is the central processing (CPU) package, 14, 15
In order to realize hot insertion and removal, package cages 12 and 1 are installed.
3 is a logic circuit provided respectively, 16 is a switching hole having a switching function,
17 is a switching guide rail having a switching function, and 18 and 19 are conductive extraction/insertion tools, respectively.
次に動作原理について説明する。スイツチング
ホール16の一方は論理回路()14のA入力
で、他方はアースに接続されており、引き抜き工
具18を挿入することでA入力はアースと接続さ
れ“O”レベル入力となる。スイツチングガイド
レール17の一方はアースに接続された他方はバ
ツクワイヤリングボード11上の制御線20を介
して論理回路()15のF入力と接続されてお
り、挿入工具19をスイツチングガイドレール1
7にかけるとF入力はアースと接続されて“O”
レベル入力となる。 Next, the operating principle will be explained. One of the switching holes 16 is the A input of the logic circuit ( ) 14, and the other is connected to the ground, and by inserting the extraction tool 18, the A input is connected to the ground and becomes an "O" level input. One side of the switching guide rail 17 is connected to ground, and the other side is connected to the F input of the logic circuit ( ) 15 via the control line 20 on the back wiring board 11.
When applied to 7, the F input is connected to ground and becomes “O”.
This is the level input.
通常は、挿抜対象パツケージ12は挿入された
まま正常動作を行つている。この状態では第2図
1に示すとおり、論理回路()14のゲートの
入力Aはプルアツプされているために論理回路
()14の出力Cの値は“1”となる。この出
力Cは、第2図3に示すとおり、バツクワイヤリ
ングボード11上の制御線20を通り論理回路
()15のF入力となる。第2図2に示す論理
回路()15は、第3図に示された論理回路
のタイムチヤートに従い動作する。F入力が
“1”の場合にはCPUは正常動作状態となる。 Normally, the package 12 to be inserted and removed continues to operate normally while being inserted. In this state, as shown in FIG. 2, since the input A of the gate of the logic circuit ( ) 14 is pulled up, the value of the output C of the logic circuit ( ) 14 becomes "1". This output C passes through the control line 20 on the back wiring board 11 and becomes the F input of the logic circuit ( ) 15, as shown in FIG. The logic circuit ( ) 15 shown in FIG. 2 operates according to the time chart of the logic circuit shown in FIG. When the F input is "1", the CPU is in a normal operating state.
挿抜対象パツケージ12を抜き解る際に導電性
の引き抜き工具18をスイツチングホール16に
挿入すると、前述のとおりA入力は“0”レベル
となり、それによりC出力も“0”レベルとなつ
てF入力も“0”レベルとなる。従つて、論理回
路()15のフリツプフロツプFF3出力Qは
“1”となり、CPUは“HALT”状態となる。次
に挿抜対象パツケージ12を引き抜くと、C出力
とバツクワイヤリングボード11の間が離れるた
めにF入力はハイインピーダンス状態となる。F
入力はプルアツプされているために、“1”レベ
ルに固定され、フリツプフロツプFF3出力Qは
“0”となり、CPUが動作状態にもどる。 When the conductive extraction tool 18 is inserted into the switching hole 16 when removing/extracting the package 12 to be inserted/extracted, the A input goes to "0" level as described above, and as a result, the C output also goes to "0" level, and the F input goes to the "0" level. is also at the “0” level. Therefore, the flip-flop FF3 output Q of the logic circuit ( ) 15 becomes "1", and the CPU enters the "HALT" state. Next, when the package 12 to be inserted and removed is pulled out, the C output and the back wiring board 11 are separated, so that the F input becomes a high impedance state. F
Since the input is pulled up, it is fixed at the "1" level, the flip-flop FF3 output Q becomes "0", and the CPU returns to the operating state.
挿抜対象パツケージ12を挿入する際には、導
電性挿入具19をスイツチングガイドレール17
にかけると、接地電位は信号線D、制御線20を
介して論理回路()15のF入力に伝達され、
従つて、前述のとおりバツクワイヤリングボード
11上で接続された論理回路()15のF入力
も“0”となる。従つて、論理回路()15の
フリツプフロツプFF3出力Qは“1”となり
CPUは“HALT”状態となる。次に挿抜対象パ
ツケージ12を完全に挿入し挿入工具19をスイ
ツチングガイドレール17からはずすと論理回路
()15のF入力は“1”となる。従つて、論
理回路()15のFF3出力Qは“0”となり
CPU動作状態にもどる。 When inserting the package 12 to be inserted or removed, the conductive insertion tool 19 is inserted into the switching guide rail 17.
When applied to , the ground potential is transmitted to the F input of the logic circuit () 15 via the signal line D and the control line 20,
Therefore, as described above, the F input of the logic circuit ( ) 15 connected on the back wiring board 11 also becomes "0". Therefore, the flip-flop FF3 output Q of the logic circuit ( ) 15 becomes "1".
The CPU enters the “HALT” state. Next, when the package 12 to be inserted and removed is completely inserted and the insertion tool 19 is removed from the switching guide rail 17, the F input of the logic circuit ( ) 15 becomes "1". Therefore, the FF3 output Q of the logic circuit ( ) 15 becomes “0”.
Return to CPU operating status.
以上の説明は挿抜対象パツケージ1枚に関する
ものであるが、挿抜対象パツケージが複数の場合
にはバツクワイヤリングボード11上の制御線を
マルチ接続すれば良い。 The above explanation relates to one package to be inserted and removed, but when there are a plurality of packages to be inserted and removed, the control lines on the back wiring board 11 may be connected in multiple ways.
発明の効果
以上説明したように、本発明によれば、電源投
入状態でパツケージを挿抜しても、CPUが一時
的にHALT状態となるために、誤動作が生じな
い。また、HALTスイツチをCPUパツケージに
設けるのではなく、引き抜き・挿入工具を使用す
ることでスイツチングを行つているために、保守
者の人為的ミスもないという効果が得られる。Effects of the Invention As explained above, according to the present invention, even if a package is inserted or removed while the power is on, the CPU temporarily enters the HALT state, so no malfunction occurs. Furthermore, since the HALT switch is not installed in the CPU package, but is switched using a pull-out/insertion tool, there is no human error caused by maintenance personnel.
第1図は本発明の一実施例を示す概略斜視図、
第2図1〜3は本発明の一実施例の動作を説明す
る為の図であり、そのうち、1は論理回路のブ
ロツク構成図、2は論理回路のブロツク構成
図、Cはバツクワイヤリングボードの正面図、第
3図は論理回路()の動作タイムチヤート第4
図は従来の活線挿抜方式を示す斜視図である。
10,41……ユニツト、11,42……バツ
クワイヤリングボード、12,44……挿抜対象
パツケージ、13,45……CPUパツケージ、
14,15……論理回路,、16……スイツ
チングホール、17……スイツチングガイドレー
ル、18,19,48,49……引き抜き・挿入
工具、20……制御線、21……データバス、2
2……ピン、43……電源パツケージ、46……
ガイドレール、47……引き抜き穴。
FIG. 1 is a schematic perspective view showing an embodiment of the present invention;
FIGS. 2 1 to 3 are diagrams for explaining the operation of an embodiment of the present invention. Among them, 1 is a block diagram of a logic circuit, 2 is a block diagram of a logic circuit, and C is a diagram of a back wiring board. Front view, Figure 3 is the operation time chart of the logic circuit () No. 4
The figure is a perspective view showing a conventional hot insertion/removal method. 10,41...Unit, 11,42...Back wiring board, 12,44...Package to be inserted and removed, 13,45...CPU package,
14, 15...Logic circuit, 16...Switching hole, 17...Switching guide rail, 18, 19, 48, 49...Extraction/insertion tool, 20...Control line, 21...Data bus, 2
2...Pin, 43...Power supply package, 46...
Guide rail, 47... Pull-out hole.
Claims (1)
回路パツケージを搭載するパツケージ搭載ユニツ
トと、前記パツケージ間の信号を伝達するための
バツクワイヤリングボードと、前記パツケージに
設けられ活線挿抜を実現するための論理回路と、
前記パツケージのうち挿抜対象パツケージに形成
されたスイツチング機能を有するパツケージ引き
ぬき用スイツチングホールと、前記ユニツトに形
成されたスイツチング機能を有するスイツチング
ガイドレールと、前記ホール及びガイドレールに
係合される導電性の引き抜き挿入工具とを有する
ことを特徴とした活線挿抜方式。1 A plurality of electronic circuit packages, a package mounting unit on which the plurality of electronic circuit packages are mounted, a back wiring board for transmitting signals between the packages, and a back wiring board provided on the package for realizing hot insertion and removal. logic circuit and
A switching hole for pulling out a package having a switching function formed in the package to be inserted/extracted among the package, a switching guide rail having a switching function formed in the unit, and engaged with the hole and the guide rail. A hot-line insertion/extraction method characterized by having a conductive extraction/insertion tool.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP30592486A JPS63157497A (en) | 1986-12-22 | 1986-12-22 | Hot-line mating/unmating system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP30592486A JPS63157497A (en) | 1986-12-22 | 1986-12-22 | Hot-line mating/unmating system |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63157497A JPS63157497A (en) | 1988-06-30 |
| JPH0482200B2 true JPH0482200B2 (en) | 1992-12-25 |
Family
ID=17950937
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP30592486A Granted JPS63157497A (en) | 1986-12-22 | 1986-12-22 | Hot-line mating/unmating system |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63157497A (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5434752A (en) * | 1993-10-27 | 1995-07-18 | International Business Machines Corporation | System and method for regulating staggered connection insertion timing |
-
1986
- 1986-12-22 JP JP30592486A patent/JPS63157497A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS63157497A (en) | 1988-06-30 |
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